JPS59112304A - シ−ケンスコントロ−ラ - Google Patents

シ−ケンスコントロ−ラ

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JPS59112304A
JPS59112304A JP18532383A JP18532383A JPS59112304A JP S59112304 A JPS59112304 A JP S59112304A JP 18532383 A JP18532383 A JP 18532383A JP 18532383 A JP18532383 A JP 18532383A JP S59112304 A JPS59112304 A JP S59112304A
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JP
Japan
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program
key
memory
command
input
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Application number
JP18532383A
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English (en)
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JPS6118206B2 (ja
Inventor
Keisuke Kawashima
河島 恵輔
Hideaki Nakamura
秀明 中村
Yoshitane Saito
斉藤 善胤
Kenji Nishikido
憲治 錦戸
Kiyoto Hirase
平瀬 清人
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Tateisi Electronics Co
Omron Tateisi Electronics Co
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Publication date
Application filed by Tateisi Electronics Co, Omron Tateisi Electronics Co filed Critical Tateisi Electronics Co
Priority to JP18532383A priority Critical patent/JPS59112304A/ja
Publication of JPS59112304A publication Critical patent/JPS59112304A/ja
Publication of JPS6118206B2 publication Critical patent/JPS6118206B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00Program-control systems
    • G05B19/02Program-control systems electric
    • G05B19/04Program control other than numerical control, i.e. in sequence controllers or logic controllers
    • G05B19/10Program control other than numerical control, i.e. in sequence controllers or logic controllers using selector switches

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Automation & Control Theory (AREA)
  • Programmable Controllers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は歩進型のシーケンスコントローラに関する。シ
ーケンスコントローラには歩進型と走査型とがある。歩
進型は制御プログラムの成るステップに対応した動作が
完了すると、その完了の検出信号によってプログラムが
−ステップ歩進ぜしめられて次のステップの動作が開始
されるように制御を行うものである。走査型は被制御系
の状態を示すデータが制御装置の入力装置に入力されて
おり制御装置は常時繰返して入力装置を走査して被制御
系の状態を検知し、その状態に対応して定められた制御
を行うようになっている。走査型は制御が事実上連続的
であるような制御が可能であるが制御グラグラムの作成
が難しく制御装置も複雑高価々ものとなる。歩進型の制
御装置では被制御系の動作は段階的となり、時にはぎこ
ちない制御しかできないと云う弱点もあるが、プログラ
ムの作成が簡単で誰にでも作ることができ制御装置も比
較的安価である上、実際上段階的制御で充分な被制御対
象も多いので、そのような対象に対しては大へん経済的
なシーケンスコントローラである。
本発明は上述した歩進型シーケンスコントローラを対象
としたものであり、従来この型のシーケンスコントロー
ラはプログラムを作成しこれを制御装置(シーケンスコ
ントローラ)に入力させるのにピンボードとピンを用い
ていたのを、キーボ也 一ドに〆べた幾つかのキーの操作によってプログラムを
制御装置に入力し得るようにすると共に、歩進型であり
ながらリターン命令のような複雑なプログラム内容を設
定できるようにすることを目的としてなされたものであ
る。
ピンボード式のシーケンスコントローラではプログラム
の各ステップ毎にピンボードの所定段のピン孔の所定位
置にピンを挿入することによりプログラムをシーケンス
コントローラに入力させるので、作成したプログラムの
全体がピンの配置によって表示されていると云う利点が
ある反面、ピンの接触不良のため信頼性が充分でなく、
ピンが多数要るのでその管理が面倒であり、プログラム
のステップ数が多い場合、ピンボードの面積が大となる
等の欠点がある。本発明によればプログラムをキーボー
ドにおけるキーの操作でシーケンスコントローラのメモ
リに入力できるのでピンの管理、ピンの接触不良、プロ
グラムのステップ数が多くなると大きなピンボードを有
するシーケンスコントローラとしなければならないと云
った問題がなくなり、管理、信頼性1価格(殊にプログ
ラムステップ数の多い場合)の面でピンボード式のもの
より優れたものが得られることになる。以下実施例によ
って本発明を説明する。
第1図は本発明の一実施例のシーケンスコントローラの
操作パネルの正面図である。パネルの右下隅にある一群
のキー1は操作及び命令、データ等の入カキ−で数字の
記入されたキーは命令の入力とデータ数字の入力の両方
兼用になっており、ローマ字の記入されたキーは操作用
のキーである。
左上の上下二段の表示部2.3は出力端子表示ランプの
列で1番から32番までの32個あり成るプログラムス
テップで指定された出力端子を示す位置のランプが点灯
するようになっている。右上の二段の表示部4,41は
入力端子表示ランプの列でやはり1番から32番まであ
り、成るプログラムステップで指定されている入力端子
に入力が加わったとき対応するランプが点灯する。表示
部3の下にある数字表示部5は4個の枠51,52゜5
3.54に分れており、一番人の枠51は2桁でステッ
プ番号を表示し、その右の枠52は命令の種類を]−桁
の数で表わし図の例の4と云う数字は例えばアンドの命
令を意味する。この命令語とそのコード数字との対訳表
が数字部5の下の枠6に記載しである。数字表示部5で
左から3番目、−香石の枠53.54は夫々2桁の数字
で夫々がデータの数値を表わす。
次に上記パネルにおける操作法の概略を述べる。
プログラムの書込み。まず電源スィッチPSをオン側に
倒し、次にプログラムコンソールスイッチCSをオン側
に入れ、次にステップを0”にするためスイッチS2を
リセット側に1度倒す。まだ、こ\でプログラムを記憶
するメモリはすべてクリアされているものとする。そし
て、プログラムの各ステップを順次入力して行く。プロ
グラムの各ステップは書込みの始めにキ一群中のINS
のキーを押し次に命令のキーを押す。各ステップの命令
は必ず一語なのでINSのキーの次に押す数字キーは自
動的に命令の入力操作となり、その次以降のキー操作は
自動的にデータの入力となる。
従って同じキーが書込み操作時押された順位によって命
令入力用として働き或はデータ記入用として働く。まず
第0ステツプの命令を書込む。工NSのキーを押し、つ
いで数字2のキーを押す。数字2のキーはリターン即ち
出発点に戻れの命令で、数字表示部の左から第]枠51
は“00”、第2枠52は2”となり第0ステツプはこ
れだけで次にR/ Wのキーを押す。これはメモリへの
読出し書込みを指令するキーで、メモリにはリターンの
命令が記入され、R/ Wのキーを押すことによりステ
ップが自動的に歩進ぜしめられl数字表示部の第1枠5
1の表示は“01”となり他の枠は全部0となる。こ\
で第1ステツプの命令を入力する。このステップが例え
ば入力端子1と3の入力のアンドによって出力端子2と
4に出力を出すと云う内容であれば、まず形通j91N
sのキーを押しアンドの命令を示す数字キー4を押すと
数字表示部の枠51の表示が4となる。命令は一語に限
られるから次に押すキーは当然にデータの入力操作とな
る。今の場合入力端子1と3の入力のアンドを採れと云
う命令なので数字キー“0”次に11”を押す。数字表
示部の枠53の表示が01となり、次に数字キー゛0″
を押し次いで4”を押すと数字表示部の枠54の表示が
04となって、数字表示部はプログラムの第1ステツプ
の内容を“アンド”01”04”と表示する。次に出力
端子を指定すると云う意味でOUTのキーを押すと表示
部3の数字1のランプが点滅する。次にOFFのキーを
押すと表示部3の数字1の上のランプが消え数字2の上
のランプが点滅する。次にONのキーを押すと数字2の
上のランプが点灯して出力端子2に出力すべしと云う命
令内容が表示され次の数字3の上のランプが点滅開始す
る。出力は端子2と4とになされるので再びOFFのキ
ーを押す。そこで上記OFFキーを押すことで表示部3
の数3の上のランプが消灯し、次にONのキーを押すこ
とにより4番目の出力端子が指定されたことになる。こ
れで第1ステツプの命令の構成が終ったのでR/ Wの
キーを押して第1ステツプの命令をメモリに記入すると
共にプログラムのステップを一段歩進させて数字表示部
5の第1枠51は“02”を表示する。以下上述したよ
うな操作により1ステツプずつプログラム内容がメモリ
に入力されて行く。このようにして最後のステップがプ
ログラムの全部を15回繰返して実行せよと云う内容で
あるとすると、次の順序でキーを押す。rlNsJ r
8J (繰返せの命令のコード番号)rJ 、r5J 
(15回を意味する)「0」「1」(プログラムのステ
ップ1からの意、即ちステップlからこのステップ丑で
を15回繰返すことになる。)rR/WJと云うように
押す。プログラムの形式上の最後は[E N Djの命
令で上記繰返しの命令の次のステップで[工N SJ 
、  [KNDj、  [R/Wjの順のキー操作で全
プログラムの記入が終る。
次に上記したプログラムを実行させるには、プロクラム
コンソールスイッチC8をOFF側に倒し、スイッチS
1を゛自動”側に倒し、スタートスイッチS3を下へ1
度倒す。これでプログラムの実行が開始される。プログ
ラム実行中は数字表示部5の右にある表示灯55が点灯
している。数字表示部5の各枠は今実行しつ\あるプロ
グラムステップの番号、プログラム内容等を数字で表示
している。例えば第1ステツプを実行中は数字表示部5
の第1枠51には01の数字が出て第1ステツプである
ことを示し、このステップの命令がANDであるときは
第2枠52は04の数字を示し、AND条件が成立すべ
き二つの入力端子が1番と3番とであると数字表字部の
第3枠53には0]−の数字が、また第4枠54には0
3の数字が−9〜                 
       ^「表われる。この第1ステツプでは指
定された出力端子2,4へ出力が出されるとともに表示
部20ランプ2.4が点灯する。第1ステツプは入力端
子1と3とに共に入力信号が入ったらプログラムは−ス
テップ進行して数字表示部等の表示は第2ステツプの内
容表示に変わるとともに第2ステツプの実行が開始され
る。即ちプログラムの進行は成るステップの命令内容即
ち設定条件が成立するとステップが歩進されて次段のス
テップの実行に移る。
第2図は上述装置の内部構成を示すブロック図である。
CPUと記入されたブロックはこの装置における中央制
御装置でマイクロコンピュータであり、Mはこのシーケ
ンス制御装置が実行すべきプログラムを記憶させるメモ
リで前述したプログラム書込み操作でプログラムが記憶
せしめられている。今プログラムの成るステップを実行
中でそのステップで指定された出力を出しているものと
する。そのときCPUはメモリMから上記ステップの命
令を読出しCPU内のアキュームレータに−10= 記憶させており、他方常時入力端子IN’1〜IN。
nを走査してその入力状態を見ており、この入力状態と
アキュームレータに記憶させであるそのステップの命令
中の入力端子番号及び条件とをCPU内蔵の演算判別回
路で比較し、両者が一致しだらメモリMのアドレス指定
数に1を加えて次のステップを読出し、上と同様の操作
を行う。即ちこの装置は外部負荷の制御については歩進
型であるが内部的には走査型のシーケンス制御を行って
いる。しかしこの走査型のシーケンス制御は外部に対し
て実行すべき動作とは無関係に上述したように一定して
おり、この内部制御のプログラムはCPU内の読出し専
用メモIJ(ROM)に記憶させである。外部負荷を制
御するプログラムを書込む場合、CPUはROMからプ
ログラム書込み用の内部制御プログラムを読出し、その
プログラムに従って前述したパネルのキ一群1及びコン
ソールスイッチC8,スイッチS2等が接続されている
内部入力回路の入力状態を繰返し走査する。正確にはC
PUはROMに書込まれた内部制御プログラムに従い外
部入力回路INの各入力端子IN1〜INn及び内部入
力端子に接続されたコンソールスイッチC8,スイッチ
82等の開閉状態、キ一群1等を走査し内部入力回路に
おける入力状態によってプログラムの書込みかプログラ
ムの実行かその他の動作かを識別し内部入力回路の入力
状態に応じて夫々の動作が実行されるようになっている
。今の場合内部入力回路の入力状態がプログラム書込み
となっているので上述したようにキ一群1と内部入力回
路の走査のみが行われてキ一群によりセットされた命令
は順次メモリMに書込まれて行く。更にプログラムの書
込み、実行その他の動作において、CPUは書込み中の
プログラムのステップの内容或は実行中のプログラムの
ステップの内容或はプログラム中の指定したステップの
内容等を数字表示部5.表示部2,3等に表示する動作
をROM内の内部制御プログラムに従い実行している。
要するにCPUはROMに書込まれたCPU自身を制御
する内部制御プログラムによって動作しており、内部入
力回路の入力状態によってCPUを制御する内部制御プ
ログラムが切換わって装置全体としての外部的動作が外
部負荷制御プログラムの書込み、同プログラムの実行等
に切換わる。
上述装置の基本的な動作としてAND命令とOR命令に
関連して装置の構成及び動作を具体的に説明する。金側
としてプログラムの第35ステツプがアンド命令で入力
端子の第12番lNl2と第13番lNl3とに共に入
力が入ったらステップが1歩進し、そしてそのステップ
(第35ステツプ)で、出力端子の第1. 2,3. 
5. 8に信号を出力せよと云う内容であるとする。表
示部2.3及び5の表示のフォーマットは第3図のよう
になる。プログラムの実行が進んで第34ステツプの動
作が完了するとステップカウンタの計数は35になって
おり、この計数がプログラムを書込んだメモリMのテド
レス指定情報となりメモリMの35番地の命令即ち第3
5ステツプの命令が読出され、第3図のフォーマットで
、表示部2,3.5に表示される。同時に第35ステツ
プで指定された出力端子1. 2. 3. 5. 8に
出力が出される。CPUでは命令の種類を判別しAND
命令と判ると入力回路における入力端子工N12の入力
状態をチェックし、この入力が有りになる捷でチェック
を繰返している。1N12の入力が有りになると入力回
路工N13をチェックする。そして入力回路工N13の
入力が有りに々るまで入力端子工N12.工N13の入
力状態を続けてチェックする動作を繰返す。この過程で
工N12の入力がOに々つたら再び入力端子工N12の
みのチェックを繰返す動作に戻る。このようにして入力
端子工N12及び工N13が共に入力有りになったこと
が検出されたらステップカウンタの計数を数だけ歩進さ
せ次のステップの命令を読出す。CPHにおける以上の
動作のプログラムはROMに書込んである。ステップカ
ウンタはCPUが有するランダムアクセスメモリRAM
を用いてもよく、メモリMを用いてもよい。上記RAM
をプログラム書込み用のメモIJMとして用いてもよい
第4図は上述したAND命令におけるCPUの動作をフ
ローチャートで表わしたものである。
OR命令における表示部2. 3. 5の表示のフォー
マットはANDのときと同じで命令の種類を表わす表示
部52の数字がOR命令のコードである5となる。そこ
で第3図を借用してOR命令の表示のフォーマットを説
明すると、表示部53゜54に示される数字は2つの入
力端子の番号を示し、同時に出力端子1. 2. 3.
 5. 8に出力が出され、入力端子12.13の何れ
かに入力信号が入ったら次ステツプの命令の実行動作に
移ることになる。
第5図はCPUにおけるOR命令実行動作のフローチャ
ートを示す。メモリMから読出した命令がOR命令と判
定されると表示部2. 3. 5に命令内容を表示する
と共に出力端子1. 2. 3. 5.8へ出力を出し
入力端子工N12をチェックし入力がなければ工N13
をチェックすると云う動作を繰返し何れの入力端子にで
も入力が検出され\ばステップカウンタの計数に1を加
え次ステツプの命令を読出しその実行に移る。
以上で本発明に係る一実施例装置の全体的な説明を終り
、以下本発明に係る一実施例装置によって本発明の特徴
的な機能動作について述べる。
リターン命令。これは一般に停電に対する対策として用
いられる。装置がプログラムの成るステップを実行中に
停電が起ると、装置ではそのプログラムステップを記憶
し、出力端子への出力を0にする。電源回復後スタート
スイッチをスタート側に押して装置を再スタートさせる
とプログラムは第0ステツプから開始される。そこで第
0ステツプにリターン命令を入れておくと装置はリター
ン命令を実行する。リターン命令は停電時に記憶させて
おいたステップ番号を読出し、これをプログラムカウン
タにプリセットする動作である。即ち停電によりプログ
ラムカウンタの内容は0になってオリ、リターン命令で
このカウンタに動作を再開すべきプログラムのステップ
番号を入力する。
こ\で再びスタートスイッチをスタート側に押すとその
ステップから制御が再開される。同じように停電対策で
も、停電後の装置動作再開に当り、15− 直ちに中断プログラムステップから再開しては具合が悪
く、動作再開に当って何等かの特殊動作をしなければな
らない場合があシ、このような場合にもリターン命令が
用いられる。停電回復後プログラムステップはOから始
まるので、0ステツプにジャンプ命令を入れ、通常のプ
ログラムの最後のステップ(エンド命令が入れである)
より更に後の方の番号の所へプログラムをジャンプさせ
る。
これはジャンプ命令で表示部53に表示されている数字
をプログラムカウンタにプリセットする動作で、予めプ
ログラムでこのステップ番号以下の所に動作再開前に処
理しておくべき動作のプログラムを書込んでおき、その
プログラムの最後をリターン命令としておく。こうする
と電源回復後、スタートスイッチを押すとまずジャンプ
命令が実行され、それに続いて上記した再開前の処理動
作が実行され、その後でリターン命令が読出されて、停
電したとき記憶せしめられた中断ステップが読出され、
プログラムカウンタにプリセットされる。
こ\で再度スタートスイッチを押して本来のプロ16− ダラムの実行を再開させる。第6図はリターン命令の表
示で、この命令の書込みは数字2のキーと共用で、工N
Sキーの後に数字キー2を押し、この命令は停電に当っ
て緊急退避させたプログラムステップを読出しこれをプ
ログラムカウンタに入力させるものであるから任意のデ
ータを書込むことは誤操作であり数字キー2を押し次に
R/Wのキーを押す。従って表示部53.54には表示
が現れない。第7図はリターン命令実行のフローチャー
トを示す。
本発明シーケンスコントローラは上述したような構成で
、歩進型に属するのでプログラムの作成が容易であり、
しかもプログラムの書込みはキーボードにおけるキー操
作で行われるので従来のピンボード式のものに比し、ピ
ンの接触不良等の心配がなく、ピンボードが不要だから
小型化できると共に、歩進型でありながらリターン動作
の創設により停電後等の動作再開が適切筒単にできるプ
ログラム設定が可能となった。
【図面の簡単な説明】
第1図は本発明の一実施例装置の正面図、第2図は同じ
く内部構成を示すブロック図、第3図は同じく表示にお
けるAND命令の表示フォーマット、第4図は同じく上
記AND命令の実行に関する装置動作のフローチャート
、第5図は同じくOR命令実行動作のフローチャート、
第6図はリターン命令の表示のフォーマット、第7図は
上記命令実行のフローチャートを示す。 1・・・キ一群のキー、2. 3. 5・・・表示部、
CPU・・・中央制御装置、M・・・シーケンスコント
ロールプログラムを書込むメモリ、工Nl〜工Nn・・
・入力端子、0UTI〜0UTn・・・出力端子。 代理人 弁理士  縣   浩  介 19−

Claims (1)

    【特許請求の範囲】
  1. 命令の種類並びにデータの入カキ−と、外部負荷制御プ
    ログラム用メモリと、外部入力端子群及び出力端子群と
    、上記人力キ一群のキーインの状態を走査し上記入力キ
    一群により設定された命令を上記メモリに書込み、また
    同メモリに書込まれたプログラムを読出し上記外部入力
    端子群を走査し上記読出したプログラムの内容に従って
    出力端子に信号を出力することによって外部負荷を制御
    するように内部制御プログラムを書込んだROMを有し
    、上記人力キ一群内の一つのキーとしてリターン命令キ
    ーを備え、外部負荷制御プログラムの上記メモリへの書
    込み操作において、成るステップにおいて上記リターン
    命令キーを押すとリターン命令が上記メモリに書き込ま
    れ、外部負荷制御において、この命令が上記メモリから
    読出されたときは別途記憶させである外部負荷制御プロ
    グうにした内部制御プログラムを上記ROM内に設ケタ
    シーケンスコントローラ。
JP18532383A 1983-10-03 1983-10-03 シ−ケンスコントロ−ラ Granted JPS59112304A (ja)

Priority Applications (1)

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JP18532383A JPS59112304A (ja) 1983-10-03 1983-10-03 シ−ケンスコントロ−ラ

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JP13418878A Division JPS607802B2 (ja) 1978-10-30 1978-10-30 シ−ケンスコントロ−ラ

Publications (2)

Publication Number Publication Date
JPS59112304A true JPS59112304A (ja) 1984-06-28
JPS6118206B2 JPS6118206B2 (ja) 1986-05-12

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ID=16168817

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