JPS5958700A - 記憶保護判定方式 - Google Patents

記憶保護判定方式

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JPS5958700A
JPS5958700A JP57170080A JP17008082A JPS5958700A JP S5958700 A JPS5958700 A JP S5958700A JP 57170080 A JP57170080 A JP 57170080A JP 17008082 A JP17008082 A JP 17008082A JP S5958700 A JPS5958700 A JP S5958700A
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立石　輝隆
Minoru Etsuno
越野　実
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Fujitsu Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、単位領域毎に記憶保護キーをもつシステムに
おいて、単位領域に対するアクセス要求の記憶保護判定
を高速に行い得るようになった記憶保護判定方式に関す
るものでるる。
〔従来技術と問題点〕
主記憶装置は、記憶保６の単位として例えは２にバイト
毎のプロッタに分割きれており、谷ブロックに対して８
ビツトの記憶装置キーがキー記憶に書込まれている。記
憶装置キーは、 ０１２３４５６７ という構成をもつものでりり、Ａはアクセス１１ｉｌ制
御ビツト、Ｆは読出保ｉピット、Ｒは参照ピント、Ｃは
変更ピント、Ｓは書込保護ビットをそれぞれ示している
。中央処理装置やチャネルは保護キーを有している。中
央処理装置はＰｓｗＯ中に保枝キーを有しており％ま：
１ＴＬＢの中に記憶装置キーを保持している。チャネル
は、ＣＡＷを取込み、この中に記入きれている保護キー
を保持してい妬下記の表は保護動作の要約をまとめたも
のでめ妃上記の表において、一致、可および不可は次の
ように定義される。一致とは、記憶装置キーの上位４ピ
ントと等しいか、保験キーがゼロである場合を示す。可
とは、アクセスが許さｎることを示す。
不可とは、アクセスが許きれないことを示す。っまり、
取出しの場合には情報はそのプログラムで使用できるよ
うにならないし、書込みの場合にはその記憶位置の内容
は変更されない。主記憶装置への書込みは、記憶装置キ
ーと保護キーと一致し、且つ記憶装置キーの書込保険ピ
ットがセロの時にのみ許される。主記憶装置からの読出
しは、記憶装置キーと保護キーが一致した場合、または
記憶装置キーの続出保ｈビットがゼロの場合に許される
。
第１図は従来の記憶保護判定回路を説明するものであっ
て、１はアクセス制御回路、２は主記憶制御回路、３は
記憶保険キー制御回路、４は記憶保護判定回路、５は主
記憶、１ｏはアクセス要求、１１はアクセス要求キー、
１２は主記憶アクセス要求、］３はキー記憶アクセス要
求、包は主記憶アクセス情報、（９）はキー記憶アクセ
ス情報、３１はキー記憶判定信号、４０は主記憶アクセ
ス許可信号、４２はゼロ判定信号、４３は一致信号、２
はゼロ判定回路、Ｍは一致判足回路、０はＯＲ回路、Ａ
はＡＮＤ回路をそれぞれ示している。
アクセス制御回路１は、アクセス要求を分析し、分析結
果に従って主記憶制御回路２および記憶保護キー制御回
路３を制御するものである。主記憶制御回路２は主記憶
５を制御するものであり、記憶保護キー制御回路３はキ
ー記憶６を制御するものである。記憶保護判定回路４は
、ゼロ判定回路ｚ１一致判定回路Ｍ、ＯＲ回路０および
ＡＮＤ回路Ａを有している。ゼロ判定回路２は、アクセ
ス要求キー１１がゼロであるか否かを判定するものであ
る。一致判定回路Ｍは、アタセス要求キー１１トキー記
憶６から読出？れた記憶装置キー６０とが一致するか否
かを判定するものである。アクセス要求キーエ１は、保
禮キーおよびリード／ライトの別を下す情報から構成は
れている。ゼロ判定信号４２が論理「１」又は一致信号
４３が論理「１」の場合にはＯＲ回路０は論理「１」を
出力する。ＯＲ（ロ）路Ｏが嗣埋「１」を出力している
ときにキー記憶判定信号３１が論理「１」になると、主
記憶アクセス許可信号４０が論理「１」になる。キー記
憶判定信号３１は、キー記憶６からデータが読出される
タイミングを見計らって出ざｎる。
チャネルは、ブロック境界を越えて主記憶をアクセスす
るとき、キー・チェック付きアクセス要求をアクセス制
御回路１に送る。なお、中央処理装置は、ＴＬＢの中に
記憶装置キーを取込んでいるので、自分自身でその主記
憶アクセス要求が可とされるべきものか、或は不可とさ
れるべきものかを判断する。キー・チェック付アクセス
要求が送られて来ると、アクセス制御回路１は、記憶保
護キー制御回路３にキー記憶アクセス要求１３を送出す
る。キー記憶アクセス要求１３を受取ると、記憶保険キ
ー制御回路３は、キー記憶６に対してキー記憶アクセス
情報３０を送出する。キー記憶アクセス制御回路３０は
、リード／ライトの別を示すリード／ライト信号および
キー記憶アドレス情報で構成されている。この場合は、
リード／ライト信号はリードを示す。キー記憶６から続
出ハ扛た記憶装置キー６０は、記憶保護判定回路４の一
致回路Ｍに送られろ。記憶保膜キー制御回路３が論理「
１」のキー記憶判定信号３１を送出した時、ゼロ判定信
号４２又は一致信号４３が論理「ｌ」であれば、主記憶
アクセス許可信号４０が論理「１」になる。主記憶アク
セス許可信号４０が論理「１」になると、アクセス制御
回路１は、主記憶制御回路１２に対して主記憶アクセス
要求１２を送る。主記憶アクセス要求■２を受取ると、
主記憶制御回路２は主記憶アクセス要求報２０を主記憶
５ＶＣ送る。主記憶５は、主記憶アクセス情報２０に従
ってリード／ライトを行う０アクセス要求キーが特定の
値をもつ場合にはキー記憶からの脱出テークに関係なく
、主記憶アクセスが許される筈であるが、第１図の従来
方式はアクセス要求キーが特定値をもつ場合でも、キー
記憶判定信号が論理「１」になったときに主記憶アクセ
ス許可信号が論理「１」とさｎる。このような従来方式
では、次のキー記憶アクセス要求の待ｆｃすれる時間が
長くな９、キー記憶を効率的にアクセスすることが出来
ない。
〔発明の目的〕
本発明は、上記の考察に基づくものでろって、主記憶に
対するアクセス要求の記憶保護判定を高速に行い得るよ
うになった記憶保護判定方式を提供することを目的とし
ている０ 〔発明の構成〕 そしてそのため、本発明の記憶保護判定方式は、記憶領
域の単位領域毎にその領域に対する記憶装置キーを設け
、これら記憶装置キーをキー記憶に格納したシステムに
おける記憶保護判定方式において、上記記憶領域に対す
るアクセス要求に付随するアクセス要求キーの値を予め
判定し、その値が特定の値を持ったときには上記キー記
憶から記憶装置キーを読出すことなく、直ちに上記記憶
領域のアクセスを行うことを特徴とするものである。
〔発明の実施例〕
以下、本発明を図面を参照しつつ説明する。第２図は本
発明の１実施例を示すものである。第２図において、Ａ
ＩないしんはＡＮＤ回路、Ｎｉｌ″ｊ：Ｎ　０１回路、
４１はキー記瞳アクセス許可信号をそれぞれ示している
。なお、第１図と同一符号は同一物を示している。第２
図の記憶保護判定回路４は、ゼロ判定回路Ｚ、一致判定
回路Ｍ、Ｎ０Ｔｌ路Ｎ、ＡＮＤ回路ＡＩないしんおよび
ＯＲ回路Ｏを有しているｃ、ＡＮＤ回路Ａ１にはゼロ判
定信号４２およびキー記憶アクセス要求１３が入力され
る。ＡＮＤ回路んには一致信号４３およびキー記憶判定
信号３１が入力される。ＡＮＤ回路Ａ１およびんの出力
′は、ＯＲ回路Ｏに入力され、ＯＲ回路Ｏの出力が主記
憶アクセス許可信号４０になる。ＡＮＤ回路Ａ２にはキ
ー記憶アクセス要求１３およびゼロ判定信号Ｃを反転し
たものが入力される。ＡＮＤ回路Ａ２の出力がキー記憶
アクセス許可信号４１となる。
次に第２図の実施例の動作について説明する。
チャネルは、ブロック境界を越えて主記憶５をアクセス
するときキー・チェック付アクセス要求１０とアクセス
要求キー１１を送出する。アクセス制御回路１は、キー
・チェック付アクセス要求１０を受取ると、キー記憶ア
クセス要求１３を送出する。一方、アクセス要求キー１
１はゼロ判定回路２に入力されろ。キー記憶アクセス要
求１３が送出された時、ゼロ判定信号４２が論理「１」
であれば主記憶アクセス許可信号４０が論理「１」と々
る０主記憶アクセモ 制御回路１は、主記憶アクセスのための制御を行う。ア
クセス制御回路１からキー記憶アクセス要求１３を送出
した時、ゼロ判定信号４２が論理「０」であれば、キー
記憶アクセス許可信号４１が記憶保護キー制御回路３に
送らｎる。ギー記１．ハアクセス許可信号４１を受取る
と、記憶保護キー制御（ロ）路３は、キー記憶アクセス
情報３０をキー記憶６に送る。
キー記憶６から読出きれた記憶装置な６０は、記憶保護
判定回路４の一致判定回路Ｍに入力きれる。記憶保護キ
ー制御回路３がキー記憶判定信号３１をオンとした時、
一致信号４３がＡＮＤ回路Ａ３およびＯＲ回路０を経由
して主記憶アクセス許可信号４０としてアクセス制御回
路１に送られる。主記憶アクセス許可信号が論理「１」
で６３ば、アクセス制御回路１は、主記憶アクセスのた
めの制御を行う。
〔発明の効果〕
以上の説明から明らかなように５本発明によｎ゛ば、ア
クセス要求キーが特定の１直を有しているときはキー記
憶のアクセスを行うことなく主記憶をアクセスするので
、キー記憶のアクセスを効率的に行うことが出来る〇
【図面の簡単な説明】
第１図は従来の記憶保護判定方式を示すブロック図、第
２図は本発明の１実施例のブロック図である。 １・・・アクセス制御回路、２・・・主記憶制御回路、
３・・・記憶保護キー制御回路、４・・・記憶保護判定
方式、５・・・主記憶、１０・・・アクセス要求、１１
・・・アクセス要求キー、１２・・・主記憶アクセス要
求、１３・・・キー記憶アクセス要求、２０・・・主記
憶アクセス情報、３０・・・キー記憶アクセス情報、３
１・・・キー記憶判定信号、４０・・・主記憶アクセス
許可信号、Ｃ・・・ゼロ判定信号、４３・・・一致信号
、Ｚ・・・ゼロ判定回路、Ｍ・・・−′＆刊定回路、０
・・・ＯＲ回路、Ａ・・・ＡＮＤ回路、ＡＩないしＡｓ
・・・ＡＮＤ回路、Ｎ・・・ＮＯＴ回路、４１・・・キ
ー記憶アクセス許可信号。 特許出願人　富士通株式会社 代理人弁理士　京　谷　四　部

Claims (1)

    【特許請求の範囲】
  1. 記憶領域の単位領域毎にその領域に対する記憶装置キー
    を設け、これら記憶装置キーをキー記憶に格納したシス
    テムにおける記憶保護判足方式において、上記記憶領域
    に対するアクセス要求に付随するアクセス要求キーの値
    を予め判定し、その値が特定の値を持つときには、上記
    キー記憶から記憶装（ａキーを読出すことなく、直ちに
    上記記憶領域のアクセスを行うことを特徴とする記憶保
    護判定方式。
JP57170080A 1982-09-29 1982-09-29 記憶保護判定方式 Granted JPS5958700A (ja)

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CA000436651A CA1208803A (en) 1982-09-29 1983-09-14 Method for checking storage protection and a circuit for carrying out the same
AU19124/83A AU545373B2 (en) 1982-09-29 1983-09-14 Checking storage protection
KR1019830004556A KR880000360B1 (ko) 1982-09-29 1983-09-28 기억보호 검사방법 및 그 수행 시스템
BR8305341A BR8305341A (pt) 1982-09-29 1983-09-28 Processo para verificacao de protecao de armazenamento e um circuito para realizacao do mesmo
ES526027A ES526027A0 (es) 1982-09-29 1983-09-28 Un metodo para comprobar la proteccion de una memoria de almacenamiento de informacion.
DE8383305875T DE3381025D1 (de) 1982-09-29 1983-09-29 Schaltung zur speichersicherungspruefung.
EP83305875A EP0106600B1 (en) 1982-09-29 1983-09-29 Circuit for checking storage protection
US07/315,213 US4954982A (en) 1982-09-29 1989-02-24 Method and circuit for checking storage protection by pre-checking an access request key

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ES (1) ES526027A0 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022505011A (ja) * 2018-11-14 2022-01-14 アーム・リミテッド メモリ・アクセスを制御するための装置及び方法

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5297268A (en) * 1988-06-03 1994-03-22 Dallas Semiconductor Corporation ID protected memory with a readable/writable ID template
CA2006732C (en) * 1988-12-27 1994-05-03 Tsuyoshi Mori Control system for fetching an instruction
DE3901457A1 (de) * 1989-01-19 1990-08-02 Strahlen Umweltforsch Gmbh Verfahren zur adressbereichsueberwachung bei datenverarbeitungsgeraeten in echtzeit
US5335334A (en) * 1990-08-31 1994-08-02 Hitachi, Ltd. Data processing apparatus having a real memory region with a corresponding fixed memory protection key value and method for allocating memories therefor
US5163096A (en) * 1991-06-06 1992-11-10 International Business Machines Corporation Storage protection utilizing public storage key control
JP3006730B2 (ja) * 1991-08-13 2000-02-07 富士ゼロックス株式会社 共同作業用情報処理装置及び共同作業用情報処理方法
JP2788836B2 (ja) * 1992-05-15 1998-08-20 インターナショナル・ビジネス・マシーンズ・コーポレイション ディジタルコンピュータシステム
US5475829A (en) * 1993-03-22 1995-12-12 Compaq Computer Corp. Computer system which overrides write protection status during execution in system management mode
US5802397A (en) * 1996-05-23 1998-09-01 International Business Machines Corporation System for storage protection from unintended I/O access using I/O protection key by providing no control by I/O key entries over access by CP entity
US5900019A (en) * 1996-05-23 1999-05-04 International Business Machines Corporation Apparatus for protecting memory storage blocks from I/O accesses
US5787309A (en) * 1996-05-23 1998-07-28 International Business Machines Corporation Apparatus for protecting storage blocks from being accessed by unwanted I/O programs using I/O program keys and I/O storage keys having M number of bits
US5724551A (en) * 1996-05-23 1998-03-03 International Business Machines Corporation Method for managing I/O buffers in shared storage by structuring buffer table having entries include storage keys for controlling accesses to the buffers
US5809546A (en) * 1996-05-23 1998-09-15 International Business Machines Corporation Method for managing I/O buffers in shared storage by structuring buffer table having entries including storage keys for controlling accesses to the buffers
US6324537B1 (en) * 1999-09-30 2001-11-27 M-Systems Flash Disk Pioneers Ltd. Device, system and method for data access control
US6807620B1 (en) * 2000-02-11 2004-10-19 Sony Computer Entertainment Inc. Game system with graphics processor
IL148834A (en) 2000-09-10 2007-03-08 Sandisk Il Ltd Removable, active, personal storage device, system and method
US7093104B2 (en) * 2001-03-22 2006-08-15 Sony Computer Entertainment Inc. Processing modules for computer architecture for broadband networks
US7516334B2 (en) 2001-03-22 2009-04-07 Sony Computer Entertainment Inc. Power management for processing modules
US6809734B2 (en) 2001-03-22 2004-10-26 Sony Computer Entertainment Inc. Resource dedication system and method for a computer architecture for broadband networks
US6826662B2 (en) 2001-03-22 2004-11-30 Sony Computer Entertainment Inc. System and method for data synchronization for a computer architecture for broadband networks
US7231500B2 (en) * 2001-03-22 2007-06-12 Sony Computer Entertainment Inc. External data interface in a computer architecture for broadband networks
US7233998B2 (en) 2001-03-22 2007-06-19 Sony Computer Entertainment Inc. Computer architecture and software cells for broadband networks
US6526491B2 (en) 2001-03-22 2003-02-25 Sony Corporation Entertainment Inc. Memory protection system and method for computer architecture for broadband networks
US7024519B2 (en) * 2002-05-06 2006-04-04 Sony Computer Entertainment Inc. Methods and apparatus for controlling hierarchical cache memory
US8224639B2 (en) 2004-03-29 2012-07-17 Sony Computer Entertainment Inc. Methods and apparatus for achieving thermal management using processing task scheduling
US8265270B2 (en) * 2007-12-05 2012-09-11 Microsoft Corporation Utilizing cryptographic keys and online services to secure devices
CN102203054B (zh) 2008-11-05 2014-07-30 巴斯夫欧洲公司 生产n，n-取代的3-氨基丙-1-醇的方法

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5247858A (en) * 1975-10-14 1977-04-16 Kobe Steel Ltd Device for coating steel pipe
JPS542026A (en) * 1977-06-07 1979-01-09 Hitachi Ltd Memory unit

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3284776A (en) * 1961-06-08 1966-11-08 Decca Ltd Data processing apparatus
US3328765A (en) * 1963-12-31 1967-06-27 Ibm Memory protection system
US3328768A (en) * 1964-04-06 1967-06-27 Ibm Storage protection systems
US3377626A (en) * 1966-04-01 1968-04-16 Robert E. Smith Insulated goggles
US3576544A (en) * 1968-10-18 1971-04-27 Ibm Storage protection system
DE2010640A1 (de) * 1969-05-19 1970-11-26 VEB Kombinat Robotron, χ 8l42 Radeberg Patentwesen, Ost-Berlin WPI3989O Schaltungsanordnung zur Durchführung des Speicherschutzes in Verbindung mit Kanalsteuereinheiten
DE2047287A1 (de) * 1969-10-27 1972-02-03 Robotron Veb K Verfahren und Schaltungsanordnung zur Durchfuhrung des Schutzes von Speicher platzen
US3825903A (en) * 1973-04-30 1974-07-23 Ibm Automatic switching of storage protect keys
US4135240A (en) * 1973-07-09 1979-01-16 Bell Telephone Laboratories, Incorporated Protection of data file contents
US4035779A (en) * 1976-04-30 1977-07-12 International Business Machines Corporation Supervisor address key control system
US4038645A (en) * 1976-04-30 1977-07-26 International Business Machines Corporation Non-translatable storage protection control system
US4037214A (en) * 1976-04-30 1977-07-19 International Business Machines Corporation Key register controlled accessing system
JPS596415B2 (ja) * 1977-10-28 1984-02-10 株式会社日立製作所 多重情報処理システム
US4521846A (en) * 1981-02-20 1985-06-04 International Business Machines Corporation Mechanism for accessing multiple virtual address spaces
US4472790A (en) * 1982-02-05 1984-09-18 International Business Machines Corporation Storage fetch protect override controls

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5247858A (en) * 1975-10-14 1977-04-16 Kobe Steel Ltd Device for coating steel pipe
JPS542026A (en) * 1977-06-07 1979-01-09 Hitachi Ltd Memory unit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022505011A (ja) * 2018-11-14 2022-01-14 アーム・リミテッド メモリ・アクセスを制御するための装置及び方法

Also Published As

Publication number Publication date
ES8502275A1 (es) 1984-12-16
ES526027A0 (es) 1984-12-16
US4954982A (en) 1990-09-04
EP0106600A3 (en) 1987-01-21
DE3381025D1 (de) 1990-02-01
AU1912483A (en) 1984-04-05
KR840006092A (ko) 1984-11-21
EP0106600A2 (en) 1984-04-25
CA1208803A (en) 1986-07-29
EP0106600B1 (en) 1989-12-27
JPS6235702B2 (ja) 1987-08-03
KR880000360B1 (ko) 1988-03-20
BR8305341A (pt) 1984-05-08
AU545373B2 (en) 1985-07-11

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