JPS6235702B2 - - Google Patents

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JPS6235702B2
JPS6235702B2 JP57170080A JP17008082A JPS6235702B2 JP S6235702 B2 JPS6235702 B2 JP S6235702B2 JP 57170080 A JP57170080 A JP 57170080A JP 17008082 A JP17008082 A JP 17008082A JP S6235702 B2 JPS6235702 B2 JP S6235702B2
Authority
JP
Japan
Prior art keywords
key
storage
circuit
access request
protection
Prior art date
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Application number
JP57170080A
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English (en)
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JPS5958700A (ja
Inventor
Terutaka Tateishi
Minoru Etsuno
Kazuyuki Shimizu
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Priority to DE8383305875T priority patent/DE3381025D1/de
Priority to EP83305875A priority patent/EP0106600B1/en
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Publication of JPS6235702B2 publication Critical patent/JPS6235702B2/ja
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    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00—Accessing, addressing or allocating within memory systems or architectures
    • G06F12/14—Protection against unauthorised use of memory or access to memory
    • G—PHYSICS
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    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00—Accessing, addressing or allocating within memory systems or architectures
    • G06F12/14—Protection against unauthorised use of memory or access to memory
    • G06F12/1458—Protection against unauthorised use of memory or access to memory by checking the subject access rights
    • G06F12/1466—Key-lock mechanism

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Security & Cryptography (AREA)
  • Storage Device Security (AREA)

Description

【発明の詳細な説明】
〔発明の技術分野〕 本発明は、単位領域毎に記憶保護キーをもつシ
ステムにおいて、単位領域に対するアクセス要求
の記憶保護判定を高速に行い得るようになつた記
憶保護判定方式に関するものである。 〔従来技術と問題点〕 主記憶装置は、記憶保護の単位として例えば
2Kバイト毎のブロツクに分割されており、各ブ
ロツクに対して８ビツトの記憶装置キーがキー記
憶に書込まれている。記憶装置キーは、 という構成をもつものであり、Ａはアクセス制御
ビツト、Ｆは読出保護ビツト、Ｒは参照ビツト、
Ｃは変更ビツト、Ｓは書込保護ビツトをそれぞれ
示している。中央処理装置やチヤネルは保護キー
を有している。中央処理装置はPSWの中に保護
キーを有しており、またTLBの中に記憶装置キ
ーを保持している。チヤネルは、CAWを取込
み、この中に記入されている保護キーを保持して
いる。下記の表は保護動作の要約をまとめたもの
である。
〔発明の構成〕
そしてそのため、本発明の記憶保護判定方式
は、記憶領域の単位領域毎にその領域に対する記
憶装置キーを設け、これら記憶装置キーをキー記
憶に格納したシステムにおける記憶保護判定方式
において、上記記憶領域に対するアクセス要求に
付随するアクセス要求キーの値を予め判定し、そ
の値が特定の値を持つたときには上記キー記憶か
ら記憶装置キーを読出すことなく、直ちに上記記
憶領域のアクセスを行うことを特徴とするもので
ある。 〔発明の実施例〕 以下、本発明を図面を参照しつつ説明する。第
２図は本発明の１実施例を示すものである。第２
図において、A1ないしA3はAND回路、ＮはNOT
回路、４１はキー記憶アクセス許可信号をそれぞ
れ示している。なお、第１図と同一符号は同一物
を示している。第２図の記憶保護判定回路４は、
ゼロ判定回路Ｚ、一致判定回路Ｍ、NOT回路
Ｎ、AND回路A1ないしA3およびOR回路Ｏを有し
ている。AND回路A1にはゼロ判定信号４２およ
びキー記憶アクセス要求１３が入力される。
AND回路A3には一致信号４３およびキー記憶判
定信号３１が入力される。AND回路A1およびA3
の出力はOR回路Ｏに入力され、OR回路Ｏの出力
が主記憶アクセス許可信号４０になる。AND回
路A2にはキー記憶アクセス要求１３およびゼロ
判定信号４２を反転したものが入力される。
AND回路A2の出力がキー記憶アクセス許可信号
４１となる。 次に第２図の実施例の動作について説明する。
チヤネルは、ブロツク境界を越えて主記憶５をア
クセスするときキー・チエツク付アクセス要求１
０とアクセス要求キー１１を送出する。アクセス
制御回路１は、キー・チエツク付アクセス要求１
０を受取ると、キー記憶アクセス要求１３を送出
する。一方、アクセス要求キー１１はゼロ判定回
路Ｚに入力される。キー記憶アクセス要求１３が
送出された時、ゼロ判定信号４２が論理「１」で
あれば主記憶アクセス許可信号４０が論理「１」
となる。主記憶アクセス許可信号４０が論理
「１」になると、アクセス制御回路１は、主記憶
アクセスのための制御を行う。アクセス制御回路
１からキー記憶アクセス要求１３を送出した時、
ゼロ判定信号４２が論理「０」であれば、キー記
憶アクセス許可信号４１が記憶保護キー制御回路
３に送られる。キー記憶アクセス許可信号４１を
受取ると、記憶保護キー制御回路３は、キー記憶
アクセス情報３０をキー記憶６に送る。キー記憶
６から読出された記憶装置６０は、記憶保護判定
回路４の一致判定回路Ｍに入力される。記憶保護
キー制御回路３がキー記憶判定信号３１をオンと
した時、一致信号４３がAND回路A3およびOR回
路Ｏを経由して主記憶アクセス許可信号４０とし
てアクセス制御回路１に送られる。主記憶アクセ
ス許可信号が論理「１」であれば、アクセス制御
回路１は、主記憶アクセスのための制御を行う。 〔発明の効果〕 以上の説明から明らかなように、本発明によれ
ば、アクセス要求キーが特定の値を有していると
きはキー記憶のアクセスを行うことなく主記憶を
アクセスするので、キー記憶のアクセスを効率的
に行うことが出来る。
【図面の簡単な説明】
第１図は従来の記憶保護判定方式を示すブロツ
ク図、第２図は本発明の１実施例のブロツク図で
ある。 １…アクセス制御回路、２…主記憶制御回路、
３…記憶保護キー制御回路、４…記憶保護判定回
路、５…主記憶、１０…アクセス要求、１１…ア
クセス要求キー、１２…主記憶アクセス要求、１
３…キー記憶アクセス要求、２０…主記憶アクセ
ス情報、３０…キー記憶アクセス情報、３１…キ
ー記憶判定信号、４０…主記憶アクセス許可信
号、４２…ゼロ判定信号、４３…一致信号、Ｚ…
ゼロ判定回路、Ｍ…一致判定回路、Ｏ…OR回
路、Ａ…AND回路、A1ないしA3…AND回路、Ｎ
…NOT回路、４１…キー記憶アクセス許可信
号。

Claims (1)

    【特許請求の範囲】
  1. １ 記憶領域の単位領域毎にその領域に対する記
    憶装置キーを設け、これら記憶装置キーをキー記
    憶に格納したシステムにおける記憶保護判定方式
    において、上記記憶領域に対するアクセス要求に
    付随するアクセス要求キーの値を予め判定し、そ
    の値が特定の値を持つときには、上記キー記憶か
    ら記憶装置キーを読出すことなく、直ちに上記記
    憶領域のアクセスを行うことを特徴とする記憶保
    護判定方式。
JP57170080A 1982-09-29 1982-09-29 記憶保護判定方式 Granted JPS5958700A (ja)

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JPS5958700A JPS5958700A (ja) 1984-04-04
JPS6235702B2 true JPS6235702B2 (ja) 1987-08-03

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US (1) US4954982A (ja)
EP (1) EP0106600B1 (ja)
JP (1) JPS5958700A (ja)
KR (1) KR880000360B1 (ja)
AU (1) AU545373B2 (ja)
BR (1) BR8305341A (ja)
CA (1) CA1208803A (ja)
DE (1) DE3381025D1 (ja)
ES (1) ES526027A0 (ja)

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