JPS6040152U - デ−タサンプリング回路 - Google Patents

デ−タサンプリング回路

Info

Publication number
JPS6040152U
JPS6040152U JP13064783U JP13064783U JPS6040152U JP S6040152 U JPS6040152 U JP S6040152U JP 13064783 U JP13064783 U JP 13064783U JP 13064783 U JP13064783 U JP 13064783U JP S6040152 U JPS6040152 U JP S6040152U
Authority
JP
Japan
Prior art keywords
data
signal
counter
memory
latch circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP13064783U
Other languages
English (en)
Other versions
JPH0117880Y2 (ja
Inventor
大槻 光弘
Original Assignee
日本電気ホームエレクトロニクス株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 日本電気ホームエレクトロニクス株式会社 filed Critical 日本電気ホームエレクトロニクス株式会社
Priority to JP13064783U priority Critical patent/JPS6040152U/ja
Publication of JPS6040152U publication Critical patent/JPS6040152U/ja
Application granted granted Critical
Publication of JPH0117880Y2 publication Critical patent/JPH0117880Y2/ja
Granted legal-status Critical Current

Links

Landscapes

  • Compression, Expansion, Code Conversion, And Decoders (AREA)
  • Dc Digital Transmission (AREA)
  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は、本考案によるデータサンプリング回路の一実
施例を示す回路図、第2図は、第1図における主要個所
の信号の時間的関係を示すタイミングチャートである。 1・・・・・・シフトレジスタ、2・・・・・・ラッチ
回路、3・・・・・・メモリ、4・・・・・・カウンタ
、5・・・・・・デコーダ。

Claims (1)

    【実用新案登録請求の範囲】
  1. N番目のデータ語がmビットで、他のデータ語はnビッ
    トで構成される直列データ信号を入力し、データのビッ
    トクロック信号に同期して並列nビットデータ信号に変
    換するシフトレジスタと、このシフトレジスタからの並
    列nビットデータをラッチするラッチ回路と、前記ラッ
    チ回路の出力データを格納するメモリと、前記ピットク
    ロック信号を計数し、nカウント毎に、前記ラッチ回路
    を動作させると共に前記メモリに対し書込み信号および
    アドレス信号を供給するカウンタと、このカウンタの計
    数出力を入力し、計数値が(N−1)Xn+mの時、こ
    のカウーンタに対しそれぞれ強制的にNXnに変換、す
    るように制御するデコーダとを備えたデータサンプリン
    グ回路。
JP13064783U 1983-08-24 1983-08-24 デ−タサンプリング回路 Granted JPS6040152U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP13064783U JPS6040152U (ja) 1983-08-24 1983-08-24 デ−タサンプリング回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP13064783U JPS6040152U (ja) 1983-08-24 1983-08-24 デ−タサンプリング回路

Publications (2)

Publication Number Publication Date
JPS6040152U true JPS6040152U (ja) 1985-03-20
JPH0117880Y2 JPH0117880Y2 (ja) 1989-05-24

Family

ID=30295630

Family Applications (1)

Application Number Title Priority Date Filing Date
JP13064783U Granted JPS6040152U (ja) 1983-08-24 1983-08-24 デ−タサンプリング回路

Country Status (1)

Country Link
JP (1) JPS6040152U (ja)

Also Published As

Publication number Publication date
JPH0117880Y2 (ja) 1989-05-24

Similar Documents

Publication Publication Date Title
JPS6118153B2 (ja)
JPS5941336B2 (ja) バツフアメモリ装置
JPS5861540U (ja) シリアル−パラレル変換回路
SU1667082A1 (ru) Устройство мажорировани
SU1605244A1 (ru) Устройство дл сопр жени источника и приемника информации
SU1129598A1 (ru) Устройство дл вывода информации
JPS60135869U (ja) インタリ−ブ用ramの読出し書込みパルス発生回路
JPS60144332U (ja) シリアルデ−タ入力−パラレルデ−タ出力回路
JPH0215086B2 (ja)
JPS6020695U (ja) 入力信号検出回路
JPH0358737U (ja)
JPS599639U (ja) コ−ド変換回路
JPS6364698A (ja) 記憶装置
JPH01302918A (ja) データ設定回路
JPS6082343U (ja) メモリアドレス発生回路
JPS58195343U (ja) キ−入力検出回路
JPS6162144A (ja) 状態履歴記憶装置
JPH0172653U (ja)
JPS58123588A (ja) メロデイ発生用集積回路
JPS60100851U (ja) メモリ−装置
JPS6271747U (ja)
JPS6079834U (ja) クロツクパルス検出回路
JPS61139832A (ja) ランダムデ−タ発生装置
JPS5860397U (ja) シフトレジスタ装置
JPS61160556U (ja)