JPS6042933A - ３相ソリツドステ−トリレ− - Google Patents
３相ソリツドステ−トリレ−Info
- Publication number
- JPS6042933A JPS6042933A JP15192783A JP15192783A JPS6042933A JP S6042933 A JPS6042933 A JP S6042933A JP 15192783 A JP15192783 A JP 15192783A JP 15192783 A JP15192783 A JP 15192783A JP S6042933 A JPS6042933 A JP S6042933A
- Authority
- JP
- Japan
- Prior art keywords
- phase
- main
- ssr
- power supply
- main terminal
- Prior art date
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- Pending
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/72—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices having more than two PN junctions; having more than three electrodes; having more than one electrode connected to the same conductivity region
- H03K17/725—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices having more than two PN junctions; having more than three electrodes; having more than one electrode connected to the same conductivity region for AC voltages or currents
Landscapes
- Thyristor Switches And Gates (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、３相交流電源の負荷への供給を桜餅制御する
３相ソリツドステートリレー（以下３相ＳＳＲと記す）
に関するものである。
３相ソリツドステートリレー（以下３相ＳＳＲと記す）
に関するものである。
従来、３相交流モータの駆動制御を行なう場合には、メ
カニカルリレーである電磁開閉器を用い、これを開閉制
御することにより該モータへの３相交流電源の供給を桜
餅制御するようにしていた。
カニカルリレーである電磁開閉器を用い、これを開閉制
御することにより該モータへの３相交流電源の供給を桜
餅制御するようにしていた。
ところが、この電磁開閉器は、その開閉頻度が高い使用
状況下では、その接点の摩耗が激しくなり、寿命が短く
なるという問題があった。
状況下では、その接点の摩耗が激しくなり、寿命が短く
なるという問題があった。
ところで、従来、単相交流電源の負荷への供給を捨所制
御するためのものとしては、半導体を用いた無接点式の
単相ソリッドステートリレー（以下単相ＳＳＲと記す）
があり、これば上記電磁開閉器のような接点は必要ない
ものであり、従って上記接点の摩耗による寿命低下の問
題は生じない。
御するためのものとしては、半導体を用いた無接点式の
単相ソリッドステートリレー（以下単相ＳＳＲと記す）
があり、これば上記電磁開閉器のような接点は必要ない
ものであり、従って上記接点の摩耗による寿命低下の問
題は生じない。
第１図（ａｌ （ｂｌは、このような単相ＳＳＲの２つ
の例を示すもので、第１図（ａ）の単相ＳＳＲは端子が
両側部に設けられたものである。この第１図ｆａｔにお
いて、１は単相５ＳＲ１ｌａ、ｌｂは該単相５ＳＲＩの
一方の側部に設げられ、単相交流電源の負荷への供給を
接断するための外部からの制御信号を制御回路に印加す
るための制御端子、ｌｃ。
の例を示すもので、第１図（ａ）の単相ＳＳＲは端子が
両側部に設けられたものである。この第１図ｆａｔにお
いて、１は単相５ＳＲ１ｌａ、ｌｂは該単相５ＳＲＩの
一方の側部に設げられ、単相交流電源の負荷への供給を
接断するための外部からの制御信号を制御回路に印加す
るための制御端子、ｌｃ。
１ｄは上記単相５ＳＲＩの他方の側部に設けられ、電源
側、負荷側からの単相ケーブルを接続するための一対の
主端子である。
側、負荷側からの単相ケーブルを接続するための一対の
主端子である。
次に、第１図（ｂ）は端子が一方の側部に集中して設け
られた単相ＳＳＲを示し、同図において、２は単相５Ｓ
Ｒ１２ａ、２ｂは第１図（ａｌの１ａ、１ｂに相当する
制御端子、２ｃ、２ｄは第１図（ａ）のｌｃ、ｉｄに相
当する一対の主端子である。
られた単相ＳＳＲを示し、同図において、２は単相５Ｓ
Ｒ１２ａ、２ｂは第１図（ａｌの１ａ、１ｂに相当する
制御端子、２ｃ、２ｄは第１図（ａ）のｌｃ、ｉｄに相
当する一対の主端子である。
第２図は上記単相ＳＳＲの半導体主素子回路８０を示し
、同図において、８１．８２は電源側。
、同図において、８１．８２は電源側。
負荷側主端子、’８３．８４は第１．第２サイリスク、
８５．８６は図示しない制御回路に接続される制御端子
、８７．８８はそれぞれ抵抗８９．ダイオード９０から
なる第１．第２ゲート補助回路である。
８５．８６は図示しない制御回路に接続される制御端子
、８７．８８はそれぞれ抵抗８９．ダイオード９０から
なる第１．第２ゲート補助回路である。
そして上記制御回路に外部から印加される制御信号が“
Ｈ”のときは、上記制御端子８５．８６間が短絡され、
これにより単相交流の正の半サイクルにおいては、電源
側主端子８１．第１ゲート補助回路８７．制御端子８５
．８６間、第２サイリスタ８４のゲート、負荷側主端子
８２の経路で補助電流が流れて第一２サイリスタ８４が
オンし、これにより主電流が電源側主端子８１から第２
サイリスタ８４を通って負荷側主端子８２に流れ、また
単相交流の負の半サイクルでは、同様にして第２ゲート
補助回路８８及び第１サイリスタ８３が動作し、主電流
が負荷側から第１サイリスタ８３を通って電源側に流れ
、その結果負荷に単相電力が供給されることとなる。
Ｈ”のときは、上記制御端子８５．８６間が短絡され、
これにより単相交流の正の半サイクルにおいては、電源
側主端子８１．第１ゲート補助回路８７．制御端子８５
．８６間、第２サイリスタ８４のゲート、負荷側主端子
８２の経路で補助電流が流れて第一２サイリスタ８４が
オンし、これにより主電流が電源側主端子８１から第２
サイリスタ８４を通って負荷側主端子８２に流れ、また
単相交流の負の半サイクルでは、同様にして第２ゲート
補助回路８８及び第１サイリスタ８３が動作し、主電流
が負荷側から第１サイリスタ８３を通って電源側に流れ
、その結果負荷に単相電力が供給されることとなる。
一方、上記制御信号が“Ｌ”のときは、上記制御端子８
５．８６間は開放状態となり、その結果側サイリスク８
３．８４はオフのままで負荷には単相電力は供給されな
い。従ってこの単相ＳＳＲを用いれば、上記制御信号に
よって単相電源の負荷への供給を接話制御できることと
なる。
５．８６間は開放状態となり、その結果側サイリスク８
３．８４はオフのままで負荷には単相電力は供給されな
い。従ってこの単相ＳＳＲを用いれば、上記制御信号に
よって単相電源の負荷への供給を接話制御できることと
なる。
このような従来の状況において、上記３相交流電源の負
荷への供給を接話制御する場合は、電磁開閉器の代わり
に上記単相ＳＳＲを組合わせることによって上記寿命低
下の問題を回避することが可能であり、このような単相
ＳＳＲを組合わせた３相ＳＳＲとしては、第３図に示す
ものが考えられる。
荷への供給を接話制御する場合は、電磁開閉器の代わり
に上記単相ＳＳＲを組合わせることによって上記寿命低
下の問題を回避することが可能であり、このような単相
ＳＳＲを組合わせた３相ＳＳＲとしては、第３図に示す
ものが考えられる。
第３図＋ａ＋は上記３個の単相５ＳＲＩを単に並列に配
置して構成した３７ｓ Ｓ Ｒ３を示す。また同７／′ 図（ｂｌはこれらの３個の単相″５ＳＲ１を一体に形成
した３相５ＳＲ４を示し、この３相５ＳＲ４は、左端の
相のＳＳＲ部のみの制御端子１ａ、ｌｂだけを残し、他
の２相のＳＳＲ部の制御端子を取り除いたものである。
置して構成した３７ｓ Ｓ Ｒ３を示す。また同７／′ 図（ｂｌはこれらの３個の単相″５ＳＲ１を一体に形成
した３相５ＳＲ４を示し、この３相５ＳＲ４は、左端の
相のＳＳＲ部のみの制御端子１ａ、ｌｂだけを残し、他
の２相のＳＳＲ部の制御端子を取り除いたものである。
また第３図（Ｃ１は上記３個の単相５ＳＲ２を単に並列
に配置して構成した３相５ＳＲ５を示し、一方、同図（
ｄ＋はこれらの３個の単相５ＳＲ２を一体に形成した３
相５ＳＲ６を示し、ごの３相５ＳＲ６では、制御端子２
ａ、２ｂは左端の相のＳＳＲ部のみにその主端子２．ｃ
、２ｄと反対側に設けられている。
に配置して構成した３相５ＳＲ５を示し、一方、同図（
ｄ＋はこれらの３個の単相５ＳＲ２を一体に形成した３
相５ＳＲ６を示し、ごの３相５ＳＲ６では、制御端子２
ａ、２ｂは左端の相のＳＳＲ部のみにその主端子２．ｃ
、２ｄと反対側に設けられている。
ところが、このように３個の単相５ＳＲＩ又は２をその
まま配置して構成した３相５ＳＲ３，５あるいはこれら
を一体形成しただけの３相５ＳＲ４，６では、全ての主
端子１ｃ、ｌｄあるいは２ｃ、２ｄが該３相５ＳＲ３〜
６の一方の側部に集中してしまうこととなり、そのため
各主端子に該主端子を電源側あるいは負荷側ケ゛−プル
のいずれに接続すべきかの表示（図中のＵ、 Ｖ、 Ｗ
、 Ｒ。
まま配置して構成した３相５ＳＲ３，５あるいはこれら
を一体形成しただけの３相５ＳＲ４，６では、全ての主
端子１ｃ、ｌｄあるいは２ｃ、２ｄが該３相５ＳＲ３〜
６の一方の側部に集中してしまうこととなり、そのため
各主端子に該主端子を電源側あるいは負荷側ケ゛−プル
のいずれに接続すべきかの表示（図中のＵ、 Ｖ、 Ｗ
、 Ｒ。
Ｓ、Ｔの表示）を行なう必要があり、またこの主端子と
３相ケーブルとの接続作業が煩雑になるという問題が生
じる。
３相ケーブルとの接続作業が煩雑になるという問題が生
じる。
本発明は、かかる従来の状況において、上記電磁開閉器
における接点の摩耗による寿命低下という問題を回避で
き、さらには主端子を電源側と負荷例のいずれに接続す
べきかの表示を不要にでき、かつ３相ケーブルの接続作
業を非常に容易に行なえる３相ＳＳＲを提供することを
目的としている。
における接点の摩耗による寿命低下という問題を回避で
き、さらには主端子を電源側と負荷例のいずれに接続す
べきかの表示を不要にでき、かつ３相ケーブルの接続作
業を非常に容易に行なえる３相ＳＳＲを提供することを
目的としている。
即ち本発明は、３相交流電源の負荷への供給を装置する
ための３つの半導体主素子回路を備えた３相ＳＳＲであ
って、かつ該３つの半導体主素子回路の電源側、負荷側
主端子を各相の電源側主端子と負荷側主端子とが相互に
対向し、３つの電源側主端子及び３つの負荷側主端子が
それぞれ相互に平行な直線上に順に並ぶよう配設したも
のである。
ための３つの半導体主素子回路を備えた３相ＳＳＲであ
って、かつ該３つの半導体主素子回路の電源側、負荷側
主端子を各相の電源側主端子と負荷側主端子とが相互に
対向し、３つの電源側主端子及び３つの負荷側主端子が
それぞれ相互に平行な直線上に順に並ぶよう配設したも
のである。
以下、本発明の実施例を図について説明する。
第４図（８１ｆｂｌは本発明の一実施例にょる３相５Ｓ
Ｒ１・００を示し、これは第５図に示すように、３相交
流電源９２と負荷である３相交流モータ９３とを接続す
る３相ケーブル９４の途中に介挿され、上記第２図に示
す半導体主素子回路８ｏと同じ回路を３つ備えた主回路
部９１でもって上記３相交流電源９２のモーフ９３への
供給を装置制御するものである。
Ｒ１・００を示し、これは第５図に示すように、３相交
流電源９２と負荷である３相交流モータ９３とを接続す
る３相ケーブル９４の途中に介挿され、上記第２図に示
す半導体主素子回路８ｏと同じ回路を３つ備えた主回路
部９１でもって上記３相交流電源９２のモーフ９３への
供給を装置制御するものである。
第４図（ａｌ （ｂ） ニおいて、１ｏはＳ Ｓ Ｒ本
体であり、該ＳＳＲ本体１ｏ内には図示していないが、
上述の主回路部９１が収容されている。
体であり、該ＳＳＲ本体１ｏ内には図示していないが、
上述の主回路部９１が収容されている。
また、上記ＳＳＲ本体１ｏの第４図（ａｌ上、下側部に
は、上記主回路部９ｊの各相の半導体主素子回路８０に
３相ケーブル９４の各線を接続するたメ（７）［１％子
ｉ１１． １２．．１３が取り付けられている。そして
この主端子板１１，１２．１３としては、電源側主端子
板１１ａ、１２ａ、１３ａとこれに対向した負荷側主端
子板１１ｂ、１２ｂ。
は、上記主回路部９ｊの各相の半導体主素子回路８０に
３相ケーブル９４の各線を接続するたメ（７）［１％子
ｉ１１． １２．．１３が取り付けられている。そして
この主端子板１１，１２．１３としては、電源側主端子
板１１ａ、１２ａ、１３ａとこれに対向した負荷側主端
子板１１ｂ、１２ｂ。
１３ｂとがあり、この電源側主端子板１１２．１２ａ、
’１３ａ及び負荷側主端子板１ ｌ ｂ、１２ ｂ。
’１３ａ及び負荷側主端子板１ ｌ ｂ、１２ ｂ。
１３ｂはそれぞれ相互に平行な直線上に順に並ぶよう配
設されている。なお、５１．５２は３相ケーブル９４を
上記電源側主端子板１１ａ、１２ａ。
設されている。なお、５１．５２は３相ケーブル９４を
上記電源側主端子板１１ａ、１２ａ。
１３ａ１負荷側主端子板１１ｂ、１２ｂ、１３ｂに締付
は接続するための主端子取付ねしであり、５３は主端子
板１１−１３と図示しないゲート中継端子との絶縁距離
をとるための出力バリアである。また４１〜４４は上記
ＳＳＲ本体１０を被取付体に取り付けるための取イ」穴
である。
は接続するための主端子取付ねしであり、５３は主端子
板１１−１３と図示しないゲート中継端子との絶縁距離
をとるための出力バリアである。また４１〜４４は上記
ＳＳＲ本体１０を被取付体に取り付けるための取イ」穴
である。
また上記ＳＳＲ本体１０の第４図ｔａ＋の左、右側部中
央には、制御端子取付座３０．２０が形成されており、
右側の制御端子取付座２０には、上記ＳＳＲ本体１０内
に収容され、半導体主素子回路８０をオン・オフ制御す
るための制御回路（図示せず）の制御端子板２１．２’
２が固着されている。
央には、制御端子取付座３０．２０が形成されており、
右側の制御端子取付座２０には、上記ＳＳＲ本体１０内
に収容され、半導体主素子回路８０をオン・オフ制御す
るための制御回路（図示せず）の制御端子板２１．２’
２が固着されている。
なお、６１．．６２は制御信号入力用リード線を上記制
御端子板２１．２２に接続するための制御端子取付ねし
、３１．３２は制御端子取付穴である。
御端子板２１．２２に接続するための制御端子取付ねし
、３１．３２は制御端子取付穴である。
そして、上記ＳＳＲ本体１０の上面には、アブソーバケ
ース４０が取付ねし７１〜７４により締付は固着されて
おり、該アブソーバケース４０内には、上記半導体主素
子回路８０にサージ電圧等の異品高電圧が印加されたと
きこれを吸収するためのアブソーバ回路が収容されてい
る。
ース４０が取付ねし７１〜７４により締付は固着されて
おり、該アブソーバケース４０内には、上記半導体主素
子回路８０にサージ電圧等の異品高電圧が印加されたと
きこれを吸収するためのアブソーバ回路が収容されてい
る。
本実施例の３相ＳＳＲに３相ケーブル９４を接続するに
は、ＳＳＲ本体１０を被取付体に取付穴４１〜４４を利
用してボルト締め固着し、電源側の３相ケーブルの一端
を電源側主端子板１１ａ。
は、ＳＳＲ本体１０を被取付体に取付穴４１〜４４を利
用してボルト締め固着し、電源側の３相ケーブルの一端
を電源側主端子板１１ａ。
１２ａ、１３ａに主端子取付ねじ５１で締付は接続し、
負荷側の３相ケーブルの一端を負荷側主端子板１１ｂ、
１２ｂ、１３ｂに１端子取付ねじ５２で締付は接続し、
さらに制御信号入力用リード線を制御端子板２１．２２
に制御端子取付ねじ６１．６２により締め付は接続する
。
負荷側の３相ケーブルの一端を負荷側主端子板１１ｂ、
１２ｂ、１３ｂに１端子取付ねじ５２で締付は接続し、
さらに制御信号入力用リード線を制御端子板２１．２２
に制御端子取付ねじ６１．６２により締め付は接続する
。
このような構成になる本実施例では、まず、３相交流電
源の負荷への供給を装置制御するものとして半導体を用
いた３相ＳＳＲを構成したので、接点の摩耗による寿命
低下の問題を解消できる。
源の負荷への供給を装置制御するものとして半導体を用
いた３相ＳＳＲを構成したので、接点の摩耗による寿命
低下の問題を解消できる。
また本実施例の３相ＳＳＲでは、電源側主端子板１１２
〜１．３ ａの各々と負荷側主端子板１１ｂ〜１３ｂの
各々とを相互に対向せしめたので、主端子板を電源側あ
るいは負荷側のいずれに接続すべきかの表示が不要にな
り、配線間違いが生じることがなく、また電源側主端子
板１１ａ、１２ａ。
〜１．３ ａの各々と負荷側主端子板１１ｂ〜１３ｂの
各々とを相互に対向せしめたので、主端子板を電源側あ
るいは負荷側のいずれに接続すべきかの表示が不要にな
り、配線間違いが生じることがなく、また電源側主端子
板１１ａ、１２ａ。
１３ａ及び負荷側主端子板１１ｂ、１２ｂ、１３ｂをそ
れぞれＳＳＲ本体１０の一方の側部にまとめて設けたの
で、配線作業を容易に行なうことができる。
れぞれＳＳＲ本体１０の一方の側部にまとめて設けたの
で、配線作業を容易に行なうことができる。
なお、上記実施例では、制御端子板２１，２２を第４図
（ａ） （ｂｌの右側の制御端子取付座２０に取付けた
場合について説明したが、この制御端子板２１．２２は
同図の左側の制御端子取付座３０に取付けてもよい。
（ａ） （ｂｌの右側の制御端子取付座２０に取付けた
場合について説明したが、この制御端子板２１．２２は
同図の左側の制御端子取付座３０に取付けてもよい。
また、上記実施例では、説明の都合上主端子板１１ａ、
１２ａ、１３ａを電源側主端子板とし、主端子板１１ｂ
、１２ｂ、１３ｂを負荷側主端子板としたが、これらは
第２図を見ればわかるようにどちらを電源側あるいは負
荷側にしても良い。
１２ａ、１３ａを電源側主端子板とし、主端子板１１ｂ
、１２ｂ、１３ｂを負荷側主端子板としたが、これらは
第２図を見ればわかるようにどちらを電源側あるいは負
荷側にしても良い。
以上のように、本発明によれば、３つの半導体主素子回
路により３相ＳＳＲを構成したので、従来の電磁開閉器
のような短寿命という問題を解消できるばかりでなく、
該３相ＳＳＲにおいて、−３つの半導体主素子回路の電
源側、負荷側主端子を各相の電源側主端子と負荷側主端
子とが相互に対向し、３つの電源側主端子及び３つの負
荷側主端子がそれぞれ相互に平行な直線上に順に並ぶよ
う配設したので、主端子を電源側と負荷側のいずれに接
続すべきかの表示が不要となり、また３相ケーブルの接
続作業の能率を大きく向上できる効果がある。
路により３相ＳＳＲを構成したので、従来の電磁開閉器
のような短寿命という問題を解消できるばかりでなく、
該３相ＳＳＲにおいて、−３つの半導体主素子回路の電
源側、負荷側主端子を各相の電源側主端子と負荷側主端
子とが相互に対向し、３つの電源側主端子及び３つの負
荷側主端子がそれぞれ相互に平行な直線上に順に並ぶよ
う配設したので、主端子を電源側と負荷側のいずれに接
続すべきかの表示が不要となり、また３相ケーブルの接
続作業の能率を大きく向上できる効果がある。
第１図（ａ）は従来の単相ＳＳＲの斜視図、第１図（ｂ
ｌは従来の他の単相ＳＳＲの斜視図、第２図は従来の単
相ＳＳＲの回路図、第３図（ａｌ、’ （ｂｌ、 （Ｃ
１，＋ｄｉは本発明の考案の途中で考えられた３相ＳＳ
Ｒを示す平面図、第４図ｆａｔは本発明の一実施例によ
る３相ＳＳＲの平面図、第４図（ｂｌはその側面図、第
５図は上記実施例の３相ＳＳＲの使用状態における電源
、負荷との接続関係を示す回路図である。 １１ａ、１２ａ、１３ａ・・・電源側主端子、１１ｂ、
１２ｂ’、１３ｂ・・・負荷側主端子、８０・・・半導
体主素子回路、９２・・・３相交流電源、９３・・・負
荷、１００・・・３相５ＳＲ０ なお図中、同一符号は同−又は相当部分を示す。 代理人 大岩増雄 第１図 （Ｃ１） 第２図 第３図 第４図
ｌは従来の他の単相ＳＳＲの斜視図、第２図は従来の単
相ＳＳＲの回路図、第３図（ａｌ、’ （ｂｌ、 （Ｃ
１，＋ｄｉは本発明の考案の途中で考えられた３相ＳＳ
Ｒを示す平面図、第４図ｆａｔは本発明の一実施例によ
る３相ＳＳＲの平面図、第４図（ｂｌはその側面図、第
５図は上記実施例の３相ＳＳＲの使用状態における電源
、負荷との接続関係を示す回路図である。 １１ａ、１２ａ、１３ａ・・・電源側主端子、１１ｂ、
１２ｂ’、１３ｂ・・・負荷側主端子、８０・・・半導
体主素子回路、９２・・・３相交流電源、９３・・・負
荷、１００・・・３相５ＳＲ０ なお図中、同一符号は同−又は相当部分を示す。 代理人 大岩増雄 第１図 （Ｃ１） 第２図 第３図 第４図
Claims (1)
- （１）３相交流電源の負荷への供給を接断するための３
つの半導体主素子回路を備えた３相ソリツドステートリ
レーであって、上記３つの半導体主素子回路の電源側主
端子及び負荷側主端子は各相の電源側主端子と負荷側主
端子とが相互に対向し３つの電源側主端子及び３つの負
荷側主端子がそれぞれ相互に平行な直線上に順に並ぶよ
う配設されていることを特徴とする３相ソリンドステー
トリレー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15192783A JPS6042933A (ja) | 1983-08-19 | 1983-08-19 | ３相ソリツドステ−トリレ− |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15192783A JPS6042933A (ja) | 1983-08-19 | 1983-08-19 | ３相ソリツドステ−トリレ− |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6042933A true JPS6042933A (ja) | 1985-03-07 |
Family
ID=15529238
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15192783A Pending JPS6042933A (ja) | 1983-08-19 | 1983-08-19 | ３相ソリツドステ−トリレ− |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6042933A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS527140A (en) * | 1975-07-07 | 1977-01-20 | Nippon Solid Co Ltd | Method of reclamation |
-
1983
- 1983-08-19 JP JP15192783A patent/JPS6042933A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS527140A (en) * | 1975-07-07 | 1977-01-20 | Nippon Solid Co Ltd | Method of reclamation |
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