JPS6074972A - 同期式ｐｗｍインバ−タの基準信号作成回路 - Google Patents
同期式ｐｗｍインバ−タの基準信号作成回路Info
- Publication number
- JPS6074972A JPS6074972A JP58181856A JP18185683A JPS6074972A JP S6074972 A JPS6074972 A JP S6074972A JP 58181856 A JP58181856 A JP 58181856A JP 18185683 A JP18185683 A JP 18185683A JP S6074972 A JPS6074972 A JP S6074972A
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- Japan
- Prior art keywords
- frequency
- circuit
- reference signal
- inverter
- divider
- Prior art date
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/42—Conversion of DC power input into AC power output without possibility of reversal
- H02M7/44—Conversion of DC power input into AC power output without possibility of reversal by static converters
- H02M7/48—Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Inverter Devices (AREA)
- Power Conversion In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明はＰ Ｗ Ｍインバータの基準信号をデジタル
的に生成する回路に関する。
的に生成する回路に関する。
〔従来技術］
同期式ＰＷＭインバータ例えばスイッチング素子がゲー
トターンオフサイリスクであるインバータの点弧パルス
は第１図に示す如く、基準三角波信号Ｖｃと正弦波信号
■ｃｓを比較して生成する。Ｖｐは出力パルスを示す。
トターンオフサイリスクであるインバータの点弧パルス
は第１図に示す如く、基準三角波信号Ｖｃと正弦波信号
■ｃｓを比較して生成する。Ｖｐは出力パルスを示す。
同期式の場合には、−周期中にふくまれる出力パルスＶ
ｐのパルス数Ｎは常に整数個になるが、インバータのス
イッチング素子のスイッチンク周波数に制限がある為、
上記パルス数Ｎはインバータの出力周波数ｆｏが増加す
るとこれに対応して低減させる必要がある。？ｆｆＪち
、変調基準周波数＝ｆｏＸＮが最大スイッチング周波数
ｆｍｔｌ−越えないようにする必要がある。しかしなが
ら、インバータ負荷が交流電動機である場合、電動機の
トルク脈動を小さくする為には、ｆｏＸＮの値はできる
だけ大きい方が良いので、第２図に示す如く、パルス数
Ｎを出力周波数ｆｏに応じて変化させるが、この結果、
変調基準周波数ｆは図示の如く不連続に変化することに
なる。
ｐのパルス数Ｎは常に整数個になるが、インバータのス
イッチング素子のスイッチンク周波数に制限がある為、
上記パルス数Ｎはインバータの出力周波数ｆｏが増加す
るとこれに対応して低減させる必要がある。？ｆｆＪち
、変調基準周波数＝ｆｏＸＮが最大スイッチング周波数
ｆｍｔｌ−越えないようにする必要がある。しかしなが
ら、インバータ負荷が交流電動機である場合、電動機の
トルク脈動を小さくする為には、ｆｏＸＮの値はできる
だけ大きい方が良いので、第２図に示す如く、パルス数
Ｎを出力周波数ｆｏに応じて変化させるが、この結果、
変調基準周波数ｆは図示の如く不連続に変化することに
なる。
この為、マイクロコンピュータを用いる従来のＰＷＭ制
御回路では、第３図に示す如く、この不連続に変化する
変調基準周波数ｆを函数として符号１で示すＲＯＭに記
１ａさせておき、これを呼び出してＤ／Ａ変換器２でア
ナログ信号に変換したのち電圧／周波数変換器３に導い
て変調基準周波数をもつＰＷＭ基準信号を得るようにし
ている。
御回路では、第３図に示す如く、この不連続に変化する
変調基準周波数ｆを函数として符号１で示すＲＯＭに記
１ａさせておき、これを呼び出してＤ／Ａ変換器２でア
ナログ信号に変換したのち電圧／周波数変換器３に導い
て変調基準周波数をもつＰＷＭ基準信号を得るようにし
ている。
このように、従来のコンピュータ制御のＰＷＭ基準信号
作成回路では変調基準周波数に対応するＲＯＭのデジタ
ル出力をアナログ信号に戻す必要があるので回路が複雑
で高価になると云う欠点があった。
作成回路では変調基準周波数に対応するＲＯＭのデジタ
ル出力をアナログ信号に戻す必要があるので回路が複雑
で高価になると云う欠点があった。
この発明は上記した従来の欠点を除去する為にりなされ
たもので、コンピュータ制御される第１及び第２のプロ
グラマブルデバイダと、帰還回路に他の固定もしくはプ
ログラマブルなデバイダを持つＰ Ｌ １．、回路を用
い、」二記第１のプログラマブルデバイダにマイクロコ
ンピュータの基準クロックを与えてインバータ周波数基
準を生成せしめ、ごのインバータ周波数基準を」−記Ｐ
Ｌ Ｌ回路に与、このＰ Ｌ Ｌ回路の出力を北記第
２のプログラマブルデバイダで分周してＰＷＭ基準信号
を得る構成とすることにより、純デジタル的に上記ＰＷ
Ｍ基準信号を作成することができ、従って、従来のもの
に比して安価である同期式ＰＷＭインバータの基準信号
作成回路を提案するものである。
たもので、コンピュータ制御される第１及び第２のプロ
グラマブルデバイダと、帰還回路に他の固定もしくはプ
ログラマブルなデバイダを持つＰ Ｌ １．、回路を用
い、」二記第１のプログラマブルデバイダにマイクロコ
ンピュータの基準クロックを与えてインバータ周波数基
準を生成せしめ、ごのインバータ周波数基準を」−記Ｐ
Ｌ Ｌ回路に与、このＰ Ｌ Ｌ回路の出力を北記第
２のプログラマブルデバイダで分周してＰＷＭ基準信号
を得る構成とすることにより、純デジタル的に上記ＰＷ
Ｍ基準信号を作成することができ、従って、従来のもの
に比して安価である同期式ＰＷＭインバータの基準信号
作成回路を提案するものである。
゛第４図はの発明の一実施例を示すブロック図である。
同図において、１０．２０．３０．４０はプログラマブ
ルデバイダ（以下、分周器と略記する）であって、その
分周数はマイクロコンピュータ１００によって制御され
る。５０はＰＬＬ回路であって、上記分周器３０と４０
をその帰還回路に具え、周波数てい倍器作用を行う。
ルデバイダ（以下、分周器と略記する）であって、その
分周数はマイクロコンピュータ１００によって制御され
る。５０はＰＬＬ回路であって、上記分周器３０と４０
をその帰還回路に具え、周波数てい倍器作用を行う。
分周器１０にはマイクロコンピュータ＋００の基（（１
クロツクが入力される。分周器１０は基準クロックの周
波数ｆｃをインバータの出力周波数ｆｏに応じた値に分
周する。この場合、分周器１０の分周数Ｍ１を充分に大
にすれば、高精度の出力周波数を得ることができる。こ
のようにして得た出力周波数［０はＩ） Ｌ Ｔ−回路
５０の周波数基γ（へとして与えられる。ＰＩ、Ｌ回路
５０の出力は分周器（分周数Ｍ２）２０に入力される。
クロツクが入力される。分周器１０は基準クロックの周
波数ｆｃをインバータの出力周波数ｆｏに応じた値に分
周する。この場合、分周器１０の分周数Ｍ１を充分に大
にすれば、高精度の出力周波数を得ることができる。こ
のようにして得た出力周波数［０はＩ） Ｌ Ｔ−回路
５０の周波数基γ（へとして与えられる。ＰＩ、Ｌ回路
５０の出力は分周器（分周数Ｍ２）２０に入力される。
なお、帰還回路の分周器３０と４０は一つにして固定の
デバイダとしてもよい。
デバイダとしてもよい。
今、説明の便宜」−１分周器３０の分周数Ｍ３＝２５６
、分周器４０の分周数ＭＩｌ＝１３５であるとするとＰ
Ｌ Ｌ回路５０の性質から、出力点５Ｉ、３１．４１
に現れる周波数はそれぞれ２５６×１３５Ｘｆｏ、１３
５Ｘｆｏ、ｆｏとなり、Ｐ Ｉ−■１回路５０の出力は
出力周波数ｆｏに応じた値となる。この値、即ち２５６
Ｘ１３５Ｘｆｏが分周器４０に与えられる。従って、分
周器４０の分周数Ｍ４を、例えは、４５．２７．１５・
・・とコンピュータ制御ずれは、パルス数Ｎ＝３．５．
９・・・に対する変調周波数のＰＷＭ基準信号が簡単に
高精度で得られる。
、分周器４０の分周数ＭＩｌ＝１３５であるとするとＰ
Ｌ Ｌ回路５０の性質から、出力点５Ｉ、３１．４１
に現れる周波数はそれぞれ２５６×１３５Ｘｆｏ、１３
５Ｘｆｏ、ｆｏとなり、Ｐ Ｉ−■１回路５０の出力は
出力周波数ｆｏに応じた値となる。この値、即ち２５６
Ｘ１３５Ｘｆｏが分周器４０に与えられる。従って、分
周器４０の分周数Ｍ４を、例えは、４５．２７．１５・
・・とコンピュータ制御ずれは、パルス数Ｎ＝３．５．
９・・・に対する変調周波数のＰＷＭ基準信号が簡単に
高精度で得られる。
この発明は以上説明したとおり、プログラマブルデバイ
ダとＰ Ｌ Ｌ回路を用いた純デジタル的な構成である
ので、従来に比し、安価に構成することができ、その構
成も簡単になるという効果がある。
ダとＰ Ｌ Ｌ回路を用いた純デジタル的な構成である
ので、従来に比し、安価に構成することができ、その構
成も簡単になるという効果がある。
第１図は同期式ＰＷＭ信号の波形図、第２図はインバー
タ出力周波数に対する変調基準周波数の関係を示す図、
第３図は従来のＰＷＭ基準信号作成回路のブロック図、
第４図Ｌ：１、この発明の一実施例のブロック図である
。 図において、１０〜４０ばプログラマブルデバイダ、５
Ｑ 、−Ｐ Ｌ １−回路、１００−マイクロコンピ
ュータ。 代理人 大 岩 増 雄 第 ３ 図 第 ４ 図 ００
タ出力周波数に対する変調基準周波数の関係を示す図、
第３図は従来のＰＷＭ基準信号作成回路のブロック図、
第４図Ｌ：１、この発明の一実施例のブロック図である
。 図において、１０〜４０ばプログラマブルデバイダ、５
Ｑ 、−Ｐ Ｌ １−回路、１００−マイクロコンピ
ュータ。 代理人 大 岩 増 雄 第 ３ 図 第 ４ 図 ００
Claims (1)
- （１） マイクロコンピュータにより制御される第１及
び第２のプログラマブルデバイダ、及び帰還回路に固定
もしくはプログラマブルなデバイダを有し上記第２のプ
ログラマブルデバイダに出力を与えるＰ Ｌ Ｌ回路を
具え、」二記第１のプログラマブルデバイダは上記マイ
クロコンピュータの基準クロックの周波数をインバータ
出方周波数に分周して上記Ｐ Ｌ Ｌ回路に与え、上記
第２のプログラマブルデバイダの分周数を制御してＰＷ
Ｍ基準信号を生成せしめることを特徴とする同期式２ｗ
Ｍインバータの基準信号作成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58181856A JPH0681509B2 (ja) | 1983-09-28 | 1983-09-28 | 同期式ｐｗｍインバータの基準信号作成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58181856A JPH0681509B2 (ja) | 1983-09-28 | 1983-09-28 | 同期式ｐｗｍインバータの基準信号作成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6074972A true JPS6074972A (ja) | 1985-04-27 |
| JPH0681509B2 JPH0681509B2 (ja) | 1994-10-12 |
Family
ID=16108025
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58181856A Expired - Lifetime JPH0681509B2 (ja) | 1983-09-28 | 1983-09-28 | 同期式ｐｗｍインバータの基準信号作成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0681509B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01214268A (ja) * | 1988-02-22 | 1989-08-28 | Nippon Steel Corp | インバータ制御装置 |
| WO2004109901A1 (ja) * | 2003-06-02 | 2004-12-16 | Seiko Epson Corporation | Ｐｗｍ制御システム |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5566288A (en) * | 1978-11-09 | 1980-05-19 | Toshiba Corp | Inverter control circuit |
| JPS55136732A (en) * | 1979-04-13 | 1980-10-24 | Sanyo Electric Co Ltd | Receiver of frequency synthesizer system |
-
1983
- 1983-09-28 JP JP58181856A patent/JPH0681509B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5566288A (en) * | 1978-11-09 | 1980-05-19 | Toshiba Corp | Inverter control circuit |
| JPS55136732A (en) * | 1979-04-13 | 1980-10-24 | Sanyo Electric Co Ltd | Receiver of frequency synthesizer system |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01214268A (ja) * | 1988-02-22 | 1989-08-28 | Nippon Steel Corp | インバータ制御装置 |
| WO2004109901A1 (ja) * | 2003-06-02 | 2004-12-16 | Seiko Epson Corporation | Ｐｗｍ制御システム |
| US7315155B2 (en) | 2003-06-02 | 2008-01-01 | Seiko Epson Corporation | PWM control system |
| US7528591B2 (en) | 2003-06-02 | 2009-05-05 | Seiko Epson Corporation | PWM control system |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0681509B2 (ja) | 1994-10-12 |
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