JPS6149657A - 電源装置 - Google Patents
電源装置Info
- Publication number
- JPS6149657A JPS6149657A JP16928284A JP16928284A JPS6149657A JP S6149657 A JPS6149657 A JP S6149657A JP 16928284 A JP16928284 A JP 16928284A JP 16928284 A JP16928284 A JP 16928284A JP S6149657 A JPS6149657 A JP S6149657A
- Authority
- JP
- Japan
- Prior art keywords
- transformer
- output
- voltage
- time constant
- power supply
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は電源装置、特に昇圧トランスの一次側を断続し
て二次側に発生する電力を負荷に供給する電源装置に関
するものである。
て二次側に発生する電力を負荷に供給する電源装置に関
するものである。
従来この種の装置は複写機の帯電器やＣＲＴの水平偏向
電圧などの高圧を′発生する装置として広く用いられて
いる。
電圧などの高圧を′発生する装置として広く用いられて
いる。
この種の装置の多くけ昇圧トランスの一次側＠線に対す
る電力の印加を、トランジスタ等によるスイッチング手
段により断続して二次側に巻線比に応じた電圧を発生す
るように構成されている。
る電力の印加を、トランジスタ等によるスイッチング手
段により断続して二次側に巻線比に応じた電圧を発生す
るように構成されている。
前記のスイッチング手段のクイソチングパルスのうち一
次巻線に対する電力の印加を遮断する時ｆ’、’ｌｌ：
！Ｉ］あオ、よヶよりい、わ、アエｐ５：ｙＺｊゆ１．
゛じて回路ごとに適宜決定されていた。従っていくつか
の異なった昇圧トランスを用いる電源装置を製造する場
合には各トランスに応じて適切なオフタイムを設定する
よう装置に応じて制御回路を適宜変更する必要があった
。即ちする程度までは回路基根を共有化することができ
るが、トランスの種類に応じてオフタイムを適宜変化さ
せることができるような調整手段を設ける必要があった
。従ってこの分回路基７阪上のスペースを多く必要とし
、寸だ製造時間・もこの調整時間分長くなるという間；
追があった。
次巻線に対する電力の印加を遮断する時ｆ’、’ｌｌ：
！Ｉ］あオ、よヶよりい、わ、アエｐ５：ｙＺｊゆ１．
゛じて回路ごとに適宜決定されていた。従っていくつか
の異なった昇圧トランスを用いる電源装置を製造する場
合には各トランスに応じて適切なオフタイムを設定する
よう装置に応じて制御回路を適宜変更する必要があった
。即ちする程度までは回路基根を共有化することができ
るが、トランスの種類に応じてオフタイムを適宜変化さ
せることができるような調整手段を設ける必要があった
。従ってこの分回路基７阪上のスペースを多く必要とし
、寸だ製造時間・もこの調整時間分長くなるという間；
追があった。
本発明は以上の問題点に鑑みて成されたもので、用いら
れる昇圧トランスが変更になった場合でも無調整で制御
回路部分を対応させることができ、製造が容易で簡単安
価な電源装置を従供することを目的とする。
れる昇圧トランスが変更になった場合でも無調整で制御
回路部分を対応させることができ、製造が容易で簡単安
価な電源装置を従供することを目的とする。
以下図面に示す実施例に基づき本発明の詳細な説明する
。
。
第１図は本発明（でよる電源装置の一実施例を示−すも
ので、同図においてＴで示されるものけ昇圧トランスで
ある。昇圧トランスＴの一次巻、ｒｌＴ１の一端は抵抗
Ｒ１を介して電源電圧■ＣＣに接続されるとともに、コ
ンデンサＣ２を介して接地されている。また−次巻線Ｔ
１の他端はスイッチングトランジスタＴｒのコレクタに
接続されている。
ので、同図においてＴで示されるものけ昇圧トランスで
ある。昇圧トランスＴの一次巻、ｒｌＴ１の一端は抵抗
Ｒ１を介して電源電圧■ＣＣに接続されるとともに、コ
ンデンサＣ２を介して接地されている。また−次巻線Ｔ
１の他端はスイッチングトランジスタＴｒのコレクタに
接続されている。
このスイッチングトランジスタＴ「のエミッタは接地さ
れており、さらにコレフタル接地間にはコンデンサＣ１
及びダイオードＤ１が接続されている。ここでコンデン
サＣ１は一次巻繍Ｔ１と共１辰して効率的な電圧変換を
行なうためのもの、またダイオード］〕１け一次巻υ′
ｒ１の逆電力を吸収し、トランジスタＴｒを保護するた
めのものである。
れており、さらにコレフタル接地間にはコンデンサＣ１
及びダイオードＤ１が接続されている。ここでコンデン
サＣ１は一次巻繍Ｔ１と共１辰して効率的な電圧変換を
行なうためのもの、またダイオード］〕１け一次巻υ′
ｒ１の逆電力を吸収し、トランジスタＴｒを保護するた
めのものである。
−次巻線Ｔ１に対する電力印加はスイッチングトランジ
スタエトにより断続される。この結果二次巻線Ｔ ２に
は巻線比に応じて昇圧された電圧が発生する。この交流
電圧はダイオードＤ２及びコンデンサＣ３によシ整流、
平滑され負荷ＲＬに供給される。
スタエトにより断続される。この結果二次巻線Ｔ ２に
は巻線比に応じて昇圧された電圧が発生する。この交流
電圧はダイオードＤ２及びコンデンサＣ３によシ整流、
平滑され負荷ＲＬに供給される。
本発明では昇圧トランスＴに検出用巻線Ｔ６を設けであ
る。検出用巻線Ｔ３の一端は接地されておシもう一端は
抵抗Ｒ５を介して接地されている。
る。検出用巻線Ｔ３の一端は接地されておシもう一端は
抵抗Ｒ５を介して接地されている。
抵抗Ｒ５の端子電圧はオペアンプ等から構成されたゼロ
クロス検出器１の一方の入力に接続されている。
クロス検出器１の一方の入力に接続されている。
ゼロクロス検出器１の他方の入力は接地されてふりその
出力信号ａは抵抗およびコンデンサ等から構成された時
定数回路２０セツト端子に入力される。この時定数回路
２の出力信号すはオペアンプ等から構成された比較回路
４，５の一方の入力にそれぞれ接続されている。
出力信号ａは抵抗およびコンデンサ等から構成された時
定数回路２０セツト端子に入力される。この時定数回路
２の出力信号すはオペアンプ等から構成された比較回路
４，５の一方の入力にそれぞれ接続されている。
一方、二次巻線Ｔ２の一端及び接地間には電流検出用の
抵抗Ｒ２が接続されており、抵抗Ｒ２の端子電圧はオペ
アンプ等から構成された誤差増幅器６の一方の入力に接
続されている。誤差増幅器乙の他方の入力には電源電圧
ＶＣＣを抵抗Ｒ３及び１＜４により分圧した所定の基準
電圧が入力さ九ている。誤差増幅器乙の出力信号Ｃは前
記の比較器４の残りの入力に接続されている。
抵抗Ｒ２が接続されており、抵抗Ｒ２の端子電圧はオペ
アンプ等から構成された誤差増幅器６の一方の入力に接
続されている。誤差増幅器乙の他方の入力には電源電圧
ＶＣＣを抵抗Ｒ３及び１＜４により分圧した所定の基準
電圧が入力さ九ている。誤差増幅器乙の出力信号Ｃは前
記の比較器４の残りの入力に接続されている。
比較器４の出力信号ｄは時定数回路２のリセット入力に
接続されている。前期の比較器５の残りの入力には電源
型１圧■ＣＣを抵抗Ｒ６、Ｒ７で分圧した所定の基準電
圧Ｃが接続されている。比較器５の出力信号ｆはオペア
ンプあるいけトランジスタ等から構成された電流増幅器
６に入力される。
接続されている。前期の比較器５の残りの入力には電源
型１圧■ＣＣを抵抗Ｒ６、Ｒ７で分圧した所定の基準電
圧Ｃが接続されている。比較器５の出力信号ｆはオペア
ンプあるいけトランジスタ等から構成された電流増幅器
６に入力される。
電流増幅器乙の出力はスイッチングトランジスタＴＲの
ペースに接続されておシミ流増幅器６の出力によりトラ
ンジスタＴｌのスイッチング動作が制御される。
ペースに接続されておシミ流増幅器６の出力によりトラ
ンジスタＴｌのスイッチング動作が制御される。
次に以上の構成における動作を第２図のタイミングチャ
ートを参照して詳細に説明する。
ートを参照して詳細に説明する。
第２図の最上段に符号Ｉｉ”Ｂｖで示される波形は第１
図の抵抗Ｒ５の両端の電圧で、昇圧トランスＴの二次巻
線Ｔ２のフライベック電圧に対応した電圧となっている
。
図の抵抗Ｒ５の両端の電圧で、昇圧トランスＴの二次巻
線Ｔ２のフライベック電圧に対応した電圧となっている
。
このフライベック電圧ＦＢＶが正の領域から負の領域に
向かってゼロ点を通過すると、オペアンプ等から構成さ
れたゼロクロス検出器１の出力が正の側に反転する。ゼ
ロクロス検出器１の出方信号に立ち上がる。時定数回路
２の出力信号すの波形−力点差増幅器３は負荷電流に応
じた抵抗Ｒ２は第２図の３−目に示さ九ている。
向かってゼロ点を通過すると、オペアンプ等から構成さ
れたゼロクロス検出器１の出力が正の側に反転する。ゼ
ロクロス検出器１の出方信号に立ち上がる。時定数回路
２の出力信号すの波形−力点差増幅器３は負荷電流に応
じた抵抗Ｒ２は第２図の３−目に示さ九ている。
の両端電圧と抵抗Ｒ３、ｒ１４で形成された基準電圧と
の誤差信号Ｃを出力している。この信号の波形も第２図
の３段目に破線で示されている。比較器４は時定数回路
２の出力信号すとこの誤差信号Ｃを比較し時定数回路２
の出力信号すが誤差信号Ｃより高くなった際に第２図の
４段目に示すよう一方、比較器５の基準電圧ｅけ第２図
の３段目に破線で示すようなレベルとなっている。比較
器５は時定数回路２の出力信号すと基準電圧ｅを比較し
、基準電圧Ｃより時定数回路２の出力信号すが高くなる
と出力をハイレベルにし、基準電圧ｅよりも時定数回路
２の出力信号すが低くなった際に出力をローにする。こ
の結果比較器５の出力信号ｆけ第２図の最下段に示すよ
うな波形となる。
の誤差信号Ｃを出力している。この信号の波形も第２図
の３段目に破線で示されている。比較器４は時定数回路
２の出力信号すとこの誤差信号Ｃを比較し時定数回路２
の出力信号すが誤差信号Ｃより高くなった際に第２図の
４段目に示すよう一方、比較器５の基準電圧ｅけ第２図
の３段目に破線で示すようなレベルとなっている。比較
器５は時定数回路２の出力信号すと基準電圧ｅを比較し
、基準電圧Ｃより時定数回路２の出力信号すが高くなる
と出力をハイレベルにし、基準電圧ｅよりも時定数回路
２の出力信号すが低くなった際に出力をローにする。こ
の結果比較器５の出力信号ｆけ第２図の最下段に示すよ
うな波形となる。
比較器５の出力信号ｆけ電流増幅器６で電流増幅された
後スイッチングトランジスタＴＲに伝達され昇圧トラン
スＴをスイッチングする。
後スイッチングトランジスタＴＲに伝達され昇圧トラン
スＴをスイッチングする。
以上の動作を繰シ返して電源電圧ＶＣＣから巻線比に応
じて昇圧された電圧が昇圧トランスＴの二次巻線Ｔ２に
発生され負荷に供給される。
じて昇圧された電圧が昇圧トランスＴの二次巻線Ｔ２に
発生され負荷に供給される。
以上の様な実施例によれば、フライバック電圧のゼロク
ロスのタイミングと負荷電流に応じて自動的に昇圧トラ
ンスのオフ時間が決定されるので、トランスＴを変更し
た場合でも回路部分の変更や調整を行なう必要はなく、
常に無調整で最適な電圧変換を行なうことができる。従
って製造や設計変更が非常に容易になり、また回路基板
のスペースも節約することができる。
ロスのタイミングと負荷電流に応じて自動的に昇圧トラ
ンスのオフ時間が決定されるので、トランスＴを変更し
た場合でも回路部分の変更や調整を行なう必要はなく、
常に無調整で最適な電圧変換を行なうことができる。従
って製造や設計変更が非常に容易になり、また回路基板
のスペースも節約することができる。
以上の実施例ではフライバック電圧を検出するために昇
圧トランスＴに検出巻線を設けたが 検出巻線を設けな
くても、”フライバック電圧に対応したスイッチングト
ランジスタＴｉのコレクタ電圧を検出してゼロクロス検
出を行なうようにしても良い。また以上の実施例でけ昇
圧トランスを用いたスイッチング電源装置を例示したが
、オン／オフ方式のスイッチング電源装置、あるいはオ
ン／オフ方式のスイッチング電源装置にも本発明が応用
できる。この場合にはフライバック電圧を検出するので
はなく、電圧降下や電流減少などを検出することにより
ゼロクロス検出を行なうようにすれば良い。
圧トランスＴに検出巻線を設けたが 検出巻線を設けな
くても、”フライバック電圧に対応したスイッチングト
ランジスタＴｉのコレクタ電圧を検出してゼロクロス検
出を行なうようにしても良い。また以上の実施例でけ昇
圧トランスを用いたスイッチング電源装置を例示したが
、オン／オフ方式のスイッチング電源装置、あるいはオ
ン／オフ方式のスイッチング電源装置にも本発明が応用
できる。この場合にはフライバック電圧を検出するので
はなく、電圧降下や電流減少などを検出することにより
ゼロクロス検出を行なうようにすれば良い。
以上の説明から明らかなように、本発明によれば昇圧ト
ランスの一次側をスイッチング手段により断続してその
二次側に発生する電圧変換された出力を負荷に供給する
電源装置において、昇圧トランスのフライバンク電圧の
ゼロ点通過時を検出するゼロクロス検出手段と、検出し
た負荷電流に応じて電圧変換効率を制御する手段と、こ
の効率制作１手段の出力と時定数回路の出力を比較する
比較手段とを設け、前記時定数回路が前記ゼロクロス検
出手段の出力に上シ一定の時定数で立ち上がりかつ前記
比較手段の出力によりリセットされるとともに、この時
定数回路の出力と基準電圧の比較信号により前記スイッ
チング手段を制御する構成を採用しているので、フライ
バック電圧のゼロクロスのタイミングと負荷電流に応じ
て自動的に昇圧トランスのオフ時間が決定されるので、
トランスを変更した場合でも無調整で回路を対応させる
ことができ設計変更が容易で製造が簡、Ｏｉな優れた電
源装置を提供することができる。
ランスの一次側をスイッチング手段により断続してその
二次側に発生する電圧変換された出力を負荷に供給する
電源装置において、昇圧トランスのフライバンク電圧の
ゼロ点通過時を検出するゼロクロス検出手段と、検出し
た負荷電流に応じて電圧変換効率を制御する手段と、こ
の効率制作１手段の出力と時定数回路の出力を比較する
比較手段とを設け、前記時定数回路が前記ゼロクロス検
出手段の出力に上シ一定の時定数で立ち上がりかつ前記
比較手段の出力によりリセットされるとともに、この時
定数回路の出力と基準電圧の比較信号により前記スイッ
チング手段を制御する構成を採用しているので、フライ
バック電圧のゼロクロスのタイミングと負荷電流に応じ
て自動的に昇圧トランスのオフ時間が決定されるので、
トランスを変更した場合でも無調整で回路を対応させる
ことができ設計変更が容易で製造が簡、Ｏｉな優れた電
源装置を提供することができる。
第１図は本発明による電源装置の回路構成の一実施例を
示す回路図、第２図は第１図の構成における各部の電圧
波形を示すタイミングチャート図である。 １・・・ゼロクロス検出器 ２・・・時定数回路６・・
・誤差増幅器 ４，５・・・比較器６・・・電流
増幅器 Ｔｆｔ・・・スイッチングトランジス
タＴ・・・トランス Ｔ１・・・−次巻線Ｔ２
・・・二次巻線 Ｔ３・・・検出巻線ＲＬ・・・
負荷 特許出願人 キ゛ヤ ノ ン 株式会社第２図 第１図
示す回路図、第２図は第１図の構成における各部の電圧
波形を示すタイミングチャート図である。 １・・・ゼロクロス検出器 ２・・・時定数回路６・・
・誤差増幅器 ４，５・・・比較器６・・・電流
増幅器 Ｔｆｔ・・・スイッチングトランジス
タＴ・・・トランス Ｔ１・・・−次巻線Ｔ２
・・・二次巻線 Ｔ３・・・検出巻線ＲＬ・・・
負荷 特許出願人 キ゛ヤ ノ ン 株式会社第２図 第１図
Claims (1)
- 昇圧トランスの一次側をスイッチング手段により断続し
てその二次側に発生する電圧変換された出力を負荷に供
給する電源装置において、昇圧トランスのフライバック
電圧のゼロ点通過時を検出するゼロクロス検出手段と、
検出した負荷電流に応じて電圧変換効率を制御する手段
と、この効率制御手段の出力と時定数回路の出力を比較
する比較手段とを設け、前記時定数回路が前記ゼロクロ
ス検出手段の出力により一定の時定数で立ち上がりかつ
前記比較手段の出力によりリセットされるとともに、こ
の時定数回路の出力と基準電圧の比較信号により前記ス
イッチング手段が制御されることを特徴とする電源装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16928284A JPS6149657A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16928284A JPS6149657A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6149657A true JPS6149657A (ja) | 1986-03-11 |
Family
ID=15883623
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16928284A Pending JPS6149657A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6149657A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58190277A (ja) * | 1982-04-30 | 1983-11-07 | Shikoku Henatsuki Kk | スイツチング型直流変換装置の駆動回路 |
| JPS5932370A (ja) * | 1982-08-16 | 1984-02-21 | Hitachi Ltd | 高圧電源装置 |
| JPS6148346A (ja) * | 1984-08-11 | 1986-03-10 | 鈴木 晃 | 大動脈内用バル−ン装置 |
-
1984
- 1984-08-15 JP JP16928284A patent/JPS6149657A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58190277A (ja) * | 1982-04-30 | 1983-11-07 | Shikoku Henatsuki Kk | スイツチング型直流変換装置の駆動回路 |
| JPS5932370A (ja) * | 1982-08-16 | 1984-02-21 | Hitachi Ltd | 高圧電源装置 |
| JPS6148346A (ja) * | 1984-08-11 | 1986-03-10 | 鈴木 晃 | 大動脈内用バル−ン装置 |
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