JPS6160144A - 試験診断方式 - Google Patents

試験診断方式

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Publication number
JPS6160144A
JPS6160144A JP59182119A JP18211984A JPS6160144A JP S6160144 A JPS6160144 A JP S6160144A JP 59182119 A JP59182119 A JP 59182119A JP 18211984 A JP18211984 A JP 18211984A JP S6160144 A JPS6160144 A JP S6160144A
Authority
JP
Japan
Prior art keywords
degraded
test
epu3
incorporation
test program
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59182119A
Other languages
English (en)
Inventor
Shinichi Kobayashi
眞一 小林
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP59182119A priority Critical patent/JPS6160144A/ja
Publication of JPS6160144A publication Critical patent/JPS6160144A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/22Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing

Landscapes

  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Tests Of Electronic Circuits (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (技術分野) 本発明体試験診断方式、とくに情報処理システムの試験
診断方式に関する。
(従来技術) 例えばキャラでユ等がデグレード状態で使用されている
演写処理装!を、修理の目的でいったんシスーテムから
切離し、このデグレードされている部分の修理を行なっ
た彼に、再びシステムに組込む場合には、従来下記のよ
うに行なわれている。
す々わち、修理確認ロールとしてFT(機能試験プログ
ラム)を用い、インラインFT(主記憶中のシステムの
ジョブ用領域から切離された試験専用領域にF T 、
!;それに必要なファームウェアテーブルとをロード、
シ、これを用いて、システム運用中にこれと独立して試
験診断を行なう方法)により、このシステムから切離さ
れた演算処理装置の診断試験を行ない、こ(窄正常終了
すればシステム再組込Wとし、異常終了すれば再組込み
不可としてシステムへ9再組込みが拒否されるようにな
っている。
このため、いったんシステムから切離して修理を行なっ
てしまうと、この修理が完了してインラインFTが正常
終了するようにならない間は、も早や、もとのデグレー
ドされた状態でもシステムに組込むことができなくなる
これは例えば、顧客の昼休み時間等の比較的負荷の軽い
時間を利用してデグレード状態で使用されている装置を
システムから切離してこのデグレードされている部分の
修理を早急に行うような場合に、この制限時間内に修理
に成功すればよいが、もし修理に成功しない場合には、
この装置をシステムに組込むことができなくなり、もと
のデグレードされた運転によるシステム参加すら不可能
となり、このためシステム性能が著るしく低下してしま
うという欠点を有している。
(発明の目的) 本発明の目的は、上述の欠点を除去し゛C1修理未完で
あっても、必要に応じてデグレードされた状態でシステ
ム再組込みを許すような試験診断方式を提供するにある
(発明の構成) 本発明の方式は、試験用テストプログラムの実行時の環
境として装置内のハードウェアを全てテストするかある
いはハードウェアをデグレードしてテストするかの情報
を外部から与えられるようにし、前記デグレードした環
境が与えられた場合には前記試験用テストプログラムが
デグレードされたハードウェア部分を除いてテストが行
なわれるようにし、前記デグレードした環境下で前記試
験用テストプログラムが正常終了した場合には前記装置
を前記デグレードされた状態でシステムに組込みを行な
うようにする。
(実施例) 次に図面を参照して本発明の詳細な説明する。
第1図は本発明の一実施例を示すブロック図である。
本実施例は主記憶装置1(以後MMU1)、システム制
御装置2(以後5CU2)、演算処理装置3−1(以後
EPU3−1)、演算処理装置3−2(以後EPU3−
2)、入出力制御装置41(&l0P4)、ユニットレ
コードプロセッサ5(以後U几P5)およびサービスプ
ロセッサ6(以後8VP6)を含んでいる。
さて、今EPU3−1の中に含まれているキャッシュ(
図示せず)の一部に障害が発生し、このためキャッジ−
のこれを含む部分がキャッシュの他の部分から切離され
、従ってEPU3−1はキャッジ−が不完全な、デグレ
ード運転が行なわれいたと仮定する。
障害を発生したキャッシュを修理する目的で、この状態
にあるEPU3−1をシステムから切離し、デグレード
して使用されていたキャッシュの修理を行ない、EPU
3−1を再びシステムに組込む場合の本実施例の試験診
断方式は下記の通りである。
操作者は、5VP6のコンソールから、システムから切
離されているEPU3−1に対するインラインFTを行
なうための環境を設定する。
本実施例においては、FT実行時の環境として装置内の
ハードウェアをすべてテストするか、おるいはハードウ
ェアをデグレードしてテストするかの情報を5VP6を
介してF’Tに設定できるように構成されている。
ソコテ操作者1dtf、5VP6KEPU3−1の全て
のハードウェアのテストを行なうように指定する。この
情報は8VP6によって記憶され、これによってFTの
環境が設定される。
さて8VP6から診断ユニット21(以後DGU21)
を介してO8(オペレーティングシステム)にFT実行
の情報が伝えられると、O8は、MMTJlの現在使用
されていないジップ用領域を確保し、これをシステムか
ら切離し、診断試験用の専用領域に割当てる。
8VP6はこの割当てられたMMUlの専用領域に前述
のように環境設定されたFTとこれを実行するのに必要
なファームウェアテーブル等をロードし、EPU3−1
にFTの実行を指令する。
この結果、E P U 3− tはMMUlの上述の専
用領域を専有してFTを実行する。
このFTが正常終了すれば、5VP6に通報され、5v
P6はEPU3−1のシステム組込みの要求に対し組込
可を応答する。
これに対してFTが異常終了した場合にはEPU3−1
のシステムへの組込みは8VP6のソフトウェアにより
拒否される。
そこで操作者は、5VP6のコンソールを介し、EPU
3−1のキャッシュをデグレードした形でFTの動作環
境の再設定を行ない、デグレードした部分についてはテ
ストが行なわれないように設定する。
こうして5VP6はこの再設定されたFTを上述の専用
領域に再ロードしEPU3−1に対するインラインF’
Tを繰り返す。
この結果FTが正常終了すれば、8VP6はEPU3−
tをそのFTがテストしたのと同じにデグレードして(
FTでテストしないハードウェア部分を除いて) B 
P U 3−1のシステムへの組込要求に対し組込可を
応答する。
このような試験診断方式をとることにより、EPU3−
1は少くもはじめのシステムから切離される前のデグレ
ードされた状態でシステムに組込むことが可能となり、
EPU3−1のシステム不参加による著るしい性能低下
を回避し、次の適当な修理チャンスを狙うようにするこ
とができる。
(発明の効果) 以上のように本発明によると、いったんシステムから構
成される装置を、その修理完了を待たずにデグレードさ
れた状態でのシステム再組込みを許すような試験診断方
式を提供できる。
これにより、修理の柔軟性が向上される。
【図面の簡単な説明】
第1図は本発明の一実施例を示すプロ、り図である。 図において、

Claims (1)

  1. 【特許請求の範囲】 試験用テストプログラムの実行時の環境として装置内の
    ハードウェアを全てテストするかあるいはハードウェア
    をデグレードしてテストするかの情報を外部から与えら
    れるようにし、 前記デグレードした環境が与えられた場合には前記試験
    用テストプログラムがデグレードされたハードウェア部
    分を除いてテストが行なわれるようにし、 前記デグレードした環境下で前記試験用テストプログラ
    ムが正常終了した場合には前記装置を前記デグレードさ
    れた状態でシステムに組込みを行なうようにしたことを
    特徴とする試験診断方式。
JP59182119A 1984-08-31 1984-08-31 試験診断方式 Pending JPS6160144A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59182119A JPS6160144A (ja) 1984-08-31 1984-08-31 試験診断方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59182119A JPS6160144A (ja) 1984-08-31 1984-08-31 試験診断方式

Publications (1)

Publication Number Publication Date
JPS6160144A true JPS6160144A (ja) 1986-03-27

Family

ID=16112659

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59182119A Pending JPS6160144A (ja) 1984-08-31 1984-08-31 試験診断方式

Country Status (1)

Country Link
JP (1) JPS6160144A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07145457A (ja) * 1993-11-24 1995-06-06 Nippon Foil Mfg Co Ltd 金属箔コイル状物のクッション用エンボス金属箔

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07145457A (ja) * 1993-11-24 1995-06-06 Nippon Foil Mfg Co Ltd 金属箔コイル状物のクッション用エンボス金属箔

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