JPS621236B2 - - Google Patents
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- JPS621236B2 JPS621236B2 JP54069327A JP6932779A JPS621236B2 JP S621236 B2 JPS621236 B2 JP S621236B2 JP 54069327 A JP54069327 A JP 54069327A JP 6932779 A JP6932779 A JP 6932779A JP S621236 B2 JPS621236 B2 JP S621236B2
- Authority
- JP
- Japan
- Prior art keywords
- week
- day
- output
- circuit
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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Description
【発明の詳細な説明】
本発明は予め設定した時刻に所定の出力を発生
させるプログラムタイマーに係り、毎週予め指定
された曜日とその他の曜日においてそれぞれ指定
された時刻に所定の出力が現われるようにするこ
とを目的とするものである。
させるプログラムタイマーに係り、毎週予め指定
された曜日とその他の曜日においてそれぞれ指定
された時刻に所定の出力が現われるようにするこ
とを目的とするものである。
一般に曜日を１日指定してその日の一定時刻に
所定の出力が現われるように構成したプログラム
タイマーは公知である。しかしながら、最近では
週体２日制を取入れる企業、官庁が多いため、こ
のような生活実態を考えると、上記プログラムタ
イマーは必ずしも充分なものではなかつた。
所定の出力が現われるように構成したプログラム
タイマーは公知である。しかしながら、最近では
週体２日制を取入れる企業、官庁が多いため、こ
のような生活実態を考えると、上記プログラムタ
イマーは必ずしも充分なものではなかつた。
本発明は、このような問題に鑑みて、たとえば
毎週土曜日と日曜日は予め設定した第１の時刻
（たとえば午前８時）、月曜日から金曜日までの５
日間は予め設定した第１の時刻と異なる第２の時
刻（たとえば午前７時）に所定の出力を発生する
ような優れたプログラムタイマーを提供すること
を目的とするものである。
毎週土曜日と日曜日は予め設定した第１の時刻
（たとえば午前８時）、月曜日から金曜日までの５
日間は予め設定した第１の時刻と異なる第２の時
刻（たとえば午前７時）に所定の出力を発生する
ような優れたプログラムタイマーを提供すること
を目的とするものである。
以下、本発明のプログラムタイマーについて一
実施例の図面とともに説明する。第１図は本発明
のプログラムタイマーにおける一実施例のブロツ
クダイヤグラムであり、図中、１は水晶発振器又
は商用電源等より成る基準信号発生源、２は基準
信号発生源１からの信号を１秒周期の時刻パルス
に分周する分周器、３は分周器２によつて得られ
た１秒周期の時刻パルスを計数する時，分，秒用
のカウンター、４はカウンター３によつて得られ
る24時間に１個のパルスを計数する曜日用のカウ
ンター、５はカウンター３，４の各々の出力を入
力とする切換回路、６は切換回路５を介して入力
されるカウンター３，４の各々の出力によつて駆
動される表示器駆動回路、７は表示器駆動回路６
の出力によつて駆動される液晶表示器、螢光表示
管、その他のデイジタル表示器、８は日メモリ用
スイツチS1、日送り用スイツチS2、第１，第２の
タイマー／クロツク切換スイツチS3，S4、時送り
用スイツチS5、分送り用スイツチS6等を操作する
ことにより、それぞれ駆動される時刻設定回路、
９，１０はそれぞれ時刻設定回路８によつて設定
された曜日及び時，分をそれぞれメモリーする曜
日メモリー及び時分メモリー、１１は曜日カウン
ター４の出力と曜日メモリー９の出力とを比較し
両者が一致したとき所定の出力を発生する曜日比
較回路、１２は時分秒カウンター３の出力と時分
メモリー１０の出力とを比較し、両者が一致した
とき所定の出力を発生する時分比較回路、１３は
曜日比較回路１１の出力と時分比較回路１２の出
力とを入力とするアンド回路、１４はアンド回路
１３の出力によつて駆動される制御信号発生回
路、１５は制御信号発生回路１４の出力と時分秒
カウンター３の出力とを入力とするアンド回路、
１６はアンド回路１５の出力によつて駆動され制
御信号発生回路１４の出力端に現われる制御信号
の接続時間を規制するための制御信号停止時間設
定用のカウンターである。
実施例の図面とともに説明する。第１図は本発明
のプログラムタイマーにおける一実施例のブロツ
クダイヤグラムであり、図中、１は水晶発振器又
は商用電源等より成る基準信号発生源、２は基準
信号発生源１からの信号を１秒周期の時刻パルス
に分周する分周器、３は分周器２によつて得られ
た１秒周期の時刻パルスを計数する時，分，秒用
のカウンター、４はカウンター３によつて得られ
る24時間に１個のパルスを計数する曜日用のカウ
ンター、５はカウンター３，４の各々の出力を入
力とする切換回路、６は切換回路５を介して入力
されるカウンター３，４の各々の出力によつて駆
動される表示器駆動回路、７は表示器駆動回路６
の出力によつて駆動される液晶表示器、螢光表示
管、その他のデイジタル表示器、８は日メモリ用
スイツチS1、日送り用スイツチS2、第１，第２の
タイマー／クロツク切換スイツチS3，S4、時送り
用スイツチS5、分送り用スイツチS6等を操作する
ことにより、それぞれ駆動される時刻設定回路、
９，１０はそれぞれ時刻設定回路８によつて設定
された曜日及び時，分をそれぞれメモリーする曜
日メモリー及び時分メモリー、１１は曜日カウン
ター４の出力と曜日メモリー９の出力とを比較し
両者が一致したとき所定の出力を発生する曜日比
較回路、１２は時分秒カウンター３の出力と時分
メモリー１０の出力とを比較し、両者が一致した
とき所定の出力を発生する時分比較回路、１３は
曜日比較回路１１の出力と時分比較回路１２の出
力とを入力とするアンド回路、１４はアンド回路
１３の出力によつて駆動される制御信号発生回
路、１５は制御信号発生回路１４の出力と時分秒
カウンター３の出力とを入力とするアンド回路、
１６はアンド回路１５の出力によつて駆動され制
御信号発生回路１４の出力端に現われる制御信号
の接続時間を規制するための制御信号停止時間設
定用のカウンターである。
尚、時刻設定回路８によつて得られる信号は時
分秒カウンター３、曜日カウンター４、切換回路
５にそれぞれ印加されるように構成され、また曜
日メモリー９、時分メモリー１０の出力はそれぞ
れ切換回路５に印加されるように構成されてい
る。そして、第１図において鎖線で囲んだ部分は
集積回路化されている。
分秒カウンター３、曜日カウンター４、切換回路
５にそれぞれ印加されるように構成され、また曜
日メモリー９、時分メモリー１０の出力はそれぞ
れ切換回路５に印加されるように構成されてい
る。そして、第１図において鎖線で囲んだ部分は
集積回路化されている。
上記実施例において、基準信号発生源１の出力
は分周器２によつて分周され１秒周期の時刻パル
スに変換される。１秒周期の時刻パルスは時分秒
カウンタ３によつて計数され、さらに時分秒カウ
ンタ３によつて得られる24時間に１個のパルスは
曜日カウンタ４によつて計数される。そして、こ
れらのカウンタ３，４の出力はそれぞれ切換回路
５を介して表示器駆動回路６に印加される。した
がつて、表示器７は上記カウンタ３，４によつて
計数された曜日及び時，分をそれぞれ表示する。
は分周器２によつて分周され１秒周期の時刻パル
スに変換される。１秒周期の時刻パルスは時分秒
カウンタ３によつて計数され、さらに時分秒カウ
ンタ３によつて得られる24時間に１個のパルスは
曜日カウンタ４によつて計数される。そして、こ
れらのカウンタ３，４の出力はそれぞれ切換回路
５を介して表示器駆動回路６に印加される。した
がつて、表示器７は上記カウンタ３，４によつて
計数された曜日及び時，分をそれぞれ表示する。
今、第１のタイマー／クロツク切換スイツチS3
をタイマー側端子ａに投入したとすると切換回路
５が時間設定回路８の出力によつて駆動し、表示
器７が曜日メモリー９、時分メモリー１０に記憶
された曜日及び時分を表示することになる。この
状態で日送り用スイツチS2、時送り用スイツチ
S5、分送り用スイツチS6を操作すると曜日メモリ
ー９、時分メモリー１０に記憶された曜日、時分
がそれぞれ順次変化し、このことが表示器７で表
示される。したがつて、この状態で表示器７を見
ながら日送り用スイツチS3、時送り用スイツチ
S5、分送り用スイツチS6を操作して第１の曜日、
時分（たとえば土曜日の午前９時30分）を曜日メ
モリー９、時分メモリー１０に記憶する。そし
て、第２の曜日、時分（たとえば日曜日の午前９
時30分）をセツトする場合には日メモリ用スイツ
チS1を瞬間的にオンし、同様に第１のタイマ／ク
ロツク切換スイツチS3をタイマー側端子ａに投入
した状態で日送り用スイツチS2、時送り用スイツ
チS5、分送り用スイツチS6を操作する。このよう
に操作すると第２の曜日、時分が同様に曜日メモ
リー９、時分メモリー１０に記憶される。
をタイマー側端子ａに投入したとすると切換回路
５が時間設定回路８の出力によつて駆動し、表示
器７が曜日メモリー９、時分メモリー１０に記憶
された曜日及び時分を表示することになる。この
状態で日送り用スイツチS2、時送り用スイツチ
S5、分送り用スイツチS6を操作すると曜日メモリ
ー９、時分メモリー１０に記憶された曜日、時分
がそれぞれ順次変化し、このことが表示器７で表
示される。したがつて、この状態で表示器７を見
ながら日送り用スイツチS3、時送り用スイツチ
S5、分送り用スイツチS6を操作して第１の曜日、
時分（たとえば土曜日の午前９時30分）を曜日メ
モリー９、時分メモリー１０に記憶する。そし
て、第２の曜日、時分（たとえば日曜日の午前９
時30分）をセツトする場合には日メモリ用スイツ
チS1を瞬間的にオンし、同様に第１のタイマ／ク
ロツク切換スイツチS3をタイマー側端子ａに投入
した状態で日送り用スイツチS2、時送り用スイツ
チS5、分送り用スイツチS6を操作する。このよう
に操作すると第２の曜日、時分が同様に曜日メモ
リー９、時分メモリー１０に記憶される。
そして、第１、第２の曜日以外はすべて異なる
時間にセツトする場合には再び日メモリ用スイツ
チS1を瞬間的にオンし、第２のタイマー／クロツ
ク切換スイツチS4をタイマー側端子ａに投入し、
この状態で日送り用スイツチS2、時送り用スイツ
チS5、分送り用スイツチS6を操作する。そして、
この場合には、第１の曜日以外の曜日（たとえば
土曜以外の日曜から金曜まで）を曜日メモリー９
に記憶させ、時分メモリー１０に希望の時間（た
とえば午前６時30分）を記憶させる。そして、再
び日メモリ用スイツチS1を瞬間的にオンし、第２
のタイマー／クロツク切換スイツチS4をタイマー
側端子ａに投入した状態で日送り用スイツチS2、
時送り用スイツチS5、分送り用スイツチS6を操作
して第２の曜日以外の曜日（たとえば日曜以外の
月曜から土曜日まで）を曜日メモリー９に記憶さ
せ、時分メモリー１０に先と同じ時間（たとえば
午前６時30分）を記憶させる。
時間にセツトする場合には再び日メモリ用スイツ
チS1を瞬間的にオンし、第２のタイマー／クロツ
ク切換スイツチS4をタイマー側端子ａに投入し、
この状態で日送り用スイツチS2、時送り用スイツ
チS5、分送り用スイツチS6を操作する。そして、
この場合には、第１の曜日以外の曜日（たとえば
土曜以外の日曜から金曜まで）を曜日メモリー９
に記憶させ、時分メモリー１０に希望の時間（た
とえば午前６時30分）を記憶させる。そして、再
び日メモリ用スイツチS1を瞬間的にオンし、第２
のタイマー／クロツク切換スイツチS4をタイマー
側端子ａに投入した状態で日送り用スイツチS2、
時送り用スイツチS5、分送り用スイツチS6を操作
して第２の曜日以外の曜日（たとえば日曜以外の
月曜から土曜日まで）を曜日メモリー９に記憶さ
せ、時分メモリー１０に先と同じ時間（たとえば
午前６時30分）を記憶させる。
このように曜日メモリー９、時分メモリー１０
にそれぞれ希望する曜日及び時刻を記憶させてお
くと上記記憶された曜日、時刻になつたとき、第
１，第２の比較回路１１，１２より所定の出力が
現われるため、アンド回路１３より出力が現われ
制御信号回路１４が動作して所定の出力を発生す
る。そして制御信号発生回路１４より出力が現わ
れると、アンド回路１５を通してカウンタ１６に
時分秒カウンター３の出力が印加され、カウンタ
１６が所定の時間を計数し、制御信号発生回路１
４の動作を停止させる。すなわち、前述のように
土曜，日曜にそれぞれ午前９時30分，その他の曜
日に午前６時30分にセツトした場合には、この曜
日，この時刻になつたときカウンタ１６によつて
設定された所定時間だけ制御信号発生回路１４よ
り所定の出力が現われることになる。
にそれぞれ希望する曜日及び時刻を記憶させてお
くと上記記憶された曜日、時刻になつたとき、第
１，第２の比較回路１１，１２より所定の出力が
現われるため、アンド回路１３より出力が現われ
制御信号回路１４が動作して所定の出力を発生す
る。そして制御信号発生回路１４より出力が現わ
れると、アンド回路１５を通してカウンタ１６に
時分秒カウンター３の出力が印加され、カウンタ
１６が所定の時間を計数し、制御信号発生回路１
４の動作を停止させる。すなわち、前述のように
土曜，日曜にそれぞれ午前９時30分，その他の曜
日に午前６時30分にセツトした場合には、この曜
日，この時刻になつたときカウンタ１６によつて
設定された所定時間だけ制御信号発生回路１４よ
り所定の出力が現われることになる。
第２図は第１図に示すプログラムタイマーの要
部をより詳細に示したものである。第２図におい
て曜日カウンタ４は日曜から土曜日まで計数する
７進カウンターであり、３ビツトの出力端を有す
る。そして、日曜から土曜日までを第３図の
D1，D2，D3で示す３ビツトで対応させ更に指定
した曜日に動作するか、指定した曜日以外の曜日
に動作するかを第３図のD4で示すもう１つのビ
ツトで決定するようにしている。
部をより詳細に示したものである。第２図におい
て曜日カウンタ４は日曜から土曜日まで計数する
７進カウンターであり、３ビツトの出力端を有す
る。そして、日曜から土曜日までを第３図の
D1，D2，D3で示す３ビツトで対応させ更に指定
した曜日に動作するか、指定した曜日以外の曜日
に動作するかを第３図のD4で示すもう１つのビ
ツトで決定するようにしている。
今、時刻設定回路８を構成するフリツプフロツ
プFF1の一方の端子Ｑの出力がハイレベル（以下
１という）で他方の端子の出力がローレベル
（以下０という）であるとするとアンド回路g1は
開き、アンド回路g2は閉じることになる。したが
つて、この状態で日送り用スイツチS2を操作する
と日送り用スイツチS2によつて得られる出力がア
ンド回路g1を通して曜日メモリー９を構成する第
１のメモリー部９ａに印加されるため、第１のメ
モリー部9aに所望の曜日を記憶させることができ
る。
プFF1の一方の端子Ｑの出力がハイレベル（以下
１という）で他方の端子の出力がローレベル
（以下０という）であるとするとアンド回路g1は
開き、アンド回路g2は閉じることになる。したが
つて、この状態で日送り用スイツチS2を操作する
と日送り用スイツチS2によつて得られる出力がア
ンド回路g1を通して曜日メモリー９を構成する第
１のメモリー部９ａに印加されるため、第１のメ
モリー部9aに所望の曜日を記憶させることができ
る。
日メモ用スイツチS1を瞬間的にオンすると時刻
設定回路８を構成するフリツプフロツプFF1の動
作が反転し、一方の端子Ｑの出力が０、他方の端
子の出力が１になりアンド回路g1は閉じ、アン
ド回路g2が開くことになる。したがつて、この状
態で日送り用スイツチS2を操作すると日送り用ス
イツチS2の出力がアンド回路g2を通して曜日メモ
リー９を構成する第２のメモリー部９ｂに印加さ
れるようになり、第２のメモリー部９ｂに所望の
曜日を記憶させることができるようになる。
設定回路８を構成するフリツプフロツプFF1の動
作が反転し、一方の端子Ｑの出力が０、他方の端
子の出力が１になりアンド回路g1は閉じ、アン
ド回路g2が開くことになる。したがつて、この状
態で日送り用スイツチS2を操作すると日送り用ス
イツチS2の出力がアンド回路g2を通して曜日メモ
リー９を構成する第２のメモリー部９ｂに印加さ
れるようになり、第２のメモリー部９ｂに所望の
曜日を記憶させることができるようになる。
ところでメモリー部９ａ，９ｂはそれぞれ４ビ
ツトD1，D2，D3，D4で構成されD1，D2，D3の３
ビツトで日，月，火，水，木，金，土の各曜日を
表わし、D4のビツトでD1，D2，D3の各ビツトで
表わされた曜日を指定するか、D1，D2，D3の各
ビツトで表わされた曜日以外の曜日を指定するか
を表わすようにしている。たとえば、（D4，D3，
D2，D1）＝（０，１，１，０）であれば金曜日、
（D4，D3，D2，D1）＝（１，１，０，０）であれば
水曜日以外の曜日すなわち日，月，火，木，金，
土の５日間を表わすように構成している。
ツトD1，D2，D3，D4で構成されD1，D2，D3の３
ビツトで日，月，火，水，木，金，土の各曜日を
表わし、D4のビツトでD1，D2，D3の各ビツトで
表わされた曜日を指定するか、D1，D2，D3の各
ビツトで表わされた曜日以外の曜日を指定するか
を表わすようにしている。たとえば、（D4，D3，
D2，D1）＝（０，１，１，０）であれば金曜日、
（D4，D3，D2，D1）＝（１，１，０，０）であれば
水曜日以外の曜日すなわち日，月，火，木，金，
土の５日間を表わすように構成している。
メモリー部９ａ，９ｂの各ビツトD1，D2，D3
の出力は比較回路１１を構成する第１，第２の比
較部１１ａ，１１ｂによつて曜日カウンタ４の出
力と比較され、一致すれば出力端に１の出力が現
われ、これがそれぞれアンド回路g3，g3′の一方
の入力端に印加される。そして、この場合メモリ
ー部９ａ，９ｂのD4の出力が０であるとこれが
インバータg7，g7′によつて反転されて１の出力
がアンド回路g3，g3′の他方の入力端に印加され
る。したがつて、アンド回路g3，g3′より１の出
力が現われこれがそれぞれオアー回路g5，g5′及
びオアー回路g8を介してアンド回路１３に印加さ
れる。時分比較回路１２の出力が１であればアン
ド回路１３の出力は１となり制御信号発生回路１
４が駆動される。
の出力は比較回路１１を構成する第１，第２の比
較部１１ａ，１１ｂによつて曜日カウンタ４の出
力と比較され、一致すれば出力端に１の出力が現
われ、これがそれぞれアンド回路g3，g3′の一方
の入力端に印加される。そして、この場合メモリ
ー部９ａ，９ｂのD4の出力が０であるとこれが
インバータg7，g7′によつて反転されて１の出力
がアンド回路g3，g3′の他方の入力端に印加され
る。したがつて、アンド回路g3，g3′より１の出
力が現われこれがそれぞれオアー回路g5，g5′及
びオアー回路g8を介してアンド回路１３に印加さ
れる。時分比較回路１２の出力が１であればアン
ド回路１３の出力は１となり制御信号発生回路１
４が駆動される。
メモリー部９ａ，９ｂの各ビツトD1，D2，D3
の出力が曜日カウンタ４の出力と不一致の場合に
は比較回路１１を構成する第１，第２の比較部１
１ａ，１１ｂの出力が０であり、したがつてこれ
がインバータg6，g6′によつて反転されて１の出
力がアンド回路g4，g4′に印加される。そして、
このときメモリー部９ａ，９ｂのd4の出力が１で
あればアンド回路g4，g4′より１の出力が現われ
これがオアー回路g5，g5′及びオアー回路g8を介
してアンド回路１３に印加される。したがつて、
時分比較回路１２の出力が１であればアンド回路
１３より１の出力が現われ制御信号発生回路１４
が駆動される。
の出力が曜日カウンタ４の出力と不一致の場合に
は比較回路１１を構成する第１，第２の比較部１
１ａ，１１ｂの出力が０であり、したがつてこれ
がインバータg6，g6′によつて反転されて１の出
力がアンド回路g4，g4′に印加される。そして、
このときメモリー部９ａ，９ｂのd4の出力が１で
あればアンド回路g4，g4′より１の出力が現われ
これがオアー回路g5，g5′及びオアー回路g8を介
してアンド回路１３に印加される。したがつて、
時分比較回路１２の出力が１であればアンド回路
１３より１の出力が現われ制御信号発生回路１４
が駆動される。
すなわち、メモリー部９ａ，９ｂのd4の出力が
０である場合、すなわちD1，D2，D3の各ビツト
によつて現わされる曜日を指定した場合には比較
部１１ａ，１１ｂの出力が１すなわちメモリー部
９ａ，９ｂによつて指定した曜日と曜日カウンタ
４の曜日とが一致したときのみアンド回路１３に
１の出力が現われ、時分比較回路１２の出力が１
になつたとき制御信号発回路１４が駆動する。そ
してメモリー部９ａ，９ｂのd4の出力が１である
場合すなわちD1，D2，D3の各ビツトによつて表
わされる曜日以外の曜日を指定した場合には比較
部１１ａ，１１ｂの出力が０すなわち、メモリー
部９ａ，９ｂのD1，D2，D3によつて表わされる
曜日と曜日カウンター４の曜日とが不一致である
ときにのみアンド回路１３に１の出力が現われ、
時分比較回路１２の出力が１になつたとき制御信
号発生回路１４が駆動する。したがつて上記第３
図に示す実施例によれば特定の曜日又は特定の曜
日以外の全ての曜日にそれぞれ所望の制御信号を
得ることができる。そして、メモリー部９ａ，９
ｂ及び比較部１１ａ，１１ｂを更に複数追加する
ことにより上記指定できる特定の曜日を１日から
２日、更には３日といつた具合に増加させること
ができる。
０である場合、すなわちD1，D2，D3の各ビツト
によつて現わされる曜日を指定した場合には比較
部１１ａ，１１ｂの出力が１すなわちメモリー部
９ａ，９ｂによつて指定した曜日と曜日カウンタ
４の曜日とが一致したときのみアンド回路１３に
１の出力が現われ、時分比較回路１２の出力が１
になつたとき制御信号発回路１４が駆動する。そ
してメモリー部９ａ，９ｂのd4の出力が１である
場合すなわちD1，D2，D3の各ビツトによつて表
わされる曜日以外の曜日を指定した場合には比較
部１１ａ，１１ｂの出力が０すなわち、メモリー
部９ａ，９ｂのD1，D2，D3によつて表わされる
曜日と曜日カウンター４の曜日とが不一致である
ときにのみアンド回路１３に１の出力が現われ、
時分比較回路１２の出力が１になつたとき制御信
号発生回路１４が駆動する。したがつて上記第３
図に示す実施例によれば特定の曜日又は特定の曜
日以外の全ての曜日にそれぞれ所望の制御信号を
得ることができる。そして、メモリー部９ａ，９
ｂ及び比較部１１ａ，１１ｂを更に複数追加する
ことにより上記指定できる特定の曜日を１日から
２日、更には３日といつた具合に増加させること
ができる。
以上、実施例より明らかなように本発明のプロ
グラムタイマーによれば簡単な構成で予め指定さ
れた曜日と希望しない曜日指定にもとづくそれ以
外の曜日とにおいて、それぞれ同又は異なる指定
された時刻に所定の制御信号を得ることができる
ものであり、たとえば制御信号を目覚まし用の警
報器を駆動する信号として利用した場合には、日
曜日又は日曜日と土曜日のみ他の曜日より遅く警
報器が駆動するようにすることも可能であり、使
用者の生活実態に合せて効果的に活用することが
でき、実用上きわめて有利なものである。
グラムタイマーによれば簡単な構成で予め指定さ
れた曜日と希望しない曜日指定にもとづくそれ以
外の曜日とにおいて、それぞれ同又は異なる指定
された時刻に所定の制御信号を得ることができる
ものであり、たとえば制御信号を目覚まし用の警
報器を駆動する信号として利用した場合には、日
曜日又は日曜日と土曜日のみ他の曜日より遅く警
報器が駆動するようにすることも可能であり、使
用者の生活実態に合せて効果的に活用することが
でき、実用上きわめて有利なものである。
第１図は本発明のプログラムタイマーにおける
一実施例のブロツクダイヤグラム、第２図は同実
施例の要部をより詳細に示したブロツクダイヤグ
ラム、第３図は同実施例に使用するメモリー部の
出力を表わす説明図である。 １……基準信号発生源、２……分周器、３……
時分秒カウンター、４……曜日カウンター、５…
…切換回路、６……表示器駆動回路、７……デイ
ジタル表示器、８……時刻設定回路、９……曜日
メモリー、１０……時分メモリー、１１……曜日
比較回路、１２……時分比較回路、１３……アン
ド回路、１４……制御信号発生回路、１５……ア
ンド回路、１６……制御信号停止時間設定用カウ
ンター。
一実施例のブロツクダイヤグラム、第２図は同実
施例の要部をより詳細に示したブロツクダイヤグ
ラム、第３図は同実施例に使用するメモリー部の
出力を表わす説明図である。 １……基準信号発生源、２……分周器、３……
時分秒カウンター、４……曜日カウンター、５…
…切換回路、６……表示器駆動回路、７……デイ
ジタル表示器、８……時刻設定回路、９……曜日
メモリー、１０……時分メモリー、１１……曜日
比較回路、１２……時分比較回路、１３……アン
ド回路、１４……制御信号発生回路、１５……ア
ンド回路、１６……制御信号停止時間設定用カウ
ンター。
Claims (1)
- １ 基準信号発生源からの基準信号よう１秒周期
の時刻パルスを得る手段と、この時刻パルスを計
数し曜日、時分を計数する手段と、予め希望する
曜日及び希望しない曜日以外の曜日を記憶する手
段と、予め希望する時分を記憶する手段と、これ
らの記憶された曜日、時分と時刻パルスを計数し
て得られた曜日、時分とが一致又は不一致のとき
に所定の制御信号を発生する手段とを備え、前記
曜日を記憶する手段は記憶した曜日に制御信号を
発生するか又は記憶した曜日を除いた他の曜日に
制御信号を発生するかを決定するコードを記憶す
る手段を含み、希望曜日又は希望以外の曜日にお
いてそれぞれ指定された時刻に上記所定の制御信
号が出力されるように構成したプログラムタイマ
ー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6932779A JPS55160896A (en) | 1979-06-01 | 1979-06-01 | Program timer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6932779A JPS55160896A (en) | 1979-06-01 | 1979-06-01 | Program timer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55160896A JPS55160896A (en) | 1980-12-15 |
| JPS621236B2 true JPS621236B2 (ja) | 1987-01-12 |
Family
ID=13399336
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6932779A Granted JPS55160896A (en) | 1979-06-01 | 1979-06-01 | Program timer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55160896A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57124284A (en) * | 1981-01-24 | 1982-08-03 | Idec Izumi Corp | Week programmer |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5411476B2 (ja) * | 1973-05-08 | 1979-05-15 | ||
| JPS522563A (en) * | 1975-06-24 | 1977-01-10 | Seiko Instr & Electronics Ltd | Electronic clock with alarm |
| JPS5411477A (en) * | 1977-06-29 | 1979-01-27 | Kaoru Nagaya | Switch |
-
1979
- 1979-06-01 JP JP6932779A patent/JPS55160896A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55160896A (en) | 1980-12-15 |
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