JPS62145437A - コンピユ−タ - Google Patents
コンピユ−タInfo
- Publication number
- JPS62145437A JPS62145437A JP60288730A JP28873085A JPS62145437A JP S62145437 A JPS62145437 A JP S62145437A JP 60288730 A JP60288730 A JP 60288730A JP 28873085 A JP28873085 A JP 28873085A JP S62145437 A JPS62145437 A JP S62145437A
- Authority
- JP
- Japan
- Prior art keywords
- instruction
- program
- skip
- signal
- address
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
顧客のプログラムを格納した読み出し専用メモリ（以下
ＲＯＭと記する）を具備し、試験時に分岐命令及びスキ
ップ命令を禁止しながら読み出し専用メモリシこ格納し
であるプログラムを実行することができるコンピュータ
に関する。
ＲＯＭと記する）を具備し、試験時に分岐命令及びスキ
ップ命令を禁止しながら読み出し専用メモリシこ格納し
であるプログラムを実行することができるコンピュータ
に関する。
例としてＲＯＭ内蔵のマイクロコンビエータを用いる。
マイクロコンビ為−夕の試験はマイクロコンピュータを
試験状態に切り換え、外部からマイクロコンビエータの
試験状態時の入力端子より命令を入力しその応答を期待
値と比較する機能試験と顧客のプログラムの格納されて
いるＲＯＭの各アドレスの情報をコンビ為−夕の端子よ
り出力し、あらかじめｉ客のプログラムを基にして作り
た、期待値情報と比較するＲＯＭ内容確認試峨が行なわ
れる。
試験状態に切り換え、外部からマイクロコンビエータの
試験状態時の入力端子より命令を入力しその応答を期待
値と比較する機能試験と顧客のプログラムの格納されて
いるＲＯＭの各アドレスの情報をコンビ為−夕の端子よ
り出力し、あらかじめｉ客のプログラムを基にして作り
た、期待値情報と比較するＲＯＭ内容確認試峨が行なわ
れる。
機能試験にお−て入力する命令はマイクロコンビエータ
を装造するメーカ側で作るので命令のシーケンスは限定
されてしまう。
を装造するメーカ側で作るので命令のシーケンスは限定
されてしまう。
対して、ＲＯＭに格納される顧客のプログラムによる命
令シーケンスは無数にある。ＲＯＭ内容確認試験ではＲ
ＯＭに顧客の命令が正しくＲＯＭに格納されたかどうか
を確認するだけで顧客のプログラムが正確にマイクロコ
ンビ為−夕を動かすかどうかは確認できない。
令シーケンスは無数にある。ＲＯＭ内容確認試験ではＲ
ＯＭに顧客の命令が正しくＲＯＭに格納されたかどうか
を確認するだけで顧客のプログラムが正確にマイクロコ
ンビ為−夕を動かすかどうかは確認できない。
この為に、メーカ側で行った試験では良品となるが実装
の状態では命令の組み合わせに起因する不良のため正し
く動作しない場合があった。
の状態では命令の組み合わせに起因する不良のため正し
く動作しない場合があった。
本発明は上記欠点を見切するために、考慮されたもので
試験時にＲＯＭＫ格納された顧客のプログラムが正しく
、コンビエータを動作されることができるかどうか確認
する為に顧客のプログラムを格納した読み出し専用メモ
リを具備し、試験時に分岐命令及びスキップ命令を禁止
しながら読み出し専用メモリに格納しであるプログラム
を実行することができる簡易な回路を具備したコンピュ
ータを提供することにある。
試験時にＲＯＭＫ格納された顧客のプログラムが正しく
、コンビエータを動作されることができるかどうか確認
する為に顧客のプログラムを格納した読み出し専用メモ
リを具備し、試験時に分岐命令及びスキップ命令を禁止
しながら読み出し専用メモリに格納しであるプログラム
を実行することができる簡易な回路を具備したコンピュ
ータを提供することにある。
第１図は本発明の一実施例である。
マイクロコンピュータ試験時のＲＯＭに内蔵されている
プログラムによる機能確認試験において試験状態信号９
によシ分岐命令及びスキップ命令禁止信号発生回路８が
動作状態になり、プログラムカウンタリヒット信号５に
よシプログラムカクンタ７はθ番地に設定される。
プログラムによる機能確認試験において試験状態信号９
によシ分岐命令及びスキップ命令禁止信号発生回路８が
動作状態になり、プログラムカウンタリヒット信号５に
よシプログラムカクンタ７はθ番地に設定される。
次ニグログムムカウンタはインクリメントされてθ番地
から順々にインストラクションデコーダ３に命令が送信
される。インストラクションデコーダ３がシステムの各
所に信号を送りマイクロコンビエータを動作させる。分
岐命令がＲＯＭからインストラクションデコーダ３に送
られた場合通常はプログラムカウンタ７にＲＯＭ１から
の番地データをロード信号４が発生されて、プログラム
カランタフにＲＯＭからの番地データが設定されるか、
この場合分岐命令及びスキップ命令禁止信号発生回路が
動作状態にあるのでインストラクタ１ンデコーダからア
ドレスロード命令４は分岐命令禁止信号６が低レベルで
あることによりアドレスロード命令４は無視される。
から順々にインストラクションデコーダ３に命令が送信
される。インストラクションデコーダ３がシステムの各
所に信号を送りマイクロコンビエータを動作させる。分
岐命令がＲＯＭからインストラクションデコーダ３に送
られた場合通常はプログラムカウンタ７にＲＯＭ１から
の番地データをロード信号４が発生されて、プログラム
カランタフにＲＯＭからの番地データが設定されるか、
この場合分岐命令及びスキップ命令禁止信号発生回路が
動作状態にあるのでインストラクタ１ンデコーダからア
ドレスロード命令４は分岐命令禁止信号６が低レベルで
あることによりアドレスロード命令４は無視される。
また、スキップ命令がＲＯＭからインストラクションデ
コーダに送られた場合通常インストラクションデコーダ
にスキップ命令の次のアドレスにある命令を実行するか
いないかの判断信号１２が送信されるが分岐命令及びス
キップ命令禁止信号発生回路８が動作状態にあるので、
スキップ命令禁止信号１１が発生され１１は低レベルに
なシ、判断信号１２は無視される。この為に、顧客のプ
ログラムでループを作っている場合でもループを無視し
、さらに、プログラムの条件によって実行されないスキ
ップ命令の次の命令も実行でき、これにより、ＲＯＭに
格納されたプログラムによる命令のシーケンスは０番地
から順々に最後のアドレスまで実行される。
コーダに送られた場合通常インストラクションデコーダ
にスキップ命令の次のアドレスにある命令を実行するか
いないかの判断信号１２が送信されるが分岐命令及びス
キップ命令禁止信号発生回路８が動作状態にあるので、
スキップ命令禁止信号１１が発生され１１は低レベルに
なシ、判断信号１２は無視される。この為に、顧客のプ
ログラムでループを作っている場合でもループを無視し
、さらに、プログラムの条件によって実行されないスキ
ップ命令の次の命令も実行でき、これにより、ＲＯＭに
格納されたプログラムによる命令のシーケンスは０番地
から順々に最後のアドレスまで実行される。
この試験時のマイクロコンビエータの各端子の期待値は
顧客のプログラムを基にして作成しておく、このようを
こして、ＲＯＭ内のプログラムを実行してひき期待値と
比較すｎば顧客のプログラムによる命令シーケンス毎に
マイクロコンピュータの機能が確認できる。
顧客のプログラムを基にして作成しておく、このようを
こして、ＲＯＭ内のプログラムを実行してひき期待値と
比較すｎば顧客のプログラムによる命令シーケンス毎に
マイクロコンピュータの機能が確認できる。
但し、この場合分岐命令と分岐命令の行き先のアドレス
にある命令との組み合わせは確認できないかもしｎない
が、前述の〔従来の技術〕に書いである機能試験におい
て、分岐命令と他の命令の組み合わせ試験において、分
岐命令と他の命令の組み合わせ試験を行えば顧客のプロ
グラムによる命令シーケンスはすべて確認できた事にな
る。
にある命令との組み合わせは確認できないかもしｎない
が、前述の〔従来の技術〕に書いである機能試験におい
て、分岐命令と他の命令の組み合わせ試験において、分
岐命令と他の命令の組み合わせ試験を行えば顧客のプロ
グラムによる命令シーケンスはすべて確認できた事にな
る。
以上説明したように簡単な回路をもって顧客のプログラ
ムによるＲＯＭの命令ジ−タンスの機能試験ができ、命
令の組み合わせに起因する不良が減少するという大きな
効果がある。
ムによるＲＯＭの命令ジ−タンスの機能試験ができ、命
令の組み合わせに起因する不良が減少するという大きな
効果がある。
第１因は本発明の一実施例を示す図である。
１・・・・・・読み出し専用メモリ（ＲＯＭ）、２・・
・・・・ＲＯＭからのデータバス、３・・・・・・イン
ストラクションデコーダ、４・・・・・・アドレスロー
ド信号、５・・・・・・リセット信号、６・・・・・・
分岐命令禁止信号、７・・・・・・プログラム・カウン
タ、８・・・・・・分岐命令及び、スキップ命令禁止信
号発生回路、９・・・・・・テストモード信号、１０・
・・・・、ＲＯＭアドレスデコーダ、１１・・・・・・
スキップ命令禁止信号、１２・・・・・・判断信号。
・・・・ＲＯＭからのデータバス、３・・・・・・イン
ストラクションデコーダ、４・・・・・・アドレスロー
ド信号、５・・・・・・リセット信号、６・・・・・・
分岐命令禁止信号、７・・・・・・プログラム・カウン
タ、８・・・・・・分岐命令及び、スキップ命令禁止信
号発生回路、９・・・・・・テストモード信号、１０・
・・・・、ＲＯＭアドレスデコーダ、１１・・・・・・
スキップ命令禁止信号、１２・・・・・・判断信号。
Claims (1)
- 読み出し専用メモリを内蔵し、試験時に分岐命令とスキ
ップ命令を禁止し、該読み出し専用メモリに格納されて
いる命令を実行する手段を有する事を特徴とするコンピ
ュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60288730A JPH0789330B2 (ja) | 1985-12-20 | 1985-12-20 | コンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60288730A JPH0789330B2 (ja) | 1985-12-20 | 1985-12-20 | コンピュータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62145437A true JPS62145437A (ja) | 1987-06-29 |
| JPH0789330B2 JPH0789330B2 (ja) | 1995-09-27 |
Family
ID=17733941
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60288730A Expired - Fee Related JPH0789330B2 (ja) | 1985-12-20 | 1985-12-20 | コンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0789330B2 (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6031653A (ja) * | 1983-08-01 | 1985-02-18 | Nec Corp | ワンチツプマイクロコンピユ−タ |
| JPS6031652A (ja) * | 1983-08-01 | 1985-02-18 | Nec Corp | Ｒｏｍ内蔵マイクロコンピュ−タ |
-
1985
- 1985-12-20 JP JP60288730A patent/JPH0789330B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6031653A (ja) * | 1983-08-01 | 1985-02-18 | Nec Corp | ワンチツプマイクロコンピユ−タ |
| JPS6031652A (ja) * | 1983-08-01 | 1985-02-18 | Nec Corp | Ｒｏｍ内蔵マイクロコンピュ−タ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0789330B2 (ja) | 1995-09-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |