JPS6218882A - 静止画デ−タ表示装置 - Google Patents
静止画デ−タ表示装置Info
- Publication number
- JPS6218882A JPS6218882A JP60158994A JP15899485A JPS6218882A JP S6218882 A JPS6218882 A JP S6218882A JP 60158994 A JP60158994 A JP 60158994A JP 15899485 A JP15899485 A JP 15899485A JP S6218882 A JPS6218882 A JP S6218882A
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- Japan
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- Controls And Circuits For Display Device (AREA)
- Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、外部装置から直接、又は記録媒体を介して圧
縮された静止画データをマイクロコンピュータによシ静
止画メモリへ取り込み、静止画データを展開して表示す
る静止画データ表示に関す単位にデータ圧縮し、それぞ
れに行末コードとして特定のコード１ｂｙｔｅを付加し
、データ内容を示すＨｅａｄｅｒデータとから構成され
ている。上記静止画データはｎｂｙｔｅを一群とするグ
ループに分割し、群間にキャリアを挿入する伝送方式で
外部装置から送信される。本装置は上記静止画データを
読み取り、静止画メモリへ格納する。Ｈｅａｄａｒデー
タに基づき画像表示部の座標位置及び領域サイズの情報
を得て、静止画メモリへ格納した本体データの中からｎ
行目のＲＧＢデータをそれぞれ行末コードのｂｙｔｅ位
置までデータ展開し、展開Ｂｕｆｆ６ｒへＳｅｔする。
縮された静止画データをマイクロコンピュータによシ静
止画メモリへ取り込み、静止画データを展開して表示す
る静止画データ表示に関す単位にデータ圧縮し、それぞ
れに行末コードとして特定のコード１ｂｙｔｅを付加し
、データ内容を示すＨｅａｄｅｒデータとから構成され
ている。上記静止画データはｎｂｙｔｅを一群とするグ
ループに分割し、群間にキャリアを挿入する伝送方式で
外部装置から送信される。本装置は上記静止画データを
読み取り、静止画メモリへ格納する。Ｈｅａｄａｒデー
タに基づき画像表示部の座標位置及び領域サイズの情報
を得て、静止画メモリへ格納した本体データの中からｎ
行目のＲＧＢデータをそれぞれ行末コードのｂｙｔｅ位
置までデータ展開し、展開Ｂｕｆｆ６ｒへＳｅｔする。
展開Ｂｕｆｆｏｒ の内容を画像表示エリアへ書き込む
。次にｎ−１−１行目のＲＧＢデータをデータ展開し、
画像表示エリアへ書き込むことを繰）返すことにより、
静止画を表示する。
。次にｎ−１−１行目のＲＧＢデータをデータ展開し、
画像表示エリアへ書き込むことを繰）返すことにより、
静止画を表示する。
発ＢＡが解決しようとする問題点
しかし、上記のように行末コードを基準としてデータ展
開する場合、伝送線間に電磁波又は機械的雑音がのった
場合、正規の行末コードが他のデータへ、又はデータ部
分が行末コードへ変化してしまうことがあり１箇所でも
行末コードが変化すると当該行目以降の部分にも影響を
与え、正規のカラー静止画を表示することができないと
いう欠点を有していた。
開する場合、伝送線間に電磁波又は機械的雑音がのった
場合、正規の行末コードが他のデータへ、又はデータ部
分が行末コードへ変化してしまうことがあり１箇所でも
行末コードが変化すると当該行目以降の部分にも影響を
与え、正規のカラー静止画を表示することができないと
いう欠点を有していた。
問題点を解決するための手段
本発明の構成は、外部装置から静止画データを受信し、
静止画の表示手順を制御するマイクロコンピュータ（以
下、ＣＰＵという）、前記ＣＰＵを介して静止画データ
を記憶する静止画メモリ（以下、５−ＲＡＭという）、
前記５−ＲＡＭのデータを復元するために展開して５Ａ
ＶＥする展開Ｂｕｆｆｅｒ （以下、Ｔ−Ｂｕｆｆｅｒ
という）、画像を表示制御するビデオグロセソサ−（以
下、ＶＤＰという）、前記ＶＤＰと接続されるグラフイ
ンクメモリ（以下、Ｇ−ＲＡＭという）、並びに静止画
を表示する画像表示部から構成し、雑音等によシ静止画
の絵のみだれを最少限にする為に従来の伝送フォーマッ
トを変えて、本装置側ばて行末コードを付加する手順を
追加したものである。
静止画の表示手順を制御するマイクロコンピュータ（以
下、ＣＰＵという）、前記ＣＰＵを介して静止画データ
を記憶する静止画メモリ（以下、５−ＲＡＭという）、
前記５−ＲＡＭのデータを復元するために展開して５Ａ
ＶＥする展開Ｂｕｆｆｅｒ （以下、Ｔ−Ｂｕｆｆｅｒ
という）、画像を表示制御するビデオグロセソサ−（以
下、ＶＤＰという）、前記ＶＤＰと接続されるグラフイ
ンクメモリ（以下、Ｇ−ＲＡＭという）、並びに静止画
を表示する画像表示部から構成し、雑音等によシ静止画
の絵のみだれを最少限にする為に従来の伝送フォーマッ
トを変えて、本装置側ばて行末コードを付加する手順を
追加したものである。
作用
本発明は、静止画データをＨｅａｄａｒ データと、
各行数の色情報をそれぞれＲＧＢ単位に分割したデータ
群に分割した本体データ部分から構成し、各群間にキャ
リア信号を挿入した伝送フォーマットにすることにより
、本装置内でキャリア信号を識別し、キャリア信号を受
信したら行末と判定して新たに行末コードを付加するこ
とにより、雑音等によりデータが変化しても静止画の絵
のみだれを一行のみに抑えることができる。
各行数の色情報をそれぞれＲＧＢ単位に分割したデータ
群に分割した本体データ部分から構成し、各群間にキャ
リア信号を挿入した伝送フォーマットにすることにより
、本装置内でキャリア信号を識別し、キャリア信号を受
信したら行末と判定して新たに行末コードを付加するこ
とにより、雑音等によりデータが変化しても静止画の絵
のみだれを一行のみに抑えることができる。
実施列
以下、図面に基づき本発明の詳細な説明する。
第１図は本発明の静止画データ表示装置の一実施例を示
すブロック図である。第１図において外部装置から静止
画データを受信するとともに表示手順を制御するＣＰＵ
１ 、前記ＣＰＵ１を介して静止画データを格納する５
−ＲＡＭ２、前記Ｓ −ＲＡＭ２の内容をデータ展開し
て一時的にセーブするＴ −Ｂｕｆｆａｒ ３ 、画（
象データの表示制御を行うＶＤＰ３、前記ＶＤＰ３と接
続され画像データを記憶するＧ−ＲＡＭ４、並びに前記
Ｇ−ＲＡＭ４の内容を表示する画像表示部から構成する
。
すブロック図である。第１図において外部装置から静止
画データを受信するとともに表示手順を制御するＣＰＵ
１ 、前記ＣＰＵ１を介して静止画データを格納する５
−ＲＡＭ２、前記Ｓ −ＲＡＭ２の内容をデータ展開し
て一時的にセーブするＴ −Ｂｕｆｆａｒ ３ 、画（
象データの表示制御を行うＶＤＰ３、前記ＶＤＰ３と接
続され画像データを記憶するＧ−ＲＡＭ４、並びに前記
Ｇ−ＲＡＭ４の内容を表示する画像表示部から構成する
。
第２図は、従来の伝送フォーマットと本発明の実施列の
伝送フォルマットを対比しながら説明するため外部装置
から送信される静止画データの伝送手順を示した図であ
シ、第２図（ａ）に従来の伝送７オーマントを、第２図
（ｂ）に新しい伝送フォーマットを示す。以下、これに
ついて説明する従来の伝送フォーマットの本体データ部
は、各行のＲＧＢ単位に圧縮されたデータに行末コード
を付加し、ｎ ｂｙｔｅを単位としてキャリア信号を付
加して送信される。本発明の実施列における伝送フォー
マットは第２図（ｂ）に示すように、本体データ部は各
ＧＲＢのデータ単位にキャリア信号を付加し、送信され
るものである。
伝送フォルマットを対比しながら説明するため外部装置
から送信される静止画データの伝送手順を示した図であ
シ、第２図（ａ）に従来の伝送７オーマントを、第２図
（ｂ）に新しい伝送フォーマットを示す。以下、これに
ついて説明する従来の伝送フォーマットの本体データ部
は、各行のＲＧＢ単位に圧縮されたデータに行末コード
を付加し、ｎ ｂｙｔｅを単位としてキャリア信号を付
加して送信される。本発明の実施列における伝送フォー
マットは第２図（ｂ）に示すように、本体データ部は各
ＧＲＢのデータ単位にキャリア信号を付加し、送信され
るものである。
第３図は同実施Ｆ！ｉＩＪの動作手順を示すフォローチ
ャートであシ、本図を用いて具体的な本実施例の動作を
説明する。ステップａは、外部装置から静止画データを
受信するまで待機し、スタートビットを確認したらステ
ップｂへ進む。ステップｂで静止画のＨｅａｄθｒデー
タを受信し、 ステップＣで前記ステップｂで得たＨｅ
ａｄｅｒデータをＢｕｆｆｅｒヘセソトする。ステップ
ｄで次の本体データ部を受信するまで待機し、キャリア
信号から本体データのスタートビットを確認したら、ス
テップθへ進む。ステップθで本体データの１ ｂｙｔ
ｅデータを受信し、受信用Ｂｕｆｆｏｒへセットし、ス
テップｆでデータがキャリアでなければステップｅへ戻
り、次のデータを受信する。キャリアであるならば、ｎ
行目における各ＲＧＢのデータの終了とみなし、ステッ
プｇへ進む。ステップｇでは前記ステップｅで受信した
受信Ｂｕｆｆｅｒの内容に行末コードを付加し、５−Ｒ
ＡＭ２へ格納する。
ャートであシ、本図を用いて具体的な本実施例の動作を
説明する。ステップａは、外部装置から静止画データを
受信するまで待機し、スタートビットを確認したらステ
ップｂへ進む。ステップｂで静止画のＨｅａｄθｒデー
タを受信し、 ステップＣで前記ステップｂで得たＨｅ
ａｄｅｒデータをＢｕｆｆｅｒヘセソトする。ステップ
ｄで次の本体データ部を受信するまで待機し、キャリア
信号から本体データのスタートビットを確認したら、ス
テップθへ進む。ステップθで本体データの１ ｂｙｔ
ｅデータを受信し、受信用Ｂｕｆｆｏｒへセットし、ス
テップｆでデータがキャリアでなければステップｅへ戻
り、次のデータを受信する。キャリアであるならば、ｎ
行目における各ＲＧＢのデータの終了とみなし、ステッ
プｇへ進む。ステップｇでは前記ステップｅで受信した
受信Ｂｕｆｆｅｒの内容に行末コードを付加し、５−Ｒ
ＡＭ２へ格納する。
ステップにで本体データ受信完了をチェックし、未完了
ならステップｄへ戻る。完了なら次のステップエヘ進む
。ステップｉはステップＣで受信したＨｅａｄａｒデー
タから静止画を表示する座標位置及び領域サイズ情報を
得る。、ステップｊでステップｇで格納した本体データ
を一行分のＲＧＢデータをそれぞれ行末コードの位１電
までデータを展開し、Ｔ−Ｂｕｆｆ’ｅｒ ３ヘセノト
する。ステップにでＴ −Ｂｕｆｆｅｒ ３の内容をＧ
−ＲＡＭ５へ書き込む。ステップｅす全行のデータ展開
が完了すれば終了とし、未完了ならステソプフへ進み、
次の行のデータを展開する。
ならステップｄへ戻る。完了なら次のステップエヘ進む
。ステップｉはステップＣで受信したＨｅａｄａｒデー
タから静止画を表示する座標位置及び領域サイズ情報を
得る。、ステップｊでステップｇで格納した本体データ
を一行分のＲＧＢデータをそれぞれ行末コードの位１電
までデータを展開し、Ｔ−Ｂｕｆｆ’ｅｒ ３ヘセノト
する。ステップにでＴ −Ｂｕｆｆｅｒ ３の内容をＧ
−ＲＡＭ５へ書き込む。ステップｅす全行のデータ展開
が完了すれば終了とし、未完了ならステソプフへ進み、
次の行のデータを展開する。
発明の効果
上記のように本発明によれば、静止画データの本体デー
タ部分を各行のＲＧＢ単位にキャリアを付加して伝送し
、上記伝送データを受信して、本装置側で行末コードを
付加すれば、雑音等によりデータが変化しても全ての画
像に影響を与えることなく、最少限に画像のみだれを抑
えることができる。
タ部分を各行のＲＧＢ単位にキャリアを付加して伝送し
、上記伝送データを受信して、本装置側で行末コードを
付加すれば、雑音等によりデータが変化しても全ての画
像に影響を与えることなく、最少限に画像のみだれを抑
えることができる。
第１図は本発明の一実施例を示す静止画データ表示装置
のプロ、り図、第２図（２Ｌ）は従来の伝送フォーマノ
ｌ−を示す図、同図すは本発明の実施例の伝送フォーマ
ットを示す図、第３図は同実施しＩＪの処理手順を示す
フローチャー１・である。 １・・・・マイクロコンピュータ（ＣＰＵ）、２・・・
・静止画メモＩＪ（Ｓ−ＲＡＭ）、３ 、・・展開Ｂｕ
ｆｆｅｒ（Ｔ−Ｂｕｆｆｅｒ）、４−・・−ビデオプロ
セッサー（ｖＤＰ）、５・・・・・グラフィックメモリ
（Ｇ−ＲＡＭ）、６・・・・画像表示部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第３
図子のｔ 第３図 その２ 手続補正書（方式） ％式％ １事件の表示 昭和６０年特許願第１５８９９４号 ２発明の名称 静止画データ表示装置 ３補正をする者 代表者 山 下 俊 彦 ４代理人 〒５７１ 住 所 大阪府門真市大字門真１００６番地松下電器
産業株式会社内 ４、図面の簡単な説明 第１図は本発明の一実施例を示す静止画データ表示装置
のブロック図、第２図は従来の伝送フォーマット及び本
発明の実施例の伝送フォーマットを示す図、第３図は同
実施例の処理手順を示すフローチャートである。
のプロ、り図、第２図（２Ｌ）は従来の伝送フォーマノ
ｌ−を示す図、同図すは本発明の実施例の伝送フォーマ
ットを示す図、第３図は同実施しＩＪの処理手順を示す
フローチャー１・である。 １・・・・マイクロコンピュータ（ＣＰＵ）、２・・・
・静止画メモＩＪ（Ｓ−ＲＡＭ）、３ 、・・展開Ｂｕ
ｆｆｅｒ（Ｔ−Ｂｕｆｆｅｒ）、４−・・−ビデオプロ
セッサー（ｖＤＰ）、５・・・・・グラフィックメモリ
（Ｇ−ＲＡＭ）、６・・・・画像表示部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第３
図子のｔ 第３図 その２ 手続補正書（方式） ％式％ １事件の表示 昭和６０年特許願第１５８９９４号 ２発明の名称 静止画データ表示装置 ３補正をする者 代表者 山 下 俊 彦 ４代理人 〒５７１ 住 所 大阪府門真市大字門真１００６番地松下電器
産業株式会社内 ４、図面の簡単な説明 第１図は本発明の一実施例を示す静止画データ表示装置
のブロック図、第２図は従来の伝送フォーマット及び本
発明の実施例の伝送フォーマットを示す図、第３図は同
実施例の処理手順を示すフローチャートである。
Claims (1)
- 外部装置から静止画データを受信し、静止画の表示手順
を制御するマイクロコンピュータと、前記静止画データ
を一時的に記憶する静止画メモリと、前記静止画データ
を表示フォーマットに展開する展開Ｂｕｆｆｅｒと、画
像を表示制御するビデオプロセッサーと、前記ビデオプ
ロセッサーに接続されて表示内容を記憶するグラフィッ
クメモリ、並びに静止画を表示する画像表示部とを備え
、外部装置から圧縮された静止画データとキャリア信号
を入力し、キャリア信号を識別することにより表示エリ
アにおける各行末を認識し、静止画データを復元して表
示する静止画データ表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60158994A JPS6218882A (ja) | 1985-07-18 | 1985-07-18 | 静止画デ−タ表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60158994A JPS6218882A (ja) | 1985-07-18 | 1985-07-18 | 静止画デ−タ表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6218882A true JPS6218882A (ja) | 1987-01-27 |
Family
ID=15683898
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60158994A Pending JPS6218882A (ja) | 1985-07-18 | 1985-07-18 | 静止画デ−タ表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6218882A (ja) |
-
1985
- 1985-07-18 JP JP60158994A patent/JPS6218882A/ja active Pending
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