JPS62258571A - クロック信号を発生する回路 - Google Patents

クロック信号を発生する回路

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JPS62258571A
JPS62258571A JP62024912A JP2491287A JPS62258571A JP S62258571 A JPS62258571 A JP S62258571A JP 62024912 A JP62024912 A JP 62024912A JP 2491287 A JP2491287 A JP 2491287A JP S62258571 A JPS62258571 A JP S62258571A
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JP
Japan
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frequency
circuit
control circuit
phase control
phase
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JP62024912A
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JPH0553434B2 (ja
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アクセル−ピーレ・ベルラント
ジヤン−クラウデ・ルフライ
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Deutsche Thomson Brandt GmbH
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Deutsche Thomson Brandt GmbH
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Publication date
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Publication of JPH0553434B2 publication Critical patent/JPH0553434B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/04Synchronising
    • H04N5/05Synchronising circuits with arrangements for extending range of synchronisation, e.g. by using switching between several time constants
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N9/00Details of colour television systems
    • H04N9/44Colour synchronisation
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
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    • H04N5/04Synchronising
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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Television Systems (AREA)
  • Synchronizing For Television (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Television Signal Processing For Recording (AREA)
  • Color Television Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、デジタル化テレビ信号を復号するために、位
相制御発信回路(PLL )を用いて線周波数と結合さ
れたクロック信号−を発生する回路装置に関する。
従来技術 デジタル信号を処理する場合、例えばビデオ信号をデジ
タル化する場合の重要な前提は、デジタル回路を制御す
るクロックが周波数および位相の両方で線周波数と結合
されていることである。この前提が充たされていれば、
走査線ごとにあるいはフィールPごとに、いつも同じ画
点に瞬時値が形成される。伝送帯域幅が5 M Hzの
場合、標本化定理に従ってクロック周波数は10〜20
M Hzとなる。提案されている規格では、クロック周
波数は13.5 M Hzである。クロック周波数の同
期調整は、画像の不可視部分、つまり帰線消去期間に行
なわれる。一方水平走査期間にはクロック発振器は自由
に振動する。
発明の解決すべき問題点 クロック周波数と線周波数との比が非常に大きく、クロ
ック周波数が十分安定でない場合、水平走査期間内にノ
ックが生じる危険性がある。
ジッタが生じると、走査線期間内に制御に悪い影響が及
ぶ。水晶制御式のPLL回路でクロック周波数を発生す
ることもできる。しかし、例えば線周波数が規格から偏
移すると(ビデオレヨーダの信号などの場合に起る)、
周波数変動を調節する手段がない。このような装置の場
合、線周波数は+/−1係ぐらい偏移することかある。
従って、クロック周波数を被処理信号の線周波数と同期
させてノックの発生を防止するには、クロック周波数の
調節が可能で−なければならない。
例えば、水晶制御式のPLL回路を用いて必要なりロッ
ク周波数を得ろことが提案されている。この場合、分周
とその後の乗算によってクロック周波数が得うレ7) 
(I E E E  Internatio−nal 
Conference onConsumer Ele
ctronics 。
1985年6月7日、デジタルテレビに関する第XVI
Iセツション)。
本発明の課題は、安い回路費用で、ビデオ信号の線周波
数と結合されたクロック周波数を発生し、またクロック
周波数の値を、偏差を伴う線周波数に自動的に整合させ
ることである。
問題点を解決するための手段 本発明によればこの課題は、特許請求の範囲第1項に記
載した発明によって解決される。
本発明の利点は、テレビ受像機の中にPLL制御回路が
既設されているので製造コストが安いことである。
実施例 次に図面を参照しながら実施例について本発明の詳細な
説明する。
電圧制御発振器1、分周器2および位相比較器3から成
るPLL回路は、その出力側0にクロック周波数fTを
発生する。公知のように位相比較器3には、分周された
周波数 fT/N 1と基準周波数fRとが供給される
。位相比較の結果として、発掘器1に対する制御電圧が
発生する。基準周波数tRを発生するのは、第2の電圧
制御発振器Φ、第20分周器5および第2の位相比較器
6から成る第20PLL回路である。
第2PLL回路は、線周波数fZと固定的に結合された
周波数fRを発生する。位相比較器6には、基準周波数
としての線周波数fZと分周された周波数fR/N2 
 とが供給される。発振器生は、セラミック振動子9に
よって発生した極めて安定な周波数を第1 PLL回路
に供給する。例えば13.5MH,のクロック周波数を
供給する第1発振器1は、500 M H2の基準周波
数によって制御される。周波数比が100未満(fT/
fR〈10o)の小さな値テアレバ、高い安定性が保証
される。第1のPLL回路1゜2.3にはコンデンサ7
によって時定数T1が与えられ、第2 PLL回路4,
5.6にはヨ。
デンサ8によって時定数T2が与えられる。この場合、
時定数T2の方がT1より大きい。従って、第2PLL
回路4,5.6の時定数T2が線周波数の5〜20周期
の範囲内にあれば有利である。線周波数が15.625
 K Hzであれば、T2の値は320μs〜1280
μsとなる。第1PLL回路の時定数T1は、分周−器
5の係数N2に基づいてT2の 1/N2になる。図示
6例ではN2=32なので、時定数T1の値は10μ5
−40μsである。第2PLL回路壬、5.6の同期引
込み範囲はセラミック振動子9によって小さくできる。
第1 PLL回路の時定数T1は小さいので、高価な振
動子(例えばセラミックや水晶)を用いずに普通の電圧
制御発振器を使用することができる。さらに、第1PL
L回路に供給される基準周波数fRが線周波数fZの偏
移に応じて変化するので、第1 PLL回路は外部から
調節できなくともよい。
例えば13,5MHzのクロック周波数を発生するため
に、503 M H2で振動する振動子9を有する第2
発振器4は、この周波数を係数N2=32で分周して線
周波数15,625KH,と比較することによって、5
00MH,に調節される。
こうして発生した基準周波数fRは、係数N1=27で
分周された周波数FTと比較される。
基準周波数fRは、線周波数が♀/−1%だけ偏移して
いる時K、第1 PLL回路で13.5MHzのクロッ
ク周波数が発生するように調節される。
発明の効果 本発明は、ビデオテキスト信号を復号するために安定な
りロック周波数を発生するのに適している。従って、高
価な水晶を使う必要はない。
テレビ送像機の正確な線周波数が基準周波数として用い
られる。セラミック振動子を使用するので、障害に対し
て十分に保護され−る。
【図面の簡単な説明】
図は本発明による装置の実施例を示すブロック図である
。 1.4.・・電圧制御発振器、2.5=9分周器、3.
6・・・位相比較器、7,8・・・コンデンサ、9・・
・振動子。

Claims (1)

  1. 【特許請求の範囲】 1、デジタル化テレビ信号を復号するために、位相制御
    発信回路(PLL)を用いて線周波数と結合されたクロ
    ック信号を発生する回路装置において、 第2の位相制御回路(4、5、6)が発生 しかつ線周波数f_Zと結合された周波数f_Rが、基
    準周波数として第1の位相制御回路(1、2、3)に供
    給され、それによつて第1の位相制御回路がクロック周
    波数f_Tを発生する、 ことを特徴とするクロック信号を発生する 回路装置。 2、第2位相制御回路の発振器(4)がセラミック振動
    子(9)によつて安定化されている、特許請求の範囲第
    1項記載の回路装置。 3、第2位相制御回路(4、5、6)の閉ループ制御回
    路が、線周波数f_Zの5〜20周期の範囲内にある大
    きな時定数T_2を有している特許請求の範囲第1項記
    載の回路装置。 4、第2位相制御回路の分周器(5)の係数がN_2で
    あり、第1位相制御回路(1、2、3)の閉ループ制御
    回路が、時定数T_2の1/N_2の小さな時定数T_
    1を有している特許請求の範囲第1項記載の回路装置。
JP62024912A 1986-02-06 1987-02-06 クロック信号を発生する回路 Granted JPS62258571A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
DE3603621.8 1986-02-06
DE19863603621 DE3603621A1 (de) 1986-02-06 1986-02-06 Schaltungsanordnung zur erzeugung eines taktsignals

Publications (2)

Publication Number Publication Date
JPS62258571A true JPS62258571A (ja) 1987-11-11
JPH0553434B2 JPH0553434B2 (ja) 1993-08-10

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ID=6293490

Family Applications (1)

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JP62024912A Granted JPS62258571A (ja) 1986-02-06 1987-02-06 クロック信号を発生する回路

Country Status (7)

Country Link
EP (1) EP0235573B1 (ja)
JP (1) JPS62258571A (ja)
KR (1) KR910006488B1 (ja)
AT (1) ATE76547T1 (ja)
DE (2) DE3603621A1 (ja)
ES (1) ES2032759T3 (ja)
HK (1) HK59096A (ja)

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DE3603621A1 (de) 1987-08-13
KR870008464A (ko) 1987-09-26
DE3779147D1 (de) 1992-06-25
ATE76547T1 (de) 1992-06-15
HK59096A (en) 1996-04-12
ES2032759T3 (es) 1993-03-01
EP0235573B1 (de) 1992-05-20
EP0235573A1 (de) 1987-09-09
JPH0553434B2 (ja) 1993-08-10

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