JPS625308U - - Google Patents
Info
- Publication number
- JPS625308U JPS625308U JP9301785U JP9301785U JPS625308U JP S625308 U JPS625308 U JP S625308U JP 9301785 U JP9301785 U JP 9301785U JP 9301785 U JP9301785 U JP 9301785U JP S625308 U JPS625308 U JP S625308U
- Authority
- JP
- Japan
- Prior art keywords
- ram
- microprocessor
- data
- sequence control
- control device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Programmable Controllers (AREA)
Description
第1図は、この考案の一実施例を示すシーケン
ス制御装置のブロツク構成図、第2図は第1図の
動作フローチヤート、第3図は第1図を制御する
ためのプログラムの構成図、第4図は従来のシー
ケンス制御装置のBITデータ処理回路図である
。 図において、1はマイクロプロセツサ、2,5
は第1、第2のROM、3は専用回路(BIT
ALU)、4はRAM、6,7は第1、第2のマ
ルチプレクサである。
ス制御装置のブロツク構成図、第2図は第1図の
動作フローチヤート、第3図は第1図を制御する
ためのプログラムの構成図、第4図は従来のシー
ケンス制御装置のBITデータ処理回路図である
。 図において、1はマイクロプロセツサ、2,5
は第1、第2のROM、3は専用回路(BIT
ALU)、4はRAM、6,7は第1、第2のマ
ルチプレクサである。
Claims (1)
- 【実用新案登録請求の範囲】 (1) マイクロプロセツサと、該マイクロプロセ
ツサで処理した対象データをRAMに書込み、該
RAMとの間でビツトデータ処理を行う専用回路
を備えたシーケンス制御装置において、通常は前
記RAMとマイクロプロセツサ間で処理対象デー
タを制御し、ビツトデータ処理時は前記マイクロ
プロセツサのコンペアストリング命令の実行バス
サイクルで前記専用回路と該RAM間で制御動作
するようにしたことを特徴とするシーケンス制御
装置。 (2) マイクロプロセツサの制御プログラムと前
記専用回路の制御プログラムとを夫々別のROM
に格納するようにしたことを特徴とする実用新案
登録請求の範囲第1項記載のシーケンス制御装置
。 (3) 前記マイクロプロセツサがコンペアストリ
ングス命令を実行する時仮想データを該マイクロ
プロセツサに出力する第1のマルチプレクサを設
けたことを特徴とする実用新案登録請求の範囲第
1項記載のシーケンス制御装置。 (4) 処理対象データを通常はRAMからマイク
ロプロセツサへ、あるいはマイクロプロセツサか
らRAMへ、また、ビツトデータ処理時は該RA
Mから前記専用回路へ、あるいは該専用回路から
RAMへとデータの流れを切換える第2のマルチ
プレクサを設けたことを特徴とする実用新案登録
請求の範囲第1項記載のシーケンス制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9301785U JPS625308U (ja) | 1985-06-21 | 1985-06-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9301785U JPS625308U (ja) | 1985-06-21 | 1985-06-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS625308U true JPS625308U (ja) | 1987-01-13 |
Family
ID=30955232
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9301785U Pending JPS625308U (ja) | 1985-06-21 | 1985-06-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS625308U (ja) |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5268340A (en) * | 1975-12-05 | 1977-06-07 | Hitachi Ltd | Data processing unit |
| JPS54104258A (en) * | 1978-02-03 | 1979-08-16 | Hitachi Ltd | Data processor capable of processing as both computer and sequencer |
| JPS5965310A (ja) * | 1982-10-06 | 1984-04-13 | Mitsubishi Electric Corp | プログラマブルコントロ−ラの演算処理装置 |
| JPS5971510A (ja) * | 1982-10-18 | 1984-04-23 | Hitachi Ltd | シ−ケンス制御回路 |
| JPS59218510A (ja) * | 1983-05-27 | 1984-12-08 | Hitachi Seiki Co Ltd | シ−ケンスコントロ−ラ |
-
1985
- 1985-06-21 JP JP9301785U patent/JPS625308U/ja active Pending
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5268340A (en) * | 1975-12-05 | 1977-06-07 | Hitachi Ltd | Data processing unit |
| JPS54104258A (en) * | 1978-02-03 | 1979-08-16 | Hitachi Ltd | Data processor capable of processing as both computer and sequencer |
| JPS5965310A (ja) * | 1982-10-06 | 1984-04-13 | Mitsubishi Electric Corp | プログラマブルコントロ−ラの演算処理装置 |
| JPS5971510A (ja) * | 1982-10-18 | 1984-04-23 | Hitachi Ltd | シ−ケンス制御回路 |
| JPS59218510A (ja) * | 1983-05-27 | 1984-12-08 | Hitachi Seiki Co Ltd | シ−ケンスコントロ−ラ |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPS625308U (ja) | ||
| JPS61202225A (ja) | プロセツサによるハ−ドウエア制御方式 | |
| JPS598060A (ja) | マイクロ・プロセツサ | |
| JPS61192351U (ja) | ||
| JPH01138143U (ja) | ||
| JPS62154551U (ja) | ||
| JPH01133643U (ja) | ||
| EP0278263A3 (en) | Multiple bus dma controller | |
| JPH0280807U (ja) | ||
| JPS59134804U (ja) | シ−ケンス制御装置におけるシ−ケンス演算回路 | |
| JPS6335139U (ja) | ||
| JPS5697154A (en) | Interruption control system for information processor | |
| JPS59169610U (ja) | 人工衛星の姿勢制御装置 | |
| JPS61193255A (ja) | 高速中央処理装置の動作方法 | |
| JPH0330103U (ja) | ||
| JPS58178404A (ja) | シ−ケンスコントロ−ラの外部演算ユニツト | |
| JPS6418348U (ja) | ||
| JPS60148647U (ja) | フアイル保護機能をもつcpu切換え装置 | |
| JPS6353143U (ja) | ||
| JPS60198656A (ja) | 主記憶装置のアクセス制御方式 | |
| JPH02100142A (ja) | 任意のレジスタ退避、復帰方式 | |
| JPH01175322U (ja) | ||
| JPH0782456B2 (ja) | キャッシュ制御方式 | |
| JPH0258845U (ja) | ||
| JPH0289545U (ja) |