JPS625352U - - Google Patents
Info
- Publication number
- JPS625352U JPS625352U JP9301985U JP9301985U JPS625352U JP S625352 U JPS625352 U JP S625352U JP 9301985 U JP9301985 U JP 9301985U JP 9301985 U JP9301985 U JP 9301985U JP S625352 U JPS625352 U JP S625352U
- Authority
- JP
- Japan
- Prior art keywords
- data
- circuit
- exclusive
- address
- latch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Detection And Correction Of Errors (AREA)
Description
第1図はこの考案の一実施例に従うデータ誤り
検知回路の回路構成図、第2図は従来のデータ誤
り検知回路の回路構成図である。 図において、5はROM、11は排他的論理和
回路、12はラツチ/シフトレジスタ回路、13
はアドレスカウンタ回路、16はサムデータチエ
ツク回路である。なお、各図中、同一符号は同一
又は相当部分を示す。
検知回路の回路構成図、第2図は従来のデータ誤
り検知回路の回路構成図である。 図において、5はROM、11は排他的論理和
回路、12はラツチ/シフトレジスタ回路、13
はアドレスカウンタ回路、16はサムデータチエ
ツク回路である。なお、各図中、同一符号は同一
又は相当部分を示す。
Claims (1)
- 最終アドレスに該最終アドレスより前の各アド
レスに夫々記憶されているデータの誤りの有無を
チエツクするための指標データを記憶している記
憶回路と、該記憶回路の各アドレスに記憶されて
いる前記データを所定のタイミングで逐次読出す
メモリアドレス信号を出力するアドレス計数回路
と、外部から与えられたデータを受けてこれを一
時的に記憶するとともに所定の信号が入力された
ときに該データをパラレル/シリアル変換して出
力するラツチ/シフトレジスタ回路と、前記記憶
回路から逐次出力されるデータと前記ラツチ/シ
フトレジスタ回路から帰還されたデータとの排他
的論理和をとつて前記ラツチ/シフトレジスタ回
路に出力する排他的論理和回路と、前記排他的論
理和回路において前記指標データと該指標データ
の直前の排他的論理和データとの排他的論理和を
とつた最終データが前記ラツチ/シフトレジスタ
回路から出力されたときに、該最終データを受け
て該データを構成している各々のビツト毎に予め
設定された基準値と比較することによつて誤りを
チエツクするデータチエツク回路とを有するデー
タ誤り検知回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9301985U JPS625352U (ja) | 1985-06-21 | 1985-06-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9301985U JPS625352U (ja) | 1985-06-21 | 1985-06-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS625352U true JPS625352U (ja) | 1987-01-13 |
Family
ID=30955238
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9301985U Pending JPS625352U (ja) | 1985-06-21 | 1985-06-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS625352U (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5178938A (en) * | 1974-12-31 | 1976-07-09 | Sharp Kk | Kiokusochino tajushorisochi |
| JPS5337041A (en) * | 1976-09-17 | 1978-04-05 | Seiichi Komazaki | Sunbeam multistage condensing method and apparatus |
| JPS5373041A (en) * | 1976-12-13 | 1978-06-29 | Nec Corp | Detection device for fixed memory error |
-
1985
- 1985-06-21 JP JP9301985U patent/JPS625352U/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5178938A (en) * | 1974-12-31 | 1976-07-09 | Sharp Kk | Kiokusochino tajushorisochi |
| JPS5337041A (en) * | 1976-09-17 | 1978-04-05 | Seiichi Komazaki | Sunbeam multistage condensing method and apparatus |
| JPS5373041A (en) * | 1976-12-13 | 1978-06-29 | Nec Corp | Detection device for fixed memory error |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPS625352U (ja) | ||
| JPS5570997A (en) | Error bit check system for read only memory | |
| JPS6016400U (ja) | 先入れ先出しバツフアの誤動作検出回路 | |
| JPS5940940U (ja) | レジスタのチエツク回路 | |
| JPS5836445U (ja) | デ−タ選択回路 | |
| JPH0267436U (ja) | ||
| JPS5847950U (ja) | 電子レジスタ | |
| JPS6016993Y2 (ja) | ファ−ストイン・ファ−ストアウト・メモリ | |
| JPS6296744U (ja) | ||
| JPS61168761U (ja) | ||
| JPS6085462U (ja) | Pcmコミユテ−シヨンデ−タ検出回路 | |
| JPS6353165U (ja) | ||
| JPS5736500A (en) | Memory check system | |
| JPS6095650U (ja) | スタツクのオ−バフロ−検出回路 | |
| JPS61650U (ja) | 多重仮想記憶方式の情報処理装置 | |
| JPH02108147U (ja) | ||
| JPS58171562U (ja) | 演算装置 | |
| JPS6384647U (ja) | ||
| JPS582040U (ja) | デ−タ処理装置におけるクロック回路 | |
| JPH0458764U (ja) | ||
| JPS6427738U (ja) | ||
| JPS59174642U (ja) | メモリの異常検出回路 | |
| JPS6034643U (ja) | 誤アクセス禁止回路 | |
| JPH0392830U (ja) | ||
| JPH02216563A (ja) | 連想メモリ装置 |