JPS6260249A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS6260249A
JPS6260249A JP60199972A JP19997285A JPS6260249A JP S6260249 A JPS6260249 A JP S6260249A JP 60199972 A JP60199972 A JP 60199972A JP 19997285 A JP19997285 A JP 19997285A JP S6260249 A JPS6260249 A JP S6260249A
Authority
JP
Japan
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film
bonding electrode
silicon nitride
silicon oxide
layer structure
Prior art date
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Pending
Application number
JP60199972A
Other languages
English (en)
Inventor
Masahide Nakajima
中島 正英
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPS6260249A publication Critical patent/JPS6260249A/ja
Pending legal-status Critical Current

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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/90Bond pads, in general
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/90Bond pads, in general
    • H10W72/921Structures or relative sizes of bond pads
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    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
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    • H10W72/931Shapes of bond pads
    • H10W72/934Cross-sectional shape, i.e. in side view
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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    • H10W72/90Bond pads, in general
    • H10W72/951Materials of bond pads
    • H10W72/952Materials of bond pads comprising metals or metalloids, e.g. PbSn, Ag or Cu

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  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はボンディング電極を改良した半導体装置に関し
、特にGa、AsFETに適用して好適なボンディング
電極を備えた半導体装置に関する。
〔従来の技術〕
一般に半導体装置では、素子回路を形成した半導体素子
チップと外部との電気的接続を図るために素子チップに
ボンディング電極を設けておき、パッケージ容器に設け
た外部導出リードと、このボンディング電極とを金属細
線等によって接続する構成が採られている。このため、
半導体装置では基板の表面上に金属膜を所定のパターン
に形成してボンディング電極を形成している。
例えば、第2図はGaAsFETに形成したボンディン
グ電極を示しており、GaAs半絶縁性基板或いはバッ
ファ層11の上に金属膜を直接形成し、これを所定形状
にパターニングしてボンディング電極12を構成してい
る。また、他の構造としては、第3図のように、GaA
s半絶縁性基板或いはバッファ層11の上にシリコン酸
化膜13を被着し、その上に金属膜からなるボンディン
グ電極4を構成している。この場合、シリコン酸化膜に
代えてシリコン窒化膜を使用することもある。
〔発明が解決しようとする問題点〕
上述した従来のボンディング電極構造では、例えば第2
図のように基板11等の上に直接ボンディング電極12
を形成していると、基板11を構成するGaASと、ボ
ンディング電極を構成する金属(通常ではA u / 
P t / T iの多層構造)との密着強度に十分な
ものを得ることができない。
このため、ボンディング電極12に熱、圧力、振動等を
印加して金属細線のボンディングを行うと、この時のス
トレスによってボンディング電極12が基板11との界
面において剥離し、半導体装置の損傷を招くという問題
が生じている。
また、第3図に示したシリコン酸化膜13上にボンディ
ング電極14を形成した構造においても、ボンディング
電極14とシリコン酸化膜13との密着強度が低く、前
述と同様にボンディング電極の剥離が生じ易い。
これに対し、シリコン酸化膜に代えてシリコン窒化膜を
用いた構造では、シリコン窒化膜とボンディング電極と
の密着強度に十分なものが得られてその剥離は防止でき
るものの、基板のGaAsとシリコン窒化膜との密着強
度が十分でないために、これらの界面において剥離が生
じ、結果としてボンディング電極が剥離されることにな
る。
〔問題点を解決するための手段〕
本発明の半導体装置は、ボンディング電極の剥離による
半導体装置の損傷を防止するために、GaAs上にシリ
コン酸化膜、シリコン窒化膜を2層構造に構成し、この
2層構造膜上に金属膜のボンディング電極を形成したボ
ンディング電極構造を備えている。
〔実施例〕
次に、本発明を図面を参照して説明する。
第1図は本発明の一実施例の要部の断面図である。図の
ように、例えばGaAsFET等の半導体装置の基板と
してのGaAs半絶縁性基板1の表面にシリコン酸化膜
2を被着し、さらにその上にシリコン窒化膜3を重ねて
被着し、これらシリコン酸化膜2とシリコン窒化膜3の
2層構造膜4を形成している。これらシリコン酸化膜2
やシリコン窒化膜3の被着には、CVD法やスパッタ法
等の通常採用される方法をそのまま利用することができ
る。そして、この2層構造膜4の上にチタン(Ti)膜
6、白金(Pt)膜7及び金(Au)膜8をスパッタ法
や真空蒸着法等により順次被着して積層形成し、しかる
上でフォトリソグラフィ技術等を用いてこれらを一体的
に所定形状にパターン形成することによりボンディング
電極5を形成している。
なお、このボンディング電極5と同時に図外のGaAs
FETの他の電極や配線を形成していることは言うまで
もない。
したがって、この構成によればボンディング電極5はそ
の直下の下地膜としてシリコン窒化膜3が用いられてい
るために、両者の密着強度に十分なものが得られる。ま
た、シリコン窒化膜3はシリコン酸化膜2との密着性が
良好であるとともに、GaAs半絶縁性基板1との間に
はシリコン酸化膜2を介在させているために、シリコン
酸化膜2とGaAs半絶縁性基板1との高密着強度によ
って、シリコン窒化膜3の基板1に対する密着強度も間
接的に増大されることになる。
このため、図外の外部導出リード等との間に接続される
金属細線を接続する際の熱、圧力、振動等が印加されて
そのストレスがボンディング電極5に影響しても、ボン
ディング電極5がシリコン窒化膜3との間で剥離される
ことはなく、またシリコン窒化膜3やシリコン酸化膜2
と基板1との間で剥離されることもない。これにより、
ボンディング電極5が基板1から剥離されることを確実
に防止し、半導体装置の損傷を防止してその信転性を向
上することができる。
なお、GaAs半絶縁性基板に代えて、低不純物濃度G
aAsバッファ層上にボンディング電極を形成する場合
も全く同じである。また、ボンディング電極は他の金属
或いは他の金属の多層構造に構成することも勿論可能で
ある。
〔発明の効果〕
以上説明したように本発明は、半導体装置の基板として
のGaAs上にシリコン酸化膜、シリコン窒化膜を2層
構造に構成し、この2層構造膜上に金属膜のボンディン
グ電極を形成しているので、ボンディング電極とシリコ
ン窒化膜との間、シリコン窒化膜とシリコン酸化膜及び
基板との間の各密着強度によって、基板に対するボンデ
ィング電極の直接的及び間接的な密着強度を増大させ、
これにより金属細線のボンディングによってもボンディ
ング電極の剥離を防止でき、その損傷を防止して信頼性
の高い半導体装置を得ることができる。
【図面の簡単な説明】
第1図は本発明の一実施例の要部の断面図、第2図は従
来構造の一部の断面図、第3図は異なる従来構造の一部
の断面図である。 1.11−・GaAs半絶縁性基板(G a A sバ
ッファ層)、2・・・シリコン酸化膜、3・・・シリコ
ン窒化膜、4・・・2層構造膜、5・・・ボンディング
電極、6・・・チタン膜、7・・・白金膜、8・・・金
膜、12.14・・・ボンディング電極、13・・・シ
リコン酸化膜(シリコン窒化膜)。 第1図 第2図 第3図

Claims (1)

  1. 【特許請求の範囲】 1、GaAsを半導体装置の基板として構成した半導体
    装置において、前記GaAs基板上にシリコン酸化膜、
    シリコン窒化膜を被着積層した2層構造膜を形成し、こ
    の2層構造膜上に金属膜からなるボンディング電極を形
    成したことを特徴とする半導体装置。 2、ボンディング電極は、チタン、白金、金の多層金属
    構造に構成してなる特許請求の範囲第1項記載の半導体
    装置。
JP60199972A 1985-09-09 1985-09-09 半導体装置 Pending JPS6260249A (ja)

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JP60199972A JPS6260249A (ja) 1985-09-09 1985-09-09 半導体装置

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JP60199972A JPS6260249A (ja) 1985-09-09 1985-09-09 半導体装置

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Publication Number Publication Date
JPS6260249A true JPS6260249A (ja) 1987-03-16

Family

ID=16416651

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JP60199972A Pending JPS6260249A (ja) 1985-09-09 1985-09-09 半導体装置

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5477569A (en) * 1977-12-02 1979-06-21 Nec Corp Production of semiconductor element

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5477569A (en) * 1977-12-02 1979-06-21 Nec Corp Production of semiconductor element

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