JPS6271255A - 注入された抵抗器の製作方法および半導体抵抗器 - Google Patents

注入された抵抗器の製作方法および半導体抵抗器

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JPS6271255A
JPS6271255A JP61157151A JP15715186A JPS6271255A JP S6271255 A JPS6271255 A JP S6271255A JP 61157151 A JP61157151 A JP 61157151A JP 15715186 A JP15715186 A JP 15715186A JP S6271255 A JPS6271255 A JP S6271255A
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パオロ・フエラーリ
フランコ・ベルトツチ
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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  • Apparatuses And Processes For Manufacturing Resistors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は注入された抵抗器を製作する方法およびその
方法で得られる抵抗器に関するものである。
周知のように、たとえばトランジスタのような能動構成
要素に回路的に接続される集積した抵抗回路の構成要素
として使用するための、半導体サブストレートまたはチ
ップ内の抵抗要素、特に高オーム値の抵抗器を製作する
ために、いくつかの技術が現在採用されており、それら
の最も一般的なものはエミッタ領域の拡散に続いて、そ
のような抵抗器を製作すること、すなわちその工程の終
、わりに製作することど、ベースおよびエミッタ領域の
生成および拡散の前にそれらを製作することである。
先行技術の前者の方法では、抵抗器は一般的にフィール
ドの酸化物上でフォト処理によって一般的に得られ、そ
れはかなりの厚みを有する。この事実は抵抗器を横切る
いかなる金属層または接続(これより先は「金属」とす
る)の遮断の問題を引き起こし、さらに、もしその抵抗
器を横切る金属が高電位であるなら、抵抗器のオーム値
の不所望な変化もまた起こるかもしれない。
逆もまた同様で、上で述べられた後者の先行技術の方法
では、述べられたようにベースおよびエミッタ領域の生
成および拡散の後で抵抗器が生成される。この場合、抵
抗のオーム値が、連続的な酸化のような熱処理に依存す
るといった実質的な欠点に遭遇する。
したがって、この発明の狙いは注入された抵抗器を製作
する方法を提供することであって、それによって先行の
方法に影響を及ぼす欠点は除去され得る。
上の狙いの中で、この発明の主たる目的は、抵抗器自身
を横切るいかなる金属の遮断も引き起こさず、そしてそ
れらの値を変化させ得る高電位の金属によって影響され
ない、高値のそして最少の負担の抵抗器を与える、示さ
れたような方法を提供することである。
この発明の別の目的は、半導体本体の連続的な酸化のよ
うな処理から独立して抵抗器を製作することができる、
示されたような方法を提供することである。
この発明の少なからぬ目的1区、最少の工程の数を含み
、そして従来の技術および装置を利用して非常に経済的
な方法で実現され得る、示されたような方法を提供する
ことである。
この発明に従えば、上記の狙いおよび目的はこれより先
に明らかとなる他の目的とともに、注入した抵抗器、特
に、注入した高オーム値の抵抗器を製作する方法によっ
て達成され、その方法は順に、周知の技術で高抵抗値ゾ
ーンを半導体領域内に注入する第1の工程を含み、その
高抵抗値ゾーンは設定された幅および長さを有し、さら
に、設定された厚みを有する多結晶シリコン層を生成し
、それによって前記高抵抗値ゾーンを完全に覆う第2の
工程と、前り己半導体領域内に設定された導電率および
ドーピングを有するさらに別のゾーンの生成および拡散
の少なくとも1つの第3の工程とを含む。
この発明のさらに別の特徴および利点は、この1つの図
を参照して以下の詳細な説明から明らかとなり、その図
はこの発明に従った半導体チップ内に注入された高値の
抵抗器の拡大した断面図を示す。
引用された図面を特に参照すると、この発明に従って半
導体サブストレート内に注入された最少の負担の高オー
ム値抵抗器を製作する方法は、周知の技術で参照番号1
で一般に示される半導体サブストレート内に、参照番号
2で一般に示されるたとえばP型の高抵抗値ゾーンを注
入する第1の工程を含み、そのゾーンは要求される抵抗
値をもとにして設定される幅および長さを有する。特に
、高抵抗値ゾーンはフォトリソグラフィの工程で得られ
るマスクを通して、半導体チップ(サブストレート1)
の表面上への硼素注入によって得ることができる。
この発明に従えば、その抵抗ゾーン2を注入した後に多
結晶シリコン3が生成され、それは抵抗ゾーン2を完全
に覆う。ポリシリコン層3の厚みもまた特定の要求に合
うように設定される。図面から、抵抗ゾーン2はその端
部に近接して、たとえばこれもまたP型の2つのゾーン
4および5を有することがわかり、これらは形成される
抵抗要素2の端子を規定するように適合される。引き続
き、方法のさらに他の工程では、たとえばベースおよび
エミッタゾーンが形成されてもよく、これらは詳細に説
明されていないが、設定されたドーピングおよび導電率
を有してもよい。
こうして、酸化はポリシリコン上になされるので、結果
として生じる抵抗器2はいかなる連続の酸化処理からも
特に独立しており、そこからの影響を受は得ない。二酸
化シリコンの上部絶縁層は参照番号6で図に示されてい
る。
当業者が認めるであろうように、ポリシリコンは抵抗器
を横切るいかなる高電位金属に対してもスクリーンとし
ての働きをする。さらに、この発明の方法は上で述べら
れたような先行技術の重大な欠点を示していた、抵抗器
を横切るいかなる金属の起こりうる亀裂の問題も解決す
る。
この発明のために、たとえば1キロオーム/′平方の高
値の抵抗要素を得ることが可能であることが実際に発見
され、その値は引用された外部の影響にかかわらず、実
質的に一定のままである。
この発明が前に述べられた目的を完全に達成することが
前述のことから認められるであろう。
特に、この発明に従った方法は一般にはチップサブスト
レート内に集積された素子の完成前に、たとえばベース
およびエミッタの生成および拡散の前に、抵抗器が形成
される、以前に示された方法の第2のクラスに入るとし
ても、連続した処理から独立し、最少の負担の高値の注
入された抵抗器を与える、特定のポリシリコン生成工程
を提供し、そして以前に述べられた利点のすべてを有す
るという点でその方法のクラスからはずれている。
この発明はそれの特定の実施例を参照して説明されたが
、この発明の概念の範囲内の修正および変化が可能であ
ることが理解される。例として、その方法は異なる高オ
ーム値を有する複数個の抵抗器を同時に製作するように
たやすく拡張されてもよい。
【図面の簡単な説明】
図面は半導体チップ内に注入された拡大された高値の抵
抗器の断面図である。 図において、1は半導体サブストレート、2はP型窩抵
抗値ゾーン、3は多結晶シリコン、4および5はP型の
ゾーン、6は二酸化シリコンである。 特許出願人 エッセ・ジ・エッセ・ミクロエレットロ二
−力−エッセ争ビ・ア

Claims (4)

    【特許請求の範囲】
  1. (1)注入された抵抗器、特に、注入された高オーム値
    抵抗器を製作する方法であって、周知の技術で半導体領
    域に高抵抗値ゾーンを注入する第1の工程を含み、前記
    高抵抗値ゾーンは設定された幅および長さを有し、設定
    された厚みを有する多結晶シリコンの層を生成し、それ
    によって前記高抵抗値ゾーンを完全に覆う第2の工程と
    、前記半導体領域内に設定された導電率とドーピングを
    有するさらに他のゾーンの生成および拡散の少なくとも
    1つの第3の工程とを順に含む、方法。
  2. (2)設定された導電率およびドーピングを有する前記
    さらに他のゾーンがベースおよびエミッタゾーンである
    ことを特徴とする、特許請求の範囲第1項に記載の方法
    。
  3. (3)酸化工程が前記多結晶シリコン層の上で実行され
    る、特許請求の範囲第1項に記載の方法。
  4. (4)半導体領域に注入される設定された長さおよび幅
    の抵抗ゾーンを有し、前記抵抗ゾーンが生成されたシリ
    コン層で完全に覆われることを特徴とし、前記抵抗ゾー
    ンは実質的に1キロオーム/平方のオーム値を有する、
    先行の特許請求の範囲のいずれかに従った方法で作られ
    た注入された抵抗器、特に高オーム値抵抗器。
JP61157151A 1985-07-04 1986-07-02 注入された抵抗器の製作方法および半導体抵抗器 Expired - Fee Related JPH0746716B2 (ja)

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IT8521433A IT1214621B (it) 1985-07-04 1985-07-04 Procedimento per realizzare una resistenza di alto valore ohmico e minimo ingombro impiantata in un corpo di semiconduttore, e resistenza ottenuta.
IT21433A/85 1985-07-04

Publications (2)

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JPH0746716B2 JPH0746716B2 (ja) 1995-05-17

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DE (1) DE3621351C2 (ja)
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NL8601663A (nl) 1987-02-02
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