JPS6281176A - 同期制御回路 - Google Patents
同期制御回路Info
- Publication number
- JPS6281176A JPS6281176A JP60220701A JP22070185A JPS6281176A JP S6281176 A JPS6281176 A JP S6281176A JP 60220701 A JP60220701 A JP 60220701A JP 22070185 A JP22070185 A JP 22070185A JP S6281176 A JPS6281176 A JP S6281176A
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- JP
- Japan
- Prior art keywords
- pulse
- signal
- field
- input signal
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Synchronizing For Television (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はテレビセット、映像再生装置等から供給される
入力信号のコンポジットビデオ信号から分離した同期信
号を利用してＣＲＴコントローラを制御する同期制御回
路に関するものである。
入力信号のコンポジットビデオ信号から分離した同期信
号を利用してＣＲＴコントローラを制御する同期制御回
路に関するものである。
従来の技術
従来の同期制御回路では、第３図に示すように同期分離
回路８によって信号源７０入力信号から分離した同期信
号だけを、制御回路９を通してＣＲＴコントローラ１０
の制御に利用していた〔ビデオディスプレイプロセッサ
・システムデザインハンドブック、；日本テキサス・イ
ンスツルメンツ株式会社編、Ｐ７０）。
回路８によって信号源７０入力信号から分離した同期信
号だけを、制御回路９を通してＣＲＴコントローラ１０
の制御に利用していた〔ビデオディスプレイプロセッサ
・システムデザインハンドブック、；日本テキサス・イ
ンスツルメンツ株式会社編、Ｐ７０）。
しかし、例えばビデオテープレコーダのよウナ映像再生
装置から供給され、″映像再生装置が特殊再生状態にあ
る場合は入力信号となるコンポジットビデオ信号の垂直
同期期間に水平同期信号および等価パルスが含まれない
と共にフィールド毎の水平パルス数が一定しないため、
安定した同期を得るには映像再生装置から供給される入
力信号の垂直同期期間に水平同期信号および等価パルス
が含まれていない状態における対策が必要になるが、従
来回路では考慮されていない。
装置から供給され、″映像再生装置が特殊再生状態にあ
る場合は入力信号となるコンポジットビデオ信号の垂直
同期期間に水平同期信号および等価パルスが含まれない
と共にフィールド毎の水平パルス数が一定しないため、
安定した同期を得るには映像再生装置から供給される入
力信号の垂直同期期間に水平同期信号および等価パルス
が含まれていない状態における対策が必要になるが、従
来回路では考慮されていない。
発明が解決１．ようとする問題点
このような従来の回路では、入力信号を単に水平同期信
号と垂直同期信号に分離した信号を利用するだけであり
、映像再生装置から供給される入力信号の垂直同期期間
に水平同期信号および等価パルスが含まれていない状態
を検出してＣＲＴ″：１ントローラのフレームの開始を
制御することが出来ない。
号と垂直同期信号に分離した信号を利用するだけであり
、映像再生装置から供給される入力信号の垂直同期期間
に水平同期信号および等価パルスが含まれていない状態
を検出してＣＲＴ″：１ントローラのフレームの開始を
制御することが出来ない。
本発明はかかる点に鑑みてなされたもので、映像再生装
置から供給される入力信号の垂直同期期間に水平同期信
号および等価パルスが含まれていない場合に対応出来る
同期制御回路を提供することを目的としている。
置から供給される入力信号の垂直同期期間に水平同期信
号および等価パルスが含まれていない場合に対応出来る
同期制御回路を提供することを目的としている。
問題点を解決するための手段
本発明は上記問題点を解決するため、垂直同期期間にお
ける水平同期信号および等価パルスの欠落を検出するパ
ルス欠落検出回路により、映像再生装置から供給される
入力信号の垂直同期期間に水平同期信号および等価パル
スが含まれていない時はフィールド毎に制御パルスを出
力するものである。
ける水平同期信号および等価パルスの欠落を検出するパ
ルス欠落検出回路により、映像再生装置から供給される
入力信号の垂直同期期間に水平同期信号および等価パル
スが含まれていない時はフィールド毎に制御パルスを出
力するものである。
作用
本発明は上記した構成によりパルス欠落検出回路出力信
号によって制御された制御パルス信号が得られるため、
入力信号の垂直同期期間に水平同期信号および等価パル
スが含まれていない状態においてもＣＲＴコントローラ
のフレームの開始を正確に制御することが出来る。
号によって制御された制御パルス信号が得られるため、
入力信号の垂直同期期間に水平同期信号および等価パル
スが含まれていない状態においてもＣＲＴコントローラ
のフレームの開始を正確に制御することが出来る。
実施例
第１図は本発明の同期制御回路の一実施例を示すブロッ
ク図である。第１図において、１は信号源、２は同期分
離回路であシ、信号源１から供給される入力信号のコン
ポジットビデオ信号は同期分離回路２で複合同期信号と
垂直同期信号に分離され、複合同期信号はフィールド選
択回路３とパルス欠落検出回路４に供給される。
ク図である。第１図において、１は信号源、２は同期分
離回路であシ、信号源１から供給される入力信号のコン
ポジットビデオ信号は同期分離回路２で複合同期信号と
垂直同期信号に分離され、複合同期信号はフィールド選
択回路３とパルス欠落検出回路４に供給される。
このとき、例えば第２図に示す回路でパルス欠落検出回
路４を構成し水平同期信号の周期をＴｈｗ、垂直同期信
号の周期をＴｖｗとして再トリガ可能な第１のモノステ
ーブル−マルチバイブレータ４ａの出力パルス幅ＴＷ１
をＴｈｗ（Ｔｗｌ（２Ｔｈｗ。
路４を構成し水平同期信号の周期をＴｈｗ、垂直同期信
号の周期をＴｖｗとして再トリガ可能な第１のモノステ
ーブル−マルチバイブレータ４ａの出力パルス幅ＴＷ１
をＴｈｗ（Ｔｗｌ（２Ｔｈｗ。
おなじく再トリガ可能な第２のモノステープル・マルチ
バイブレータ４ｂの出力パルス幅Ｔｗ２をＴ ｖｗ （
Ｔ Ｗ ２ ＜ ２ Ｔ ｖｗに設定すると、信号源１
として使用される映像再生装置から供給される入力信号
の垂直同期期間に水平同期信号および等価パルスが含ま
れていない時はパルス欠落検出回路４に供給される複合
同期信号の垂直同期期間にも水平同期信号および等価パ
ルスが存在しないことから、第１のモノステーブル・マ
ルチバイブレータ４ａの出力が周期Ｔｖｗのパルス信号
になるためパルス欠落検出回路４の出力端子４２はｒＬ
Ｊになり、映像再生装置から供給される入力信号の垂直
同期期間に水平同期信号および等価パルスが含まれてい
る時は第１のモノステープル・マルチバイブレータ４ａ
の出力がｒＨＪに固定されるため出力端子４２はｒＨＪ
になる。このように信号源１として使用される映像再生
装置から供給される入力信号の垂直同期期間に水平同期
信号および等価パルスが含まれるか否かによってパルス
欠落検出回路４の出力が異なる。
バイブレータ４ｂの出力パルス幅Ｔｗ２をＴ ｖｗ （
Ｔ Ｗ ２ ＜ ２ Ｔ ｖｗに設定すると、信号源１
として使用される映像再生装置から供給される入力信号
の垂直同期期間に水平同期信号および等価パルスが含ま
れていない時はパルス欠落検出回路４に供給される複合
同期信号の垂直同期期間にも水平同期信号および等価パ
ルスが存在しないことから、第１のモノステーブル・マ
ルチバイブレータ４ａの出力が周期Ｔｖｗのパルス信号
になるためパルス欠落検出回路４の出力端子４２はｒＬ
Ｊになり、映像再生装置から供給される入力信号の垂直
同期期間に水平同期信号および等価パルスが含まれてい
る時は第１のモノステープル・マルチバイブレータ４ａ
の出力がｒＨＪに固定されるため出力端子４２はｒＨＪ
になる。このように信号源１として使用される映像再生
装置から供給される入力信号の垂直同期期間に水平同期
信号および等価パルスが含まれるか否かによってパルス
欠落検出回路４の出力が異なる。
また、フィールド選択回路３は入力信号のフィールドが
第１フィールドか第２フィールドかを選択する回路であ
シ、例えば第１フィールドと第２フィールドの等価パル
ス期間において垂直同期信号が始まるまでのＴｈＷ／２
周期のパルス数の相違を検出することで選択することが
出来る。即ち、第１フィールドではＴｈｗ／２周期のパ
ルス数が偶数個になり第２フィールドの時は奇数個にな
るため、この相違を利用し前記のパルス数が偶数個であ
る第１フィールドの時はフィールド選択回路３の出力が
「Ｈ」（又は「Ｌ」）で、奇数個である第２フィールド
の時は「Ｌ」（又は「Ｈ」）になるフィールド選択回路
３を構成している。
第１フィールドか第２フィールドかを選択する回路であ
シ、例えば第１フィールドと第２フィールドの等価パル
ス期間において垂直同期信号が始まるまでのＴｈＷ／２
周期のパルス数の相違を検出することで選択することが
出来る。即ち、第１フィールドではＴｈｗ／２周期のパ
ルス数が偶数個になり第２フィールドの時は奇数個にな
るため、この相違を利用し前記のパルス数が偶数個であ
る第１フィールドの時はフィールド選択回路３の出力が
「Ｈ」（又は「Ｌ」）で、奇数個である第２フィールド
の時は「Ｌ」（又は「Ｈ」）になるフィールド選択回路
３を構成している。
制御回路６において久方信号源１として使用される映像
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれている時はフレーム
毎で第１フィールドのみ制御パルス信号を出力し、映像
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれていない時にはフィ
ールド毎に制御パルスを出力することが、前記のフィー
ルド選択回路３とパルス欠落検出回路４の各出力を利用
することで可能になる。
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれている時はフレーム
毎で第１フィールドのみ制御パルス信号を出力し、映像
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれていない時にはフィ
ールド毎に制御パルスを出力することが、前記のフィー
ルド選択回路３とパルス欠落検出回路４の各出力を利用
することで可能になる。
従って、フィールド選択回路３とパルス欠落検出回路４
の出力により、ＣＲＴコントローラ６に制御パルスを供
給する制御回路６を制御するため、ＣＲＴコントローラ
６のフレームの開始をそれぞれの状態に応じて正確に制
御することが出来る。
の出力により、ＣＲＴコントローラ６に制御パルスを供
給する制御回路６を制御するため、ＣＲＴコントローラ
６のフレームの開始をそれぞれの状態に応じて正確に制
御することが出来る。
発明の効果
以上述べてきたように、本発明によれば、信号源の映像
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれていない状態に対応
した制御パルスが供給出来るため、よシ安定に精度良（
ＣＲＴコントローラのフレームの開始を制御することが
出来る。
再生装置から供給される入力信号の垂直同期期間に水平
同期信号および等価パルスが含まれていない状態に対応
した制御パルスが供給出来るため、よシ安定に精度良（
ＣＲＴコントローラのフレームの開始を制御することが
出来る。
第１図は本発明の一実施例における同期制御回路のブロ
ック図、第２図は同回路におけるパルス欠落回路の回路
図、第３図は従来の同期制御回路のブロック図である。 ２・・・・・・同期分離回路、４・・・・・・パルス欠
落検出回路、５・−・・・・制御回路、５１・−・・・
・出力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 第３図 ７ Ｂ ’？ ｔ。
ック図、第２図は同回路におけるパルス欠落回路の回路
図、第３図は従来の同期制御回路のブロック図である。 ２・・・・・・同期分離回路、４・・・・・・パルス欠
落検出回路、５・−・・・・制御回路、５１・−・・・
・出力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 第３図 ７ Ｂ ’？ ｔ。
Claims (2)
- （１）信号源となる映像再生装置から供給される入力信
号の垂直同期期間における水平同期信号および等価パル
スの欠落を検出するパルス欠落検出回路を設け、垂直同
期期間に水平同期信号および等価パルスが存在しない場
合に、前記パルス欠落検出回路の出力によって前記入力
信号から分離した垂直同期信号を制御信号として出力す
ることを特徴とする同期制御回路。 - （２）入力信号のフィールドが第１フィールドか第２フ
ィールドかを検出するフィールド選択回路の制御を受け
、前記入力信号の垂直同期期間に水平同期信号および等
価パルスが含まれていない時はフィールド毎に制御パル
スを出力し、前記入力信号の垂直同期期間に水平同期信
号および等価パルスが含まれている時はフレーム毎に制
御パルスを出力することを特徴とする特許請求の範囲第
１項の同期制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60220701A JPS6281176A (ja) | 1985-10-03 | 1985-10-03 | 同期制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60220701A JPS6281176A (ja) | 1985-10-03 | 1985-10-03 | 同期制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6281176A true JPS6281176A (ja) | 1987-04-14 |
Family
ID=16755136
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60220701A Pending JPS6281176A (ja) | 1985-10-03 | 1985-10-03 | 同期制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6281176A (ja) |
-
1985
- 1985-10-03 JP JP60220701A patent/JPS6281176A/ja active Pending
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