JPS6388829A - 気相成長方法 - Google Patents
気相成長方法Info
- Publication number
- JPS6388829A JPS6388829A JP61233504A JP23350486A JPS6388829A JP S6388829 A JPS6388829 A JP S6388829A JP 61233504 A JP61233504 A JP 61233504A JP 23350486 A JP23350486 A JP 23350486A JP S6388829 A JPS6388829 A JP S6388829A
- Authority
- JP
- Japan
- Prior art keywords
- heat treatment
- film
- psg
- vapor phase
- approximately
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Formation Of Insulating Films (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、半導体装置の製造工程における半導体ウェハ
ー上に薄膜を成長させる気相成長方法に関するものであ
る。
ー上に薄膜を成長させる気相成長方法に関するものであ
る。
従来の技術
近年、デバイスの高集積化及び高速化の対応が最も大き
な関心事項として挙げられるが、特にMOS −L S
Iの製造工程において、気相成長装置は、選択的にフ
ィールド酸化膜を形成する際の2へ−7 マスクとなる813N4膜(シリコン窒化膜)、あるい
はゲート電極となるPo 1 yS i膜(多結晶シリ
コン膜)等、更には多層配線間の層間絶縁膜となるPS
G膜(リン硅酸ガラス膜)、P−8iN膜(プラズマシ
リコン窒化膜)等の薄膜を形成するために用いられ、ゲ
ート電極となるPo l yS i膜を成長させた後、
熱酸化、 813N4膜成長後、PSG膜やBPSG膜
(ボロンリン硅酸ガラス膜)を気相成長させ熱処理によ
り平坦化させる工程も多く用いられているが、気相成長
時のPSG膜やBPSG膜のステップカバレッジ(段差
被覆特性)が平坦化の度合に影響を及ぼすことは明らか
である。
な関心事項として挙げられるが、特にMOS −L S
Iの製造工程において、気相成長装置は、選択的にフ
ィールド酸化膜を形成する際の2へ−7 マスクとなる813N4膜(シリコン窒化膜)、あるい
はゲート電極となるPo 1 yS i膜(多結晶シリ
コン膜)等、更には多層配線間の層間絶縁膜となるPS
G膜(リン硅酸ガラス膜)、P−8iN膜(プラズマシ
リコン窒化膜)等の薄膜を形成するために用いられ、ゲ
ート電極となるPo l yS i膜を成長させた後、
熱酸化、 813N4膜成長後、PSG膜やBPSG膜
(ボロンリン硅酸ガラス膜)を気相成長させ熱処理によ
り平坦化させる工程も多く用いられているが、気相成長
時のPSG膜やBPSG膜のステップカバレッジ(段差
被覆特性)が平坦化の度合に影響を及ぼすことは明らか
である。
以下図面を参照しながら、上述した従来の気相成長方法
及び平坦化熱処理の一例について説明する。
及び平坦化熱処理の一例について説明する。
第3図は従来の気相成長方法及び平坦化熱処理のフロー
チャートを示すものである。
チャートを示すものである。
第3図において、表面段差を有した半導体基板上に常圧
もしくは減圧の気相成長装置により、360°C〜45
0″Cの温度条件で5in4(シフ y ) 、 PH
33 へ−/ (ホスフィン)、B2H6(ジボラン)、02(酸素)
及びN2(窒素)等の不活性ガスを供給して、PSG又
はBPSGが気相成長され、次に熱処理装置により、1
b/crti以上の高圧雰囲気900〜1100°C
の温度条件で熱処理される。第4図は、第3図のフロー
チャートに基づき、処理された前記シリコンウェハー上
のステップカバレッジの概略図を示すものであり、アス
ペクト比や気相成長前の段差の形状により、第4図に示
す様な形状となる。第4図において、1は半導体基板、
2は表面段差、3は気相成長膜、4はボイド(空洞)で
ある。
もしくは減圧の気相成長装置により、360°C〜45
0″Cの温度条件で5in4(シフ y ) 、 PH
33 へ−/ (ホスフィン)、B2H6(ジボラン)、02(酸素)
及びN2(窒素)等の不活性ガスを供給して、PSG又
はBPSGが気相成長され、次に熱処理装置により、1
b/crti以上の高圧雰囲気900〜1100°C
の温度条件で熱処理される。第4図は、第3図のフロー
チャートに基づき、処理された前記シリコンウェハー上
のステップカバレッジの概略図を示すものであり、アス
ペクト比や気相成長前の段差の形状により、第4図に示
す様な形状となる。第4図において、1は半導体基板、
2は表面段差、3は気相成長膜、4はボイド(空洞)で
ある。
発明が解決しようとする問題点
しかしながら上記のような方法で気相成長後、平坦化熱
処理されたPSGやBPSG膜は、気相成長時の下地ス
テップに対するオーパーツ・ングの形状のまま熱処理さ
れているので、膜中にボイド(空洞)を含み、後工程で
のアルミ電極配線が断線するという問題点を有していた
。
処理されたPSGやBPSG膜は、気相成長時の下地ス
テップに対するオーパーツ・ングの形状のまま熱処理さ
れているので、膜中にボイド(空洞)を含み、後工程で
のアルミ電極配線が断線するという問題点を有していた
。
本発明は上記問題点に鑑み、表面段差を平坦化するため
に用いられるPSGやBPSG膜にボイドを発生させな
い気相成長を可能にするものである。
に用いられるPSGやBPSG膜にボイドを発生させな
い気相成長を可能にするものである。
問題点を解決するための手段
上記問題点を解決するために本発明の気相成長方法は、
PSGやBPSCiなどの珪酸ガラス膜によシ平坦化す
る工程において、気相成長と熱処理を2回以上繰り返し
て行なうものである。
PSGやBPSCiなどの珪酸ガラス膜によシ平坦化す
る工程において、気相成長と熱処理を2回以上繰り返し
て行なうものである。
作 用
本発明は上記した方法によって、気相成長膜の成長時の
オーバー・・ングを徐々に少なくし、最終的に平坦化さ
れた膜中でのボイド発生を抑制することができる。
オーバー・・ングを徐々に少なくし、最終的に平坦化さ
れた膜中でのボイド発生を抑制することができる。
実施例
以下本発明の実施例の気相成長方法について、図面を参
照しながら説明する。第1図は本発明の気相成長方法を
用いた場合のフローチャート図、第2図(a)〜(d)
は第1図に示す各工程のステップカバレッジの形状の概
略図を示すものである。
照しながら説明する。第1図は本発明の気相成長方法を
用いた場合のフローチャート図、第2図(a)〜(d)
は第1図に示す各工程のステップカバレッジの形状の概
略図を示すものである。
第1図および第2図において、表面段差5を有したシリ
コンウェハー6上にまず、減圧CVDにより、温度40
0°C2圧力0.3 ton 、 S iH4゜5 ペ
ージ PH3,02供給して、約3000への第1PSG7が
成長し、次に熱処理装置によシ、約5 b/crAの高
圧雰囲気下でN2と02を用いて900°Cで、第1熱
処理を行ない、更に、上記減圧CVDによシ約6000
人の第2PSG8を成長し、最後に上記熱処理装置によ
り、第2熱処理を行なった。
コンウェハー6上にまず、減圧CVDにより、温度40
0°C2圧力0.3 ton 、 S iH4゜5 ペ
ージ PH3,02供給して、約3000への第1PSG7が
成長し、次に熱処理装置によシ、約5 b/crAの高
圧雰囲気下でN2と02を用いて900°Cで、第1熱
処理を行ない、更に、上記減圧CVDによシ約6000
人の第2PSG8を成長し、最後に上記熱処理装置によ
り、第2熱処理を行なった。
以上のように本実施例によれば、PSGの気相成長と熱
処理を2回繰り返して行なうことによシ、平坦化が徐々
に進行するため、最終的に平坦化された膜中のボイド発
生を抑制することができる。
処理を2回繰り返して行なうことによシ、平坦化が徐々
に進行するため、最終的に平坦化された膜中のボイド発
生を抑制することができる。
なお本実施例においては、PSG膜を成長させる減圧C
VDの場合について述べたが、BPSG膜を成長させる
常圧CVDの場合にも同様に適用できる。
VDの場合について述べたが、BPSG膜を成長させる
常圧CVDの場合にも同様に適用できる。
発明の効果
以上のように本発明は、表面段差を有するシリコンウェ
ハー上をリン又はリン及びボロンを含ん6 t、−ノ テップに対するオーパーツ・ングを徐々に少なくしなが
ら、最終的には平坦化された膜中でのボイド発生を抑制
することにより、後工程でのアルミ電極配線の断線を防
止することができる。
ハー上をリン又はリン及びボロンを含ん6 t、−ノ テップに対するオーパーツ・ングを徐々に少なくしなが
ら、最終的には平坦化された膜中でのボイド発生を抑制
することにより、後工程でのアルミ電極配線の断線を防
止することができる。
第1図は本発明の実施例における気相成長方法を用いた
フローチャート図、第2図(a)〜(d)は第1図に示
す各工程のステップカバレッジ形状の概略ツブカバレッ
ジの形状を示す概略図である。 5・・・・・・表面断差、6・・・・・・シリコンウエ
ノ凡−17・・・・・・第1PSG18・・・・・・第
2PSG。
フローチャート図、第2図(a)〜(d)は第1図に示
す各工程のステップカバレッジ形状の概略ツブカバレッ
ジの形状を示す概略図である。 5・・・・・・表面断差、6・・・・・・シリコンウエ
ノ凡−17・・・・・・第1PSG18・・・・・・第
2PSG。
Claims (1)
- 表面段差を有したシリコンウェハー上にリン又はリン及
びボロンを含んだ珪酸ガラス膜を気相成長させる工程に
おいて、気相成長させた後に熱処理を行う一連の工程を
2回以上繰り返して行なうことにより、前記シリコンウ
ェハーの表面段差を平坦化することを特徴とする気相成
長方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61233504A JPS6388829A (ja) | 1986-10-01 | 1986-10-01 | 気相成長方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61233504A JPS6388829A (ja) | 1986-10-01 | 1986-10-01 | 気相成長方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6388829A true JPS6388829A (ja) | 1988-04-19 |
Family
ID=16956063
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61233504A Pending JPS6388829A (ja) | 1986-10-01 | 1986-10-01 | 気相成長方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6388829A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02151032A (ja) * | 1988-12-02 | 1990-06-11 | Nec Corp | 半導体装置の製造方法 |
| WO1991011023A1 (fr) * | 1990-01-18 | 1991-07-25 | Kabushiki Kaisha Toshiba | Procede de production de dispositifs semi-conducteurs |
| JPH04269420A (ja) * | 1991-02-25 | 1992-09-25 | Oki Electric Ind Co Ltd | プラズマディスプレイパネルの製造方法 |
| WO1997024755A1 (en) * | 1995-12-29 | 1997-07-10 | Lam Research Corporation | Semiconductor structure using modulation doped silicate glasses |
-
1986
- 1986-10-01 JP JP61233504A patent/JPS6388829A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02151032A (ja) * | 1988-12-02 | 1990-06-11 | Nec Corp | 半導体装置の製造方法 |
| WO1991011023A1 (fr) * | 1990-01-18 | 1991-07-25 | Kabushiki Kaisha Toshiba | Procede de production de dispositifs semi-conducteurs |
| JPH04269420A (ja) * | 1991-02-25 | 1992-09-25 | Oki Electric Ind Co Ltd | プラズマディスプレイパネルの製造方法 |
| WO1997024755A1 (en) * | 1995-12-29 | 1997-07-10 | Lam Research Corporation | Semiconductor structure using modulation doped silicate glasses |
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