JP2000284775A - ドットパターンデータ編集方式 - Google Patents
ドットパターンデータ編集方式Info
- Publication number
- JP2000284775A JP2000284775A JP11094005A JP9400599A JP2000284775A JP 2000284775 A JP2000284775 A JP 2000284775A JP 11094005 A JP11094005 A JP 11094005A JP 9400599 A JP9400599 A JP 9400599A JP 2000284775 A JP2000284775 A JP 2000284775A
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- Japan
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- pattern data
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- dot pattern
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- Pending
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- Record Information Processing For Printing (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【課題】 印刷装置や表示装置において、文字パターン
データ等を所望のサイズ及び間隔で貼り付ける処理の高
速化を図る。 【解決手段】 一定サイズのドットパターンデータを行
毎にそのまま書込み、該書込みとは異なるビット長で読
み出すメモリ手段１と、該メモリ手段１から読み出され
るデータを順次パラレル／シリアル変換する手段２と、
該パラレル／シリアル変換手段２の出力シリアルデータ
を順次入力してビットシフトし、所定ビット単位に出力
する手段３とを設ける。
データ等を所望のサイズ及び間隔で貼り付ける処理の高
速化を図る。 【解決手段】 一定サイズのドットパターンデータを行
毎にそのまま書込み、該書込みとは異なるビット長で読
み出すメモリ手段１と、該メモリ手段１から読み出され
るデータを順次パラレル／シリアル変換する手段２と、
該パラレル／シリアル変換手段２の出力シリアルデータ
を順次入力してビットシフトし、所定ビット単位に出力
する手段３とを設ける。
Description
【０００１】
【発明の属する技術分野】本発明は、文字等の印刷装置
や表示装置において、文字や画像等のドットパターンデ
ータを編集して所望の間隔に配置する処理の高速化を可
能とするドットパターンデータ編集方式に関する。
や表示装置において、文字や画像等のドットパターンデ
ータを編集して所望の間隔に配置する処理の高速化を可
能とするドットパターンデータ編集方式に関する。
【０００２】
【従来の技術】印刷装置や表示装置において、例えば文
字パターン記憶装置に格納された文字「Ａ」のドットパ
ターンデータを、限定した文字サイズ及び限定した間隔
で「ＡＡＡ」と貼り付けるとする。文字「Ａ」のドット
パターンデータは、ＲＯＭ等の文字パターン記憶装置
（キャラクタジェネレータ）上に、図３（ａ）に示すよ
うに、例えば１００番地から１９５番地までの８ビット
データ長のデータ領域を持つメモリデータとして、
「０」、「１」の情報で格納されている。この「Ａ」の
文字パターンは、図３（ｂ）のように、縦２４ドット×
横３２ドットで構成されている。この縦２４ドット×横
３２ドットの文字「Ａ」を、例えば図４（ａ）に示すよ
うに、横１８ドット毎に「ＡＡＡ」と貼り付ける場合、
貼り付け後の文字パターンイメージは図４（ｂ）のよう
になる。
字パターン記憶装置に格納された文字「Ａ」のドットパ
ターンデータを、限定した文字サイズ及び限定した間隔
で「ＡＡＡ」と貼り付けるとする。文字「Ａ」のドット
パターンデータは、ＲＯＭ等の文字パターン記憶装置
（キャラクタジェネレータ）上に、図３（ａ）に示すよ
うに、例えば１００番地から１９５番地までの８ビット
データ長のデータ領域を持つメモリデータとして、
「０」、「１」の情報で格納されている。この「Ａ」の
文字パターンは、図３（ｂ）のように、縦２４ドット×
横３２ドットで構成されている。この縦２４ドット×横
３２ドットの文字「Ａ」を、例えば図４（ａ）に示すよ
うに、横１８ドット毎に「ＡＡＡ」と貼り付ける場合、
貼り付け後の文字パターンイメージは図４（ｂ）のよう
になる。
【０００３】図５は、図３（ａ）の文字「Ａ」のパター
ンデータに対して、上記のように１８ビット毎に「ＡＡ
Ａ」と貼り付ける処理を行って、ビットマップメモリな
どに展開したドットパターンデータを示したものであ
る。
ンデータに対して、上記のように１８ビット毎に「ＡＡ
Ａ」と貼り付ける処理を行って、ビットマップメモリな
どに展開したドットパターンデータを示したものであ
る。
【０００４】従来技術では、このようなドットパターン
データの編集は、ソフトウェアにより図６のように処理
することで実現していた。図６は、一例として図５の１
９行目のドットパターンデータの処理を示したもので、
図６（ａ）のように、１９行目（図３（ａ）の１７２番
地）の１文字目データを各ワード単位にＡ１，Ａ２、同
様に２文字目データをＢ１，Ｂ２、３文字目データをＣ
１，Ｃ２とした場合、従来の編集処理は、図６（ｂ）に
示すように、 ステップ：Ａ１を１９行１ワード目へセットする。 ステップ：Ｂ１を右に２ビットシフトした値をＢ’と
する。 ステップ：Ｂ１’を１９行２ワード目へセットする。 ステップ：Ｃ１を右に４ビットシフトした値をＣ’と
する。 ステップ：Ｃ１’を１９行３ワード目ヘセットする。 となる。
データの編集は、ソフトウェアにより図６のように処理
することで実現していた。図６は、一例として図５の１
９行目のドットパターンデータの処理を示したもので、
図６（ａ）のように、１９行目（図３（ａ）の１７２番
地）の１文字目データを各ワード単位にＡ１，Ａ２、同
様に２文字目データをＢ１，Ｂ２、３文字目データをＣ
１，Ｃ２とした場合、従来の編集処理は、図６（ｂ）に
示すように、 ステップ：Ａ１を１９行１ワード目へセットする。 ステップ：Ｂ１を右に２ビットシフトした値をＢ’と
する。 ステップ：Ｂ１’を１９行２ワード目へセットする。 ステップ：Ｃ１を右に４ビットシフトした値をＣ’と
する。 ステップ：Ｃ１’を１９行３ワード目ヘセットする。 となる。
【０００５】
【発明が解決しようとする課題】上述のように、従来技
術では、文字や画像等のドットパターンデータの貼り付
け編集処理は、もっぱらソフトウェアによるビット演算
処理／シフト演算処理の繰り返しであり、処理時間が長
くなる問題があった。
術では、文字や画像等のドットパターンデータの貼り付
け編集処理は、もっぱらソフトウェアによるビット演算
処理／シフト演算処理の繰り返しであり、処理時間が長
くなる問題があった。
【０００６】本発明の目的は、印刷装置や表示装置にお
いて、ＲＯＭ等の文字パターン記憶装置に格納された一
定サイズの文字パターンデータ等を、限定あるいは拡大
した文字サイズ及び限定あるいは引き伸ばした文字間隔
で印刷または表示する場合のイメージデータの編集処理
の高速化を図ることにある。
いて、ＲＯＭ等の文字パターン記憶装置に格納された一
定サイズの文字パターンデータ等を、限定あるいは拡大
した文字サイズ及び限定あるいは引き伸ばした文字間隔
で印刷または表示する場合のイメージデータの編集処理
の高速化を図ることにある。
【０００７】
【課題を解決するための手段】図１に本発明の原理構成
図を示す。図において、１はマスク機能を備えたデュア
ルポートメモリ、２はパラレル／シリアル変換手段、３
はシフトレジスタ、４はシリアル／パラレル変換手段で
ある。デュアルポートメモリ１は、読出し時、読出しデ
ータの一部をマスクするか、あるいはダミービットを付
加することができる。なお、シリアル／パラレル変換手
段４は通常のレジスタで置き換えてもよい。
図を示す。図において、１はマスク機能を備えたデュア
ルポートメモリ、２はパラレル／シリアル変換手段、３
はシフトレジスタ、４はシリアル／パラレル変換手段で
ある。デュアルポートメモリ１は、読出し時、読出しデ
ータの一部をマスクするか、あるいはダミービットを付
加することができる。なお、シリアル／パラレル変換手
段４は通常のレジスタで置き換えてもよい。
【０００８】例えば、縦２４ドット×横３２ドットの文
字パターンデータを１８ドット毎に貼り付ける編集の場
合、各行／各文字毎に２ワード３２ビットずつデュアル
ポードメモリ１にそのまま格納する。デュアルポートメ
モリ１は、この格納された各２ワード３２ビットを順次
並列に読み出すが、この時、不要な１４ビットをマスク
し、残り１８ビットをパラレル／シリアル変換手段２へ
送る。パラレル／シリアル変換手段２は、並列１８ビッ
トを１ビットずつシフトレジスタ３に出力していき、な
くなったら次の１８ビットをデュアルポートメモリ１か
ら入力する。シフトレジスタ３は８ビットになったらシ
リアル／パラレル変換手段へ送る。
字パターンデータを１８ドット毎に貼り付ける編集の場
合、各行／各文字毎に２ワード３２ビットずつデュアル
ポードメモリ１にそのまま格納する。デュアルポートメ
モリ１は、この格納された各２ワード３２ビットを順次
並列に読み出すが、この時、不要な１４ビットをマスク
し、残り１８ビットをパラレル／シリアル変換手段２へ
送る。パラレル／シリアル変換手段２は、並列１８ビッ
トを１ビットずつシフトレジスタ３に出力していき、な
くなったら次の１８ビットをデュアルポートメモリ１か
ら入力する。シフトレジスタ３は８ビットになったらシ
リアル／パラレル変換手段へ送る。
【０００９】図１の構成によれば、文字ドットパターン
データ等を所定間隔に配置するにあたり、文字サイズや
文字間隔を意識せずに、図３（ａ）で示したような文字
ドットパターンデータを、そのまま図７に示すように並
べた如くのイメージで、デュアルポートメモリ１に２ワ
ード３２ビットずつ送るだけで、図５で示したような文
字ドットパターンデータが自動的に作成されることにな
り、処理の高速化が可能となる。また、デュアルポート
メモリ１からの読出しデータにダミービットを付加すれ
ば、逆に元の文字ドットパターンデータに対し伸長した
間隔で貼り付けることも可能である。
データ等を所定間隔に配置するにあたり、文字サイズや
文字間隔を意識せずに、図３（ａ）で示したような文字
ドットパターンデータを、そのまま図７に示すように並
べた如くのイメージで、デュアルポートメモリ１に２ワ
ード３２ビットずつ送るだけで、図５で示したような文
字ドットパターンデータが自動的に作成されることにな
り、処理の高速化が可能となる。また、デュアルポート
メモリ１からの読出しデータにダミービットを付加すれ
ば、逆に元の文字ドットパターンデータに対し伸長した
間隔で貼り付けることも可能である。
【００１０】
【発明の実施の形態】図２に、本発明の一実施の形態の
具体的構成図を示す。図２において、デュアルポートメ
モリ１２、パラレル／シリアル変換器１３、シフトレジ
スタ１７及びシリアル／パラレル変換器１８の構成は図
１と基本的に同じであるが、デュアルポートメモリ１２
はマスク制御ビットによりマスクビット数が任意に変更
可能である。入力ポインタ１１はデュアルポートメモリ
１２のデータ書込み位置を指示し、出力ポインタ１５は
データ読出し位置を指示する。カウンタ１６はクロック
をカウントして、出力ポインタ１５、パラレル／シリア
ル変換器１３、シフトレジスタ１７及びシリアル／パラ
レル変換器１８の動作を制御する。アドレス比較器１４
は入力ポインタ１１と出力ポインタ１５の値を比較し
て、デュアルポートメモリ１２のデータ読出し位置がデ
ータ書込み位置を追い越さないようにカウンタ１６の動
作をオン／オフ制御する。
具体的構成図を示す。図２において、デュアルポートメ
モリ１２、パラレル／シリアル変換器１３、シフトレジ
スタ１７及びシリアル／パラレル変換器１８の構成は図
１と基本的に同じであるが、デュアルポートメモリ１２
はマスク制御ビットによりマスクビット数が任意に変更
可能である。入力ポインタ１１はデュアルポートメモリ
１２のデータ書込み位置を指示し、出力ポインタ１５は
データ読出し位置を指示する。カウンタ１６はクロック
をカウントして、出力ポインタ１５、パラレル／シリア
ル変換器１３、シフトレジスタ１７及びシリアル／パラ
レル変換器１８の動作を制御する。アドレス比較器１４
は入力ポインタ１１と出力ポインタ１５の値を比較し
て、デュアルポートメモリ１２のデータ読出し位置がデ
ータ書込み位置を追い越さないようにカウンタ１６の動
作をオン／オフ制御する。
【００１１】ここでも、文字パターン記憶装置に図３
（ａ）のように格納された文字「Ａ」のデータを、１８
ドット毎に「ＡＡＡ」と貼り付ける場合、図５の１９行
目（図３（ａ）の１７２番地）を例にとり、文字パター
ン記憶装置上の文字データはメモリ入力ポインタ１１に
より制御され、図６に示すように、１文字目データをＡ
１，Ａ２、２文字目データをＢ１，Ｂ２、３文字目デー
タをＣ１，Ｃ２というように、文字パターン記憶装置か
ら１行単位に繰り返し読み出され、デュアルポートメモ
リ１２にはＡ１，Ａ２，Ｂ１，Ｂ２，Ｃ１，Ｃ２の順に
各文字１行ずつ格納する文字イメージデータの編集を説
明する。
（ａ）のように格納された文字「Ａ」のデータを、１８
ドット毎に「ＡＡＡ」と貼り付ける場合、図５の１９行
目（図３（ａ）の１７２番地）を例にとり、文字パター
ン記憶装置上の文字データはメモリ入力ポインタ１１に
より制御され、図６に示すように、１文字目データをＡ
１，Ａ２、２文字目データをＢ１，Ｂ２、３文字目デー
タをＣ１，Ｃ２というように、文字パターン記憶装置か
ら１行単位に繰り返し読み出され、デュアルポートメモ
リ１２にはＡ１，Ａ２，Ｂ１，Ｂ２，Ｃ１，Ｃ２の順に
各文字１行ずつ格納する文字イメージデータの編集を説
明する。
【００１２】デュアルポートメモリ１２からは、マスク
制御ビットの指示に基づき、本例では、出力ポインタ１
５で読出し制御されるデータである１文字目データＡ
１，Ａ２の３２ビットに対して同じく１８ビットを、２
文字目データＢ１，Ｂ２の３２ビットに対して同じく１
８ビットを、３文字目データＣ１，Ｃ２の３２ビットに
対して同じく１８ビットを順次パラレル／シリアル変換
器１３へ送る。出力ポインタ１５は、カウンタ１６によ
り１８ビット毎にポインタアップされる。また、出力ポ
インタ１５が入力ポインタ１１を追い越さないように、
両ポイント値がアドレス比較器１４により比較され、該
アドレス比較器１４の比較出力によりカウンタ１６の動
作のオン／オフ制御を行う。パラレル／シリアル変換器
１３は、デュアルポートメモリ１２からの並列１８ビッ
トを１ビットずつシフトレジスタ１７に積み、シフトレ
ジスタ１７は、カウンタ１６によりカウントされた８ビ
ット毎にシリアル／パラレル変換器１８へ送る。その
後、ＤＲＶ９を介して直ちに８ビット単位に印刷され
る。シリアル／パラレル変換器１８の出力データは、例
えばドライバ等を介して直ちに８ビット単位に印刷され
るか、あるいは、図５に示したようにビットマップメモ
リ上に展開されて表示装置に表示される。
制御ビットの指示に基づき、本例では、出力ポインタ１
５で読出し制御されるデータである１文字目データＡ
１，Ａ２の３２ビットに対して同じく１８ビットを、２
文字目データＢ１，Ｂ２の３２ビットに対して同じく１
８ビットを、３文字目データＣ１，Ｃ２の３２ビットに
対して同じく１８ビットを順次パラレル／シリアル変換
器１３へ送る。出力ポインタ１５は、カウンタ１６によ
り１８ビット毎にポインタアップされる。また、出力ポ
インタ１５が入力ポインタ１１を追い越さないように、
両ポイント値がアドレス比較器１４により比較され、該
アドレス比較器１４の比較出力によりカウンタ１６の動
作のオン／オフ制御を行う。パラレル／シリアル変換器
１３は、デュアルポートメモリ１２からの並列１８ビッ
トを１ビットずつシフトレジスタ１７に積み、シフトレ
ジスタ１７は、カウンタ１６によりカウントされた８ビ
ット毎にシリアル／パラレル変換器１８へ送る。その
後、ＤＲＶ９を介して直ちに８ビット単位に印刷され
る。シリアル／パラレル変換器１８の出力データは、例
えばドライバ等を介して直ちに８ビット単位に印刷され
るか、あるいは、図５に示したようにビットマップメモ
リ上に展開されて表示装置に表示される。
【００１３】
【発明の効果】本発明によれば、文字等の印刷や表示に
おいて文字パターンデータや画像データ等を所望のサイ
ズ及び間隔で配置するイメージデータを編集する際に、
データ相互間におけるビット演算処理やシフト演算処理
が不要となり、処理の高速化が可能になる。
おいて文字パターンデータや画像データ等を所望のサイ
ズ及び間隔で配置するイメージデータを編集する際に、
データ相互間におけるビット演算処理やシフト演算処理
が不要となり、処理の高速化が可能になる。
【図１】本発明の原理構成を説明する図である。
【図２】本発明の一実施の形態を示す具体的構成図であ
る。
る。
【図３】パターン記憶装置の文字パターンデータと文字
パターンイメージの関係を示す図である。
パターンイメージの関係を示す図である。
【図４】文字パターンの貼り付けの一例を示す図であ
る。
る。
【図５】貼り付け後のビットマップメモリ上の文字パタ
ーンデータの一例を示す図である。
ーンデータの一例を示す図である。
【図６】従来の文字パターン貼り付け処理を説明する図
である。
である。
【図７】本発明による文字データ並びのイメージを示す
図である。
図である。
１，１２ デュアルポートメモリ ２，１３ パラレル／シリアル変換器 ３，１７ シフトレジスタ ４，１８ シリアル／パラレル変換器
Claims (1)
- 【請求項１】 一定サイズのドットパターンデータを所
望のサイズ及び間隔で配置するドットパターンデータ編
集方式であって、ドットパターンデータをそのまま書込
み、該書込みとは異なるビット長で読み出すメモリ手段
と、前記メモリ手段から読み出されるデータを順次パラ
レル／シリアル変換する手段と、前記パラレル／シリア
ル変換手段の出力シリアルデータを順次入力してビット
シフトし、所定ビット単位に出力する手段とを有するこ
とを特徴とするドットパターンデータ編集方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11094005A JP2000284775A (ja) | 1999-03-31 | 1999-03-31 | ドットパターンデータ編集方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11094005A JP2000284775A (ja) | 1999-03-31 | 1999-03-31 | ドットパターンデータ編集方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000284775A true JP2000284775A (ja) | 2000-10-13 |
Family
ID=14098323
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11094005A Pending JP2000284775A (ja) | 1999-03-31 | 1999-03-31 | ドットパターンデータ編集方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000284775A (ja) |
-
1999
- 1999-03-31 JP JP11094005A patent/JP2000284775A/ja active Pending
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