JPH01231348A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPH01231348A JPH01231348A JP5611888A JP5611888A JPH01231348A JP H01231348 A JPH01231348 A JP H01231348A JP 5611888 A JP5611888 A JP 5611888A JP 5611888 A JP5611888 A JP 5611888A JP H01231348 A JPH01231348 A JP H01231348A
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- Japan
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- tungsten
- contact hole
- sputtering
- molybdenum
- peeled
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- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Physical Deposition Of Substances That Are Components Of Semiconductor Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(概要〕
タングステンまたはモリブデンをコンタクトホール内に
穴埋めする半導体装置の製造方法に関し、できるだけ結
晶粒が小さい穴埋め材料によって、コンタクトホールの
穴埋めを表面が平坦になるよう行うことが可能な半導体
装置の製造方法を提供することを目的とし、 コンタクトホールをタングステンで穴埋めする半導体装
置の製造方法において、タングステンをスパッタリング
でコンタクトホール内を埋め込み可能な厚さに全面に形
成する工程、コンタクトホール以外に形成され下地から
部分的にはがれたタングステンを溶液エツチングで除去
する工程を含むことを特徴とする半導体装置の製造方法
、およびコンタクトホールをモリブデンで穴埋めする半
導体装置の製造方法において、モリブデンをスパッタリ
ングでコンタクトホール内を埋め込み可能な厚さに全面
に形成する工程、コンタクトホール以外に形成され下地
から部分的にはがれたモリブデンを溶液エツチングで除
去する工程を含むことを特徴とする半導体装置の製造方
法を含み構成する。
穴埋めする半導体装置の製造方法に関し、できるだけ結
晶粒が小さい穴埋め材料によって、コンタクトホールの
穴埋めを表面が平坦になるよう行うことが可能な半導体
装置の製造方法を提供することを目的とし、 コンタクトホールをタングステンで穴埋めする半導体装
置の製造方法において、タングステンをスパッタリング
でコンタクトホール内を埋め込み可能な厚さに全面に形
成する工程、コンタクトホール以外に形成され下地から
部分的にはがれたタングステンを溶液エツチングで除去
する工程を含むことを特徴とする半導体装置の製造方法
、およびコンタクトホールをモリブデンで穴埋めする半
導体装置の製造方法において、モリブデンをスパッタリ
ングでコンタクトホール内を埋め込み可能な厚さに全面
に形成する工程、コンタクトホール以外に形成され下地
から部分的にはがれたモリブデンを溶液エツチングで除
去する工程を含むことを特徴とする半導体装置の製造方
法を含み構成する。
[産業上の利用分野]
本発明はタングステンまたはモリブデンをコンタクトホ
ール内に穴埋めする半導体装置の製造方法に関する。
ール内に穴埋めする半導体装置の製造方法に関する。
〔従来の技術]
第2図各図はCVD法でタングステンを形成した表面斜
視図で、その(a)は堆積した状態図、(b)は110
0°Cのアニール後の状態図、第3図各図はスパッタリ
ング法でタングステンを形成した表面斜視図で、その(
a)は堆積した状態図、ら)は1100°Cのアニール
後の状態図である。なお第2図および第3図は写真に基
づいた図面である。
視図で、その(a)は堆積した状態図、(b)は110
0°Cのアニール後の状態図、第3図各図はスパッタリ
ング法でタングステンを形成した表面斜視図で、その(
a)は堆積した状態図、ら)は1100°Cのアニール
後の状態図である。なお第2図および第3図は写真に基
づいた図面である。
従来、例えばコンタクトホールをタングステンで穴埋め
する場合、選択化学気相成長(選択C■D)法やスパッ
タリング法(PVD)を用いることが試みられている。
する場合、選択化学気相成長(選択C■D)法やスパッ
タリング法(PVD)を用いることが試みられている。
しかし実際にタングステンを使って選択CVD法で穴埋
めする場合、埋め込みは可能であるが結晶粒の実測平均
が500人程度あって、スパッタリング法の場合の26
0人程度と比べると大きく、ICの集積化にともなって
コンタクトホールが微細化する場合に結晶粒が大きいと
埋め込み方法としては適当でない。埋め込み材料の結晶
粒はできるだけ小さい方が望ましいのである。
めする場合、埋め込みは可能であるが結晶粒の実測平均
が500人程度あって、スパッタリング法の場合の26
0人程度と比べると大きく、ICの集積化にともなって
コンタクトホールが微細化する場合に結晶粒が大きいと
埋め込み方法としては適当でない。埋め込み材料の結晶
粒はできるだけ小さい方が望ましいのである。
また第2図および第3図に示す写真に基づいた図面を参
照すると、第3図に示すスパッタリング法の場合、表面
の凹凸状態を示すピークからピークまでの値が100〜
200人程度と比較的平坦で上層配線の形成にも支障は
ないが、第2図に示す選択CVD法の場合、1000〜
2000人程度とスパッタリング法の10倍の凹凸があ
って、微細な構造の素子を形成する場合に支障が出るお
それがある。
照すると、第3図に示すスパッタリング法の場合、表面
の凹凸状態を示すピークからピークまでの値が100〜
200人程度と比較的平坦で上層配線の形成にも支障は
ないが、第2図に示す選択CVD法の場合、1000〜
2000人程度とスパッタリング法の10倍の凹凸があ
って、微細な構造の素子を形成する場合に支障が出るお
それがある。
さらに選択CVD法の場合、コンタクトホールの底部の
基板表面をタングステンが浸食して食い込みが生じ易い
という問題がある。
基板表面をタングステンが浸食して食い込みが生じ易い
という問題がある。
そこで結晶粒が小さく表面が平坦なスパッタリング法を
用いてコンタクトホールを穴埋めしようとすると、コン
タクトホールの埋め込みが難しく、完全に埋め込むには
膜厚を厚く形成しなければならない。ところがタングス
テンを厚く形成すると下地との密着性が悪いため、スパ
ッタリング後にウェハの反りが戻るとタングステン層に
圧縮応力がはたらいて下地からはがれ、後に説明する第
1図(a)に示す如く凸凹に波を打った状態となり、こ
の上に配線等を形成することは不可能であった。
用いてコンタクトホールを穴埋めしようとすると、コン
タクトホールの埋め込みが難しく、完全に埋め込むには
膜厚を厚く形成しなければならない。ところがタングス
テンを厚く形成すると下地との密着性が悪いため、スパ
ッタリング後にウェハの反りが戻るとタングステン層に
圧縮応力がはたらいて下地からはがれ、後に説明する第
1図(a)に示す如く凸凹に波を打った状態となり、こ
の上に配線等を形成することは不可能であった。
このように従来の半導体装置の製造方法は、コンタクト
ホールを選択CVD法やスパッタリング法を使って穴埋
めしようとしても結晶粒や表面の凸凹が大きくて好まし
くなかったり、層のはがれなどが生じるなど種々の問題
があって実用的でなかった。
ホールを選択CVD法やスパッタリング法を使って穴埋
めしようとしても結晶粒や表面の凸凹が大きくて好まし
くなかったり、層のはがれなどが生じるなど種々の問題
があって実用的でなかった。
そこで本発明は、できるだけ結晶粒が小さい穴埋め材料
によって、コンタクトホールの穴埋めを表面が平坦にな
るよう行うことが可能な半導体装置の製造方法を提供す
ることを目的とする。
によって、コンタクトホールの穴埋めを表面が平坦にな
るよう行うことが可能な半導体装置の製造方法を提供す
ることを目的とする。
〔課題を解決するための手段]
上記課題は、コンタクトホールをタングステンで穴埋め
する半導体装置の製造方法において、タングステンをス
パッタリングでコンタクトホール内を埋め込み可能な厚
さに全面に形成する工程、コンタクトホール以外に形成
され下地からはがれたタングステンを溶液エツチングで
除去する工程を含むことを特徴とする半導体装置の製造
方法、およびコンタクトホールをモリブデンで穴埋めす
る半導体装置の製造方法において、モリブデンをスパッ
タリングでコンタクトホール内を埋め込み可能な厚さに
全面に形成する工程、コンタクトホ−ル以外に形成され
下地からはがれたモリブデンを溶液エツチングで除去す
る工程を含むことを特徴とする半導体装置の製造方法に
よって解決される。
する半導体装置の製造方法において、タングステンをス
パッタリングでコンタクトホール内を埋め込み可能な厚
さに全面に形成する工程、コンタクトホール以外に形成
され下地からはがれたタングステンを溶液エツチングで
除去する工程を含むことを特徴とする半導体装置の製造
方法、およびコンタクトホールをモリブデンで穴埋めす
る半導体装置の製造方法において、モリブデンをスパッ
タリングでコンタクトホール内を埋め込み可能な厚さに
全面に形成する工程、コンタクトホ−ル以外に形成され
下地からはがれたモリブデンを溶液エツチングで除去す
る工程を含むことを特徴とする半導体装置の製造方法に
よって解決される。
本発明では、タングステンまたはモリブデンをスパッタ
リングでコンタクトホール内を埋め込み可能な厚さに全
面に成長し、コンタクトホール以外に形成され下地から
部分的にはがれたタングステンまたはモリブデンを溶液
エツチングで除去する方法を用いることにより、スパッ
タリングで埋め込む場合の利点である小さな結晶粒と表
面の平坦性が得られると共に、スパッタリングの場合に
問題があった厚いタングステンやモリブデンの層の下地
からはがれ部分を溶液エツチングで除去すればきれいに
除去できることがわかった。これは下地からはがれてで
きた空間にエツチング溶液が入り込んではがれている部
分のエツチング速度・が速くなり、反対にエツチング溶
液が最も進入しにくいコンタクトホール部分のタングス
テンやモリブデンが残るからである。その結果、第1図
(b)に示す如く、コンタクトホールにタングステンま
たはモリブデンが穴埋めされ、表面が平坦な穴埋め状態
が得られた。
リングでコンタクトホール内を埋め込み可能な厚さに全
面に成長し、コンタクトホール以外に形成され下地から
部分的にはがれたタングステンまたはモリブデンを溶液
エツチングで除去する方法を用いることにより、スパッ
タリングで埋め込む場合の利点である小さな結晶粒と表
面の平坦性が得られると共に、スパッタリングの場合に
問題があった厚いタングステンやモリブデンの層の下地
からはがれ部分を溶液エツチングで除去すればきれいに
除去できることがわかった。これは下地からはがれてで
きた空間にエツチング溶液が入り込んではがれている部
分のエツチング速度・が速くなり、反対にエツチング溶
液が最も進入しにくいコンタクトホール部分のタングス
テンやモリブデンが残るからである。その結果、第1図
(b)に示す如く、コンタクトホールにタングステンま
たはモリブデンが穴埋めされ、表面が平坦な穴埋め状態
が得られた。
以下、本発明を図示の実施例により具体的に説明する。
第1図(a)〜(C)は本実施例の工程断面図で、図に
おいて、11はコンタクトホール、12はタングステン
、13はリン・ケイ酸ガラス層、14はシリコン基板、
15は空間、16はAffi配線、22はモリブデンで
ある。
おいて、11はコンタクトホール、12はタングステン
、13はリン・ケイ酸ガラス層、14はシリコン基板、
15は空間、16はAffi配線、22はモリブデンで
ある。
本実施例の半導体装置の製造方法は、第1図(a)に示
す如く、シリコン基板14上にリン・ケイ酸ガラス層1
3を1μmの厚さで形成し、縦横1μmのコンタクトホ
ール11を図示省略したエンチングマスクを介してCF
351secMとCF4485ecsの雰囲気中で出力
1に讐、圧力0.3Torrの条件下でリアクティブイ
オンエツチング(RIE )を行い形成する。
す如く、シリコン基板14上にリン・ケイ酸ガラス層1
3を1μmの厚さで形成し、縦横1μmのコンタクトホ
ール11を図示省略したエンチングマスクを介してCF
351secMとCF4485ecsの雰囲気中で出力
1に讐、圧力0.3Torrの条件下でリアクティブイ
オンエツチング(RIE )を行い形成する。
次に埋め込み材料であるタングステン(讐)を0.8
μmの厚さでスパッタリング法を使い表面に堆積させる
。この厚さでタングステンを堆積させれば完全にコンタ
クトホール内を埋め込むことができる。スパッタリング
装置はターゲット・ウェハ対同型の枚葉式のものを使用
し、出力4 KW、圧力5mTorr、アルゴン(Ar
)40secM を使い120秒間熱処理せずにスパ
ッタリングを行った。このように形成したタングステン
層は、ウェハの反りの戻りなどで圧縮応力を受けると、
第1図(a)に示す如(下地のリン・ケイ酸ガラス層1
3からはがれて空間15が形成される。
μmの厚さでスパッタリング法を使い表面に堆積させる
。この厚さでタングステンを堆積させれば完全にコンタ
クトホール内を埋め込むことができる。スパッタリング
装置はターゲット・ウェハ対同型の枚葉式のものを使用
し、出力4 KW、圧力5mTorr、アルゴン(Ar
)40secM を使い120秒間熱処理せずにスパ
ッタリングを行った。このように形成したタングステン
層は、ウェハの反りの戻りなどで圧縮応力を受けると、
第1図(a)に示す如(下地のリン・ケイ酸ガラス層1
3からはがれて空間15が形成される。
はがれたタングステン12の層は、溶液エツチングによ
って除去する。エツチング溶液は)1.0. :IIN
(h: H2O=1: 5: 5の割合で混合したもの
を使い、70°Cでボイルして行う。この時のコンタク
トホール以外のエツチング速度は4970人/分で、コ
ンタクトホール内のエツチング速度は1030人/分で
ある。このように部分的にはがれが生じている部分はコ
ンタクトホールの約5倍の早さで除去されるため、第1
図(b)の如く、コンタクトホール内のタングステンは
残ってリン・ケイ酸ガラス13上のタングステンだけを
除去して表面を平坦化することが可能である。
って除去する。エツチング溶液は)1.0. :IIN
(h: H2O=1: 5: 5の割合で混合したもの
を使い、70°Cでボイルして行う。この時のコンタク
トホール以外のエツチング速度は4970人/分で、コ
ンタクトホール内のエツチング速度は1030人/分で
ある。このように部分的にはがれが生じている部分はコ
ンタクトホールの約5倍の早さで除去されるため、第1
図(b)の如く、コンタクトホール内のタングステンは
残ってリン・ケイ酸ガラス13上のタングステンだけを
除去して表面を平坦化することが可能である。
、最後に第1図(C)の如く、へ〇配線16をその上に
形成しても下地の表面が平坦であって、コンタクトホー
ル内は結晶粒が小さく凹凸の少ないタングステンで埋め
込まれているため、コンタクトを確実にとることができ
る。
形成しても下地の表面が平坦であって、コンタクトホー
ル内は結晶粒が小さく凹凸の少ないタングステンで埋め
込まれているため、コンタクトを確実にとることができ
る。
本実施例では埋め込み材料にタングステンを用いて行っ
たが、タングステン以外にモリブデンも上記と同様の工
程を経ることによってコンタクトホールを好適に埋め込
むことができる。
たが、タングステン以外にモリブデンも上記と同様の工
程を経ることによってコンタクトホールを好適に埋め込
むことができる。
以上のように本発明によれば、コンタクトホールをスパ
ッタリングを使ってタングステンまたはモリブデンを埋
め込むため、結晶粒の小さい表面の平坦な穴埋めを行う
ことが可能であり、コンタクトホール以外の下地からは
がれた余分なタングステンまたはモリブデンは溶液エツ
チングによって表面を平坦化できるため好適な上層配線
の形成を可能にした。
ッタリングを使ってタングステンまたはモリブデンを埋
め込むため、結晶粒の小さい表面の平坦な穴埋めを行う
ことが可能であり、コンタクトホール以外の下地からは
がれた余分なタングステンまたはモリブデンは溶液エツ
チングによって表面を平坦化できるため好適な上層配線
の形成を可能にした。
第1図(a)〜(C)は本発明実施例の工程断面図、第
2図はCVD法でタングステンを形成した表面斜視図で
、その(a)は堆積した状態図、(b)は1100°C
のアニール後の状態図、 第3図はスパッタリング法でタングステンを形成した表
面斜視図で、その(a)は堆積した状態図、■)は11
00°Cのアニール後の状態図である。 図において、 11はコンタクトホール、 12はタングステン、 13はリン・ケイ酸ガラス層、 14はシリコン基板、 15は空間、 16は/l配線、 22はモリブデン を示す。
2図はCVD法でタングステンを形成した表面斜視図で
、その(a)は堆積した状態図、(b)は1100°C
のアニール後の状態図、 第3図はスパッタリング法でタングステンを形成した表
面斜視図で、その(a)は堆積した状態図、■)は11
00°Cのアニール後の状態図である。 図において、 11はコンタクトホール、 12はタングステン、 13はリン・ケイ酸ガラス層、 14はシリコン基板、 15は空間、 16は/l配線、 22はモリブデン を示す。
Claims (2)
- (1)コンタクトホール(11)をタングステン(12
)で穴埋めする半導体装置の製造方法において、 タングステン(12)をスパッタリングでコンタクトホ
ール(11)内を埋め込み可能な厚さに全面に形成する
工程、 コンタクトホール(11)以外に形成され下地から部分
的にはがれたタングステン(12)を溶液エッチングで
除去する工程を含むことを特徴とする半導体装置の製造
方法。 - (2)コンタクトホール(11)をモリブデン(22)
で穴埋めする半導体装置の製造方法において、 モリブデン(22)をスパッタリングでコンタクトホー
ル(11)内を埋め込み可能な厚さに全面に形成する工
程、 コンタクトホール(11)以外に形成され下地から部分
的にはがれたモリブデン(22)を溶液エッチングで除
去する工程を含むことを特徴とする半導体装置の製造方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5611888A JP2592281B2 (ja) | 1988-03-11 | 1988-03-11 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5611888A JP2592281B2 (ja) | 1988-03-11 | 1988-03-11 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01231348A true JPH01231348A (ja) | 1989-09-14 |
| JP2592281B2 JP2592281B2 (ja) | 1997-03-19 |
Family
ID=13018155
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5611888A Expired - Lifetime JP2592281B2 (ja) | 1988-03-11 | 1988-03-11 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2592281B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04233224A (ja) * | 1990-07-24 | 1992-08-21 | Micron Technol Inc | 半導体ウエハ上のタングステン層をエッチングバックする方法 |
-
1988
- 1988-03-11 JP JP5611888A patent/JP2592281B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04233224A (ja) * | 1990-07-24 | 1992-08-21 | Micron Technol Inc | 半導体ウエハ上のタングステン層をエッチングバックする方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2592281B2 (ja) | 1997-03-19 |
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