JPH01232457A - 入出力制御装置 - Google Patents

入出力制御装置

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Publication number
JPH01232457A
JPH01232457A JP5918688A JP5918688A JPH01232457A JP H01232457 A JPH01232457 A JP H01232457A JP 5918688 A JP5918688 A JP 5918688A JP 5918688 A JP5918688 A JP 5918688A JP H01232457 A JPH01232457 A JP H01232457A
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JP
Japan
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input
output control
output
adapter
eprom
Prior art date
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Pending
Application number
JP5918688A
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English (en)
Inventor
Hironori Ono
小野　裕基
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
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Publication of JPH01232457A publication Critical patent/JPH01232457A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、入出力制御装置に関し、特に、入出力制御用
ファームウェアのロード方式に関する。
従来の技術 従来、この種の入出力制御装置は、各アダプタ毎に不揮
発性メモリ（ＦＲＯＭ）を持ち、このＩ’ＲＯＭに入出
力制御ファームウェアを書き込んでいた。
発明が解決しようとする課題 上述した従来の入出力制御装置では、入出力制御ファー
ムウェアは、アダプタ内のＦＲＯＭに書き込まれている
為に接続される入出力装置の構成が変更されると、ＦＲ
ＯＭの変更又はアダプタの変更が必要となるのでコスト
高及び変更作業が煩雑となり、容易に変更出来ないとい
う欠点がある。
本発明は従来の上記実情に鑑みてなされたものであり、
従って本発明の目的は、従来の技術に内在する上記欠点
を解消することを可能とした新規な入出力制御装置を提
供することにある。
課題を解決するための手段 −ｈ２目的を達成する為に、本発明に係る入出力制御装
置は、アダプタ内の制御記憶部に格納されアダプタに接
続される入出力装置毎に異なる入出力制御用ファームウ
ェアと、全ての種類の入出力制御ファームウェアを格納
するＥＦＲＯＭと、前記アダプタに設けられた入出力装
置の種別を指定する装置種別情報と、この装置種別情報
から前記ＥＰＲＯＭに格納された特定の入出力制御ファ
ームウェアの格納アドレスを指定するアドレス変換回路
と、このアドレス変換回路で生成したアドレスからＥＰ
ＲＯＭ内の入出力制御ファームウェアを読み取り前記ア
ダプタ内の制御記憶部に格納するファームウェア読み出
し回路とを備えて構成される。
実施例 次に本発明をその好ましい一実施例について図面を参照
しながら具体的に説明する。
゛　　　第１図は本発明の一実施例を示すブロック構成
図である。
第１図を参照するに、周辺装置２，３は入出力制御装置
１の入出力制御アダプタ４，５に接続されている。
ＣＰＲＯＭアダプタ６はバス線Ｃを経由して入出力制御
アダプタ４．５と接続されている。
入出力制御アダプタ４は、装置識別スイッチ４１と、入
出力制御回路４２と、制御記憶部４３と、マイクロプロ
セッサ４４とから構成される。又、入出力制御アダプタ
５は入出力制御アダプタ４と同様な構成となっている。
ＥＰＲＯＭアダプタ６は、アドレス変換回路６３とアク
セス回路６２とＥＰＲＯＭ６１から構成されている。
本実施例ではアダプタ４のファームウェアロードについ
て説明する。
アドレス変換回路６３は、上位インタフェースｄを経由
して上位装置からリセット信号を受信すると、スイッチ
４１から装置識別情報を読み取った後にＥＰＲＯＭ６１
のアドレスに変換する。
アクセス回路６２は、アドレス変換回路６３から生成さ
れたアドレスから順にＥＰＲＯＭ６１の内容を読み出し
、制御記憶部４３にバス線Ｃを経由して書き込む。
制御記憶部４３への入出力制御ファームウェアの書き込
みが終了すると、以後、マイクロプロセッサ４４が制御
記憶部４３内のマイクロ命令を実行することにより入出
力制御回路４２を動作させて周辺装置２を制御すること
が出来る。
発明の詳細 な説明したように、本発明によれば、アダプタ内に設け
られた装置識別情報をもとに、ＥＦＲＯＭから該当する
入出力制御ファームウェアをロードすることにより、接
続される周辺装置が変更されても入出力制御装置はアダ
プタ内の装置識別情報を変更するだけで容易に変更でき
る。又、新規の入出力装置が追加されてもＥＰＲＯＭに
新規の入出力制御ファームウェアを書き加えるだけで容
易に対応出来るという効果が得られる。
【図面の簡単な説明】
第１図は本発明の一実施例を示すブロック構成図である
。 １・・・入出力制御装置、２．３・・・周辺装置、４゜
５・・・入出力制御アダプタ、６・・・ＥＦＲＯＭアダ
プタ、４１・・・装置識別スイッチ、４２・・入出力制
御回路、４３°°゛制御記憶部、４４・・・マイクロプ
ロセッサ、６１・・・ＥＰＲＯＭ　、６２・・・アクセ
ス回路、６３・・・アドレス変換回路、ａ、ｂ・・・デ
バイスインタフェース、Ｃ・・・バス線、ｄ・・・上位
インタフェース 特許出願人　　　日本電気株式会社 代　理　人　　　弁理士　熊谷雄太部

Claims (1)

    【特許請求の範囲】
  1. 複数のアダプタから構成され各アダプタが各々異なる入
    出力装置を制御する入出力制御装置において、前記アダ
    プタ内の制御記憶部に格納されこのアダプタに接続され
    る入出力装置毎に異なる入出力制御用ファームウェアと
    、この入出力制御ファームウェアの全ての種類を格納す
    る書き換え可能メモリ（以後ＥＰＲＯＭと呼ぶ）と、前
    記アダプタに設けられた入出力装置の装置種別を指定す
    る装置識別情報と、この装置識別情報から前記ＥＰＲＯ
    Ｍに格納された特定の入出力制御ファームウェアの格納
    アドレスを指定するアドレス変換回路と、このアドレス
    変換回路で生成したアドレスから前記ＥＰＲＯＭ内の入
    出力制御ファームウェアを読み取り前記アダプタ内の制
    御記憶部に格納するファームウェア読み出し回路とを有
    する事を特徴とする入出力制御装置。
JP5918688A 1988-03-12 1988-03-12 入出力制御装置 Pending JPH01232457A (ja)

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JPH01232457A true JPH01232457A (ja) 1989-09-18

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0969029A (ja) * 1995-08-31 1997-03-11 Nec Corp 二重化ディスク装置
WO2000049506A1 (en) * 1999-02-19 2000-08-24 Wacom Engineering Co., Ltd. Operation input processing device and method

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