JPH0132074B2 - - Google Patents
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- JPH0132074B2 JPH0132074B2 JP55024087A JP2408780A JPH0132074B2 JP H0132074 B2 JPH0132074 B2 JP H0132074B2 JP 55024087 A JP55024087 A JP 55024087A JP 2408780 A JP2408780 A JP 2408780A JP H0132074 B2 JPH0132074 B2 JP H0132074B2
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
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- B41J2/355—Control circuits for heating-element selection
- B41J2/36—Print density control
- B41J2/365—Print density control by compensation for variation in temperature
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- Electronic Switches (AREA)
- Thermal Transfer Or Thermal Recording In General (AREA)
Description
【発明の詳細な説明】
この発明は同一の記録紙に２色以上の多色の記
録をする多色記録装置に関し、特に多色に発色す
る感熱記録紙に熱ペンを用いて記録する多色記録
装置に関するものである。
録をする多色記録装置に関し、特に多色に発色す
る感熱記録紙に熱ペンを用いて記録する多色記録
装置に関するものである。
一定の温度Ｒ℃まで加熱するとたとえば赤色に
発色し、Ｒ℃よりも高い温度であるＢ℃まで加熱
するとたとえば黒色に発色するような感熱記録紙
は従来知られている。このような記録紙上に第１
のアナログ信号を黒色で記録し第２のアナログ信
号を赤色で記録するための従来の２色記録装置で
は、記録紙を一定の方向に紙送りしながら（紙送
りの方向を仮にｘ軸とする）この紙送りと直角な
方向（仮にｙ軸とする）に上記アナログ信号の振
幅変化に比例する量だけ記録用の熱ペンを移動し
てこの熱ペンに加える熱量によつて熱ペンが接触
する部分の記録紙の温度を上昇させて感熱記録を
行つていた。第１のアナログ信号と第２のアナロ
グ信号とを同時に記録するためには各信号に対し
それぞれ別の熱ペンを用い、かつ黒色の線を記録
するには赤色の線を記録する場合に比し記録する
線の単位長に対しより多くの熱量を熱ペンに与え
ていた。
発色し、Ｒ℃よりも高い温度であるＢ℃まで加熱
するとたとえば黒色に発色するような感熱記録紙
は従来知られている。このような記録紙上に第１
のアナログ信号を黒色で記録し第２のアナログ信
号を赤色で記録するための従来の２色記録装置で
は、記録紙を一定の方向に紙送りしながら（紙送
りの方向を仮にｘ軸とする）この紙送りと直角な
方向（仮にｙ軸とする）に上記アナログ信号の振
幅変化に比例する量だけ記録用の熱ペンを移動し
てこの熱ペンに加える熱量によつて熱ペンが接触
する部分の記録紙の温度を上昇させて感熱記録を
行つていた。第１のアナログ信号と第２のアナロ
グ信号とを同時に記録するためには各信号に対し
それぞれ別の熱ペンを用い、かつ黒色の線を記録
するには赤色の線を記録する場合に比し記録する
線の単位長に対しより多くの熱量を熱ペンに与え
ていた。
このような従来の装置では、熱ペンを移動させ
るための駆動装置が複雑高価になることと、記録
紙と熱ペンとの相対速度が変化するためその変化
に応じて単位時間に熱ペンに加える熱量を変化し
ないと熱ペンの温度を所定の値に保つことができ
ず、このための制御装置が複雑になることなどの
欠点があつた。
るための駆動装置が複雑高価になることと、記録
紙と熱ペンとの相対速度が変化するためその変化
に応じて単位時間に熱ペンに加える熱量を変化し
ないと熱ペンの温度を所定の値に保つことができ
ず、このための制御装置が複雑になることなどの
欠点があつた。
他方ステーシヨナリ、サーマル、プリンテイン
グ、ヘツド、アレイ（stationary thermal
printing head array）を用いる記録装置がある。
このような記録装置では紙送りに直角な方向、す
なわちｙ軸方向に多数のサーマルヘツド（熱記録
素子）が配列されており記録しようとする信号の
振幅の変化に応じてｙ軸方向の位置の異なる熱記
録素子が選択され、選択された熱記録素子を加熱
してその素子が接触する記録紙の部分に記録を行
う。したがつてこのような記録装置では熱記録素
子の駆動装置を省略することができることと、熱
記録素子と記録紙との相対速度は紙送り速度を切
換えない限り一定に保たれる等種々の利点がある
が、このようなステーシヨナリ、サーマル、プリ
ンテイング、ヘツド、アレイにより複数種類のア
ナログ信号を同一記録紙上にそれぞれ別の色で記
録する装置は実現してなかつた。この発明はステ
ーシヨナリ、サーマル、ヘツド、アレイを用いた
複数種類のアナログ信号の色別記録が可能な多色
記録装置を提供することを目的とするもので、以
下図面についてこの発明の実施例を説明する。
グ、ヘツド、アレイ（stationary thermal
printing head array）を用いる記録装置がある。
このような記録装置では紙送りに直角な方向、す
なわちｙ軸方向に多数のサーマルヘツド（熱記録
素子）が配列されており記録しようとする信号の
振幅の変化に応じてｙ軸方向の位置の異なる熱記
録素子が選択され、選択された熱記録素子を加熱
してその素子が接触する記録紙の部分に記録を行
う。したがつてこのような記録装置では熱記録素
子の駆動装置を省略することができることと、熱
記録素子と記録紙との相対速度は紙送り速度を切
換えない限り一定に保たれる等種々の利点がある
が、このようなステーシヨナリ、サーマル、プリ
ンテイング、ヘツド、アレイにより複数種類のア
ナログ信号を同一記録紙上にそれぞれ別の色で記
録する装置は実現してなかつた。この発明はステ
ーシヨナリ、サーマル、ヘツド、アレイを用いた
複数種類のアナログ信号の色別記録が可能な多色
記録装置を提供することを目的とするもので、以
下図面についてこの発明の実施例を説明する。
第１図はこの発明の一実施例を示すブロツク図
で、第１のアナログ信号をたとえば黒色で記録し
第２のアナログ信号をたとえば赤色で記録する場
合の例を示す。ステーシヨナリ、サーマル、ヘツ
ド、アレイを用いる場合は熱記録素子と感熱記録
紙との相対速度は記録動作中一定に保たれるの
で、単に熱記録素子に加える加熱電力の通電時間
を制御するだけで黒色又は赤色の記録を行うこと
ができる。
で、第１のアナログ信号をたとえば黒色で記録し
第２のアナログ信号をたとえば赤色で記録する場
合の例を示す。ステーシヨナリ、サーマル、ヘツ
ド、アレイを用いる場合は熱記録素子と感熱記録
紙との相対速度は記録動作中一定に保たれるの
で、単に熱記録素子に加える加熱電力の通電時間
を制御するだけで黒色又は赤色の記録を行うこと
ができる。
多色感熱記録紙とその送り装置及びステーシヨ
ナリ、サーマル、ヘツド、アレイの構造と動作と
はそれぞれ従来の装置で知られているとおりであ
るので、第１図には示していない。第１図の１は
ステーシヨナリ、サーマル、ヘツド、アレイすな
わち熱記録素子列の中から加熱すべき素子を選択
しその選択した素子への加熱時間を制御する熱記
録素子制御装置、２は熱記録素子制御装置１を制
御するための信号を保持する制御用レジスタ、３
は制御用レジスタ２に追加信号を入力する入力用
レジスタ、４は制御用レジスタ２に保持される信
号のうちの一部を消去するための阻止用レジスタ
である。
ナリ、サーマル、ヘツド、アレイの構造と動作と
はそれぞれ従来の装置で知られているとおりであ
るので、第１図には示していない。第１図の１は
ステーシヨナリ、サーマル、ヘツド、アレイすな
わち熱記録素子列の中から加熱すべき素子を選択
しその選択した素子への加熱時間を制御する熱記
録素子制御装置、２は熱記録素子制御装置１を制
御するための信号を保持する制御用レジスタ、３
は制御用レジスタ２に追加信号を入力する入力用
レジスタ、４は制御用レジスタ２に保持される信
号のうちの一部を消去するための阻止用レジスタ
である。
また５１は黒色で記録すべきアナログ信号を入
力してデイジタル信号に変換するアナログデイジ
タル変換器（以下ADCと略記する）、５２は赤色
で記録すべきアナログ信号を入力してデイジタル
信号に変換するADC、６１はADC５１の出力を
入力して黒色記録のための通電時間tBだけ遅延し
て出力する遅延装置、６２はADC５２の出力を
入力して赤色記録のための通電時間tRだけ遅延し
て出力する遅延装置、７１はADC５１の出力を
入力してこの入力信号により定められるすべての
種類の信号に分離して出力する信号源信号用デコ
ーダ装置で、たとえばADC５１の出力が２進８
ビツトのデイジタル信号である場合、信号源信号
用デコーダ装置７１の出力は28＝256種類の２値
信号となる。７２，８１，８２も７１と同様なデ
コーダ装置で７２は信号源信号用デコーダ装置と
称し、８１，８２はそれぞれ遅延信号用デコーダ
装置と称することにする。入力用レジスタ３はデ
コーダ装置７１，７２の各対応する出力信号の論
理和を入力し、阻止用レジスタ４はデコーダ装置
８１，８２の各対応する出力信号の論理和を入力
する。３１はゲート装置で入力用レジスタ３に保
持する信号を制御用レジスタ２に追加するため設
けられ、２１はゲート装置で制御用レジスタ２に
保持される信号を阻止用レジスタ４に保持される
信号によつて消去するために設けられる。
力してデイジタル信号に変換するアナログデイジ
タル変換器（以下ADCと略記する）、５２は赤色
で記録すべきアナログ信号を入力してデイジタル
信号に変換するADC、６１はADC５１の出力を
入力して黒色記録のための通電時間tBだけ遅延し
て出力する遅延装置、６２はADC５２の出力を
入力して赤色記録のための通電時間tRだけ遅延し
て出力する遅延装置、７１はADC５１の出力を
入力してこの入力信号により定められるすべての
種類の信号に分離して出力する信号源信号用デコ
ーダ装置で、たとえばADC５１の出力が２進８
ビツトのデイジタル信号である場合、信号源信号
用デコーダ装置７１の出力は28＝256種類の２値
信号となる。７２，８１，８２も７１と同様なデ
コーダ装置で７２は信号源信号用デコーダ装置と
称し、８１，８２はそれぞれ遅延信号用デコーダ
装置と称することにする。入力用レジスタ３はデ
コーダ装置７１，７２の各対応する出力信号の論
理和を入力し、阻止用レジスタ４はデコーダ装置
８１，８２の各対応する出力信号の論理和を入力
する。３１はゲート装置で入力用レジスタ３に保
持する信号を制御用レジスタ２に追加するため設
けられ、２１はゲート装置で制御用レジスタ２に
保持される信号を阻止用レジスタ４に保持される
信号によつて消去するために設けられる。
この発明のデコーダ装置７１，７２，８１，８
２及びレジスタ２，３，４にはどのようなデコー
ダ装置とどのようなレジスタを用いてもよいが、
上述の数値例によつて説明すれば、256種類の２
値信号（したがつて１種類の信号は１ビツトによ
つて表すことができる）を全ビツト並列の形にし
て処理すると多数のゲート回路を必要とするし、
またこれに対して全ビツト直列の形で処理すると
処理に長時間を必要とする。したがつてこの発明
の好適な実施態様としては、16ビツト直列の形の
回路を16回路並列に設ける例が考えられ、以下そ
のような実施例について説明するが、この発明が
この実施例に限定されるものでないことは申すま
でもない。
２及びレジスタ２，３，４にはどのようなデコー
ダ装置とどのようなレジスタを用いてもよいが、
上述の数値例によつて説明すれば、256種類の２
値信号（したがつて１種類の信号は１ビツトによ
つて表すことができる）を全ビツト並列の形にし
て処理すると多数のゲート回路を必要とするし、
またこれに対して全ビツト直列の形で処理すると
処理に長時間を必要とする。したがつてこの発明
の好適な実施態様としては、16ビツト直列の形の
回路を16回路並列に設ける例が考えられ、以下そ
のような実施例について説明するが、この発明が
この実施例に限定されるものでないことは申すま
でもない。
第２図はこの発明の一実施例に用いるタイミン
グの一例に示すタイミング図で、第２図ａはクロ
ツクパルスP0を、同図ｂ，ｃはサンプリングパ
ルスP1を（ｃはｂの時間軸を1/8に縮尺して示
す）、同図ｄはデータ更新周期とデータ転送期間
とを示す。同図に示す例では、クロツク周期は
tO、サンプリング周期tSはtS＝16tO、データ更新周
期tdはtd＝8tSに定められデータ転送期間を示すゲ
ート信号ｇ（ｔ）の幅はtSに等しく周期tdの最終の
サンプリング周期がデータ転送期間として用いら
れる。さきに説明した通電時間tB、tRとの間に
は、たとえばtB＝4td、tR＝3tdの関係がある。
グの一例に示すタイミング図で、第２図ａはクロ
ツクパルスP0を、同図ｂ，ｃはサンプリングパ
ルスP1を（ｃはｂの時間軸を1/8に縮尺して示
す）、同図ｄはデータ更新周期とデータ転送期間
とを示す。同図に示す例では、クロツク周期は
tO、サンプリング周期tSはtS＝16tO、データ更新周
期tdはtd＝8tSに定められデータ転送期間を示すゲ
ート信号ｇ（ｔ）の幅はtSに等しく周期tdの最終の
サンプリング周期がデータ転送期間として用いら
れる。さきに説明した通電時間tB、tRとの間に
は、たとえばtB＝4td、tR＝3tdの関係がある。
第３図は第１図のADC５１，５２、遅延装置
６１，６２、デコーダ装置７１，７２，８１，８
２の一例を示すブロツク図で、第１図と同一符号
は同一部分を示し、７３，７４，８３，８４はそ
れぞれプリセツト可能なカウンタ、７５，７６，
８５，８６はデコーダで、７３と７５により第１
図のデコーダ装置７１を、７４と７６によりデコ
ーダ装置７２を、８３と８５によりデコーダ装置
８１を、８４と８６によりデコーダ装置８２をそ
れぞれ構成する。各サンプリング周期tSごとに
ADC５１の出力信号８ビツトのうち下位４ビツ
トがカウンタ７３にプリセツトされ、上位４ビツ
トはデコーダ７５により出力線D0，D1……D15の
うちからデコーダ７５の入力信号によつて定めら
れる出力線を選択する。Ｓはデコーダ７５のチツ
プイネーブル（chip enable）信号入力端子、Ｑ
はカウンタ７３のキヤリ信号出力端子である。カ
ウンタ７３にはクロツクパルスP0が入力されて
いるので、プリセツトされた時点からプリセツト
された数値に対応する時間が経過した後端子Ｑか
ら信号を出力しデコーダ７５からの出力を可能に
する。すなわち７３と７５でADC５１の上位４
ビツトにより信号の出力線を決定し下位４ビツト
によりサンプリング周期tS内における信号の出力
タイミングを決定するデコーダ装置を構成する。
７４と７６、８３と８５、８４と８６によつて構
成されるデコーダ装置も同様に動作する。デコー
ダ７５とデコーダ７６の対応する出力信号の論理
和がD0，D1……D15の出力線から、デコーダ８５
とデコーダ８６の対応する出力信号の論理和が
I0，I1，……I15の出力線からそれぞれ出力され
る。
６１，６２、デコーダ装置７１，７２，８１，８
２の一例を示すブロツク図で、第１図と同一符号
は同一部分を示し、７３，７４，８３，８４はそ
れぞれプリセツト可能なカウンタ、７５，７６，
８５，８６はデコーダで、７３と７５により第１
図のデコーダ装置７１を、７４と７６によりデコ
ーダ装置７２を、８３と８５によりデコーダ装置
８１を、８４と８６によりデコーダ装置８２をそ
れぞれ構成する。各サンプリング周期tSごとに
ADC５１の出力信号８ビツトのうち下位４ビツ
トがカウンタ７３にプリセツトされ、上位４ビツ
トはデコーダ７５により出力線D0，D1……D15の
うちからデコーダ７５の入力信号によつて定めら
れる出力線を選択する。Ｓはデコーダ７５のチツ
プイネーブル（chip enable）信号入力端子、Ｑ
はカウンタ７３のキヤリ信号出力端子である。カ
ウンタ７３にはクロツクパルスP0が入力されて
いるので、プリセツトされた時点からプリセツト
された数値に対応する時間が経過した後端子Ｑか
ら信号を出力しデコーダ７５からの出力を可能に
する。すなわち７３と７５でADC５１の上位４
ビツトにより信号の出力線を決定し下位４ビツト
によりサンプリング周期tS内における信号の出力
タイミングを決定するデコーダ装置を構成する。
７４と７６、８３と８５、８４と８６によつて構
成されるデコーダ装置も同様に動作する。デコー
ダ７５とデコーダ７６の対応する出力信号の論理
和がD0，D1……D15の出力線から、デコーダ８５
とデコーダ８６の対応する出力信号の論理和が
I0，I1，……I15の出力線からそれぞれ出力され
る。
したがつて入力用レジスタ３は出力線D0，D1
……D15のそれぞれに対応して16ビツトのシフト
レジスタを（合計16個）備え阻止用レジスタ４は
出力線I0，I1，……I15のそれぞれに対応して16ビ
ツトのシフトレジスタを（合計16個）備え、制御
用レジスタ２は入力用レジスタ３の各シフトレジ
スタにそれぞれ対応して16ビツトの並列出力端子
をも備えたシフトレジスタを（合計16個）備えて
いる。
……D15のそれぞれに対応して16ビツトのシフト
レジスタを（合計16個）備え阻止用レジスタ４は
出力線I0，I1，……I15のそれぞれに対応して16ビ
ツトのシフトレジスタを（合計16個）備え、制御
用レジスタ２は入力用レジスタ３の各シフトレジ
スタにそれぞれ対応して16ビツトの並列出力端子
をも備えたシフトレジスタを（合計16個）備えて
いる。
第４図は第１図の制御用レジスタ２、入力用レ
ジスタ３、阻止用レジスタ４、ゲート装置２１，
３１の一例を示す接続図で、出力線D0，D1……
D15のそれぞれに対応する16組の回路のうち出力
線D0に対応する回路だけを示す。他の回路も同
様である。第４図において２００は制御用シフト
レジスタ、３００は入力用シフトレジスタ、４０
０は阻止用シフトレジスタ、２０，２１０，３１
０，３２０，４１０，４２０はゲート回路であ
る。各シフトレジスタにおいてＤは直列入力端
子、Ｑは直列出力端子、CLKはクロツク入力端
であり制御用シフトレジスタ２００だけが並列出
力端子を備えている。
ジスタ３、阻止用レジスタ４、ゲート装置２１，
３１の一例を示す接続図で、出力線D0，D1……
D15のそれぞれに対応する16組の回路のうち出力
線D0に対応する回路だけを示す。他の回路も同
様である。第４図において２００は制御用シフト
レジスタ、３００は入力用シフトレジスタ、４０
０は阻止用シフトレジスタ、２０，２１０，３１
０，３２０，４１０，４２０はゲート回路であ
る。各シフトレジスタにおいてＤは直列入力端
子、Ｑは直列出力端子、CLKはクロツク入力端
であり制御用シフトレジスタ２００だけが並列出
力端子を備えている。
シフトレジスタ３００，４００は16ビツトのシ
フトレジスタで直列出力端子Ｑから直列入力端子
Ｄへはゲートを介して信号が帰されておりクロツ
クパルスP0で常時クロツクされているのでサン
プリング周期tSごとにデータが一巡しかつ出力線
D0，I0からの信号がそれぞれゲート３２０，４２
０を介して論理和的に加えられる。ただしデータ
更新周期tdごとにｇ（ｔ）の期間はゲート３１０，
４１０により入力が阻止されシフトレジスタ３０
０，４００の内容はクリアされる。制御用シフト
レジスタ２００はゲート信号ｇ（ｔ）の期間だけ
クロツクパルスP0によちゲート２０を介してク
ロツクされ、その間出力線D0上の信号、シフト
レジスタ３００に保持されていてその端子Ｑから
出力される信号及び制御用シフトレジスタ２００
自身に保持されていてその端子Ｑから出力される
信号の論理和がゲート３２０を介して入力される
がこれら信号のうちゲート４２０の出力と同時点
の信号はゲート２１０により阻止される。
フトレジスタで直列出力端子Ｑから直列入力端子
Ｄへはゲートを介して信号が帰されておりクロツ
クパルスP0で常時クロツクされているのでサン
プリング周期tSごとにデータが一巡しかつ出力線
D0，I0からの信号がそれぞれゲート３２０，４２
０を介して論理和的に加えられる。ただしデータ
更新周期tdごとにｇ（ｔ）の期間はゲート３１０，
４１０により入力が阻止されシフトレジスタ３０
０，４００の内容はクリアされる。制御用シフト
レジスタ２００はゲート信号ｇ（ｔ）の期間だけ
クロツクパルスP0によちゲート２０を介してク
ロツクされ、その間出力線D0上の信号、シフト
レジスタ３００に保持されていてその端子Ｑから
出力される信号及び制御用シフトレジスタ２００
自身に保持されていてその端子Ｑから出力される
信号の論理和がゲート３２０を介して入力される
がこれら信号のうちゲート４２０の出力と同時点
の信号はゲート２１０により阻止される。
制御用シフトレジスタ２００の並列出力はゲー
ト信号ｇ（ｔ）の期間ごとに更新されて熱記録素
子制御装置１を介しサーマル、プリンテイング、
ヘツド、アレイ中の記録素子に対する通電時間を
制御する。
ト信号ｇ（ｔ）の期間ごとに更新されて熱記録素
子制御装置１を介しサーマル、プリンテイング、
ヘツド、アレイ中の記録素子に対する通電時間を
制御する。
たとえば、ある時点TSのサンプリング周期の
ときADC５１の出力が数値12（10進表示）に相当
するものであり、ADC５２の出力が数値８（10進
表示）に相当するものであつたとすればデコーダ
７５と７６に共通なD0の出力線には０〜15に相
当する出力位相のうちの８と12に相当する出力位
相でパルスが出力し、この２個のパルスがゲート
３２０から入力されてシフトレジスタ３００内を
循環しながら保持されているが、次に来るｇ（ｔ）
の期間にはシフトレジスタ３００のＱ端子から出
力しゲート３２０，２１０を経て制御用シフトレ
ジスタ２００に入力され保持される。したがつて
その時点（仮にTDとする）から熱記録素子列の
うち第８番目と第12番目の素子に対する通電が開
始される。上記TSの時点からtR時間後には遅延装
置６２の出力に数値８を示す信号が出力されデコ
ーダ８６の出力線I0には０〜15に相当する出力位
相のうちの８に相当する出力位相でパルスが出力
し、このパルスがゲート４２０から入力されてシ
フトレジスタ４００内を循環しながら保持されて
いるが、次に来るｇ（ｔ）の期間にはシフトレジ
スタ４００のＱ端子から出力しゲート４２０を経
てゲート２１０において制御用シフトレジスタ２
００のＱ端子から出てゲート３２０を経て来た８
に相当する位相のパルスを阻止しこのパルスを消
去する。この時点はTDからTR時間後の時点であ
り、このとき熱記録素子列のうちの第８番目の素
子に対する通電が終了される。したがつてtR時間
通電された第８番目の素子の下の記録紙の部分は
赤色に発色する。また上記TSの時点からtB時間後
には遅延装置６１の出力に数値12を示す信号が出
力されデコーダ８５の出力線I0には０〜15に相当
する出力位相のうちの12に相当する出力位相でパ
ルスが出力し、このパルスがゲート４２０から入
力されてシフトレジスタ４００内を循環しながら
保持されているが、次に来るｇ（ｔ）の期間には
シフトレジスタ４００のＱ端子から出力しゲート
４２０を経てゲート２１０において制御用シフト
レジスタ２００のＱ端子から出てゲート３２０を
経て来た12に相当する位相のパルスを阻止しこの
パルスを消去する。この時点はTDからtB時間後の
時点であり、このとき熱記録素子列のうちの第12
番目の素子に対する通電が終了される。したがつ
てtB時間通電された第12番目の素子の下の記録紙
の部分は黒色に発色する。
ときADC５１の出力が数値12（10進表示）に相当
するものであり、ADC５２の出力が数値８（10進
表示）に相当するものであつたとすればデコーダ
７５と７６に共通なD0の出力線には０〜15に相
当する出力位相のうちの８と12に相当する出力位
相でパルスが出力し、この２個のパルスがゲート
３２０から入力されてシフトレジスタ３００内を
循環しながら保持されているが、次に来るｇ（ｔ）
の期間にはシフトレジスタ３００のＱ端子から出
力しゲート３２０，２１０を経て制御用シフトレ
ジスタ２００に入力され保持される。したがつて
その時点（仮にTDとする）から熱記録素子列の
うち第８番目と第12番目の素子に対する通電が開
始される。上記TSの時点からtR時間後には遅延装
置６２の出力に数値８を示す信号が出力されデコ
ーダ８６の出力線I0には０〜15に相当する出力位
相のうちの８に相当する出力位相でパルスが出力
し、このパルスがゲート４２０から入力されてシ
フトレジスタ４００内を循環しながら保持されて
いるが、次に来るｇ（ｔ）の期間にはシフトレジ
スタ４００のＱ端子から出力しゲート４２０を経
てゲート２１０において制御用シフトレジスタ２
００のＱ端子から出てゲート３２０を経て来た８
に相当する位相のパルスを阻止しこのパルスを消
去する。この時点はTDからTR時間後の時点であ
り、このとき熱記録素子列のうちの第８番目の素
子に対する通電が終了される。したがつてtR時間
通電された第８番目の素子の下の記録紙の部分は
赤色に発色する。また上記TSの時点からtB時間後
には遅延装置６１の出力に数値12を示す信号が出
力されデコーダ８５の出力線I0には０〜15に相当
する出力位相のうちの12に相当する出力位相でパ
ルスが出力し、このパルスがゲート４２０から入
力されてシフトレジスタ４００内を循環しながら
保持されているが、次に来るｇ（ｔ）の期間には
シフトレジスタ４００のＱ端子から出力しゲート
４２０を経てゲート２１０において制御用シフト
レジスタ２００のＱ端子から出てゲート３２０を
経て来た12に相当する位相のパルスを阻止しこの
パルスを消去する。この時点はTDからtB時間後の
時点であり、このとき熱記録素子列のうちの第12
番目の素子に対する通電が終了される。したがつ
てtB時間通電された第12番目の素子の下の記録紙
の部分は黒色に発色する。
以上のようにしてADC５１に入力するアナロ
グ信号は黒色で記録され、ADC５２に入力する
アナログ信号は赤色で記録される。なお実際の設
計においては、多くの場合、熱記録素子が連続加
熱されて過度の温度上昇をすることがないような
防止回路を付加することが必要となるが、この防
止回路はこの発明には直接の関係がないので第１
図には示してない。第１図の回路に過熱防止回路
を付加する場合は、遅延装置６１，６２に縦続し
てそれぞれの第２次遅延装置を設けこれら第２次
遅延装置の出力をデコードしてそのデコードした
各出力をデコーダ装置８１，８２の対応出力に論
理和的に加えればよい。
グ信号は黒色で記録され、ADC５２に入力する
アナログ信号は赤色で記録される。なお実際の設
計においては、多くの場合、熱記録素子が連続加
熱されて過度の温度上昇をすることがないような
防止回路を付加することが必要となるが、この防
止回路はこの発明には直接の関係がないので第１
図には示してない。第１図の回路に過熱防止回路
を付加する場合は、遅延装置６１，６２に縦続し
てそれぞれの第２次遅延装置を設けこれら第２次
遅延装置の出力をデコードしてそのデコードした
各出力をデコーダ装置８１，８２の対応出力に論
理和的に加えればよい。
このような第２次遅延装置を設けておけばtB又
はtRの時間加熱され加熱が終了した直後の熱素子
を再び選択して加熱を開始する信号がADC５１，
５２から出力されても、その信号は第２次遅延装
置の出力から阻止用レジスタ４に入力された信号
によつて阻止された所定時間は連続通電を防止す
ることができる。
はtRの時間加熱され加熱が終了した直後の熱素子
を再び選択して加熱を開始する信号がADC５１，
５２から出力されても、その信号は第２次遅延装
置の出力から阻止用レジスタ４に入力された信号
によつて阻止された所定時間は連続通電を防止す
ることができる。
以上は黒色及び赤色の２色記録の場合について
この発明を説明したが、３色以上の多色記録にこ
の発明を応用できることは明らかである。
この発明を説明したが、３色以上の多色記録にこ
の発明を応用できることは明らかである。
以上のようにこの発明によれば、ステーシヨナ
リ、サーマル、プリンテイング、ヘツド、アレイ
を用いて多色記録を行う多色記録装置を得ること
ができる。
リ、サーマル、プリンテイング、ヘツド、アレイ
を用いて多色記録を行う多色記録装置を得ること
ができる。
第１図はこの発明の一実施例を示すブロツク
図、第２図はこの発明の一実施例に用いるタイミ
ングの一例を示すタイミング図、第３図は第１図
に示すデコーダ装置の一例を示すブロツク図、第
４図は第１図に示すレジスタの一例を示す接続図
である。 １……熱記録素子制御装置、２……制御用レジ
スタ、３……入力用レジスタ、４……阻止用レジ
スタ、５１，５２……ADC、６１，６２……遅
延装置、７１，７２……信号源信号用デコーダ装
置、８１，８２……遅延信号用デコーダ装置、７
３，７４，８３，８４……カウンタ、７５，７
６，８５，８６……デコーダ、２００……制御用
シフトレジスタ、３００……入力用シフトレジス
タ、４００……阻止用シフトレジスタ。
図、第２図はこの発明の一実施例に用いるタイミ
ングの一例を示すタイミング図、第３図は第１図
に示すデコーダ装置の一例を示すブロツク図、第
４図は第１図に示すレジスタの一例を示す接続図
である。 １……熱記録素子制御装置、２……制御用レジ
スタ、３……入力用レジスタ、４……阻止用レジ
スタ、５１，５２……ADC、６１，６２……遅
延装置、７１，７２……信号源信号用デコーダ装
置、８１，８２……遅延信号用デコーダ装置、７
３，７４，８３，８４……カウンタ、７５，７
６，８５，８６……デコーダ、２００……制御用
シフトレジスタ、３００……入力用シフトレジス
タ、４００……阻止用シフトレジスタ。
Claims (1)
- 【特許請求の範囲】 １ 多色に発色する感熱記録紙と、この感熱記録
紙上に配列されその配列のうちから選択された素
子によつて上記記録紙を加熱する熱記録素子列
と、この熱記録素子列の中から加熱すべき素子を
選択しその選択した素子への加熱時間を制御する
熱記録素子制御装置と、記録すべき複数種類のア
ナログ信号の各アナログ信号に対応してそれぞれ
設けられ互に同一のサンプリング周期で入力アナ
ログ信号を互に同一ビツト数のデイジタル信号に
変換して出力する各アナログデイジタル変換器
と、上記各アナログデイジタル変換器にそれぞれ
対応して設けられ当該アナログデイジタル変換器
の出力を入力してそれぞれあらかじめ定められた
遅延時間だけ入力信号を遅延して出力する各遅延
装置と、上記各アナログデイジタル変換器の出力
信号を入力して当該入力信号により定められるす
べての種類の信号に分離して出力する各信号源信
号用デコーダ装置と、上記各遅延装置の出力信号
を入力して当該入力信号により定められるすべて
の種類の信号に分離して出力する各遅延信号用デ
コーダ装置と、上記サンプリング周期ごとにすべ
ての信号源用デコーダ装置の各対応する出力信号
の論理和を入力し上記サンプリング周期の所定整
数倍のデータ更新周期の間の入力信号の論理和を
保持する入力用レジスタと、上記サンプリング周
期ごとにすべての遅延信号用デコーダ装置の各対
応する出力信号の論理和を入力し上記データ更新
周期の間の入力信号の論理和を保持する阻止用レ
ジスタと、上記データ更新周期中の最終のサンプ
リング周期ごとに更新したデータの信号を入力し
この入力信号を次のデータ更新期間中保持する制
御用レジスタと、上記最終のサンプリング周期ご
とに上記制御用レジスタに保持した信号と上記入
力用レジスタに保持した信号との論理和信号のう
ち上記阻止用レジスタに保持した信号によつて阻
止される信号を除いた信号を上記更新したデータ
の信号として上記制御用レジスタに入力し上記入
力用レジスタと阻止用レジスタの内容を消去する
手段と、上記制御用レジスタに保持する信号によ
り上記熱記録素子制御装置を制御する手段とを備
えたことを特徴とする多色記録装置。 ２ 信号源信号用デコーダ装置と遅延信号用デコ
ーダ装置は共に入力デイジタル信号の上位ビツト
により信号の出力線を決定し下位ビツトによりサ
ンプリング周期内における上記信号の出力タイミ
ングを決定する手段を備え、入力用レジスタは上
記信号源用デコーダ装置の各出力線に対応してそ
れぞれ設けられる入力用シフトレジスタを備え、
阻止用レジスタは上記遅延信号用デコーダ装置の
各出力線に対応してそれぞれ設けられる阻止用シ
フトレジスタを備え、上記各入力用シフトレジス
タ及び上記各阻止用シフトレジスタは共に入力信
号をサンプリング周期だけ遅延して出力しこの出
力信号と対応するデコーダ装置出力線上の信号と
の論理和を入力するゲート回路を備え、制御用レ
ジスタは上記各入力用シフトレジスタに対応して
それぞれ設けられ並列出力端子を有する制御用シ
フトレジスタを備えたことを特徴とする特許請求
の範囲第１項記載の多色記録装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2408780A JPS56120369A (en) | 1980-02-29 | 1980-02-29 | Multicolor recording device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2408780A JPS56120369A (en) | 1980-02-29 | 1980-02-29 | Multicolor recording device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56120369A JPS56120369A (en) | 1981-09-21 |
| JPH0132074B2 true JPH0132074B2 (ja) | 1989-06-29 |
Family
ID=12128604
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2408780A Granted JPS56120369A (en) | 1980-02-29 | 1980-02-29 | Multicolor recording device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS56120369A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61192569A (ja) * | 1985-02-21 | 1986-08-27 | Tokyo Electric Co Ltd | 計量印字装置 |
| JPH065458B2 (ja) * | 1985-02-21 | 1994-01-19 | 東京電気株式会社 | ラベル |
| JPS61193871A (ja) * | 1985-02-22 | 1986-08-28 | Tokyo Electric Co Ltd | 計量印字装置 |
| JPS61193870A (ja) * | 1985-02-22 | 1986-08-28 | Tokyo Electric Co Ltd | 計量印字装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5852506B2 (ja) * | 1977-07-20 | 1983-11-22 | 株式会社日立製作所 | 画像記録装置 |
-
1980
- 1980-02-29 JP JP2408780A patent/JPS56120369A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56120369A (en) | 1981-09-21 |
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