JPH02113732A - 浮動小数点形エコーキャンセラ - Google Patents
浮動小数点形エコーキャンセラInfo
- Publication number
- JPH02113732A JPH02113732A JP26862188A JP26862188A JPH02113732A JP H02113732 A JPH02113732 A JP H02113732A JP 26862188 A JP26862188 A JP 26862188A JP 26862188 A JP26862188 A JP 26862188A JP H02113732 A JPH02113732 A JP H02113732A
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- JP
- Japan
- Prior art keywords
- circuit
- output
- floating point
- impulse response
- correction
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- Granted
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- 230000004044 response Effects 0.000 claims abstract description 27
- 238000006243 chemical reaction Methods 0.000 claims abstract description 14
- 238000004364 calculation method Methods 0.000 claims abstract description 11
- 230000005540 biological transmission Effects 0.000 claims description 4
- 238000000034 method Methods 0.000 abstract description 9
- 230000003247 decreasing effect Effects 0.000 abstract 2
- 238000004904 shortening Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 2
- PXFBZOLANLWPMH-UHFFFAOYSA-N 16-Epiaffinine Natural products C1C(C2=CC=CC=C2N2)=C2C(=O)CC2C(=CC)CN(C)C1C2CO PXFBZOLANLWPMH-UHFFFAOYSA-N 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
Landscapes
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は４線２線変換の際に生じる４線受信側の信号が
４線送信側に廻り込むエコー信号を消去する浮動小数点
形エコーキャンセラに関するものである。
４線送信側に廻り込むエコー信号を消去する浮動小数点
形エコーキャンセラに関するものである。
エコーキャンセラでは疑似エコーを生成するための受信
信号とインパルス応答のたたみこみ演算と、そのインパ
ルス応答を求める修正過程とから構成される。そのだめ
、消去能力はたたみこみ演算の精度と修正過程の精度に
依存するが、修正過程で必要な演算精度の方が一般に長
くなる。これは修正過程が一時刻前のフィルタ係数に残
差出力に比例した修正量を加えて新しいフィルタ係数を
計算するだめ、収束が進むにつれて残差出力が小さくな
シ修正量も小さくなるからである。従ってインパルス応
答のビット長は十分長くないと、必要な収束が得られる
前に修正量が零になってしまう。そこで、従来のエコー
キャンセラでは、たたみこみ演算で必要なビット長以上
のインパルス応答の記憶回路および演算回路が用いられ
ている。
信号とインパルス応答のたたみこみ演算と、そのインパ
ルス応答を求める修正過程とから構成される。そのだめ
、消去能力はたたみこみ演算の精度と修正過程の精度に
依存するが、修正過程で必要な演算精度の方が一般に長
くなる。これは修正過程が一時刻前のフィルタ係数に残
差出力に比例した修正量を加えて新しいフィルタ係数を
計算するだめ、収束が進むにつれて残差出力が小さくな
シ修正量も小さくなるからである。従ってインパルス応
答のビット長は十分長くないと、必要な収束が得られる
前に修正量が零になってしまう。そこで、従来のエコー
キャンセラでは、たたみこみ演算で必要なビット長以上
のインパルス応答の記憶回路および演算回路が用いられ
ている。
エコーキャンセラをＬＳＩ化する場合には、記憶回路の
大きさがチップ面積を左右する。ところカ、従来のエコ
ーキャンセラでは、インパルス応答の記憶回路はたたみ
こみ演算で必要なビット長以上となるため記憶回路が大
きくなシ、ＬＳＩのチップ面積を大きくする欠点があっ
た。
大きさがチップ面積を左右する。ところカ、従来のエコ
ーキャンセラでは、インパルス応答の記憶回路はたたみ
こみ演算で必要なビット長以上となるため記憶回路が大
きくなシ、ＬＳＩのチップ面積を大きくする欠点があっ
た。
本発明の目的は、インパルス応答の記憶回路のビット長
を短くして、回路規模の小さな浮動小数点形エコーキャ
ンセラを提供することにある。
を短くして、回路規模の小さな浮動小数点形エコーキャ
ンセラを提供することにある。
Ｃ課題を解決するための手段〕
本発明の浮動小数点形エコーキャンセラは、４線２線変
換の際に４線受信側の信号が４線送信側に廻り込むエコ
ー信号を消去するエコーキャンセラにおいて、受信信号
を記憶する第１の記憶回路と、インパルス応答を浮動小
数点形式で記憶する第２の記憶回路と、前記インパルス
応答と前記受信信号を掛け算する第１の浮動小数点乗算
器と、前記第１の浮動小数点乗算器の出力を累積加算す
る累算器と、送信信号から前記累算器の出力をりき送信
出力とする減算器と、前記減算器の出力より修正量を求
める修正量計算回路と、前記修正量計算回路の出力と前
記受信信号を掛け算する第２の浮動小数点乗算器と、前
記第２の浮動小数点乗算器の出力に前記インパルス応答
の指数部に対応する補正値を加える補正回路と、前記イ
ンパルス応答を固定小数点形式に変換する変換回路と、
前記補正回路の出力に前記変換回路の出力を加える加算
器と、前記加算器の出力を浮動小数点形式に変換して前
記第２の記憶回路に入力する逆変換回路を備えている。
換の際に４線受信側の信号が４線送信側に廻り込むエコ
ー信号を消去するエコーキャンセラにおいて、受信信号
を記憶する第１の記憶回路と、インパルス応答を浮動小
数点形式で記憶する第２の記憶回路と、前記インパルス
応答と前記受信信号を掛け算する第１の浮動小数点乗算
器と、前記第１の浮動小数点乗算器の出力を累積加算す
る累算器と、送信信号から前記累算器の出力をりき送信
出力とする減算器と、前記減算器の出力より修正量を求
める修正量計算回路と、前記修正量計算回路の出力と前
記受信信号を掛け算する第２の浮動小数点乗算器と、前
記第２の浮動小数点乗算器の出力に前記インパルス応答
の指数部に対応する補正値を加える補正回路と、前記イ
ンパルス応答を固定小数点形式に変換する変換回路と、
前記補正回路の出力に前記変換回路の出力を加える加算
器と、前記加算器の出力を浮動小数点形式に変換して前
記第２の記憶回路に入力する逆変換回路を備えている。
エコーキャンセラの信号処理は、次のよりに計算されて
いる。
いる。
ｅ（ｊｌ＝ ｙ（ｊ）−ｙ（Ｊ）
・・−・・・・（２ｈ”−１（ｋ）−ｈ’（ｋ）＋
μｅ（ｊ）ｘ（ｊ−ｋ） ・＝・＝ｉ３）（ｋ二０
．１，２．・・・、Ｎ−１，）ここで、ｘ（ｊ） 、
ｙ（ｊ） 、 ９（ｊ） 、 ｅ（ｊ） 、 ｈｊ（ｉ
）ぐｌ−０，１，２，・・・、Ｎ−１）はそれぞれ時刻
ｊの受信入力信号、送信入力信号、疑似エコー信号、残
差出力信号、インパルス応答である。μは収束速度を決
める係数であり、Ｎはエコーキャンセラのタップ長であ
る。
・・−・・・・（２ｈ”−１（ｋ）−ｈ’（ｋ）＋
μｅ（ｊ）ｘ（ｊ−ｋ） ・＝・＝ｉ３）（ｋ二０
．１，２．・・・、Ｎ−１，）ここで、ｘ（ｊ） 、
ｙ（ｊ） 、 ９（ｊ） 、 ｅ（ｊ） 、 ｈｊ（ｉ
）ぐｌ−０，１，２，・・・、Ｎ−１）はそれぞれ時刻
ｊの受信入力信号、送信入力信号、疑似エコー信号、残
差出力信号、インパルス応答である。μは収束速度を決
める係数であり、Ｎはエコーキャンセラのタップ長であ
る。
（３）式の係数修正計算かられかるよりに、収束が進む
につれて残差出力信号ｅ（ｊ）が小さくなり右辺第２項
の絶対値も小さくなる。従ってインパルス応答ｈ ’（
ｉ）が十分なビット長をもたないと、収束が十分進まな
いうちに右辺第２項が切捨てられて零になる。特に浮動
小数点形式では、インパルス応答ｈ’（ｉ）の絶対値が
大きくなると切捨てされる量も大きくなる。
につれて残差出力信号ｅ（ｊ）が小さくなり右辺第２項
の絶対値も小さくなる。従ってインパルス応答ｈ ’（
ｉ）が十分なビット長をもたないと、収束が十分進まな
いうちに右辺第２項が切捨てられて零になる。特に浮動
小数点形式では、インパルス応答ｈ’（ｉ）の絶対値が
大きくなると切捨てされる量も大きくなる。
そこで収束が十分進まないうちに右辺第２項が零となら
ないよりに、（３）式においてインパルス応答ｈ （
ｋ）の指数部に応じて右辺第２項に定数を加えて、切上
げ量を変えている。すなわち（３）式の右辺第２項は と計算する。インパルス応答ｈ″（ｋ）の指数部が大き
いほどδは大きい定数である。この定数δは、ｅ（ｊ）
ｘ （ｊ−ｋ） ｌが必要な収束量を得るまで涙Ｒ（ｋ
）の仮数部の最下位ビットに桁上げを生じるよりに決め
る。
ないよりに、（３）式においてインパルス応答ｈ （
ｋ）の指数部に応じて右辺第２項に定数を加えて、切上
げ量を変えている。すなわち（３）式の右辺第２項は と計算する。インパルス応答ｈ″（ｋ）の指数部が大き
いほどδは大きい定数である。この定数δは、ｅ（ｊ）
ｘ （ｊ−ｋ） ｌが必要な収束量を得るまで涙Ｒ（ｋ
）の仮数部の最下位ビットに桁上げを生じるよりに決め
る。
この結果インパルス応答ｈ’（ｋ）の指数部の大きさに
関係なく、各インパルス応答ｈ４（ｋ、）は残差出力信
号ｅ（ｊ）と受信信号ｘ （ｊ −ｋ ）の大きさＫの
み依存して修正される。従って、浮動小数点演算で、短
い仮数部のビット長でも修正過程が途中で停止して最終
収束量が不足することはない。
関係なく、各インパルス応答ｈ４（ｋ、）は残差出力信
号ｅ（ｊ）と受信信号ｘ （ｊ −ｋ ）の大きさＫの
み依存して修正される。従って、浮動小数点演算で、短
い仮数部のビット長でも修正過程が途中で停止して最終
収束量が不足することはない。
さらに、この方法はＬＭＳアルゴリズム以外の学習的同
定法やアフィン射影法のアルゴリズムにも適用可能であ
る。
定法やアフィン射影法のアルゴリズムにも適用可能であ
る。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例を示すブロック図である。１
ず受信入力信号ｘ（ｊ）はＮタップの記憶回路２０に入
力される。この記憶回路２０の信号Ｘ（ｊ −ｋ ）と
インパルス応答を保持するＮタップの記憶回路２１の信
号ｈ’（ｋ）は浮動小数点乗算器工０で乗算され、さら
に累算器３０で加算されて（１）式のただみこみが計算
され疑Φエコー信号ｙ（Ｊｌが求められる。次に減算器
６０で送信入力信号ｙ （ｊｌから累算器３０の出力ｙ
（」）を引いて残差ｅ（ｊＪを計算する。修正量計算回
路４０では（２）式の残差出力信号ｅ Ｕ）に収束速度
係数μを掛け、補正回路５０で各インパルス化＠ ｈ
’ （ｋ）の指数部の大きさに依存した定数を修正量の
絶対値に加える。最後に、記憶回路２１のインパルス応
答を固定小数点変換回路８０で固定小数点形式に変換し
て、補正回路５０の出力を加算器７０で加算して（３）
式を計算する。
ず受信入力信号ｘ（ｊ）はＮタップの記憶回路２０に入
力される。この記憶回路２０の信号Ｘ（ｊ −ｋ ）と
インパルス応答を保持するＮタップの記憶回路２１の信
号ｈ’（ｋ）は浮動小数点乗算器工０で乗算され、さら
に累算器３０で加算されて（１）式のただみこみが計算
され疑Φエコー信号ｙ（Ｊｌが求められる。次に減算器
６０で送信入力信号ｙ （ｊｌから累算器３０の出力ｙ
（」）を引いて残差ｅ（ｊＪを計算する。修正量計算回
路４０では（２）式の残差出力信号ｅ Ｕ）に収束速度
係数μを掛け、補正回路５０で各インパルス化＠ ｈ
’ （ｋ）の指数部の大きさに依存した定数を修正量の
絶対値に加える。最後に、記憶回路２１のインパルス応
答を固定小数点変換回路８０で固定小数点形式に変換し
て、補正回路５０の出力を加算器７０で加算して（３）
式を計算する。
そして（３）式の結果を浮動小数点逆変換回路９０で浮
動小数点形式に戻し、記憶回路２１のインパルス応答を
更新する。以上によシ浮動小数点形式によるエコーキャ
ンセラを実現できる。
動小数点形式に戻し、記憶回路２１のインパルス応答を
更新する。以上によシ浮動小数点形式によるエコーキャ
ンセラを実現できる。
本発明によれば、浮動小数点法の採用によυインパルス
応答の記憶回路のビット長を短くでき、さらに演算回路
においても乗算器のピッ）・長が短くできるため、回路
規模の小さなエコーキャンセラを実現できる効果がある
。
応答の記憶回路のビット長を短くでき、さらに演算回路
においても乗算器のピッ）・長が短くできるため、回路
規模の小さなエコーキャンセラを実現できる効果がある
。
第１図は本発明の一実施例を示すブロック図である。
１０ 、１．１・・・浮動小数点乗算器、２０．２１・
・・記憶回路、３０・・・累算器、４０・・・修正量計
算回路、５０・・・補正回路、６０・・減算器、７０・
・・加算器、８０・・・固定小数点変換回路、９０・・
・浮動小数点逆変換回路。
・・記憶回路、３０・・・累算器、４０・・・修正量計
算回路、５０・・・補正回路、６０・・減算器、７０・
・・加算器、８０・・・固定小数点変換回路、９０・・
・浮動小数点逆変換回路。
Claims (1)
- ４線２線変換の際に４線受信側の信号が４線送信側に廻
り込むエコー信号を消去するエコーキャンセラにおいて
、受信信号を記憶する第１の記憶回路と、インパルス応
答を浮動小数点形式で記憶する第２の記憶回路と、前記
インパルス応答と前記受信信号を掛け算する第１の浮動
小数点乗算器と、前記第１の浮動小数点乗算器の出力を
累積加算する累算器と、送信信号から前記累算器の出力
を引き送信出力とする減算器と、前記減算器の出力より
修正量を求める修正量計算回路と、前記修正量計算回路
の出力と前記受信信号を掛け算する第２の浮動小数点乗
算器と、前記第２の浮動小数点乗算器の出力に前記イン
パルス応答の指数部に対応する補正値を加える補正回路
と、前記インパルス応答を固定小数点形式に変換する変
換回路と、前記補正回路の出力に前記変換回路の出力を
加える加算器と、前記加算器の出力を浮動小数点形式に
変換して前記第２の記憶回路に入力する逆変換回路を備
えることを特徴とする浮動小数点形エコーキャンセラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26862188A JPH0793597B2 (ja) | 1988-10-24 | 1988-10-24 | 浮動小数点形エコーキャンセラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26862188A JPH0793597B2 (ja) | 1988-10-24 | 1988-10-24 | 浮動小数点形エコーキャンセラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02113732A true JPH02113732A (ja) | 1990-04-25 |
| JPH0793597B2 JPH0793597B2 (ja) | 1995-10-09 |
Family
ID=17461091
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26862188A Expired - Lifetime JPH0793597B2 (ja) | 1988-10-24 | 1988-10-24 | 浮動小数点形エコーキャンセラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0793597B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6138659B2 (ja) | 2013-10-21 | 2017-05-31 | 日置電機株式会社 | 回路基板検査装置 |
-
1988
- 1988-10-24 JP JP26862188A patent/JPH0793597B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0793597B2 (ja) | 1995-10-09 |
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