JPH02187045A - フェイスダウンボンディング用パッドの形成方法 - Google Patents

フェイスダウンボンディング用パッドの形成方法

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JPH02187045A
JPH02187045A JP1006411A JP641189A JPH02187045A JP H02187045 A JPH02187045 A JP H02187045A JP 1006411 A JP1006411 A JP 1006411A JP 641189 A JP641189 A JP 641189A JP H02187045 A JPH02187045 A JP H02187045A
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JP
Japan
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solder
electrode
bonding pad
metal layer
heat treatment
Prior art date
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Pending
Application number
JP1006411A
Other languages
English (en)
Inventor
Hiroyuki Katayama
広幸 片山
Nobuyuki Muratani
村谷 伸幸
Hiroshi Suzuki
宏 鈴木
Toshitaka Tamura
敏隆 田村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
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Filing date
Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
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Publication of JPH02187045A publication Critical patent/JPH02187045A/ja
Pending legal-status Critical Current

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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/01Manufacture or treatment
    • H10W70/05Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
    • H10W70/093Connecting or disconnecting other interconnections thereto or therefrom, e.g. connecting bond wires or bumps
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/22Secondary treatment of printed circuits
    • H05K3/24Reinforcing of the conductive pattern
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    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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    • H10W72/90Bond pads, in general
    • H10W72/951Materials of bond pads
    • H10W72/952Materials of bond pads comprising metals or metalloids, e.g. PbSn, Ag or Cu
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    • H10W72/90Bond pads, in general
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    • H10W72/983Reinforcing structures, e.g. collars

Landscapes

  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ)産業上の利用分野 この発明は、フェイスダウンボンディング法(ICチッ
プのボンディングパッド部に形成されたハンダバンプと
基板上パッドを溶融接続する方法)によってICチップ
のような電子部品を実装する基板にボンディング用パッ
ドを形成する方法に関する。
(ロ)従来の技術 第3図は従来のサーマルヘッド用の基板に駆動用ICを
搭載する場合のボンディングパッドの構成方法を説明す
る上面図、第4図は第3図のB−B矢視断面図である。
これらの図において、11はセラミック基板、I2はセ
ラミック基板I!の上に積層されたグレーズ層であり、
グレーズ層12の上に配線部13a及びボンディングパ
ッド部13bからなるニッケルリード電極13が積層さ
れ、ΔUからなるメツキ電極14か形成された後、ボン
ディングパッド部13bの周縁に、ハンダ流出防止壁、
すなわち、ハンダダムを形成するために感光性ポリイミ
ド樹脂膜15をフォトリソグラフィ技術によって積層す
るようにしている。
(ハ)発明が解決しようとする課題 しかしながら、このようなハンダダムを形成するために
ポリイミド樹脂を使用することは、材料コストが高くつ
くばかりでなく、ハンダダムを形成する工程が複雑にな
るという問題点があった。
この発明はこのような事情を考慮してなされたもので、
ハンダダムを安価に、また簡単な工程で製作することが
可能なフェイスダウンボンディング用パッドの形成方法
を提供するものである。
(ニ)課題を解決するための手段 この発明は、フェイスダウンボンディング法により電子
部品を実装する基板にボンディングパッドを形成する方
法において、基板上に第1金属層を積層して配線部及び
ボンディングパッド部を形成し、次に、そのボンディン
グパッド部のほぼ中央部に周縁を残して第2金属層を積
層し、その後、熱処理によって第1金属層の前記周縁に
酸化膜を形成することを特徴とするフェイスダウンボン
ディング用パッドの形成方法である。
なお、配線部及びボンディングパッド部を形成する第1
金属層は、ニッケルや銅を使用したメツキあるいはスパ
ッタ法などによって積層される。
また、第2金属層はAuを使用したメ゛ツキによって形
成される。また、上記熱処理を行う場合には、第1及び
第2金属膜が互いに拡散することを防止するため、第2
金属膜の膜厚と熱処理温度を選定する必要があり、第2
金属層をAuメツキによって厚さ0.3〜0.4μm程
度に形成した場合には、第1金1iliS層にニッケル
の場合)の熱処理は150ないし350℃の温度範囲で
行うことが好ましい。
(ホ)作用 熱処理によって第1金属膜のボンディングパッド部の周
縁に酸化膜が形成されると、第2金属層が酸化膜によっ
て取り囲まれるが、その酸化膜は第2金属層よりもハン
ダのぬれ性が悪いため、ボンディングパッド部にハンダ
が供給された場合、表面張力によってハンダは第2金属
層の上にした乗らず、第2金属層に形成された酸化膜が
ハンダダムとしての働きをする。したがって、高価な材
料を使用したり複雑な工程を必要とすることなく熱処理
を行うだけで容易にハンダダムを形成することができる
(へ)実施例 以下、図面に示す実施例に基づいて発明を詳述する。こ
れによって、この発明が限定されるものではない。
第1図はサーマルヘッドの駆動用ICを搭載する基板に
適用したこの発明の一実施例を示す上面図であり、第2
図は第1図のA−A矢視断面図である。
これらの図において、1はセラミック基板、2はセラミ
ック基板!上に積層されたグレーズ層である。まず、グ
レーズ層2の上面全体に配線部3a及びボンディングパ
ッド61(3bからなるニッケルリード電極3をメツキ
法によって1〜3μmの厚さで形成し、次に、ホトリソ
グラフィによって配線部2a及びボンディングパッド部
3bをパターン化して区画形成する。そして、Au電極
4を積層するため、バット部3bの中央部分以外をレジ
ストで覆った後、Auメツキを施す。それによって、0
.3〜1゜0μmの厚さのAu電極4を形成する。次に
、そのレジストを剥離した後、150〜350℃の温度
で熱処理を行い、ニッケル電極3の表面にニッケルの酸
化膜5を形成する。これによって、ボンディングパッド
部3b上のAu電極4の周りはすべて酸化膜で囲まれる
ことになる。
従って、バット部3bにハンダが供給されると、酸化膜
5のハンダのぬれ性が悪いため、ハンダはAuTr&極
4の上にとどまり、外部へ流出することがない。すなわ
ち、酸化膜5がハンダ流出防止壁(ハンダダム)として
働く。
このようにして、熱処理を行うだけでハンダダムを形成
することができるので、従来のように高価な材料を使用
したり複雑な工程を要することがない。
(ト)発明の効果 この発明によれば、高価な材料や複雑な工程を使用する
ことなくハンダ流出防止壁(ハンダダム)を安価にまた
容易に形成することが可能なフェイスダウンボンディン
グ用パッドの形成方法が提供される。
【図面の簡単な説明】
第1図はこの発明の一実施例を示す上面図、第2図は第
1図のA−A矢視断面図、第3図は従来例の第1図対応
図、第4図は第3図のB−B矢視断面図である。 l・・・・・・セラミック基板、 2・・・・・・グレーズ層、 3・・・・・・ニッケルリード電極、4・・・・・・A
u電極、5・・・・・・ニッケル酸化膜、  3a・・
・・・・配線部、3b・・・・・・ボンディングパッド
部。 b

Claims (1)

  1. 【特許請求の範囲】 1、フェイスダウンボンディング法により電子部品を実
    装する基板にボンディングパッドを形成する方法におい
    て、 基板上に第1金属層を積層して配線部及びボンディング
    パッド部を形成し、次に、そのボンディングパッド部の
    ほぼ中央部に周縁を残して第2金属層を積層し、その後
    、熱処理によって第1金属層の前記周縁に酸化膜を形成
    することを特徴とするフェイスダウンボンディング用パ
    ッドの形成方法。
JP1006411A 1989-01-13 1989-01-13 フェイスダウンボンディング用パッドの形成方法 Pending JPH02187045A (ja)

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JP1006411A JPH02187045A (ja) 1989-01-13 1989-01-13 フェイスダウンボンディング用パッドの形成方法

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JPH02187045A true JPH02187045A (ja) 1990-07-23

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ID=11637626

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Application Number Title Priority Date Filing Date
JP1006411A Pending JPH02187045A (ja) 1989-01-13 1989-01-13 フェイスダウンボンディング用パッドの形成方法

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JP (1) JPH02187045A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5281772A (en) * 1991-10-28 1994-01-25 Delco Electronics Corporation Electrical connector having energy-formed solder stops and methods of making and using the same
US6300678B1 (en) * 1997-10-03 2001-10-09 Fujitsu Limited I/O pin having solder dam for connecting substrates
USRE40819E1 (en) 1995-12-21 2009-07-07 Micron Technology, Inc. Semiconductor device with improved bond pads

Cited By (3)

* Cited by examiner, † Cited by third party
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US5281772A (en) * 1991-10-28 1994-01-25 Delco Electronics Corporation Electrical connector having energy-formed solder stops and methods of making and using the same
USRE40819E1 (en) 1995-12-21 2009-07-07 Micron Technology, Inc. Semiconductor device with improved bond pads
US6300678B1 (en) * 1997-10-03 2001-10-09 Fujitsu Limited I/O pin having solder dam for connecting substrates

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