JPH022431B2 - - Google Patents
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- JPH022431B2 JPH022431B2 JP59030686A JP3068684A JPH022431B2 JP H022431 B2 JPH022431 B2 JP H022431B2 JP 59030686 A JP59030686 A JP 59030686A JP 3068684 A JP3068684 A JP 3068684A JP H022431 B2 JPH022431 B2 JP H022431B2
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- Japan
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- line
- timer
- timing
- circuit
- black pixels
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- 238000010586 diagram Methods 0.000 description 7
- 230000000694 effects Effects 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 230000007704 transition Effects 0.000 description 5
- 238000001454 recorded image Methods 0.000 description 3
- 230000004044 response Effects 0.000 description 2
- 101100171060 Caenorhabditis elegans div-1 gene Proteins 0.000 description 1
- 230000004069 differentiation Effects 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
- B41J2/355—Control circuits for heating-element selection
Landscapes
- Electronic Switches (AREA)
- Fax Reproducing Arrangements (AREA)
Description
【発明の詳細な説明】
（技術分野）
本発明は熱記録ヘツドの駆動方式、特に情報出
力装置の記録デバイスとして使用する熱記録ヘツ
ドの駆動回路に関するものである。
力装置の記録デバイスとして使用する熱記録ヘツ
ドの駆動回路に関するものである。
（従来技術）
従来は熱記録素子の熱応答遅延による記録画の
濃淡の補償は、前ライン印字タイミングから現ラ
イン印字タイミングまでの時間によつて印字パル
ス幅を制御しているが、この方法では、前ライン
の黒画素数情報、すなわち駆動記録素子による残
熱量の温度情報としては不充分である。このた
め、連続する白ラインの後に黒ラインは、記録素
子が冷却されているため黒の濃度が充分に確保で
きない。この不具合の例としては第６図ａのよう
な原稿に対し記録画は横方向の掛線が薄くなり易
くｂのような記録画となる。
濃淡の補償は、前ライン印字タイミングから現ラ
イン印字タイミングまでの時間によつて印字パル
ス幅を制御しているが、この方法では、前ライン
の黒画素数情報、すなわち駆動記録素子による残
熱量の温度情報としては不充分である。このた
め、連続する白ラインの後に黒ラインは、記録素
子が冷却されているため黒の濃度が充分に確保で
きない。この不具合の例としては第６図ａのよう
な原稿に対し記録画は横方向の掛線が薄くなり易
くｂのような記録画となる。
（発明の目的）
本発明は印字パルス幅の制御パラメータとし
て、前ライン印字タイミングから現ライン印字タ
イミングまでの時間に加え、過去のライン中黒画
素数がある値より大きい最終ラインから現ライン
までの時間により、黒画素の少ないラインから黒
画素の多いラインへの遷移時に限り、通常の印字
パルスより印字時間を増すように制御し、掛線原
稿のような横線等の白情報の後に来る黒情報の再
現性を改善する熱記録ヘツドの駆動回路を提供す
るものである。
て、前ライン印字タイミングから現ライン印字タ
イミングまでの時間に加え、過去のライン中黒画
素数がある値より大きい最終ラインから現ライン
までの時間により、黒画素の少ないラインから黒
画素の多いラインへの遷移時に限り、通常の印字
パルスより印字時間を増すように制御し、掛線原
稿のような横線等の白情報の後に来る黒情報の再
現性を改善する熱記録ヘツドの駆動回路を提供す
るものである。
（発明の構成）
本発明によると前ライン印字タイミングから現
ライン印字タイミング迄の時間を計時する第１の
タイマと、過去のライン中黒画素数が一定値より
大きい条件を満足する最終ライン印字タイミング
から現ライン印字タイミング迄の時間を計時する
第２のタイマと、現ラインの黒画素数が所定の値
より小さい場合は前記第１のタイマの計時値で印
字パルス幅を制御し、現ラインの黒画素数が所定
の値に等しいか大きい場合は、第２のタイマの計
時値で印字パルス幅を制御する回路とを含む熱記
録ヘツドの駆動回路が得られる。
ライン印字タイミング迄の時間を計時する第１の
タイマと、過去のライン中黒画素数が一定値より
大きい条件を満足する最終ライン印字タイミング
から現ライン印字タイミング迄の時間を計時する
第２のタイマと、現ラインの黒画素数が所定の値
より小さい場合は前記第１のタイマの計時値で印
字パルス幅を制御し、現ラインの黒画素数が所定
の値に等しいか大きい場合は、第２のタイマの計
時値で印字パルス幅を制御する回路とを含む熱記
録ヘツドの駆動回路が得られる。
すなわち本発明は、熱記録式ライン記録デバイ
スにおいて、前ライン印字タイミングから現ライ
ン印字タイミング迄の時間を第１のタイマに計時
させ、過去のライン中黒画素数ｎがｎn1，
（n1：一定値）の条件を満足する最終ライン印字
タイミングから現ライン印字タイミング迄の時間
を第２のタイマに計時させて、この２つのパラメ
ータによつて印字パルス幅を制御するもので、現
ラインの黒画素数が少ない時（ｎ＜n2ここでn2は
一定値）は、白から黒への急激な変化は少ないの
で、前ラインから現ライン印字タイミングまでの
第１のタイマの計時時間で印字パルス幅を制御
し、現ラインの黒画素数が多い時（ｎn2）は白
から黒へ急激に遷移することがあり記録素子の温
度情報が大きく影響するので、このラインから数
ラインは上記第２のタイマの計時値により通常よ
り印字パルス幅を大きくすることによつて黒の濃
度を確保できるように制御するものである。
スにおいて、前ライン印字タイミングから現ライ
ン印字タイミング迄の時間を第１のタイマに計時
させ、過去のライン中黒画素数ｎがｎn1，
（n1：一定値）の条件を満足する最終ライン印字
タイミングから現ライン印字タイミング迄の時間
を第２のタイマに計時させて、この２つのパラメ
ータによつて印字パルス幅を制御するもので、現
ラインの黒画素数が少ない時（ｎ＜n2ここでn2は
一定値）は、白から黒への急激な変化は少ないの
で、前ラインから現ライン印字タイミングまでの
第１のタイマの計時時間で印字パルス幅を制御
し、現ラインの黒画素数が多い時（ｎn2）は白
から黒へ急激に遷移することがあり記録素子の温
度情報が大きく影響するので、このラインから数
ラインは上記第２のタイマの計時値により通常よ
り印字パルス幅を大きくすることによつて黒の濃
度を確保できるように制御するものである。
（発明の原理）
一般に、熱記録素子は熱応答遅延があり、高速
駆動を行なつた場合、記録素子に熱が残つている
時に比らべ、残つていない時の方が黒の濃度が充
分に確保できない。そこで、記録素子に熱が残つ
ていない時、すなわち連続した黒画素の少ないラ
インから黒画素の多いラインに遷移するときの
み、通常の印字パルス幅より印字パルス幅を大き
くすることによつて黒の濃度を確保しようとする
ものである。
駆動を行なつた場合、記録素子に熱が残つている
時に比らべ、残つていない時の方が黒の濃度が充
分に確保できない。そこで、記録素子に熱が残つ
ていない時、すなわち連続した黒画素の少ないラ
インから黒画素の多いラインに遷移するときの
み、通常の印字パルス幅より印字パルス幅を大き
くすることによつて黒の濃度を確保しようとする
ものである。
（実施例）
次に本発明の実施例について図面を参照して説
明する。第１図は熱記録ヘツドの回路図で、１ラ
インにわたる熱記録素子１１を416画素×４ブロ
ツクのマトリクス状に分割して、各ブロツクごと
にイネーブル信号EN１〜EN４で順次駆動する
ようになつている。また、この熱記録ヘツドは画
情報転送タイミングと印字タイミングを時間的に
並列処理し高速駆動を可能にするため、１ライン
分のシフトレジスタ回路１２とラツチ回路１３の
ダブル・バツフアによつて構成されており、デー
タ転送クロツクDCPと記録データDATA（ここで
黒画素は“１”，白画素は“０”である。）によつ
て転送され、ラツチパルスLATCHによつて出力
される。尚第１図で１４はナンド回路（論理積反
転出力回路）、１５は記録素子ドライバーである。
第２図は第１図の各端子に対応するタイムチヤー
トである。
明する。第１図は熱記録ヘツドの回路図で、１ラ
インにわたる熱記録素子１１を416画素×４ブロ
ツクのマトリクス状に分割して、各ブロツクごと
にイネーブル信号EN１〜EN４で順次駆動する
ようになつている。また、この熱記録ヘツドは画
情報転送タイミングと印字タイミングを時間的に
並列処理し高速駆動を可能にするため、１ライン
分のシフトレジスタ回路１２とラツチ回路１３の
ダブル・バツフアによつて構成されており、デー
タ転送クロツクDCPと記録データDATA（ここで
黒画素は“１”，白画素は“０”である。）によつ
て転送され、ラツチパルスLATCHによつて出力
される。尚第１図で１４はナンド回路（論理積反
転出力回路）、１５は記録素子ドライバーである。
第２図は第１図の各端子に対応するタイムチヤー
トである。
第３図の実施例ではこのイネーブル信号EN１
〜EN４のパルス幅を制御して目的を達してお
り、その一実施例のブロツク図を第３図に示し、
このブロツク図に対応したタイムチヤートを第４
図に示す。
〜EN４のパルス幅を制御して目的を達してお
り、その一実施例のブロツク図を第３図に示し、
このブロツク図に対応したタイムチヤートを第４
図に示す。
まず微分回路（DIV1）４０でイネーブル信号
DENが“０”になつたらタイミングをずらして
パルスφ1，φ2，φ3を出力させる。黒画素カウン
タ（C1）３８は、データ・クロツクDCPに同期
しているDATAから黒画素をカウントして、カ
ウント値がn1及びn2に達したら、それぞれ、Ｎ
１，Ｎ２を“１”にし、パルスφ3のタイミング
でクリアする。（ここでは、n1＝100，n2＝200と
してある。）T0タイマ（C4）４２はクロツクSCP
をカウントし、パルスφ2のタイミングでクリア
される。また、T1タイマ（C3）４１は、クロツ
クSCPをカウントし、N1とφ2のアント回路
（AND1）３５の出力パルスでクリアされる。T0
タイマ（C4）４２の出力ＢとT1タイマ（C3）４
１の出力Ａはデータセレクト回路（DS1）３４で
セレクト信号Ｓ（Ｓ＝N2）が“０”の時T0タイ
マ４２がセレクトされ、出力端子ＹにＢが出力さ
れ、Ｓが“１”の時T1タイマ４１がセレクトさ
れ、出力端子Ｙに出力Ａが出力される。
DENが“０”になつたらタイミングをずらして
パルスφ1，φ2，φ3を出力させる。黒画素カウン
タ（C1）３８は、データ・クロツクDCPに同期
しているDATAから黒画素をカウントして、カ
ウント値がn1及びn2に達したら、それぞれ、Ｎ
１，Ｎ２を“１”にし、パルスφ3のタイミング
でクリアする。（ここでは、n1＝100，n2＝200と
してある。）T0タイマ（C4）４２はクロツクSCP
をカウントし、パルスφ2のタイミングでクリア
される。また、T1タイマ（C3）４１は、クロツ
クSCPをカウントし、N1とφ2のアント回路
（AND1）３５の出力パルスでクリアされる。T0
タイマ（C4）４２の出力ＢとT1タイマ（C3）４
１の出力Ａはデータセレクト回路（DS1）３４で
セレクト信号Ｓ（Ｓ＝N2）が“０”の時T0タイ
マ４２がセレクトされ、出力端子ＹにＢが出力さ
れ、Ｓが“１”の時T1タイマ４１がセレクトさ
れ、出力端子Ｙに出力Ａが出力される。
カウンタ（C2）３９はφ2とN2によるアンド回
路（AND2）３６の出力ｂのパルスをスタートパ
ルスとして、パルスφ2をカウントする。このカ
ウント（C2）３９出力はスタートパルス後から
φ2カウント値がｌ（ここではｌ＝２としてある。）
になるまで“０”を出力し、ラツチ回路
（LAT2）３３のラツチパルスφ1のゲート
（AND3）３７を閉じる。すなわちラツチ回路
（LAT2）３３出力Y′はT0タイマ４２適用時は毎
ラインごとにラツチされ、T1タイマ４１適用時
はｌ＋１ラインの間ラツチされる。
路（AND2）３６の出力ｂのパルスをスタートパ
ルスとして、パルスφ2をカウントする。このカ
ウント（C2）３９出力はスタートパルス後から
φ2カウント値がｌ（ここではｌ＝２としてある。）
になるまで“０”を出力し、ラツチ回路
（LAT2）３３のラツチパルスφ1のゲート
（AND3）３７を閉じる。すなわちラツチ回路
（LAT2）３３出力Y′はT0タイマ４２適用時は毎
ラインごとにラツチされ、T1タイマ４１適用時
はｌ＋１ラインの間ラツチされる。
このT1タイマ４１適用時のラツチ処理を行な
わず、段差のある掛線の記録において単純にT1
タイマ４１を適用すると、第５図に示すように、
ｋラインにおいては、T1タイマ値T1kが適用さ
れ、ｋラインは明瞭に黒が記録されるが、ｋ＋
１，ｋ＋２ラインはT1タイマのクリアによりT0
タイマと同等の値になり、印字パルス幅が不充分
でｋ＋１，ｋ＋２ラインは、明瞭な黒が記録でき
ない。そこで、上記に示したT1タイマ適用時の
ラツチ処理により、ｋラインからｌライン分の印
字パルス幅として、T1kを適用することによつ
て、充分な黒濃度を確保させるものである。
わず、段差のある掛線の記録において単純にT1
タイマ４１を適用すると、第５図に示すように、
ｋラインにおいては、T1タイマ値T1kが適用さ
れ、ｋラインは明瞭に黒が記録されるが、ｋ＋
１，ｋ＋２ラインはT1タイマのクリアによりT0
タイマと同等の値になり、印字パルス幅が不充分
でｋ＋１，ｋ＋２ラインは、明瞭な黒が記録でき
ない。そこで、上記に示したT1タイマ適用時の
ラツチ処理により、ｋラインからｌライン分の印
字パルス幅として、T1kを適用することによつ
て、充分な黒濃度を確保させるものである。
再び第３図に戻りラツチ回路（LAT2）３３の
ラツチされた出力Y′は、印字パルス幅のデー
タ・テーブルを含むメモリ回路（ROM）３２の
アドレス端子に入力され、φ2のタイミングでテ
ーブルのデータを出力する。カウンタ（C5）３
１はこの出力をφ3のタイミングで読み込み、ク
ロツクSCPによりカウントを開始し、データ値に
達するまでQ1に“１”を出力する。Q1の出力が
終了したら、つづいてQ2〜Q4について同様にカ
ウントタイマを動作させ、第２図のイネーブル信
号EN１〜EN４のような印字パルスを形成する。
ラツチされた出力Y′は、印字パルス幅のデー
タ・テーブルを含むメモリ回路（ROM）３２の
アドレス端子に入力され、φ2のタイミングでテ
ーブルのデータを出力する。カウンタ（C5）３
１はこの出力をφ3のタイミングで読み込み、ク
ロツクSCPによりカウントを開始し、データ値に
達するまでQ1に“１”を出力する。Q1の出力が
終了したら、つづいてQ2〜Q4について同様にカ
ウントタイマを動作させ、第２図のイネーブル信
号EN１〜EN４のような印字パルスを形成する。
以上の一連の回路動作により、黒画素数の少な
いライン（ｎ＜n2）から黒画素の多いライン（ｎ
n2）に遷移する時、遷移後のｌ＋１ラインの印
字パルス幅を通常より大きくでき黒画素の濃度を
充分に確保できる。
いライン（ｎ＜n2）から黒画素の多いライン（ｎ
n2）に遷移する時、遷移後のｌ＋１ラインの印
字パルス幅を通常より大きくでき黒画素の濃度を
充分に確保できる。
このようにすると、黒画素数の少ないライン
（ｎ＜n2）から多いライン（ｎ＞n2）に遷移する
時、遷移後のｌ＋１ライン分の印字パルス幅を大
きくすることによつて高速駆動時でも第６図ｃに
示すよう掛線等の従来明瞭でなかつた部分を明瞭
にできる効果がある。
（ｎ＜n2）から多いライン（ｎ＞n2）に遷移する
時、遷移後のｌ＋１ライン分の印字パルス幅を大
きくすることによつて高速駆動時でも第６図ｃに
示すよう掛線等の従来明瞭でなかつた部分を明瞭
にできる効果がある。
（発明の効果）
本発明によると、以上説明したように、白情報
の後に来る黒情報の再現性を改善できる効果があ
る。
の後に来る黒情報の再現性を改善できる効果があ
る。
第１図は従来のダブル・バツフア方式熱記録ヘ
ツドの回路図、第２図は熱記録ヘツド駆動の制御
タイムチヤート、第３図は本発明による熱記録ヘ
ツド駆動回路の一実施例のブロツク図、第４図は
そのタイムチヤート、第５図は段差のある掛線に
おける２つのタイマの対応図、第６図ａ，ｂ，ｃ
は本発明による効果の説明図である。 １２……１ライン分の画素相当のシフトレジス
タ、１３……１ライン分の画素相当のラツチ回
路、１４……論理積反転出力回路、１５……記録
素子ドライバー、３１，３８，３９，４１，４２
…カウンタ回路、３２…データ・テーブルメモ
リ、３３…ラツチ回路、３４……データセレクト
回路、４０……パルス発生微分回路、３５，３
６，３７……論理積回路、VTH……熱記録ヘツド
駆動電源、EN１〜EN４……記録素子駆動パル
ス、LATCH……ラツチパルス、DATA……記
録用データ、DCP……データ・クロツク、SCP
……サンプル・クロツク、DEN……データ・イ
ネーブル信号。
ツドの回路図、第２図は熱記録ヘツド駆動の制御
タイムチヤート、第３図は本発明による熱記録ヘ
ツド駆動回路の一実施例のブロツク図、第４図は
そのタイムチヤート、第５図は段差のある掛線に
おける２つのタイマの対応図、第６図ａ，ｂ，ｃ
は本発明による効果の説明図である。 １２……１ライン分の画素相当のシフトレジス
タ、１３……１ライン分の画素相当のラツチ回
路、１４……論理積反転出力回路、１５……記録
素子ドライバー、３１，３８，３９，４１，４２
…カウンタ回路、３２…データ・テーブルメモ
リ、３３…ラツチ回路、３４……データセレクト
回路、４０……パルス発生微分回路、３５，３
６，３７……論理積回路、VTH……熱記録ヘツド
駆動電源、EN１〜EN４……記録素子駆動パル
ス、LATCH……ラツチパルス、DATA……記
録用データ、DCP……データ・クロツク、SCP
……サンプル・クロツク、DEN……データ・イ
ネーブル信号。
Claims (1)
- １ 前ライン印字タイミングから現ライン印字タ
イミング迄の時間を計時する第１のタイマと、過
去のライン中黒画素数が一定値より大きい条件を
満足する最終ライン印字タイミングから現ライン
印字タイミング迄の時間を計時する第２のタイマ
と、現ラインの黒画素数が所定の値より小さい場
合は前記第１のタイマの計時値で印字パルス幅を
制御し、現ラインの黒画素数が前記所定の値に等
しいか大きい場合は、前記第２のタイマの計時値
で印字パルス幅を制御する回路とを含む熱記録ヘ
ツドの駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59030686A JPS60174668A (ja) | 1984-02-21 | 1984-02-21 | 熱記録ヘッドの駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59030686A JPS60174668A (ja) | 1984-02-21 | 1984-02-21 | 熱記録ヘッドの駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60174668A JPS60174668A (ja) | 1985-09-07 |
| JPH022431B2 true JPH022431B2 (ja) | 1990-01-18 |
Family
ID=12310566
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59030686A Granted JPS60174668A (ja) | 1984-02-21 | 1984-02-21 | 熱記録ヘッドの駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60174668A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6265562A (ja) * | 1985-09-17 | 1987-03-24 | Matsushita Graphic Commun Syst Inc | 感熱記録装置 |
-
1984
- 1984-02-21 JP JP59030686A patent/JPS60174668A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60174668A (ja) | 1985-09-07 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |