JPH0225581B2 - - Google Patents
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- Publication number
- JPH0225581B2 JPH0225581B2 JP56081580A JP8158081A JPH0225581B2 JP H0225581 B2 JPH0225581 B2 JP H0225581B2 JP 56081580 A JP56081580 A JP 56081580A JP 8158081 A JP8158081 A JP 8158081A JP H0225581 B2 JPH0225581 B2 JP H0225581B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- station
- timing
- timing signal
- synchronization
- Prior art date
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- Expired - Lifetime
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/20—Repeater circuits; Relay circuits
- H04L25/24—Relay circuits using discharge tubes or semiconductor devices
- H04L25/242—Relay circuits using discharge tubes or semiconductor devices with retiming
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Dc Digital Transmission (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はPCM通信方式の従属同期中継方式に
関する。特に、一方の端局である主局に基準タイ
ミング信号発生回路を備え、他方の端局である従
局は主局から伝送路を通じて受信されるタイミン
グ信号に同期して動作するように構成された従属
同期方式の中継方式に使用する中継器の構成に関
する。
関する。特に、一方の端局である主局に基準タイ
ミング信号発生回路を備え、他方の端局である従
局は主局から伝送路を通じて受信されるタイミン
グ信号に同期して動作するように構成された従属
同期方式の中継方式に使用する中継器の構成に関
する。
第１図は従属同期方式によるPCM中継方式の
原理を示す説明図である。すなわち、主局１と従
局２との間に、主局１から従局２に向けて信号が
伝送される下り回線３と、従局２から主局１に向
けて信号が伝送される上り回線４とにより接続さ
れ、その回線３および４に、途中に生じる信号の
減衰を再生中継する再生中継器５を配置して中継
方式が構成される。再生中継器５は回線３，４の
長さに応じて複数個挿入されるが、第１図ではそ
の１個のみを表示する。
原理を示す説明図である。すなわち、主局１と従
局２との間に、主局１から従局２に向けて信号が
伝送される下り回線３と、従局２から主局１に向
けて信号が伝送される上り回線４とにより接続さ
れ、その回線３および４に、途中に生じる信号の
減衰を再生中継する再生中継器５を配置して中継
方式が構成される。再生中継器５は回線３，４の
長さに応じて複数個挿入されるが、第１図ではそ
の１個のみを表示する。
この中継方式の一方の端局である主局１には基
準タイミング信号発生回路８を備え、この回路８
の発生するタイミング信号に同期して、送信回路
９から信号が下り回線３に送信される。他方の端
局である従局２では、この下り回線３から受信さ
れる信号を等化回路１０で等化増幅し、その出力
からタイミング抽出回路１１により、タイミング
信号を抽出する。このタイミング抽出回路１１に
より抽出されたタイミング信号に同期して、送信
回線１２が上り回線４に信号を送信する。
準タイミング信号発生回路８を備え、この回路８
の発生するタイミング信号に同期して、送信回路
９から信号が下り回線３に送信される。他方の端
局である従局２では、この下り回線３から受信さ
れる信号を等化回路１０で等化増幅し、その出力
からタイミング抽出回路１１により、タイミング
信号を抽出する。このタイミング抽出回路１１に
より抽出されたタイミング信号に同期して、送信
回線１２が上り回線４に信号を送信する。
上り回路４から主局１に到達した信号は、等化
回路１５により等化増幅され、その出力信号から
タイミング抽出回路１６により、タイミング信号
が抽出される。等化回路１５の出力はこのタイミ
ング信号に同期して、エラステイツクメモリ１７
に書込まれ、さらに基準タイミング発生回路８の
出力タイミング信号に同期して、エラステイツク
メモリ１７からその書込まれた信号が読出され
る。
回路１５により等化増幅され、その出力信号から
タイミング抽出回路１６により、タイミング信号
が抽出される。等化回路１５の出力はこのタイミ
ング信号に同期して、エラステイツクメモリ１７
に書込まれ、さらに基準タイミング発生回路８の
出力タイミング信号に同期して、エラステイツク
メモリ１７からその書込まれた信号が読出され
る。
第２図は従来例方式の再生中継器の構成図であ
る。すなわち、各再生中継器５では、それぞれ回
線３，４の信号を等化回路２０，２１で等化増幅
し、その出力からそれぞれタイミング抽出回路２
２，２３によりタイミング信号を抽出し、それぞ
れこのタイミング信号に同期して送信回路２４，
２５から信号を送信するように構成されている。
る。すなわち、各再生中継器５では、それぞれ回
線３，４の信号を等化回路２０，２１で等化増幅
し、その出力からそれぞれタイミング抽出回路２
２，２３によりタイミング信号を抽出し、それぞ
れこのタイミング信号に同期して送信回路２４，
２５から信号を送信するように構成されている。
このような従属同期方式は、従局２に基準タイ
ミング発生回路を備える必要がないので安価にな
る利点があるが、タイミング信号が各再生中継器
５で繰返して抽出され再生されるため、これに伴
うジツタが次第に累加される欠点がある。従つて
再生中継器が多数個必要とされる回線には、従局
同期方式を利用することができない。
ミング発生回路を備える必要がないので安価にな
る利点があるが、タイミング信号が各再生中継器
５で繰返して抽出され再生されるため、これに伴
うジツタが次第に累加される欠点がある。従つて
再生中継器が多数個必要とされる回線には、従局
同期方式を利用することができない。
本発明はこれを改良するもので、従属同期方式
で再生中継に伴い累加されるジツタを小さく抑圧
することを目的とする。
で再生中継に伴い累加されるジツタを小さく抑圧
することを目的とする。
本発明は、従属同期方式の主局と従局との間に
挿入される再生中継器にエラステイツクメモリを
設けて、上り回線の信号のタイミングを下り回線
にあるジツタの少ないタイミング信号に同期させ
て読み出して信号を伝送することを特徴とする。
挿入される再生中継器にエラステイツクメモリを
設けて、上り回線の信号のタイミングを下り回線
にあるジツタの少ないタイミング信号に同期させ
て読み出して信号を伝送することを特徴とする。
第３図は本発明実施例装置のブロツク構成図で
ある。これは第１図に示す再生中継器５にそつく
り入れ替えて用いることができ、本発明を実施す
ることにより両端局には変更がない。本発明実施
例の再生中継器５は、下り回線３については、等
化回路２０、タイミング抽出回路２２および送信
回路２４とも、第２図に示す従来例装置と変りは
ないが、上り回線４については、等化回路２１の
出力にエラステイツクメモリ２７を挿入し、この
エラステイツクメモリ２７には、タイミング回路
２３により抽出されるタイミング信号に同期して
書込を行い、下り回線３のタイミング信号２２の
抽出するタイミング信号に同期して読出を行うと
ころに特徴がある。
ある。これは第１図に示す再生中継器５にそつく
り入れ替えて用いることができ、本発明を実施す
ることにより両端局には変更がない。本発明実施
例の再生中継器５は、下り回線３については、等
化回路２０、タイミング抽出回路２２および送信
回路２４とも、第２図に示す従来例装置と変りは
ないが、上り回線４については、等化回路２１の
出力にエラステイツクメモリ２７を挿入し、この
エラステイツクメモリ２７には、タイミング回路
２３により抽出されるタイミング信号に同期して
書込を行い、下り回線３のタイミング信号２２の
抽出するタイミング信号に同期して読出を行うと
ころに特徴がある。
すなわち、上り回線４の信号は等化回路２１で
等化増幅された後、その信号のタイミングでエラ
ステイツクメモリ２７に書込まれる。この上り回
線４のタイミングは、第１図でわかるように従局
２で折返し再生されてきたものであるので、下り
回線３のタイミングに比べると再生中継された回
数が多く、累加されたジツタの量も大きい。エラ
ステイツクメモリ２７に書込まれた信号は、ジツ
タの少ない下り回線３から抽出されたタイミング
信号に同期して読出されることにより、ジツタが
小さくなる。この信号は送信回路２５からさらに
上り回線に送出される。
等化増幅された後、その信号のタイミングでエラ
ステイツクメモリ２７に書込まれる。この上り回
線４のタイミングは、第１図でわかるように従局
２で折返し再生されてきたものであるので、下り
回線３のタイミングに比べると再生中継された回
数が多く、累加されたジツタの量も大きい。エラ
ステイツクメモリ２７に書込まれた信号は、ジツ
タの少ない下り回線３から抽出されたタイミング
信号に同期して読出されることにより、ジツタが
小さくなる。この信号は送信回路２５からさらに
上り回線に送出される。
このように構成された再生中継器５を、主局１
と従局２との間の回線のほぼ中間位置の中継器に
１個所だけ使用すると、累加されるジツタは、こ
の再生中継器５の上り回線入力または主局１の上
り回線入力でほぼ最大となるが、その大きさは従
来方式に比べると約２分の１になる。
と従局２との間の回線のほぼ中間位置の中継器に
１個所だけ使用すると、累加されるジツタは、こ
の再生中継器５の上り回線入力または主局１の上
り回線入力でほぼ最大となるが、その大きさは従
来方式に比べると約２分の１になる。
本発明の再生中継器は回線の主局と従局との中
間位置の１個所に限らず、複数の個所に使用する
ことができる。
間位置の１個所に限らず、複数の個所に使用する
ことができる。
以上述べたように、本発明により従属同期方式
をとるPCM中継方式で、伝送路の再生中継によ
り生ずるジツタの累加を小さく抑えることができ
る。特に主局と従局との中間位置でジツタの少な
い下り回線の送信タイミング信号を用いると、従
局から主局への信号伝送におけるタイミング信号
のジツタを小さくできる。
をとるPCM中継方式で、伝送路の再生中継によ
り生ずるジツタの累加を小さく抑えることができ
る。特に主局と従局との中間位置でジツタの少な
い下り回線の送信タイミング信号を用いると、従
局から主局への信号伝送におけるタイミング信号
のジツタを小さくできる。
これにより信号の誤りを小さくでき、長距離の
方式に経済的な従属同期方式を適用することがで
きる。
方式に経済的な従属同期方式を適用することがで
きる。
第１図は従属同期方式の説明図。第２図は従来
例装置の構成図。第３図は本発明実施例装置の構
成図。 １……主局、２……従局、３……下り回線、４
……上り回線、５……再生中継器、８……基準タ
イミング信号発生回路、９……送信回路、１０…
…等化回路、１１……タイミング抽出回路、１２
……送信回路、１５……等化回路、１６……タイ
ミング抽出回路、１７……エラステイツクメモ
リ、２０，２１……等化回路、２２，２３……タ
イミング抽出回路、２４，２５……送信回路、５
７……エラステイツクメモリ。
例装置の構成図。第３図は本発明実施例装置の構
成図。 １……主局、２……従局、３……下り回線、４
……上り回線、５……再生中継器、８……基準タ
イミング信号発生回路、９……送信回路、１０…
…等化回路、１１……タイミング抽出回路、１２
……送信回路、１５……等化回路、１６……タイ
ミング抽出回路、１７……エラステイツクメモ
リ、２０，２１……等化回路、２２，２３……タ
イミング抽出回路、２４，２５……送信回路、５
７……エラステイツクメモリ。
Claims (1)
- 【特許請求の範囲】 １ 主局に基準タイミング信号発生回路と、この
回路が発生するタイミング信号に同期して従局に
対して信号を伝送する手段とを備え、 従局に前記主局からのタイミング信号を受信す
る手段と、前記タイミング信号に同期して前記主
局に信号を伝送する手段とを備え、 前記主局と前記従局との間の伝送路に複数の再
生中継器が挿入された 従属同期通信方式において、 上記再生中継器内の少なくとも上記主局と従局
の中間に位置する再生中継器は、 前記主局から前記従局に向けて信号が伝送され
る下り回線からタイミング信号を抽出する第一の
タイミング抽出回路と、 前記従局から前記主局へ向けて信号が伝送され
る上り回線からタイミング信号を抽出する第二の
タイミング抽出回路と、 前記上り回線に挿入され前記第二のタイミング
抽出回路の出力タイミング信号に同期して伝送信
号の書込を行い前記第一のタイミング抽出回路の
出力タイミング信号に同期して伝送信号の読出し
を行うエラステイツクメモリと を備えたことを特徴とする従属同期中継方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56081580A JPS57194653A (en) | 1981-05-27 | 1981-05-27 | Reproducing repeater |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56081580A JPS57194653A (en) | 1981-05-27 | 1981-05-27 | Reproducing repeater |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57194653A JPS57194653A (en) | 1982-11-30 |
| JPH0225581B2 true JPH0225581B2 (ja) | 1990-06-04 |
Family
ID=13750245
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56081580A Granted JPS57194653A (en) | 1981-05-27 | 1981-05-27 | Reproducing repeater |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57194653A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3434869B2 (ja) * | 1994-02-07 | 2003-08-11 | 株式会社日立製作所 | 光再生中継器および光伝送装置 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS49121463A (ja) * | 1973-03-20 | 1974-11-20 | ||
| JPS5941336B2 (ja) * | 1976-07-21 | 1984-10-06 | 日本電気株式会社 | バツフアメモリ装置 |
-
1981
- 1981-05-27 JP JP56081580A patent/JPS57194653A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57194653A (en) | 1982-11-30 |
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| JPH0531981B2 (ja) |