JPH02280247A - 情報処理装置 - Google Patents

情報処理装置

Info

Publication number
JPH02280247A
JPH02280247A JP1102472A JP10247289A JPH02280247A JP H02280247 A JPH02280247 A JP H02280247A JP 1102472 A JP1102472 A JP 1102472A JP 10247289 A JP10247289 A JP 10247289A JP H02280247 A JPH02280247 A JP H02280247A
Authority
JP
Japan
Prior art keywords
instruction
storage means
instruction word
buffer storage
block
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1102472A
Other languages
English (en)
Inventor
Tokuo Watanabe
渡邊 徳男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP1102472A priority Critical patent/JPH02280247A/ja
Publication of JPH02280247A publication Critical patent/JPH02280247A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Memory System Of A Hierarchy Structure (AREA)
  • Advance Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、命令語を格納している主記憶手段を有する情
報処理装置に関し、特に、緩衝記憶内に有効な命令語が
−っも存在しないときにおける命令語供給の高速化を可
能とした情報処理装置に関する。
〔従来の技術〕
従来の情報処理装置は、緩衝記憶手段より主記憶手段に
対してブロックの読み出し要求があった時、主記憶手段
は、要求のあったブロックの命令語のみを緩衝記憶手段
に対して送っていた。
〔発明が解決しようとする課題〕
したがって、上述した従来の情報処理装置は、緩衝記憶
内に有効な命令語が一つも存在しない場合においては、
緩衝記憶内に有効な命令語が蓄積されるまでの間命令供
給手段が要求する命令語が緩衝記憶内に存在する確率が
低く、命令語供給が遅くなるという欠点がある。
〔課琶を解決するための手段〕
本発明の情報処理装置は、命令語を格納する主記憶手段
と、命令語の解読および処理を行う命令処理手段と、前
記主記憶手段と前記命令処理手段との間にあって前記主
記憶手段に格納されている命令語を読み出し、前記命令
処理手段へ供給するための命令供給手段と、前記主記憶
手段と前記命令供給手段との間にあって前記主記憶手段
に格納されている命令語の一部の写しをブロック単位で
記憶する緩衝記憶手段とを具備し、前記主記憶手段が、
前記緩衝記憶手段からブロックの読み出し要求があった
時、該ブロックのノ命令語とともに該ブロックと連続す
る複数ブロックの命令語も前記緩衝記憶手段へ送るため
の制御回路を有していることを特徴とする。
〔実施例〕
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例の構成図である。命令供給手
段2は命令処理手段1へ命令語を供給するために緩衝記
憶手段3に対して命令語の読み出し要求を発行する。緩
衝記憶手段3は、要求のあった命令語が緩衝記憶内に存
在するか否かを調べ、存在する時は命令供給手段2へ命
令語を送る。存在しない時は、主記憶手段に対して要求
のあった命令語を含むブロックの読み出し要求を発行す
る。
制御部5は、要求のあったブロックの命令語を記憶部4
から緩衝記憶手段3へ送るとともに、緩衝記憶手段3に
有効な命令語が一つも存在しない時は、要求のあったブ
ロックに連続する複数ブロックの命令語も記憶部4から
緩衝記憶手段3に送る。
〔発明の効果〕
以上説明したように本発明は、緩衝記憶に有効な命令語
が一つも存在しない時に、主記憶手段から複数ブロック
の命令語を送ることにより、1回の命令語要求で多量の
命令語を緩衝記憶に蓄積できるため、緩衝記憶から命令
供給手段への命令語供給を高速に行なえるという効果を
奏する。
【図面の簡単な説明】
第1図は本発明の一実施例の構成図である。 1・・・命令処理手段、2・・・命令供給手段、3・・
・緩衝記憶手段、4・・・記憶部、5・・・制御部、6
・・・主記憶手段。

Claims (1)

    【特許請求の範囲】
  1. 命令語を格納する主記憶手段と、命令語の解読および処
    理を行う命令処理手段と、前記主記憶手段と前記命令処
    理手段との間にあって前記主記憶手段に格納されている
    命令語を読み出し、前記命令処理手段へ供給するための
    命令供給手段と、前記主記憶手段と前記命令供給手段と
    の間にあって前記主記憶手段に格納されている命令語の
    一部の写しをブロック単位で記憶する緩衝記憶手段とを
    具備し、前記主記憶手段が、前記緩衝記憶手段からブロ
    ックの読み出し要求があった時、該ブロックの命令語と
    ともに該ブロックと連続する複数ブロックの命令語も前
    記緩衝記憶手段へ送るための制御回路を有していること
    を特徴とする情報処理装置。
JP1102472A 1989-04-21 1989-04-21 情報処理装置 Pending JPH02280247A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1102472A JPH02280247A (ja) 1989-04-21 1989-04-21 情報処理装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1102472A JPH02280247A (ja) 1989-04-21 1989-04-21 情報処理装置

Publications (1)

Publication Number Publication Date
JPH02280247A true JPH02280247A (ja) 1990-11-16

Family

ID=14328393

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1102472A Pending JPH02280247A (ja) 1989-04-21 1989-04-21 情報処理装置

Country Status (1)

Country Link
JP (1) JPH02280247A (ja)

Similar Documents

Publication Publication Date Title
JP3598321B2 (ja) 異なる周波数で動作するバス間でやりとりされるバッファリングデータ
JPH07113903B2 (ja) キャッシュ記憶制御方式
GB2271653A (en) Multi-level cache system
JPH08235092A (ja) データ転送制御装置
JPH02280247A (ja) 情報処理装置
JPS593774A (ja) アクセス処理方式
JPH02280246A (ja) 情報処理装置
KR100284784B1 (ko) 메모리 데이터 처리 시스템 및 방법과 이건 시스템을 구비하는 통신 시스템
JPH0212350A (ja) 情報処理装置
JPS576480A (en) Buffer memory control system
JP2000227895A (ja) 画像データ転送装置および画像データ転送方法
JPH02257342A (ja) 情報処理装置
JPH0240717A (ja) 情報処理装置
JPS6055459A (ja) プロツクデ−タ転送記憶制御方法
JPS61214047A (ja) メモリデ−タ転送回路
JPS5794974A (en) Buffer memory control system
JPS63259746A (ja) バンクメモリ間のデ−タ転送方式
JPS61165163A (ja) チヤネル選択方式
JPS61153728A (ja) 磁気記憶装置の高速制御方式
JPH0594367A (ja) バツフア記憶装置
JPH03263143A (ja) 緩衝記憶装置
JPH07160577A (ja) キャッシュメモリ制御装置
JPS6243737A (ja) 割り込み制御方式
JPS61221845A (ja) バツフアメモリ無効化アドレス生成方式
JPH05127975A (ja) 共有メモリアクセス方式