JPH0247852A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH0247852A
JPH0247852A JP19913088A JP19913088A JPH0247852A JP H0247852 A JPH0247852 A JP H0247852A JP 19913088 A JP19913088 A JP 19913088A JP 19913088 A JP19913088 A JP 19913088A JP H0247852 A JPH0247852 A JP H0247852A
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JP
Japan
Prior art keywords
wiring
film
forming
insulating film
silicon oxide
Prior art date
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Pending
Application number
JP19913088A
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English (en)
Inventor
Kazuhiko Katami
形見 和彦
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、多層配線を有する半導体装置における各配線
層間の相互接続方法に関する。
[従来の技術] 従来の半導体装置の製造方法では、最初第2図(a)の
ように、第1の金属配線203の形成された半導体基板
201上方に眉間絶縁膜204を形成した後、第2図(
b)のように、フォト・エツチングにより眉間絶縁膜2
04にコンタクトホールを開孔し、最後に、第2図(C
)のように。
第2の金属配線205を形成し、第1の金属配線203
と第2の金属配、111205は互いに電気的に接続さ
れるようになっていた。このとき、一般にはコンタクト
ホールのエツチングはドライエツチングで行ない、また
、配線金属はスパッタ法により形成している。
[発明が解決しようとする課題] しかしながら、前述の従来技術では、パターンが微細化
されるにともないコンタクトホール部分での配線金属の
被覆性が乏しくなり、最悪の場合にはこの部分で第2の
金属配線が断線する場合があった。また、眉間絶縁膜表
面の凹凸に起因する段差も急峻になり、この部分におい
て第2の配線金属が断線したり、逆に隣接する配線間で
短絡したりする場合があった。
そこで本発明はこのような課題を解決するもので、その
目的とするところは、コンタクトホールの中に導電体を
充填し、この部分における配線の断線を防止するととも
に、眉間絶縁膜表面を平坦化し眉間絶縁膜表面の凹凸に
起因する配線の断線及び短絡を防止する半導体装置の製
造方法を提供するところにある。
[課題を解決するための手段] 本発明は、半導体基板上方の第1の絶縁膜上に形成され
た第1の配線上に、前記第1の配線を構成する材質とは
異なる材質より成る導電膜を形成する工程。
フォト・エツチングによりコンタクトホールとなるよう
に設計された部分に前記導電膜より成る突起を形成する
工程。
前記第1の配線及び前記導電膜より成る突起を含む前記
第1の絶縁膜上の全面に第2の絶縁膜を形成する工程。
前記の第2の絶縁膜上に、その表面が平坦になるように
、凸部分では厚く、凹部分では薄く被膜を形成する工程
前記被膜及び前記第2の絶縁膜を互いに等しいエツチン
グ速度でエツチングし、前記導電膜より成る突起を露出
させる工程。
前記導電膜より成る突起を介して前記第1の配線と電気
的に接続されるように第2の配線を形成する工程。
よりなることを特徴とする。
[実施例] 本発明の実施例における工程断面図を、第1図(a)〜
(f)に示し、以下工程順に詳細に説明していく。
まず最初に、第1図(a)のように、半導体基板101
上方に形成されたアルミニウム・シリコン合金膜103
よりなる第1の配線を含む酸化珪素膜102上に全面的
にタングステン膜104を形成する。このとき、アルミ
ニウム・シリコン合金膜の膜厚は8000人、タングス
テン膜の膜厚は8000人である。
次に、第1図(b)のように、フォト・エツチングによ
り、第2の配線と導通をとる部分、すなわち、コンタク
トホールとなる部分にのみタングステン膜104を残し
、それ以外のタングステン膜104は除去する。このと
き、エツチングはドライエツチングによって行なってお
り、その条件は、  CF4=50secm、  6P
a、  500Wで。
この条件下では、タングステンは容易にエツチングされ
るが、下層のアルミニウム・シリコン合金j′1103
及び酸化珪素膜102はエツチングされない。
次に、第1図(C)のように2層間絶縁膜として、化学
的気相成長法により酸化珪素膜105を7000人形成
する。
次に、第1図(d)のように、酸化珪素膜1゜5上にフ
ォトレジスト106を回転塗布する。このとき、フォト
レジストは凸部分には薄く、凹部分には厚く形成される
ため、その表面は平坦になっている。
次に、第1図(e)のように、フォトレジスト106と
酸化珪素膜105のエツチング速度が等しくなるような
エツチング条件で、フォトレジスト106及び酸化珪素
l11105を連続的にエツチングし、タングステン膜
104上の酸化珪素膜105が完全に除去されタングス
テン膜104が露出するまでるまでエツチングする。こ
のときのエツチング条件は、CF4=30SCCm、0
2:20 s e c m、  6 P a、  80
0 Wであった。
最後に、第1図(f)のように、アルミニウム・シリコ
ン合金106よりなる第2の配線を形成し、第1の配線
と第2の配線は電気的に接続される。
[発明の効果] 以上述べたように1本発明によれば、第1の配線上のコ
ンタクトホールとなるように設計された部分に、第1の
配線とは異なる材質より成る導電膜の突起を形成した後
に、眉間絶縁膜を形成し。
エッチバック法を用いて表面を平坦化するとともに、突
起を露出させた後、この上に第2の配線を形成し、この
突起を介して第1の配線と第2の配線を電気的に導通さ
せるようにすることにより。
第1の配線と第2の配線の接続部分における断線。
及び層間絶縁膜表面の急峻な凹凸に起因する第2の配線
の断線、短絡を防止できるという効果を有し、これによ
り高歩留りで高信頼性の半導体装置を造ることができる
ようになった。
【図面の簡単な説明】
第1図(a)〜(f)は2本発明の半導体装置の製造方
法を示す工程断面図。 第2図(a)〜(c)は、従来の半導体装置の製造方法
を示す工程断面図。 101.201 102、 202 103、 203 104゜ 105、 204 106゜ 107、 205 半導体基板 酸化珪素膜(絶縁膜) アルミニウム・シリコン 合金(第1の配線) タングステン 酸化珪素膜(層間絶縁膜) フォトレジスト アルミニウム・シリコン 合金(第2の配線) o3 10う Oy

Claims (1)

  1. 【特許請求の範囲】 半導体基板上方の第1の絶縁膜上に形成された第1の配
    線上に、前記第1の配線を構成する材質とは異なる材質
    より成る導電膜を形成する工程、フォト・エッチングに
    よりコンタクトホールとなるように設計された部分に前
    記導電膜より成る突起を形成する工程、 前記第1の配線及び前記導電膜より成る突起を含む前記
    第1の絶縁膜上の全面に第2の絶縁膜を形成する工程、 前記の第2の絶縁膜上に、その表面が平坦になるように
    、凸部分では厚く、凹部分では薄く被膜を形成する工程
    、 前記被膜及び前記第2の絶縁膜を互いに等しいエッチン
    グ速度でエッチングし、前記導電膜より成る突起を露出
    させる工程、 前記導電膜より成る突起を介して前記第1の配線と電気
    的に接続されるように第2の配線を形成する工程、 よりなることを特徴とする半導体装置の製造方法。
JP19913088A 1988-08-10 1988-08-10 半導体装置の製造方法 Pending JPH0247852A (ja)

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