JPH0316218A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPH0316218A JPH0316218A JP15186689A JP15186689A JPH0316218A JP H0316218 A JPH0316218 A JP H0316218A JP 15186689 A JP15186689 A JP 15186689A JP 15186689 A JP15186689 A JP 15186689A JP H0316218 A JPH0316218 A JP H0316218A
- Authority
- JP
- Japan
- Prior art keywords
- electrode wiring
- contact window
- wiring layer
- layer
- semiconductor device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 26
- 238000004519 manufacturing process Methods 0.000 title claims description 10
- 239000010410 layer Substances 0.000 claims abstract description 40
- 239000000758 substrate Substances 0.000 claims abstract description 12
- 239000011229 interlayer Substances 0.000 claims abstract description 10
- 238000000034 method Methods 0.000 claims abstract description 8
- 150000001875 compounds Chemical class 0.000 claims abstract description 7
- 238000009792 diffusion process Methods 0.000 claims abstract description 7
- 238000005530 etching Methods 0.000 claims abstract description 4
- 238000000151 deposition Methods 0.000 claims description 8
- 229920000620 organic polymer Polymers 0.000 claims description 5
- 238000004528 spin coating Methods 0.000 claims description 3
- 150000002894 organic compounds Chemical class 0.000 claims 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 abstract description 17
- 229910052782 aluminium Inorganic materials 0.000 abstract description 17
- 230000003247 decreasing effect Effects 0.000 abstract 1
- 230000008021 deposition Effects 0.000 abstract 1
- 238000009413 insulation Methods 0.000 abstract 1
- 229920000642 polymer Polymers 0.000 abstract 1
- 239000005380 borophosphosilicate glass Substances 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 239000012044 organic layer Substances 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、電極配線層と半導体基板中の拡散層のコンタ
クト部分での電極配線層の平坦化を図った半導体装置の
製造方法K関するものである。
クト部分での電極配線層の平坦化を図った半導体装置の
製造方法K関するものである。
従来の技術
従来、第2図に示す様に半導体基板21の一主而上に層
間絶縁膜23としてBPSGを形戚し(b)、コンタク
ト窓24を開孔した後FC+、その上に蒸着等により第
1アルミ配線層25を形或しているf(11。
間絶縁膜23としてBPSGを形戚し(b)、コンタク
ト窓24を開孔した後FC+、その上に蒸着等により第
1アルミ配線層25を形或しているf(11。
発明が解決しようとする課題
従来、第2図に示す様に電極配線として使われているア
ルミ配線層は蒸着によう形威されるため、段差のあるコ
ンタクト窓では底部の中央部で厚くなる部分27と底部
の周辺部の角で薄くなる部分26とが存在する。その為
、電極配線抵抗が高くなったシ、時には周辺部の角で配
線が断線することも見られる。又、コンタクト窓付近で
半導体装置の段差が大きくなるなどの問題があった。
ルミ配線層は蒸着によう形威されるため、段差のあるコ
ンタクト窓では底部の中央部で厚くなる部分27と底部
の周辺部の角で薄くなる部分26とが存在する。その為
、電極配線抵抗が高くなったシ、時には周辺部の角で配
線が断線することも見られる。又、コンタクト窓付近で
半導体装置の段差が大きくなるなどの問題があった。
本発明はかかる点に鑑み、コンタクト窓の電極配線抵抗
を低減することができる半導体装置の製造方法を提供せ
んとするものである。
を低減することができる半導体装置の製造方法を提供せ
んとするものである。
課題を解決するための手段
本発明は前記目的を達或するために、半導体基板上に層
間絶縁膜を被着する工程と、前記層間絶縁膜にコンタク
ト窓を開孔する工程と、前記コンタクト窓部分に露出し
た前記半導体基板の拡散層上に第1の電極配線層を被着
する工程と、コンタクト窓部分で前記第1の電極配線層
の凹部にスピン塗布及びエッチバックにより導電性の有
機高分子化合物を埋め込む工程と、前記第1の電極配線
層及びコンタクト窓の凹部に埋め込んだ導電性の有機高
分子化合物上に第2の電極配線層を被着する工程を特徴
とする半導体装置の製造方法である。
間絶縁膜を被着する工程と、前記層間絶縁膜にコンタク
ト窓を開孔する工程と、前記コンタクト窓部分に露出し
た前記半導体基板の拡散層上に第1の電極配線層を被着
する工程と、コンタクト窓部分で前記第1の電極配線層
の凹部にスピン塗布及びエッチバックにより導電性の有
機高分子化合物を埋め込む工程と、前記第1の電極配線
層及びコンタクト窓の凹部に埋め込んだ導電性の有機高
分子化合物上に第2の電極配線層を被着する工程を特徴
とする半導体装置の製造方法である。
作用
この半導体装置の製造方法によって、コンタクト窓の電
極配線層の平坦化が図られるとともに、電極配線抵抗を
低減することができる。
極配線層の平坦化が図られるとともに、電極配線抵抗を
低減することができる。
又、コンタクト窓底部での第1の電極配線の断線は、埋
め込まれた導電性の有機高分子化合物さらには上部の第
2の電極配線層によって救済される。
め込まれた導電性の有機高分子化合物さらには上部の第
2の電極配線層によって救済される。
実施例
以下に、第1図を参照にして本発明の半導体装置の製造
方法について詳しく説明する。
方法について詳しく説明する。
第1図は本発明の半導体装置に於ける一実施例のコンタ
クト部分を示す断面図である。
クト部分を示す断面図である。
半導体基板11上に層間絶縁膜13としてBPSGを形
成し(b』、エッチングによう所定の個所にコンタクト
窓14を開孔した後FC+、前記コンタクト窓部分に露
出した前記半導体基板の拡散層領域12上に蒸着等によ
り第1のアルミ電極配線層15を被着し((13、前記
第1のアルミ電極配線層16の上部に導電性の有機高分
子化合物として導電性のレジスト1Bをスピン塗布によ
り被着した後(e)、エッチバックによシ第1のアルミ
電極配線層16の凹部以外の導電性のレジストを除去し
凹部にのみ導電性のレジスト18を残して埋め込んで平
坦化した後(0、前記第1のアルミ電極配線層16及び
コンタクトの凹部に埋め込んだ導電性のレジスト18上
に第2の電極配線層19を被着する(船。
成し(b』、エッチングによう所定の個所にコンタクト
窓14を開孔した後FC+、前記コンタクト窓部分に露
出した前記半導体基板の拡散層領域12上に蒸着等によ
り第1のアルミ電極配線層15を被着し((13、前記
第1のアルミ電極配線層16の上部に導電性の有機高分
子化合物として導電性のレジスト1Bをスピン塗布によ
り被着した後(e)、エッチバックによシ第1のアルミ
電極配線層16の凹部以外の導電性のレジストを除去し
凹部にのみ導電性のレジスト18を残して埋め込んで平
坦化した後(0、前記第1のアルミ電極配線層16及び
コンタクトの凹部に埋め込んだ導電性のレジスト18上
に第2の電極配線層19を被着する(船。
以上のように本実施例によれば、コンタクト窓底部での
第1のアルミ配線層16が断線しても、凹部の多結晶シ
リコン及び上部の第2のアルミ配線層20によって救済
される。
第1のアルミ配線層16が断線しても、凹部の多結晶シ
リコン及び上部の第2のアルミ配線層20によって救済
される。
発明の効果
本発明の半導体装置の製造方法によれば、コンタクト窓
において第1の電極配線層の上に導電性のレジストを埋
め込んで平坦化を図ることにより、電極配線抵抗を低減
するとともに、断線もなくすことができる。この結果、
電極配線層の信頼性を向上させることができる。
において第1の電極配線層の上に導電性のレジストを埋
め込んで平坦化を図ることにより、電極配線抵抗を低減
するとともに、断線もなくすことができる。この結果、
電極配線層の信頼性を向上させることができる。
第1図は本発明の一実施例にかかる半導体装置のコンタ
クト部分を示す断面図、第2図は従来の半導体装置のコ
ンタクト部分を示す断面図である。 11・・・・・・半導体基板、12・・・・・・拡散層
領域、13・・・・・・層間絶縁膜、14・・・・・・
コンタクト窓、16・・・・・・第1アルミ配線層、1
6・・・・・・コンタクト周辺部の角でアルミ配線が薄
くなっている部分、1了・・・・・・コンタクト中央部
でアルミ配線が厚くな?部分、18・・・・・・導電性
のレジスト、19・・・・・・第2アルミ配線層、21
・・・・・・半導体基板、22・・・・・・拡散層領域
、23・・・・・・層間絶縁膜、24・・・・・・コン
タクト窓、26・・・・・・アルミ配線層、26・・・
・・・コンタクト周辺部の角でアルミ配線が薄くなって
いる部分、27・・・・・・コンタクト中央部でアル■
配線が厚くなる部分。
クト部分を示す断面図、第2図は従来の半導体装置のコ
ンタクト部分を示す断面図である。 11・・・・・・半導体基板、12・・・・・・拡散層
領域、13・・・・・・層間絶縁膜、14・・・・・・
コンタクト窓、16・・・・・・第1アルミ配線層、1
6・・・・・・コンタクト周辺部の角でアルミ配線が薄
くなっている部分、1了・・・・・・コンタクト中央部
でアルミ配線が厚くな?部分、18・・・・・・導電性
のレジスト、19・・・・・・第2アルミ配線層、21
・・・・・・半導体基板、22・・・・・・拡散層領域
、23・・・・・・層間絶縁膜、24・・・・・・コン
タクト窓、26・・・・・・アルミ配線層、26・・・
・・・コンタクト周辺部の角でアルミ配線が薄くなって
いる部分、27・・・・・・コンタクト中央部でアル■
配線が厚くなる部分。
Claims (3)
- (1)半導体基板上に層間絶縁膜を被着する工程と、前
記層間絶縁膜にコンタクト窓を開孔する工程と、前記コ
ンタクト窓部分に露出した前記半導体基板の拡散層領域
上に第1の電極配線層を被着する工程と、コンタクト窓
部分で前記第1の電極配線層の凹部にスピン塗布及びエ
ッチバックにより導電性の有機高分子化合物を埋め込む
工程を特徴とする半導体装置の製造方法。 - (2)前記第1の電極配線層及び導電性の有機高分子化
合物を埋め込んだコンタクト窓上に第2の電極配線層を
被着する工程を特徴とする請求項1記載の半導体装置の
製造方法。 - (3)前記導電性の有機化合物として、導電性のレジス
トを用いることを特徴とする請求項1記載の半導体装置
の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15186689A JPH0316218A (ja) | 1989-06-14 | 1989-06-14 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15186689A JPH0316218A (ja) | 1989-06-14 | 1989-06-14 | 半導体装置の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0316218A true JPH0316218A (ja) | 1991-01-24 |
Family
ID=15527941
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15186689A Pending JPH0316218A (ja) | 1989-06-14 | 1989-06-14 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0316218A (ja) |
-
1989
- 1989-06-14 JP JP15186689A patent/JPH0316218A/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US6344964B1 (en) | Capacitor having sidewall spacer protecting the dielectric layer | |
| JPH0775235B2 (ja) | シリコンウエハ内に貫通導体を形成する為の平担化方法 | |
| US6246120B1 (en) | Sidewalls for guiding the via etch | |
| JPH09120963A (ja) | 半導体デバイス用の平坦化最終パッシベーション | |
| JP2924450B2 (ja) | 半導体装置 | |
| US6734561B2 (en) | Semiconductor device and a method of producing the same | |
| JPH0316220A (ja) | 半導体装置の製造方法 | |
| US4884121A (en) | Semiconductor device | |
| KR100295054B1 (ko) | 다층금속배선을갖는반도체소자및그제조방법 | |
| JPH0316218A (ja) | 半導体装置の製造方法 | |
| JP3249071B2 (ja) | 半導体装置の製造方法 | |
| JPH04199628A (ja) | 半導体装置の製造方法 | |
| JPH0316219A (ja) | 半導体装置の製造方法 | |
| JPH03166729A (ja) | 半導体装置の製造方法 | |
| KR100338115B1 (ko) | 반도체소자의금속층형성방법 | |
| JP2728073B2 (ja) | 半導体装置の製造方法 | |
| KR920003876B1 (ko) | 반도체 장치의 제조방법 | |
| JP2000208620A (ja) | 半導体装置の製造方法 | |
| JPS59103355A (ja) | 半導体装置 | |
| JPH03268326A (ja) | 半導体装置の製造方法 | |
| JPH05166941A (ja) | 半導体セルフアライン・コンタクト構造および製造方法 | |
| JPH0786209A (ja) | 半導体装置の製造方法 | |
| JP2937675B2 (ja) | 半導体装置の製造方法 | |
| JP2570992B2 (ja) | 半導体集積回路装置の製造方法 | |
| JPH0291968A (ja) | メモリ装置の製造方法 |