JPH03186961A - マルチプロセッサにおけるi/o割込み制御方式 - Google Patents
マルチプロセッサにおけるi/o割込み制御方式Info
- Publication number
- JPH03186961A JPH03186961A JP32667489A JP32667489A JPH03186961A JP H03186961 A JPH03186961 A JP H03186961A JP 32667489 A JP32667489 A JP 32667489A JP 32667489 A JP32667489 A JP 32667489A JP H03186961 A JPH03186961 A JP H03186961A
- Authority
- JP
- Japan
- Prior art keywords
- interrupt
- mask
- processor
- interrupts
- processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
マルチプロセッサにお&JるI/O割込み発生を制御す
るI/O割込み制御方式に関し、■/○装置からの割込
み要求に対応して、各プロセッサが持つCH分担マスク
との演算を行っていずれかIつのプロセッサに排他的に
割込みを発生させて処理を行わせることにより、I/O
割込みを受け付けないプロセッサのI/O割込み処理の
キャンセルによる負担をなくし、マルチプロセッサにお
ける処理効率を向上させることを目的とし、 I/O装置からの割込み要求に対応して、いずれのI/
O装置(あるいはCI(装置)からの割込みを排他的に
受け付けるかのマスクビットを持つCH分担マスクを各
プロセッサにそれぞれ設け、I/O装置からの割込み要
求に対応して、上記CH分担マスクムこ格納されている
マスクビットとの演算を行って割込のを受け付けるプロ
セッサにのみに割込みを発生させて処理を行わせ、それ
以外のブ0セッサに割込みを発生させないように構成す
る。
るI/O割込み制御方式に関し、■/○装置からの割込
み要求に対応して、各プロセッサが持つCH分担マスク
との演算を行っていずれかIつのプロセッサに排他的に
割込みを発生させて処理を行わせることにより、I/O
割込みを受け付けないプロセッサのI/O割込み処理の
キャンセルによる負担をなくし、マルチプロセッサにお
ける処理効率を向上させることを目的とし、 I/O装置からの割込み要求に対応して、いずれのI/
O装置(あるいはCI(装置)からの割込みを排他的に
受け付けるかのマスクビットを持つCH分担マスクを各
プロセッサにそれぞれ設け、I/O装置からの割込み要
求に対応して、上記CH分担マスクムこ格納されている
マスクビットとの演算を行って割込のを受け付けるプロ
セッサにのみに割込みを発生させて処理を行わせ、それ
以外のブ0セッサに割込みを発生させないように構成す
る。
本発明は、マルチプロセッサにおけるI/O割込み発生
を制御するI/O割込み制御方式に関するものである。
を制御するI/O割込み制御方式に関するものである。
近年、コンピュータシステムにおける多量データ処理の
要求に伴い、マルチプロセッサに多数のI10装置を接
続して高速に多量データ処理を行うことが要求されてい
る。この際、処理効率の良いI/O割込み制御が望まれ
ている。
要求に伴い、マルチプロセッサに多数のI10装置を接
続して高速に多量データ処理を行うことが要求されてい
る。この際、処理効率の良いI/O割込み制御が望まれ
ている。
従来のマルチプロセッサにおけるI/O割込み制御は、
I10装置から割込み要求があった場合、第4図に示す
ように、割込み可能な全てのプロセッサに割込みを発生
させ(■、O)、これらの割込の処理の中でI/O割込
み処理権を獲得した1つのプロセンサのみがソフトに対
する割込みの通知を行い(0、■YES、■)、それ以
外のプロセッサは割込み処理のキャンセルを行っていた
(0、■N010>。
I10装置から割込み要求があった場合、第4図に示す
ように、割込み可能な全てのプロセッサに割込みを発生
させ(■、O)、これらの割込の処理の中でI/O割込
み処理権を獲得した1つのプロセンサのみがソフトに対
する割込みの通知を行い(0、■YES、■)、それ以
外のプロセッサは割込み処理のキャンセルを行っていた
(0、■N010>。
尚、第4図において、H3A (バー1′ウエアシステ
ムエリア)は、MSU(主記憶)上のソフトからアクセ
スできないハードウェア制御用のメモリ領域である。
ムエリア)は、MSU(主記憶)上のソフトからアクセ
スできないハードウェア制御用のメモリ領域である。
このため、ソフトに対するI/O割込み通知を行うプロ
セッサ以外のものは、I/O割込み処理のキャンセルと
いう余分な仕事を行う必要があり、マルチプロセッサの
処理効率を低下させてしまうという問題があった。
セッサ以外のものは、I/O割込み処理のキャンセルと
いう余分な仕事を行う必要があり、マルチプロセッサの
処理効率を低下させてしまうという問題があった。
本発明は、■/○装置からの割込みに要求に対応して、
各プロセッサが持つCH分担マスクとの演算を行ってい
ずれか1つのプロセッサに排他的に割込みを発生させて
処理を行わせることにより、I/O割込みを受け付けな
いプロセッサのI/O割込み処理のキャンセルによる負
担をなくし、マルチプロセンサにおける処理効率を向上
させることを目的としている。
各プロセッサが持つCH分担マスクとの演算を行ってい
ずれか1つのプロセッサに排他的に割込みを発生させて
処理を行わせることにより、I/O割込みを受け付けな
いプロセッサのI/O割込み処理のキャンセルによる負
担をなくし、マルチプロセンサにおける処理効率を向上
させることを目的としている。
第1図を参照して課題を解決する手段を説明する。
第1図において、分担マスク6は、いずれのI10装置
(あるいはCH装置)からの割込みを排他的に受け付け
るかのマスクビットを持つマスクであって、各プロセッ
サ1にそれぞれ設けたものである。
(あるいはCH装置)からの割込みを排他的に受け付け
るかのマスクビットを持つマスクであって、各プロセッ
サ1にそれぞれ設けたものである。
I10装置は、I/O割込み要求を行うものである。
本発明は、第1図に示すように、l/○装置からの割込
み要求に対応して、分担マスク6に格納されているマス
クビットとの演算を行って割込みを受け付けるプロセッ
サ1にのみに割込みを発生させて処理を行わせ、それ以
外のプロセッサに割込みを発生させないようにしている
。
み要求に対応して、分担マスク6に格納されているマス
クビットとの演算を行って割込みを受け付けるプロセッ
サ1にのみに割込みを発生させて処理を行わせ、それ以
外のプロセッサに割込みを発生させないようにしている
。
従って、I10装置からの割込み要求に対応して、各プ
ロセッサが持つC8分担マスク6との演算を行っていず
れか1つのプロセンザムこ排他的に割込みを発生させて
処理を行わせることにより、170割込みを受け付けな
いプロセッサのI/O割込み処理のキャンセルによる負
担をなくし、マルチプロセッサにおける処理効率を向上
させることが可能となる。
ロセッサが持つC8分担マスク6との演算を行っていず
れか1つのプロセンザムこ排他的に割込みを発生させて
処理を行わせることにより、170割込みを受け付けな
いプロセッサのI/O割込み処理のキャンセルによる負
担をなくし、マルチプロセッサにおける処理効率を向上
させることが可能となる。
次に、第1図から第3図を用いて本発明の1実施例の構
成および動作を順次詳細に説明する。
成および動作を順次詳細に説明する。
第1図において、プロセッサ1は、各種処理を行うもの
であって、μプログラムのもとてI/O割込みをソフト
(処理プログラム)に通知したり、ソフトのもとで各種
処理を行ったりなどするものである。このプロセッサ1
を複数台(例えば4台)、1台のI10制御装置(IO
P、インプント・アウトプット・プロセッサ〉 2に接
続してマルチプロセソサンステムを構成し、I/O装置
からのチャネル(CH)7を介した割込み要求に対応し
て、いずれか1つのプロセッサにのみ排他的に割込みを
発生させて処理を行うようにしている。
であって、μプログラムのもとてI/O割込みをソフト
(処理プログラム)に通知したり、ソフトのもとで各種
処理を行ったりなどするものである。このプロセッサ1
を複数台(例えば4台)、1台のI10制御装置(IO
P、インプント・アウトプット・プロセッサ〉 2に接
続してマルチプロセソサンステムを構成し、I/O装置
からのチャネル(CH)7を介した割込み要求に対応し
て、いずれか1つのプロセッサにのみ排他的に割込みを
発生させて処理を行うようにしている。
CHマスク3は、ソフトより設定するいずれのチャネル
7を割込みによって受け付けるかのマスクビットを設定
するものである。通常は、全てのチャネルに対して1を
セットして受け付は可能状態にしておく。
7を割込みによって受け付けるかのマスクビットを設定
するものである。通常は、全てのチャネルに対して1を
セットして受け付は可能状態にしておく。
CH分担マスク6ば、プロセッサ1が排他的にいずれの
チャネル7 (あるいはI10装置)からのI/O割込
みを受け付けるかのマスクビットを設定するものである
。
チャネル7 (あるいはI10装置)からのI/O割込
みを受け付けるかのマスクビットを設定するものである
。
CI分担制御部5ば、CH分担マスク6に対して、いず
れのチャネル7 (あるいはI10装置)からの170
割込み要求を受け付けるかのマスクビットをC8分担マ
スク6に設定したり、更に所定時間毎に循環する態様で
マスクピノ1〜をシフトして各プロセッサの負荷分担を
可及的に均一にしたりなどするものである。
れのチャネル7 (あるいはI10装置)からの170
割込み要求を受け付けるかのマスクビットをC8分担マ
スク6に設定したり、更に所定時間毎に循環する態様で
マスクピノ1〜をシフトして各プロセッサの負荷分担を
可及的に均一にしたりなどするものである。
I/O割込み制御部4は、I/O割込み要求があったと
きに、CHマスク3およびC8分担マスク6との論理積
演算を行った結果が“1“のときにプロセッサ1に1.
10割込みを発生させるものである。
きに、CHマスク3およびC8分担マスク6との論理積
演算を行った結果が“1“のときにプロセッサ1に1.
10割込みを発生させるものである。
I10制御装置(IOP)2は、複数のチャネル7と複
数のプロセッサ1との間に配置してデータの入出力を制
御するものであって、ここではI/O割込みを要求を制
御するI/O割込み制御部2−1などから構成されてい
る。
数のプロセッサ1との間に配置してデータの入出力を制
御するものであって、ここではI/O割込みを要求を制
御するI/O割込み制御部2−1などから構成されてい
る。
チャネル(CH)7は、複数のI10装置とI/O制御
装置2との間に配置してデータの人出力制御を行うもの
であって、ここではI/O割込み要求をT/○制御装W
2に通知したりなどするものである。
装置2との間に配置してデータの人出力制御を行うもの
であって、ここではI/O割込み要求をT/○制御装W
2に通知したりなどするものである。
I10装置は、データの入出力を行う装置である。
次に、第2図フローチャートを用いて第1図構成の動作
を詳細に説明する。
を詳細に説明する。
第2図において、[相]は、I10制御装置(IOP)
2からプロセッサ#0ないし#3にI/O割込み要求を
通知する。これは、第1図I/O装置からチャネル7を
介してI10制御装置(T。
2からプロセッサ#0ないし#3にI/O割込み要求を
通知する。これは、第1図I/O装置からチャネル7を
介してI10制御装置(T。
P)2に割込み要求があったことに対応して、当該I1
0制御装置2が4台のプロセッサ#0ないし#3の全て
にI/O割込み要求を通知する。このI/O割込み要求
に対応して、ここでは、プロセッサ#Oのみが排他的に
割込みを発生させてソフトに通知し、残りの他のプロセ
ッサ#1ないし#3は割込みを発生させないように、第
1図CH分担マスク6を設定したときの動作を以下説明
する。
0制御装置2が4台のプロセッサ#0ないし#3の全て
にI/O割込み要求を通知する。このI/O割込み要求
に対応して、ここでは、プロセッサ#Oのみが排他的に
割込みを発生させてソフトに通知し、残りの他のプロセ
ッサ#1ないし#3は割込みを発生させないように、第
1図CH分担マスク6を設定したときの動作を以下説明
する。
■は、[相]のI/O割込み要求の通知をプロセッサ#
0が受ける。
0が受ける。
@は、CH分担マスク&CHマスクの論理積演算を行う
。ここでは、論理積演算の結果が”1”となってYES
となり、■を行う。
。ここでは、論理積演算の結果が”1”となってYES
となり、■を行う。
■は、μプログラムにI/O割込みを発生させる。
■は、0でI/O割込みによって通知されたμプログラ
ムがソフトに対して所定のI10装置(チャネル7)か
ら割込みがあった旨を通知し、入出力処理を行わせる。
ムがソフトに対して所定のI10装置(チャネル7)か
ら割込みがあった旨を通知し、入出力処理を行わせる。
そして、次の命令の処理を行う。
以上の0ないし[相]の処理によって、l10IIHI
I装置2からのI/O割込み要求に対応して、C8分担
マスク6の該当マスクビットが“1”となっていたプロ
セッサ#0のみに排他的にI/O割込みを発生させて処
理を行わせることにより、マルチプロセッサにおけるI
/O割込み処理を効率的に行うことが可能となる。
I装置2からのI/O割込み要求に対応して、C8分担
マスク6の該当マスクビットが“1”となっていたプロ
セッサ#0のみに排他的にI/O割込みを発生させて処
理を行わせることにより、マルチプロセッサにおけるI
/O割込み処理を効率的に行うことが可能となる。
■は、[相]のI/O割込み要求の通知をプロセンサ#
1ないし#3が受ける。
1ないし#3が受ける。
[相]は、CH分担マスク&CHマスクの論理積演算を
それぞれのプロセッサ#lないし#3内で行う。ここで
は、論理積演算の結果がそれぞれ“0”となってNoと
なり、I/O割込みを発生させることなく、次の命令の
処理を行う。
それぞれのプロセッサ#lないし#3内で行う。ここで
は、論理積演算の結果がそれぞれ“0”となってNoと
なり、I/O割込みを発生させることなく、次の命令の
処理を行う。
以上の■、0の処理によって、I10制御装置2からの
I/O割込み要求に対応して、CH分担マスク6の該当
マスクビットが“O”となっていたプロセッサ#1ない
し#3ば、I/O割込みを発生させることなく終了する
ことにより、無駄なI/O割込み処理を削除することが
可能となる。
I/O割込み要求に対応して、CH分担マスク6の該当
マスクビットが“O”となっていたプロセッサ#1ない
し#3ば、I/O割込みを発生させることなく終了する
ことにより、無駄なI/O割込み処理を削除することが
可能となる。
第3図は、本発明の1実施例構戒図を示す。ここでプロ
セッサ1は、3台のプロセッサのうちの1台のプロセッ
サの構成を示す。
セッサ1は、3台のプロセッサのうちの1台のプロセッ
サの構成を示す。
第3図において、CH分担制御回路5−1は、所定時間
経過毎にTOD (タイマ)5−2から送出されるCR
YN (タイマのビットNからのキャリー)に対応して
SFT (1ビツトのサーキュラ−シフタ)6−2に1
ビットシフト信号を通知し、CHDM (Cf(分担マ
スク)6−1に設定されているマスクピントを1ビツト
だけ循環する態様でシフトさせるものである。これによ
り、CHDM(C8分担マスク)6〜■に設定されてい
るマスクピントの内容が所定時間毎に循環する態様でシ
フトされるため、I10装置(チャネル7)からのI/
O割込み要求を受け付けるプロセッサ1が順次変更され
、負荷分散を均一にすることができ1す る。
経過毎にTOD (タイマ)5−2から送出されるCR
YN (タイマのビットNからのキャリー)に対応して
SFT (1ビツトのサーキュラ−シフタ)6−2に1
ビットシフト信号を通知し、CHDM (Cf(分担マ
スク)6−1に設定されているマスクピントを1ビツト
だけ循環する態様でシフトさせるものである。これによ
り、CHDM(C8分担マスク)6〜■に設定されてい
るマスクピントの内容が所定時間毎に循環する態様でシ
フトされるため、I10装置(チャネル7)からのI/
O割込み要求を受け付けるプロセッサ1が順次変更され
、負荷分散を均一にすることができ1す る。
CHマスク3−1は、Cl−1(チャネル7)からのI
/O割込み要求を受け付るか否かのマスクビットを設定
するマスクである。■を設定したCHに対してI/O割
込みを受け付け、0を設定したCHに対してI/O割込
みを受け付けない。通常は、CHマスク3−1の全ての
マスクビットに“l゛を設定する。
/O割込み要求を受け付るか否かのマスクビットを設定
するマスクである。■を設定したCHに対してI/O割
込みを受け付け、0を設定したCHに対してI/O割込
みを受け付けない。通常は、CHマスク3−1の全ての
マスクビットに“l゛を設定する。
I/O割込み制御回路4−1は、CHマスク31からの
マスクビットと、CHDM(分担マスクビット)6−■
と、IOP (I10制御装置2)からのI/O割込み
要求との論理積の結果が“1゛となった該当チャネルに
対してI/O割込みを発生させるものである(第2図@
YES、0)。
マスクビットと、CHDM(分担マスクビット)6−■
と、IOP (I10制御装置2)からのI/O割込み
要求との論理積の結果が“1゛となった該当チャネルに
対してI/O割込みを発生させるものである(第2図@
YES、0)。
以上の構成において、I10制御装置2からプロセッサ
1にI/O割込み要求が通知されたとき、当該I/O割
込み要求と、CHDM (C8分担マスク)6−1のマ
スクビットと、CHマスク3Iのマスクビア)との論理
積演算を行い、その結2 果が“1”のときにのみ■/○割込み制御回路41がμ
プログラムにI/O割込みを発生させてソフトにI/O
割込みを通知させ、該当チャネル(I10装置)に対し
て入出力処理を行わせるようにしている。
1にI/O割込み要求が通知されたとき、当該I/O割
込み要求と、CHDM (C8分担マスク)6−1のマ
スクビットと、CHマスク3Iのマスクビア)との論理
積演算を行い、その結2 果が“1”のときにのみ■/○割込み制御回路41がμ
プログラムにI/O割込みを発生させてソフトにI/O
割込みを通知させ、該当チャネル(I10装置)に対し
て入出力処理を行わせるようにしている。
以上説明したように、本発明によれば、I/○装置から
の割込みに要求に対応して、各プロセッサが持つCH分
担マスク6との演算を行っていずれか1つのプロセッサ
に排他的に割込みを発生させて処理を行わせる構成を採
用しているため、I/O割込みを受け付けないプロセッ
サのI/O割込み処理のキャンセルによる負担をなくし
〜マルチプロセッサにおける処理効率を向上させること
ができる。
の割込みに要求に対応して、各プロセッサが持つCH分
担マスク6との演算を行っていずれか1つのプロセッサ
に排他的に割込みを発生させて処理を行わせる構成を採
用しているため、I/O割込みを受け付けないプロセッ
サのI/O割込み処理のキャンセルによる負担をなくし
〜マルチプロセッサにおける処理効率を向上させること
ができる。
第1図は本発明の原理構成図、第2図は本発明のI/O
割込み処理フローチャート、第3図は本発明の1実施例
構戒図、第4図は従来のI/O割込み処理フローチャー
トを示す。 図中、1はプロセッサ、2はI10制御装置(IOP)
、3はCH下マスク4はI/O割込み制御部、5はC
H分担制御部、6はC8分担マスク、7はチャネル(C
H)を表す。
割込み処理フローチャート、第3図は本発明の1実施例
構戒図、第4図は従来のI/O割込み処理フローチャー
トを示す。 図中、1はプロセッサ、2はI10制御装置(IOP)
、3はCH下マスク4はI/O割込み制御部、5はC
H分担制御部、6はC8分担マスク、7はチャネル(C
H)を表す。
Claims (1)
- 【特許請求の範囲】 マルチプロセッサにおけるI/O割込み発生を制御する
I/O割込み制御方式において、 I/O装置からの割込み要求に対応して、いずれのI/
O装置(あるいはCH装置)からの割込みを排他的に受
け付けるかのマスクビットを持つCH分担マスク(6)
を各プロセッサにそれぞれ設け、I/O装置からの割込
み要求に対応して、上記CH分担マスク(6)に格納さ
れているマスクビットとの演算を行って割込みを受け付
けるプロセッサにのみに割込みを発生させて処理を行わ
せ、それ以外のプロセッサに割込みを発生させないよう
に構成したことを特徴とするマルチプロセッサにおける
I/O割込み制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32667489A JPH03186961A (ja) | 1989-12-15 | 1989-12-15 | マルチプロセッサにおけるi/o割込み制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32667489A JPH03186961A (ja) | 1989-12-15 | 1989-12-15 | マルチプロセッサにおけるi/o割込み制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03186961A true JPH03186961A (ja) | 1991-08-14 |
Family
ID=18190396
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32667489A Pending JPH03186961A (ja) | 1989-12-15 | 1989-12-15 | マルチプロセッサにおけるi/o割込み制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03186961A (ja) |
-
1989
- 1989-12-15 JP JP32667489A patent/JPH03186961A/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US5367690A (en) | Multiprocessing system using indirect addressing to access respective local semaphore registers bits for setting the bit or branching if the bit is set | |
| JP2577865B2 (ja) | ベクトル処理装置及びその制御方法 | |
| JPH0268632A (ja) | 割込み制御装置 | |
| JPH02230455A (ja) | 外部記憶装置の割込み制御方式 | |
| JPS59761A (ja) | 複数プロセツサによる画像処理方式 | |
| JP2837698B2 (ja) | ダイレクト・メモリ・アクセス制御装置 | |
| Narasimhan et al. | A four-channel communications arbiter for multiprocessor arrays | |
| JP3038257B2 (ja) | 電子計算機 | |
| KR920003283B1 (ko) | 다중처리기 시스템에서의 인터럽트 방법 | |
| JPH0644234B2 (ja) | タスク管理装置 | |
| JPS61136159A (ja) | シングルチツプマイクロコンピユ−タ | |
| JP2879854B2 (ja) | アドレス変換値の設定処理方式 | |
| JPH0370810B2 (ja) | ||
| JPH0318958A (ja) | マルチプロセッサシステム | |
| JP2582414B2 (ja) | 割込み処理装置 | |
| JPS6350903B2 (ja) | ||
| JPH03125251A (ja) | データマルチ処理システム及びそのバス選択方法 | |
| JPH02222059A (ja) | マルチプロセッサシステム | |
| JPS6292059A (ja) | マルチプロセツサシステム | |
| JPH02224048A (ja) | 情報処理装置 | |
| JPS5856057A (ja) | 割込信号発生装置 | |
| JPH02222058A (ja) | マルチプロセッサシステム | |
| JPH03189802A (ja) | プログラマブル・コントローラの上位リンクユニット | |
| JPS61260345A (ja) | マルチプロセサ間のバス制御方式 | |
| JPH03100853A (ja) | プロセッサ間通信方式 |