JPH0372657A - 表面平坦化成膜法 - Google Patents

表面平坦化成膜法

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JPH0372657A
JPH0372657A JP20865389A JP20865389A JPH0372657A JP H0372657 A JPH0372657 A JP H0372657A JP 20865389 A JP20865389 A JP 20865389A JP 20865389 A JP20865389 A JP 20865389A JP H0372657 A JPH0372657 A JP H0372657A
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JP
Japan
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film
baking
sog film
layer
minutes
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Pending
Application number
JP20865389A
Other languages
English (en)
Inventor
Satomi Kajiwara
里美 梶原
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Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体装置の多層配線構造などに利用される
表面平坦化成膜法に関し、特に、SOG(spin−o
n−glass )膜の塗布法による平坦化技術に関す
る。
〔従来の技術〕
多層配線構造の半導体装置の製造プロセスにおいては、
下地の段差部を緩和させるために表面平坦化処理が施さ
れる。この平坦化、平滑化技術としては、SOG膜によ
る塗布法が一般的に知られている。
このSOG膜による塗布法は、第2図(a)に示す如く
の絶縁膜l上に形成されたアルミニウム合金の配線2を
シリコン酸化膜3で全面被覆したウェハの表面を平坦化
するために、例えばシラノールを溶媒に溶したものを塗
布しこれを焼成(キュア〉してS80□化したSOG膜
4とする。その塗布工程はウェハをスピンナで回転しな
がら塗布する。塗布後にSi O,化させるためには高
温で焼威することが必要である。第一層目のSOG膜4
の成膜によっても、平坦化処理が不充分な場合、上記と
同様の手順により、第2図(b)に示す如く、下層SO
G膜4の上に上層SOG膜5を塗布してからこれを焼威
する2度塗り工程が追加される。
〔発明が解決しようとする課題〕
しかしながら、上記のSOG膜の2度塗りによる平坦化
成膜法にあっては、次の問題点がある。
即ち、2度塗りの場合、1度目の塗布後に焼威してから
、続いて2度目の塗布後に同様に焼威するが、1度目の
焼成が不充分の場合、2度目の焼成工程において、第2
図(b)に示す如く、下層のSOQ膜4から脱ガス、な
どが発生して、下層SOG膜4と上層SOG膜5との間
に気泡6やクラックなどが現われる。
そこで、本発明は上記問題点を解決するものであり、そ
の課題は、上層5OGlliの焼成工程において下層S
OC膜からの脱ガスなどの発生をなくすことにより、気
泡、クラッタなどの発生を防止し、高品質の平坦化を可
能とする表面平坦化成膜法を提供することにある。
〔課題を解決するための手段〕
上記課題を解決するために、本発明の講じた手段は、上
層のSOC膜の塗布後の焼成温度を下層のSOC膜の塗
布後の焼成温度よりも低くしたものである。
〔作用〕
このように上層SOC膜の塗布後の焼成温度を下層のそ
れよりも低く維持することにより、上層の焼成工程にお
いては下層SOC膜からの水分。
溶媒などの脱ガスの発生が起こりにくくなるため、気泡
やクランクの発生を防止することができる。
〔実施例〕
次に、本発明の実施例を添付図面に基づいて説明する。
第1図は本発明の一実施例を説明するための多層配線構
造を示す断面図である。
第1図(a)に示す如く、絶縁膜1上のアル逅ニウム合
金の配線2を被覆したシリコン酸化膜のの段差部を平坦
化するために、回転塗布法により、まず第1層目のSO
C(スピンオングラス)膜4を厚さ1000人程度塗布
し、これをその段差部に埋め込み、しかる後、例えば2
00℃、3分のプリベータと450℃、30分の焼成(
キュア)を施す。このプリベークはウェハの取扱いを容
易とするものである。焼成温度は塗布材質、溶媒などに
より異なるが、いずれの場合も最適化する必要がある。
次に、第1図(b)に示す如く、第2層目のSOG膜5
を厚さ1000人程度塗布しこれを比較的浅くなった段
差部に埋め込む。この後、塗布されたSOC膜を例えば
200°C,3分でプリベークし、次に430℃、30
分の焼成(キュア)を施す。
この第2層目のSOG膜5に対する焼成温度は430°
Cで、第1層目のSOG膜4に対する焼成温度450℃
よりも低い温度とされる。このため、第2層目のSOC
膜の焼成工程では、第1層目のSOG膜4も加熱される
が、第1層目の焼成温度450℃以上には加熱されない
ため、第1層目のSOG膜4の焼成が不充分で、水分、
溶媒などの残留があっても、その膜内からの脱ガスの発
生は起こらない。したがって、第1層目のSOG膜4と
第2層目のSOG膜5との間には気泡やクラックの発生
がなく、平坦化多層成膜自体の品質が向上する。
なお、上記実施例は2度塗りの場合を説明したが、これ
に限らず3層以上の多層の平坦化成膜にも適用できるこ
とは云う迄もない。
〔発明の効果〕
以上説明したように、本発明はSOC膜による表面平坦
化の多層成膜法において、上層のSOC膜の塗布後の焼
成温度をその下層のSOC膜の塗布後の焼成温度より低
く維持することに特徴を有するものであるから、次の効
果を奏する。
即ち、上層のSOC膜の焼成工程では、もはやそのSO
C膜から脱ガスが蒸発して5OGIIIが起こらず、阻
止されるので、気泡残留やクラッタなどの発生を防止で
き、高品質の多層成膜が得られる。
【図面の簡単な説明】
第1図(a)、(b)は本発明の一実施例を夫々説明す
るための多層配線構造を示す断面図である。 第2 (a)、(b)は従来のSOC膜による表面平坦
化成膜法を夫々説明するための多層配線構造を示す断面
図である。 〔符号の説明〕 l・・・絶縁膜 2・・・アルくニウム合金の配線 3・・・シリコン酸化膜 4・・・第1層目のSOC膜 5・・・第2層目のSOG膜 6・・・気泡。

Claims (1)

  1. 【特許請求の範囲】 段差部をもつ基板の表面を2層以上のSOG膜で平坦化
    する成膜法において、 上層のSOG膜の塗布後の焼成温度がその下層のSOG
    膜の塗布後の焼成温度よりも低いことを特徴とする表面
    平坦化成膜法。
JP20865389A 1989-08-11 1989-08-11 表面平坦化成膜法 Pending JPH0372657A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2009066983A3 (en) * 2007-11-21 2009-07-16 Mimos Berhad Method of curing defects in spin-on-glass
JP2015126020A (ja) * 2013-12-25 2015-07-06 東京エレクトロン株式会社 絶縁領域の形成方法

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* Cited by examiner, † Cited by third party
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WO2009066983A3 (en) * 2007-11-21 2009-07-16 Mimos Berhad Method of curing defects in spin-on-glass
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