JPH0420218B2 - - Google Patents
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- JPH0420218B2 JPH0420218B2 JP58157082A JP15708283A JPH0420218B2 JP H0420218 B2 JPH0420218 B2 JP H0420218B2 JP 58157082 A JP58157082 A JP 58157082A JP 15708283 A JP15708283 A JP 15708283A JP H0420218 B2 JPH0420218 B2 JP H0420218B2
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- connection
- cpu
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- computer system
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- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4004—Coupling between buses
- G06F13/4027—Coupling between buses using bus bridges
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- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Small-Scale Networks (AREA)
- Testing And Monitoring For Control Systems (AREA)
- Hardware Redundancy (AREA)
- Multi Processors (AREA)
Description
【発明の詳細な説明】
（発明の属する技術分野）
本発明は、多重系計算機システムにおいて、そ
の各系統に配設された各種機器を接続しているバ
スの接続系統を切替えるバス切替装置に関する。
の各系統に配設された各種機器を接続しているバ
スの接続系統を切替えるバス切替装置に関する。
（従来技術とその問題点）
第１図は多重系計算機システムの一例として、
計算機を２つ具えた二重系計算機システムの一構
成例を示し、ここで、CPU ＡおよびCPU Ｂは、
それぞれ、メインバスMB−ＡおよびMB−Ｂに
接続された以下の各種機器を制御する計算機とし
ての中央処理装置（CPU）である。メインバス
MB−ＡおよびMB−Ｂに対しては分岐バスBB
１〜BB６が設けられ、それら分岐バスBB１〜
BB６は、バス切替器BS内に設けられたバス接続
部１Ａ〜６Ａまたは１Ｂ〜６Ｂにより、それぞ
れ、メインバスMB−ＡまたはMB−Ｂを介して
CPU ＡまたはCPU Ｂに接続される。
計算機を２つ具えた二重系計算機システムの一構
成例を示し、ここで、CPU ＡおよびCPU Ｂは、
それぞれ、メインバスMB−ＡおよびMB−Ｂに
接続された以下の各種機器を制御する計算機とし
ての中央処理装置（CPU）である。メインバス
MB−ＡおよびMB−Ｂに対しては分岐バスBB
１〜BB６が設けられ、それら分岐バスBB１〜
BB６は、バス切替器BS内に設けられたバス接続
部１Ａ〜６Ａまたは１Ｂ〜６Ｂにより、それぞ
れ、メインバスMB−ＡまたはMB−Ｂを介して
CPU ＡまたはCPU Ｂに接続される。
このような二重系計算機システムに配設される
各種機器として、例えば、分岐バスBB１〜BB
６には、それぞれ、メモリＭ１、メモリＭ２、入
出力機器Ｉ／０１、入出力機器Ｉ／０２、プロセ
ス入出力制御装置PI／０１およびプロセス入出
力制御装置PI／０２が接続され、さらに、プロ
セス入出力制御装置PI／０１およびPI／０２に
は、それぞれ、制御対象としてのプロセスが接続
される。
各種機器として、例えば、分岐バスBB１〜BB
６には、それぞれ、メモリＭ１、メモリＭ２、入
出力機器Ｉ／０１、入出力機器Ｉ／０２、プロセ
ス入出力制御装置PI／０１およびプロセス入出
力制御装置PI／０２が接続され、さらに、プロ
セス入出力制御装置PI／０１およびPI／０２に
は、それぞれ、制御対象としてのプロセスが接続
される。
なお、第１図において、斜線を施したバス接続
部は、そのバス接続部が、対応するメインバスと
分岐バスとを接続している状態を示す。
部は、そのバス接続部が、対応するメインバスと
分岐バスとを接続している状態を示す。
かかる二重系計算機システムにおけるバスの切
替処理は、従来、バス切替器BSに対し、次に示
す装置を用いて操作が行われていた。
替処理は、従来、バス切替器BSに対し、次に示
す装置を用いて操作が行われていた。
第２図は操作者がバス切替器BSに対して操作
を加える従来の操作パネルCPの構成の一例を示
し、ここで、NP−ＡおよびNP−Ｂは、それぞ
れ、CPU ＡおよびCPU ＢのCPU名称板、PBL
１Ａ〜PBL６ＡおよびPBL１Ｂ〜PBL６Ｂは、
それぞれCPU名称板NP−ＡおよびNP−Ｂに対
応して配設され、それぞれ上述の各種機器に関連
した押ボタンであり、その押下に応じてバスの接
続を切替えることができる。また、例えば、それ
ぞれの押ボタンはバスの接続状態に応じて点灯す
る表示灯を有する。
を加える従来の操作パネルCPの構成の一例を示
し、ここで、NP−ＡおよびNP−Ｂは、それぞ
れ、CPU ＡおよびCPU ＢのCPU名称板、PBL
１Ａ〜PBL６ＡおよびPBL１Ｂ〜PBL６Ｂは、
それぞれCPU名称板NP−ＡおよびNP−Ｂに対
応して配設され、それぞれ上述の各種機器に関連
した押ボタンであり、その押下に応じてバスの接
続を切替えることができる。また、例えば、それ
ぞれの押ボタンはバスの接続状態に応じて点灯す
る表示灯を有する。
第３図は、押ボタンPBL１Ａ〜PBL６Ａおよ
びPBL１Ｂ〜PBL６Ｂの押下によつて発生する
切替指令信号、およびバス接続に応じてバス接続
部１Ａ〜６Ａおよび１Ｂ〜６Ｂが発生する接続状
態信号の流れを示す。ここで、SW１Ａ〜SW６
ＡおよびＬ１Ａ〜Ｌ６Ａは、それぞれ、押ボタン
PBL１Ａ〜PBL６Ａの押下に応じて閉成される
スイツチおよび点灯する表示灯、SW１Ｂ〜SW
６ＢおよびＬ１Ｂ〜Ｌ６Ｂは、それぞれ、押ボタ
ンPBL１Ｂ〜PBL６Ｂの押下に応じて閉成され
るスイツチおよび点灯する表示灯である。すなわ
ち、押ボタンPBL１Ａ〜PBL６ＡおよびPB１Ｂ
〜PBL６Ｂの押下に応じて、切替指令信号SS１
Ａ〜SS６ＡおよびSS１Ｂ〜SS６Ｂが、それぞ
れ、バス接続部１Ａ〜６Ａおよび１Ｂ〜６Ｂに加
えられ、そのバス接続部に対応したメインバスと
分岐バスとが接続される。バス接続部１Ａ〜６Ａ
および１Ｂ〜６Ｂは、当該指定された接続状態に
応じて、それぞれ、接続状態信号SC１Ａ〜SC６
ＡおよびSC１Ｂ〜SC６Ｂを表示灯Ｌ１Ａ〜Ｌ６
ＡおよびＬ１Ｂ〜Ｌ６Ｂに供給して点灯させる。
びPBL１Ｂ〜PBL６Ｂの押下によつて発生する
切替指令信号、およびバス接続に応じてバス接続
部１Ａ〜６Ａおよび１Ｂ〜６Ｂが発生する接続状
態信号の流れを示す。ここで、SW１Ａ〜SW６
ＡおよびＬ１Ａ〜Ｌ６Ａは、それぞれ、押ボタン
PBL１Ａ〜PBL６Ａの押下に応じて閉成される
スイツチおよび点灯する表示灯、SW１Ｂ〜SW
６ＢおよびＬ１Ｂ〜Ｌ６Ｂは、それぞれ、押ボタ
ンPBL１Ｂ〜PBL６Ｂの押下に応じて閉成され
るスイツチおよび点灯する表示灯である。すなわ
ち、押ボタンPBL１Ａ〜PBL６ＡおよびPB１Ｂ
〜PBL６Ｂの押下に応じて、切替指令信号SS１
Ａ〜SS６ＡおよびSS１Ｂ〜SS６Ｂが、それぞ
れ、バス接続部１Ａ〜６Ａおよび１Ｂ〜６Ｂに加
えられ、そのバス接続部に対応したメインバスと
分岐バスとが接続される。バス接続部１Ａ〜６Ａ
および１Ｂ〜６Ｂは、当該指定された接続状態に
応じて、それぞれ、接続状態信号SC１Ａ〜SC６
ＡおよびSC１Ｂ〜SC６Ｂを表示灯Ｌ１Ａ〜Ｌ６
ＡおよびＬ１Ｂ〜Ｌ６Ｂに供給して点灯させる。
このように、従来装置においては、第１図示の
バス切替器BSに対し、第２図示のようなCPUの
系列毎に配列され、バス接続部１Ａ〜６Ａおよび
１Ｂ〜６Ｂとそれぞれ１対１に対応した押ボタン
PBL１Ａ〜PBL６ＡおよびPBL１Ｂ〜PBL６Ｂ
により、操作者はバスの切替指令を発生させ、か
つバスの接続状態を監視していた。しかしなが
ら、かかる従来装置においては、あるプロセスに
対し、いずれのCPUが接続されているか、ある
いはいずれのＩ／０機器や記憶装置が接続されて
いるかを操作者が調査する場合に、まずその調査
に係るプロセス、すなわちそのプロセスのプロセ
ス入出力制御装置がいずれのCPUの系列に属し
ているかを認識し、次いでその系列のCPUの名
称板あるいは点灯しているＩ／０機器や記憶装置
の押ボタンを調査する必要がある。さらに、従来
装置においては、いずれかのCPUが故障し、そ
のCPUにより制御されていたプロセスを他の
CPUでバツクアツプする場合においても、感覚
上操作者はプロセスに対しCPUを切替える処理
を施すことを所望するにも拘らず、実際の操作で
は、逆に、CPUに対してプロセスを切替えるこ
とになる。
バス切替器BSに対し、第２図示のようなCPUの
系列毎に配列され、バス接続部１Ａ〜６Ａおよび
１Ｂ〜６Ｂとそれぞれ１対１に対応した押ボタン
PBL１Ａ〜PBL６ＡおよびPBL１Ｂ〜PBL６Ｂ
により、操作者はバスの切替指令を発生させ、か
つバスの接続状態を監視していた。しかしなが
ら、かかる従来装置においては、あるプロセスに
対し、いずれのCPUが接続されているか、ある
いはいずれのＩ／０機器や記憶装置が接続されて
いるかを操作者が調査する場合に、まずその調査
に係るプロセス、すなわちそのプロセスのプロセ
ス入出力制御装置がいずれのCPUの系列に属し
ているかを認識し、次いでその系列のCPUの名
称板あるいは点灯しているＩ／０機器や記憶装置
の押ボタンを調査する必要がある。さらに、従来
装置においては、いずれかのCPUが故障し、そ
のCPUにより制御されていたプロセスを他の
CPUでバツクアツプする場合においても、感覚
上操作者はプロセスに対しCPUを切替える処理
を施すことを所望するにも拘らず、実際の操作で
は、逆に、CPUに対してプロセスを切替えるこ
とになる。
すなわち、多重系計算機システムを操作する上
で、一般に、操作者はプロセスを中心にシステム
を認識するにも拘らず、従来のバス切替装置にお
いてはCPUを中心に考えた操作が要求されるの
で、操作者は直感に従つた操作を行うことができ
ず、装置の操作性の向上を図る必要があつた。
で、一般に、操作者はプロセスを中心にシステム
を認識するにも拘らず、従来のバス切替装置にお
いてはCPUを中心に考えた操作が要求されるの
で、操作者は直感に従つた操作を行うことができ
ず、装置の操作性の向上を図る必要があつた。
（発明の目的）
本発明は、かかる従来の問題点に鑑みてなされ
たものであり、プロセスに対するCPU、記憶装
置、およびＩ／０機器の接続状態を容易に把握で
き、さらにその接続切替操作を、プロセスを中心
として容易に行うことができるようにした多重系
計算機システムのバス切替装置を提供することを
目的とする。
たものであり、プロセスに対するCPU、記憶装
置、およびＩ／０機器の接続状態を容易に把握で
き、さらにその接続切替操作を、プロセスを中心
として容易に行うことができるようにした多重系
計算機システムのバス切替装置を提供することを
目的とする。
（発明の要点）
かかる目的を達成するために、本発明は、複数
の計算機CPUA，CPUB，…と、該複数の計算機
に各別に設けた複数のバスMB−Ａ，MB−Ｂ，
…と、複数の制御対象Ｐ１，Ｐ２，…および計算
機システムを構成する複数の機器Ｍ１，Ｍ２，
Ｉ／０１，Ｉ／０２……をそれぞれ前記複数のバ
スに選択的に接続する複数の接続手段１Ａ〜６
Ａ，１Ｂ〜６Ｂ，…とを備えた多重系計算機シス
テムにおいて、 前記複数の計算機および複数の機器の各々に対
応して設けられ、前記制御対象との前記複数のバ
スを介する接続を前記複数の接続手段に対して指
令するバス切替指令手段と、当該バス切替指令手
段からの接続指令を受けた接続手段からの表示指
令に基づいて接続結果を表示する表示手段とが前
記複数の制御対象毎にそれぞれ配列された操作パ
ネル、および 前記複数の機器に対応するバス切替指令手段か
ら前記複数の接続手段に送出される指令の送出先
および前記複数の接続手段から前記表示手段に送
られる表示指令の送出先を、前記制御対象と前記
複数の計算機との接続状態に応じて連動させて変
更する変更手段、 を具えたことを特徴とする。
の計算機CPUA，CPUB，…と、該複数の計算機
に各別に設けた複数のバスMB−Ａ，MB−Ｂ，
…と、複数の制御対象Ｐ１，Ｐ２，…および計算
機システムを構成する複数の機器Ｍ１，Ｍ２，
Ｉ／０１，Ｉ／０２……をそれぞれ前記複数のバ
スに選択的に接続する複数の接続手段１Ａ〜６
Ａ，１Ｂ〜６Ｂ，…とを備えた多重系計算機シス
テムにおいて、 前記複数の計算機および複数の機器の各々に対
応して設けられ、前記制御対象との前記複数のバ
スを介する接続を前記複数の接続手段に対して指
令するバス切替指令手段と、当該バス切替指令手
段からの接続指令を受けた接続手段からの表示指
令に基づいて接続結果を表示する表示手段とが前
記複数の制御対象毎にそれぞれ配列された操作パ
ネル、および 前記複数の機器に対応するバス切替指令手段か
ら前記複数の接続手段に送出される指令の送出先
および前記複数の接続手段から前記表示手段に送
られる表示指令の送出先を、前記制御対象と前記
複数の計算機との接続状態に応じて連動させて変
更する変更手段、 を具えたことを特徴とする。
（発明の実施例）
以下、図面を参照して本発明を詳細に説明す
る。
る。
第４図は本発明多重系計算機システムのバス切
替装置の一例として、二重系計算機システムにお
けるバス接続装置に係る操作パネルCP１の一構
成例を示す。ここで、NP１およびNP２は、そ
れぞれ、プロセスＰ１およびＰ２のプロセス名称
板であり、本実施例においては、プロセス名称板
NP１およびNP２に対応して、それぞれ表示灯
を有する押ボタンPBL１１〜PLB６１および
PBL１２〜PBL６２は第１図示の各部と第４図
示のように対応する。なお、図中斜線を施した押
ボタンは、その機器と対応したプロセスとが接続
状態にあり、その押ボタンが有する表示灯が点灯
していることを示す。すなわち、この場合、各部
が第１図と同一の接続状態にある。
替装置の一例として、二重系計算機システムにお
けるバス接続装置に係る操作パネルCP１の一構
成例を示す。ここで、NP１およびNP２は、そ
れぞれ、プロセスＰ１およびＰ２のプロセス名称
板であり、本実施例においては、プロセス名称板
NP１およびNP２に対応して、それぞれ表示灯
を有する押ボタンPBL１１〜PLB６１および
PBL１２〜PBL６２は第１図示の各部と第４図
示のように対応する。なお、図中斜線を施した押
ボタンは、その機器と対応したプロセスとが接続
状態にあり、その押ボタンが有する表示灯が点灯
していることを示す。すなわち、この場合、各部
が第１図と同一の接続状態にある。
第５図は第１図示のバス切替器と第４図示の操
作パネルとの間に配設した、本発明装置に係るバ
ス切替制御部BCの回路構成の一例を示す。ここ
で、操作パネルCP１の内部において、SW１１〜
SW６１およびＬ１１〜Ｌ６１は、それぞれ、プ
ロセスＰ１に対応し、押ボタンPBL１１〜PBL
６１の押下に応じて閉成されるスイツチおよび点
灯する表示灯、SW１２〜SW６２およびＬ１２
〜Ｌ６２は、それぞれ、プロセスＰ２に対応し、
押ボタンPBL１２〜PBL６２の押下に応じて閉
成されるスイツチおよび点灯する表示灯である。
バス切替制御部BCの内部において、Ry５Ａ，
Ry５Ｂ，Ry６ＡおよびRy６Ｂはリレーであり、
それぞれ接続部５Ａ，５Ｂ，６Ａおよび６Ｂの接
続状態に応じて、接点を閉成する。
作パネルとの間に配設した、本発明装置に係るバ
ス切替制御部BCの回路構成の一例を示す。ここ
で、操作パネルCP１の内部において、SW１１〜
SW６１およびＬ１１〜Ｌ６１は、それぞれ、プ
ロセスＰ１に対応し、押ボタンPBL１１〜PBL
６１の押下に応じて閉成されるスイツチおよび点
灯する表示灯、SW１２〜SW６２およびＬ１２
〜Ｌ６２は、それぞれ、プロセスＰ２に対応し、
押ボタンPBL１２〜PBL６２の押下に応じて閉
成されるスイツチおよび点灯する表示灯である。
バス切替制御部BCの内部において、Ry５Ａ，
Ry５Ｂ，Ry６ＡおよびRy６Ｂはリレーであり、
それぞれ接続部５Ａ，５Ｂ，６Ａおよび６Ｂの接
続状態に応じて、接点を閉成する。
第４図示の押ボタン群のうちCPU Ａおよび
CPU Ｂに対応した押ボタンPBL１１，PBL２
１，PBL１２およびPBL２２の押下により発生
する切替指令信号SS１１，SS２１，SS１２およ
びSS２２を、それぞれ、バス切替器BS内のバス
接続部分５Ａ，５Ｂ，６Ａおよび６Ｂに導く。一
方、バス接続部５Ａ，５Ｂ，６Ａおよび６Ｂが発
生する接続状態信号SC５Ａ，SC５Ｂ，SC６Ａお
よびSC６Ｂを、それぞれ、リレーRy５Ａ，Ry５
Ｂ，Ry６ＡおよびRy６Ｂを介して表示灯Ｌ１
１，Ｌ２１，Ｌ１２およびＬ２２に導く。
CPU Ｂに対応した押ボタンPBL１１，PBL２
１，PBL１２およびPBL２２の押下により発生
する切替指令信号SS１１，SS２１，SS１２およ
びSS２２を、それぞれ、バス切替器BS内のバス
接続部分５Ａ，５Ｂ，６Ａおよび６Ｂに導く。一
方、バス接続部５Ａ，５Ｂ，６Ａおよび６Ｂが発
生する接続状態信号SC５Ａ，SC５Ｂ，SC６Ａお
よびSC６Ｂを、それぞれ、リレーRy５Ａ，Ry５
Ｂ，Ry６ＡおよびRy６Ｂを介して表示灯Ｌ１
１，Ｌ２１，Ｌ１２およびＬ２２に導く。
記憶装置Ｍ１およびＭ２、Ｉ／０機器Ｉ／０１
およびＩ／０２に対応した押ボタン群のうち、プ
ロセスＰ１に関連した押ボタンPBL３１，PBL
４１，PBL５１，PBL６１の押下により発生す
る切替指令信号SS３１，SS４１，SS５１および
SS６１を、リレーRy５Ａの接点を介して、それ
ぞれ、バス接続部１Ａ，２Ａ，３Ａおよび４Ａに
導き、また、リレーRy５Ｂの接点を介して、そ
れぞれ、バス接続部１Ｂ，２Ｂ，３Ｂおよび４Ｂ
に導く。一方、プロセスＰ２に関連する押ボタン
PBL３２，PBL４２，PBL５２およびPBL６２
の押下により発生する切替指令信号SS３２，SS
４２，SS５２およびSS６２をリレーRy６Ａの接
点を介して、それぞれ、バス接続部１Ａ，２Ａ，
３Ａおよび４Ａに導き、また、リレーRy６Ｂの
接点を介して、それぞれバス接続部１Ｂ，２Ｂ，
３Ｂおよび４Ｂに導く。
およびＩ／０２に対応した押ボタン群のうち、プ
ロセスＰ１に関連した押ボタンPBL３１，PBL
４１，PBL５１，PBL６１の押下により発生す
る切替指令信号SS３１，SS４１，SS５１および
SS６１を、リレーRy５Ａの接点を介して、それ
ぞれ、バス接続部１Ａ，２Ａ，３Ａおよび４Ａに
導き、また、リレーRy５Ｂの接点を介して、そ
れぞれ、バス接続部１Ｂ，２Ｂ，３Ｂおよび４Ｂ
に導く。一方、プロセスＰ２に関連する押ボタン
PBL３２，PBL４２，PBL５２およびPBL６２
の押下により発生する切替指令信号SS３２，SS
４２，SS５２およびSS６２をリレーRy６Ａの接
点を介して、それぞれ、バス接続部１Ａ，２Ａ，
３Ａおよび４Ａに導き、また、リレーRy６Ｂの
接点を介して、それぞれバス接続部１Ｂ，２Ｂ，
３Ｂおよび４Ｂに導く。
また、CPU Ａに関連したバス接続部１Ａ，２
Ａ，３Ａおよび４Ａが発生する接続状態信号SC
１Ａ，SC２Ａ，SC３ＡおよびSC４Ａをリレー
Ry５Ａの接点を介して、それぞれ、表示灯Ｌ３
１，Ｌ４１，Ｌ５１およびＬ６１に導き、また、
リレーRy６Ａの接点を介して、それぞれ表示灯
Ｌ３２，Ｌ４２，Ｌ５２およびＬ６２に導く。さ
らにCPU Ｂに関連したバス接続部１Ｂ，２Ｂ，
３Ｂおよび４Ｂが発生する接続状態信号SC１Ｂ，
SC２Ｂ，SC３ＢおよびSC４ＢをリレーRy５Ｂ
の接点を介して、それぞれ表示灯Ｌ３１，Ｌ４
１，Ｌ５１およびＬ６１に導き、またリレーRy
６Ｂの接点を介してそれぞれ表示灯Ｌ３２，Ｌ４
２，Ｌ５２およびＬ６２に導く。
Ａ，３Ａおよび４Ａが発生する接続状態信号SC
１Ａ，SC２Ａ，SC３ＡおよびSC４Ａをリレー
Ry５Ａの接点を介して、それぞれ、表示灯Ｌ３
１，Ｌ４１，Ｌ５１およびＬ６１に導き、また、
リレーRy６Ａの接点を介して、それぞれ表示灯
Ｌ３２，Ｌ４２，Ｌ５２およびＬ６２に導く。さ
らにCPU Ｂに関連したバス接続部１Ｂ，２Ｂ，
３Ｂおよび４Ｂが発生する接続状態信号SC１Ｂ，
SC２Ｂ，SC３ＢおよびSC４ＢをリレーRy５Ｂ
の接点を介して、それぞれ表示灯Ｌ３１，Ｌ４
１，Ｌ５１およびＬ６１に導き、またリレーRy
６Ｂの接点を介してそれぞれ表示灯Ｌ３２，Ｌ４
２，Ｌ５２およびＬ６２に導く。
かかる構成によれば、プロセスＰ１またはＰ２
がいずれのメインバスMB−ＡまたはMB−Ｂに
接続されていても、切替指令信号および接続状態
信号は正規の送出先に導かれる。例えば、第１図
示のバス接続状態下で接続表示が第４図示のよう
になされている時、Ｉ／０機器Ｉ／０２をプロセ
スＰ１に使用することを所望して、操作者がプロ
セスＰ１側に関連した押ボタンPBL６１を押し
た場合、その時点でバス接続部５Ａが接続されて
おり、リレーRy５Ａが動作しているので、接続
切替信号SS６１はバス接続部４Ａに導かれる。
そして、その接続状態信号SC４Ａは、リレーRy
５Ａの接点を介して表示灯Ｌ６１に導かれ、表示
灯Ｌ６１が点灯することになる。
がいずれのメインバスMB−ＡまたはMB−Ｂに
接続されていても、切替指令信号および接続状態
信号は正規の送出先に導かれる。例えば、第１図
示のバス接続状態下で接続表示が第４図示のよう
になされている時、Ｉ／０機器Ｉ／０２をプロセ
スＰ１に使用することを所望して、操作者がプロ
セスＰ１側に関連した押ボタンPBL６１を押し
た場合、その時点でバス接続部５Ａが接続されて
おり、リレーRy５Ａが動作しているので、接続
切替信号SS６１はバス接続部４Ａに導かれる。
そして、その接続状態信号SC４Ａは、リレーRy
５Ａの接点を介して表示灯Ｌ６１に導かれ、表示
灯Ｌ６１が点灯することになる。
（発明の効果）
以上説明してきたように、本発明によれば、多
重系計算機システムのプロセスとCPUとの接続
状態信号に応じて切替指令信号の送出先および接
続状態の送出先を変更するバス切替制御部を設
け、操作部を各プロセスに対応して操作者が直観
的かつ正確にバス切替操作を行うことができるよ
うに構成したので、従来装置に比して操作性が格
段に向上した多重系計算機システムのバス切替装
置を実現できる。
重系計算機システムのプロセスとCPUとの接続
状態信号に応じて切替指令信号の送出先および接
続状態の送出先を変更するバス切替制御部を設
け、操作部を各プロセスに対応して操作者が直観
的かつ正確にバス切替操作を行うことができるよ
うに構成したので、従来装置に比して操作性が格
段に向上した多重系計算機システムのバス切替装
置を実現できる。
なお、上述の実施例においては、バス切替制御
部をリレー回路を用いて構成したが、例えば半導
体回路で置き換えたり、あるいはマイクロプロセ
ツサを所定のプログラムに従つて制御することに
よつても構成できること勿論である。
部をリレー回路を用いて構成したが、例えば半導
体回路で置き換えたり、あるいはマイクロプロセ
ツサを所定のプログラムに従つて制御することに
よつても構成できること勿論である。
第１図は多重系計算機システムの一例としての
二重系計算機システムの構成を示すブロツク図、
第２図は第１図示の二重系計算機システムに対
し、バス切替操作を行う従来の操作パネル上の配
置の一例を示す線図、第３図は第１図示の二重系
計算機システムと第２図示の操作パネルとの間の
信号の流れを説明する線図、第４図は本発明多重
系計算機システムのバス切替装置の一例として、
第１図示の二重系計算機システムに対し、バス切
替操作を行う操作パネルの配置の一例を示す線
図、第５図は本発明によつて、第１図示の二重系
計算機システムと第４図示の操作部との間の信号
の流れを制御するバス切替制御部の構成例を示す
回路図である。 Ａ，Ｂ……CPU、Ｍ１，Ｍ２……記憶装置、
Ｉ／０１，Ｉ／０２……Ｉ／０機器、Ｐ１，Ｐ２
……プロセス、PI／０１，PI／０２……プロセ
ス入出力制御装置、MB−Ａ，MB−Ｂ……メイ
ンバス、BB１〜BB６……分岐バス、１Ａ〜６
Ａ，１Ｂ〜６Ｂ……バス接続部、BS……バス切
替器、NP−Ａ，NP−Ｂ……CPU名称板、PBL
１Ａ，PBL６Ａ，PBL１Ｂ〜PBL６Ｂ……押ボ
タン、SW１Ａ〜SW６Ａ，SW１Ｂ〜SW６Ｂ…
…スイツチ、Ｌ１Ａ〜Ｌ６Ａ，Ｌ１Ｂ〜Ｌ６Ｂ…
…表示灯、NP１，NP２……プロセス名称板、
PBL１１〜PBL６１，PBL１２〜PBL６２……
押ボタン、CP１……操作部、BC……バス切替制
御部、SW１１〜SW６１，SW１２〜SW６２…
…スイツチ、Ｌ１１〜Ｌ６１，Ｌ１２，Ｌ６２…
…表示灯、Ry５Ａ，Ry５Ｂ，Ry６Ａ，Ry６Ｂ
……リレー。
二重系計算機システムの構成を示すブロツク図、
第２図は第１図示の二重系計算機システムに対
し、バス切替操作を行う従来の操作パネル上の配
置の一例を示す線図、第３図は第１図示の二重系
計算機システムと第２図示の操作パネルとの間の
信号の流れを説明する線図、第４図は本発明多重
系計算機システムのバス切替装置の一例として、
第１図示の二重系計算機システムに対し、バス切
替操作を行う操作パネルの配置の一例を示す線
図、第５図は本発明によつて、第１図示の二重系
計算機システムと第４図示の操作部との間の信号
の流れを制御するバス切替制御部の構成例を示す
回路図である。 Ａ，Ｂ……CPU、Ｍ１，Ｍ２……記憶装置、
Ｉ／０１，Ｉ／０２……Ｉ／０機器、Ｐ１，Ｐ２
……プロセス、PI／０１，PI／０２……プロセ
ス入出力制御装置、MB−Ａ，MB−Ｂ……メイ
ンバス、BB１〜BB６……分岐バス、１Ａ〜６
Ａ，１Ｂ〜６Ｂ……バス接続部、BS……バス切
替器、NP−Ａ，NP−Ｂ……CPU名称板、PBL
１Ａ，PBL６Ａ，PBL１Ｂ〜PBL６Ｂ……押ボ
タン、SW１Ａ〜SW６Ａ，SW１Ｂ〜SW６Ｂ…
…スイツチ、Ｌ１Ａ〜Ｌ６Ａ，Ｌ１Ｂ〜Ｌ６Ｂ…
…表示灯、NP１，NP２……プロセス名称板、
PBL１１〜PBL６１，PBL１２〜PBL６２……
押ボタン、CP１……操作部、BC……バス切替制
御部、SW１１〜SW６１，SW１２〜SW６２…
…スイツチ、Ｌ１１〜Ｌ６１，Ｌ１２，Ｌ６２…
…表示灯、Ry５Ａ，Ry５Ｂ，Ry６Ａ，Ry６Ｂ
……リレー。
Claims (1)
- 【特許請求の範囲】 １ 複数の計算機CPUA，CPUB，…と、該複数
の計算機に各別に設けた複数のバスMB−Ａ，
MB−Ｂ，…と、複数の制御対象Ｐ１，Ｐ２，…
および計算機システムを構成する複数の機器Ｍ
１，Ｍ２，Ｉ／０１，Ｉ／０２…をそれぞれ前記
複数のバスに選択的に接続する複数の接続手段１
Ａ〜６Ａ，１Ｂ〜６Ｂ，…とを備えた多重系計算
機システムにおいて、 前記複数の計算機および複数の機器の各々に対
応して設けられ、前記制御対象との前記複数のバ
スを介する接続を前記複数の接続手段に対して指
令するバス切替指令手段と、当該バス切替指令手
段からの接続指令を受けた接続手段からの表示指
令に基づいて接続結果を表示する表示手段とが前
記複数の制御対象毎にそれぞれ配列された操作パ
ネル、および 前記複数の機器に対応するバス切替指令手段か
ら前記複数の接続手段に送出される指令の送出先
および前記複数の接続手段から前記表示手段に送
される表示指令の送出先を、前記制御対象と前記
複数の計算機との接続状態に応じて連動させて変
更する変更手段、 を具えたことを特徴とする多重系計算機システム
のバス切替装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58157082A JPS6049466A (ja) | 1983-08-30 | 1983-08-30 | 多重系計算機システムのバス切替装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58157082A JPS6049466A (ja) | 1983-08-30 | 1983-08-30 | 多重系計算機システムのバス切替装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6049466A JPS6049466A (ja) | 1985-03-18 |
| JPH0420218B2 true JPH0420218B2 (ja) | 1992-04-02 |
Family
ID=15641852
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58157082A Granted JPS6049466A (ja) | 1983-08-30 | 1983-08-30 | 多重系計算機システムのバス切替装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6049466A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05204567A (ja) * | 1992-07-27 | 1993-08-13 | Canon Inc | 機能切換装置及び方法 |
-
1983
- 1983-08-30 JP JP58157082A patent/JPS6049466A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6049466A (ja) | 1985-03-18 |
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