JPH0466615U - - Google Patents

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JPH0466615U
JPH0466615U JP10369690U JP10369690U JPH0466615U JP H0466615 U JPH0466615 U JP H0466615U JP 10369690 U JP10369690 U JP 10369690U JP 10369690 U JP10369690 U JP 10369690U JP H0466615 U JPH0466615 U JP H0466615U
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JP
Japan
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cpu
clock
circuit
memory
signal
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JP10369690U
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【図面の簡単な説明】
第1図はこの考案による計算機の構成ブロツク
図、第2図はこの考案による計算機の動作タイム
チヤート図、第3図は従来の計算機の構成ブロツ
ク図、第4図と第5図は従来の計算機の動作タイ
ムチヤート図。 図中、1はCPU、2はクロツク信号、3はク
ロツク発生回路、4はデータ、5はメモリ、6は
リード信号、7はアドレス信号、8はチツプセレ
クト信号、9はアドレスデコーダ、10はウエイ
ト信号、11はウエイトコントロール回路、12
はクロツク信号A、13はクロツク停止回路、1
4はワンシヨツト回路、15は同期回路、16は
ゲート、17はワンシヨツトパルス信号、18は
クロツク信号Bである。なお図中、同一あるいは
相当部分には同一符号を付してある。

Claims (1)

    【実用新案登録請求の範囲】
  1. 演算、制御を行うCMOS部品で構成されたC
    PU、CPUがデータをリードするメモリ、CP
    Uからのアドレス信号を入力してメモリを選択す
    るチツプセレクト信号を出力するアドレスデコー
    ダ、CPUへ入力するクロツクを発生するクロツ
    ク発生回路、一定の幅のパルス信号を出力するワ
    ンシヨツト回路と同期回路により構成されたCP
    Uへのクロツク入力を停止させるクロツク停止回
    路で構成する計算機において、CPUがメモリか
    らのデータをアクセスする時に、クロツク停止回
    路がCPUへのクロツク出力を一時止めて、CP
    Uの処理を一定期間停止させることを特徴とする
    計算機。
JP10369690U 1990-10-02 1990-10-02 Pending JPH0466615U (ja)

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JP10369690U JPH0466615U (ja) 1990-10-02 1990-10-02

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JP10369690U JPH0466615U (ja) 1990-10-02 1990-10-02

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JPH0466615U true JPH0466615U (ja) 1992-06-12

Family

ID=31848668

Family Applications (1)

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JP10369690U Pending JPH0466615U (ja) 1990-10-02 1990-10-02

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