JPH0766614B2 - インデックス信号回路 - Google Patents
インデックス信号回路Info
- Publication number
- JPH0766614B2 JPH0766614B2 JP62155026A JP15502687A JPH0766614B2 JP H0766614 B2 JPH0766614 B2 JP H0766614B2 JP 62155026 A JP62155026 A JP 62155026A JP 15502687 A JP15502687 A JP 15502687A JP H0766614 B2 JPH0766614 B2 JP H0766614B2
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- JP
- Japan
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- comparator
- signal
- circuit
- zero
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- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000001514 detection method Methods 0.000 claims description 15
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 244000145845 chattering Species 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Rotational Drive Of Disk (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、ディスク記憶装置の回転駆動源であるスピン
ドルモータから、インデックス信号を取出すための回路
に関する。
ドルモータから、インデックス信号を取出すための回路
に関する。
最近、フロッピーディスク又はハードディスクが高容量
（高密度）化してきたため、回転精度−つまり回転むら
の少ないこと−が厳しく要求されるようになると共に、
インデックス信号自体の周期の安定性が強く要望され
る。
（高密度）化してきたため、回転精度−つまり回転むら
の少ないこと−が厳しく要求されるようになると共に、
インデックス信号自体の周期の安定性が強く要望され
る。
従来のインデックス信号回路では、温度変化、電源電圧
変動等によるドリフトが問題であった。即ち、ディスク
記憶装置のロータの被検出点を検出コイルにより検出す
る手段によって得られる信号は、第３図Ｉに示すような
交番波形１であり、例えば、温度が変化するとその出力
波形１は、実線と破線のように変化する。従来、この第
３図Ｉ及びIIに示す如く、基準電圧Vsと該波形１との交
点a,a又はb,bでスライスして、方形波2a又は2bを得てい
た。この２種の方形波2a,2bを相互に比較すれば明らか
なように、温度変化に伴って、時間ｔ的にずれを生じて
いる。
変動等によるドリフトが問題であった。即ち、ディスク
記憶装置のロータの被検出点を検出コイルにより検出す
る手段によって得られる信号は、第３図Ｉに示すような
交番波形１であり、例えば、温度が変化するとその出力
波形１は、実線と破線のように変化する。従来、この第
３図Ｉ及びIIに示す如く、基準電圧Vsと該波形１との交
点a,a又はb,bでスライスして、方形波2a又は2bを得てい
た。この２種の方形波2a,2bを相互に比較すれば明らか
なように、温度変化に伴って、時間ｔ的にずれを生じて
いる。
言いかえれば第４図に示すように、ディスク３の機械的
に決まった位置４に対し、温度T1のときと温度T2のとき
では、前記方形波2a,2bを処理して得られるインデック
ス信号5a,5bに、ドリフトDoを発生する。（なお、同図
中の周期Tnは一定と仮定する。） 本発明は従来のこのような問題点を解決して、ドリフト
の減少を目的とする。
に決まった位置４に対し、温度T1のときと温度T2のとき
では、前記方形波2a,2bを処理して得られるインデック
ス信号5a,5bに、ドリフトDoを発生する。（なお、同図
中の周期Tnは一定と仮定する。） 本発明は従来のこのような問題点を解決して、ドリフト
の減少を目的とする。
本発明のインデックス信号回路は、ロータの被検出点を
検出して交番波形の検出信号を生成する回転検出センサ
と、ゼロクロス特性を有し、前記検出信号のゼロクロス
点から特定極性の範囲において出力信号を生成する第１
のコンパレータと、ヒステリシス特性を有し、前記検出
信号が前記特定極性と反対極性の範囲内において比較電
圧のヒステリシス範囲を越えてから前記ゼロクロス点を
通過して前記特定極性の範囲内において前記比較電圧の
ヒスレリシス範囲を越えるまで出力信号を生成する第２
のコンパレータと、前記第１のコンパレータ及び前記第
２のコンパレータからの出力信号が入力されるAND回路
又はNAND回路と、を具備し、前記AND回路又はNAND回路
は、前記第１のコンパレータ及び第２のコンパレータが
出力信号を生成したときにインデックス信号を生成し、
かくして前記インデックス信号は前記ゼロクロス点に合
致して生成される。
検出して交番波形の検出信号を生成する回転検出センサ
と、ゼロクロス特性を有し、前記検出信号のゼロクロス
点から特定極性の範囲において出力信号を生成する第１
のコンパレータと、ヒステリシス特性を有し、前記検出
信号が前記特定極性と反対極性の範囲内において比較電
圧のヒステリシス範囲を越えてから前記ゼロクロス点を
通過して前記特定極性の範囲内において前記比較電圧の
ヒスレリシス範囲を越えるまで出力信号を生成する第２
のコンパレータと、前記第１のコンパレータ及び前記第
２のコンパレータからの出力信号が入力されるAND回路
又はNAND回路と、を具備し、前記AND回路又はNAND回路
は、前記第１のコンパレータ及び第２のコンパレータが
出力信号を生成したときにインデックス信号を生成し、
かくして前記インデックス信号は前記ゼロクロス点に合
致して生成される。
本発明のインデックス信号回路では、ゼロクロス特性を
有する第１のコンパレータは、回転検出センサからの前
記検出信号がゼロクロス点から特定極性の範囲にあると
きに出力信号を生成し、またヒステリシス特性を有する
第２のコンパレータは、前記検出信号が前記特定極性と
反対極性の範囲内において比較電圧のヒステリシス範囲
を越えてからゼロクロス点を通過して前記特定極性の範
囲内において前記比較電圧のヒステリシス範囲を越える
まで出力信号を生成する。第１のコンパレータ及び第２
のコンパレータからの出力信号はAND回路又はNAND回路
に供給され、AND回路又はNAND回路は、第１のコンパレ
ータ及び第２のコンパレータが出力信号を生成したとき
にインデックス信号を生成する。従って、このインデッ
クス信号は回転検出センサの検出信号のゼロクロス点に
合致して生成され、このゼロクロス点から発生するよう
になり、ゼロクロス点を確実に検出することができる。
有する第１のコンパレータは、回転検出センサからの前
記検出信号がゼロクロス点から特定極性の範囲にあると
きに出力信号を生成し、またヒステリシス特性を有する
第２のコンパレータは、前記検出信号が前記特定極性と
反対極性の範囲内において比較電圧のヒステリシス範囲
を越えてからゼロクロス点を通過して前記特定極性の範
囲内において前記比較電圧のヒステリシス範囲を越える
まで出力信号を生成する。第１のコンパレータ及び第２
のコンパレータからの出力信号はAND回路又はNAND回路
に供給され、AND回路又はNAND回路は、第１のコンパレ
ータ及び第２のコンパレータが出力信号を生成したとき
にインデックス信号を生成する。従って、このインデッ
クス信号は回転検出センサの検出信号のゼロクロス点に
合致して生成され、このゼロクロス点から発生するよう
になり、ゼロクロス点を確実に検出することができる。
以下、図示の実施例を詳説する。
第１図に於て、ディスク記憶装置の回転駆動源であるス
ピンドルモータのロータ６に１箇所乃至複数箇所の被検
出点７を設けておく。この被検出点７は凹状切欠部であ
ったり、小型マグネットである。８はセンサであり、被
検出点７の接近を検出する。
ピンドルモータのロータ６に１箇所乃至複数箇所の被検
出点７を設けておく。この被検出点７は凹状切欠部であ
ったり、小型マグネットである。８はセンサであり、被
検出点７の接近を検出する。
第１図と第２図に示すように、その検出した波形９を入
力信号10として第１コンパレータ11のマイナス側に入力
する。第１コンパレータ11のプラス側は接地する。そし
て、第１コンパレータ11の上記マイナス側を、別の第２
コンパレータ12のプラス側に接続13する。第２コンパレ
ータ12のマイナス側は抵抗を介して接地する。
力信号10として第１コンパレータ11のマイナス側に入力
する。第１コンパレータ11のプラス側は接地する。そし
て、第１コンパレータ11の上記マイナス側を、別の第２
コンパレータ12のプラス側に接続13する。第２コンパレ
ータ12のマイナス側は抵抗を介して接地する。
14はNAND回路であり、第１コンパレータ11及び第２コン
パレータ12の出力（Ｂ点出力とＣ点出力）を該NAND回路
14に入力して、インデックス信号15を出力する（Ｄ点出
力）。
パレータ12の出力（Ｂ点出力とＣ点出力）を該NAND回路
14に入力して、インデックス信号15を出力する（Ｄ点出
力）。
第２図のように該インデックス信号15のパルス部16の左
端が使用エッジ17であり、該使用エッジ17は、入力信号
10のゼロクロス点Ｚと時間的に一致していることが分
る。即ち、波形９のゼロクロス点Ｚを立ち上がりエッジ
とするパルス部16が得られる。
端が使用エッジ17であり、該使用エッジ17は、入力信号
10のゼロクロス点Ｚと時間的に一致していることが分
る。即ち、波形９のゼロクロス点Ｚを立ち上がりエッジ
とするパルス部16が得られる。
第１図及び第２図に示す通り、第１のコンパレータ11
は、ゼロクロス点Ｚから信号を生成するゼロクロスコン
パレータから構成されている。このコンパレータ11は、
実施例では、センサ８からの出力信号が負（特定極性）
の範囲において出力信号を生成し、回転検出センサ８か
らの信号が実質上零のときにノイズを含むと、第２図に
Ｂ点出力で示す通り、チャタリング18を発生する。ま
た、第２のコンパレータ12は、ヒステリシス特性を有
し、このヒステリシス特性によって第１コンパレータ11
の出力信号に比してその出力信号が幾分時間的に遅延す
る。即ち、第２のコンパレータ12においては、出力信号
の発生を幾分遅延するためのヒステリシス範囲（第２図
においてレベル範囲Ｈで示す領域）が存在し、このコン
パレータ12は、実施例において、センサ８からの出力信
号が正（特定極性とは反対の極性）の範囲においてヒス
テリシス範囲Ｈを越えてからゼロクロス点Ｚを通過して
その出力信号が負（特定極性）の範囲において上記ヒス
テリシス範囲Ｈを越えるまで出力信号を生成する。
は、ゼロクロス点Ｚから信号を生成するゼロクロスコン
パレータから構成されている。このコンパレータ11は、
実施例では、センサ８からの出力信号が負（特定極性）
の範囲において出力信号を生成し、回転検出センサ８か
らの信号が実質上零のときにノイズを含むと、第２図に
Ｂ点出力で示す通り、チャタリング18を発生する。ま
た、第２のコンパレータ12は、ヒステリシス特性を有
し、このヒステリシス特性によって第１コンパレータ11
の出力信号に比してその出力信号が幾分時間的に遅延す
る。即ち、第２のコンパレータ12においては、出力信号
の発生を幾分遅延するためのヒステリシス範囲（第２図
においてレベル範囲Ｈで示す領域）が存在し、このコン
パレータ12は、実施例において、センサ８からの出力信
号が正（特定極性とは反対の極性）の範囲においてヒス
テリシス範囲Ｈを越えてからゼロクロス点Ｚを通過して
その出力信号が負（特定極性）の範囲において上記ヒス
テリシス範囲Ｈを越えるまで出力信号を生成する。
この回路では、第１のコンパレタ11及び第２のコンパレ
ータ12からの出力信号は、NAND回路14に送給される。NA
ND回路14では、第２図にＤ点出力で示す通り、第１のコ
ンパレータ11及び第２のコンパレータ12が出力信号を生
成しているときに、出力信号、換言するとインデックス
信号16を生成する。即ち、このNAND回路14は、センサ８
からの出力信号がゼロクロス点Ｚを通過してから所定の
ヒステリシス範囲Ｈを越えるまでの間インデックス信号
16を生成し、その信号16の発生時は、上記ゼロクロス点
Ｚと一致し、このインデックス信号16の立ち下がりを利
用することによってゼロクロス点Ｚを確実に検出するこ
とができる。
ータ12からの出力信号は、NAND回路14に送給される。NA
ND回路14では、第２図にＤ点出力で示す通り、第１のコ
ンパレータ11及び第２のコンパレータ12が出力信号を生
成しているときに、出力信号、換言するとインデックス
信号16を生成する。即ち、このNAND回路14は、センサ８
からの出力信号がゼロクロス点Ｚを通過してから所定の
ヒステリシス範囲Ｈを越えるまでの間インデックス信号
16を生成し、その信号16の発生時は、上記ゼロクロス点
Ｚと一致し、このインデックス信号16の立ち下がりを利
用することによってゼロクロス点Ｚを確実に検出するこ
とができる。
第３図IIIに、本発明の回路によって得られるＤ点出
力、即ちインデックス信号を示す。第３図から明らかな
通り、温度変化によってセンサ８からの出力信号の振幅
が幾分変化したとしても、ゼロクロス点Ｚは変化せず、
この出力信号と上記ヒステリシス範囲Ｈとの交差点が変
化するのみである。従って、周囲の温度が変化してもイ
ンデックス信号16の幅（信号が発生する時間）が変化す
るのみで、このインデックス信号16の発生時（インデッ
クス信号16の立ち下がり17）は変化せず、ゼロクロス点
Ｚを確実に検出することができる。なお、この第３図II
Iでは、第１図中のNAND回路14に変えてAND回路を用いて
おり、いずれを用いるも自由である。
力、即ちインデックス信号を示す。第３図から明らかな
通り、温度変化によってセンサ８からの出力信号の振幅
が幾分変化したとしても、ゼロクロス点Ｚは変化せず、
この出力信号と上記ヒステリシス範囲Ｈとの交差点が変
化するのみである。従って、周囲の温度が変化してもイ
ンデックス信号16の幅（信号が発生する時間）が変化す
るのみで、このインデックス信号16の発生時（インデッ
クス信号16の立ち下がり17）は変化せず、ゼロクロス点
Ｚを確実に検出することができる。なお、この第３図II
Iでは、第１図中のNAND回路14に変えてAND回路を用いて
おり、いずれを用いるも自由である。
なお、センサ８としてはマグネチックセンサが好適であ
るが、これ以外のものを用いるも自由である。
るが、これ以外のものを用いるも自由である。
本発明は上述の構成であって、回路が比較的簡単であり
ながら、温度等の変動によるドリフトを発生せず、最近
の高容量化したディスクの回転精度への厳しい要望に十
分に応えることが出来るという顕著な効果を奏する。特
に巧妙にセンサ８からの出力波形９のゼロクロス点Ｚを
活用している。
ながら、温度等の変動によるドリフトを発生せず、最近
の高容量化したディスクの回転精度への厳しい要望に十
分に応えることが出来るという顕著な効果を奏する。特
に巧妙にセンサ８からの出力波形９のゼロクロス点Ｚを
活用している。
第１図は本発明に係るインデックス信号回路の一実施例
を示す回路図、第２図は第１図によって得られる波形説
明図、第３図は本発明と従来例とを比較して示した比較
説明図である。第４図は従来の説明用波形図である。 Ｚ……ゼロクロス点、６……ロータ、７……被検出点、
８……センサ、10……入力信号、11,12……コンパレー
タ、14……NAND回路、15……インデックス信号。
を示す回路図、第２図は第１図によって得られる波形説
明図、第３図は本発明と従来例とを比較して示した比較
説明図である。第４図は従来の説明用波形図である。 Ｚ……ゼロクロス点、６……ロータ、７……被検出点、
８……センサ、10……入力信号、11,12……コンパレー
タ、14……NAND回路、15……インデックス信号。
Claims (1)
- 【請求項１】ロータ（６）の被検出点（4a）を検出して
交番波形の検出信号を生成する回転検出センサ（８）
と、 ゼロクロス特性を有し、前記検出信号のゼロクロス点か
ら特定極性の範囲において出力信号を生成する第１のコ
ンパレータ（11）と、 ヒステリシス特性を有し、前記検出信号が前記特定極性
と反対極性の範囲内において比較電圧のヒステリシス範
囲を越えてから前記ゼロクロス点を通過して前記特定極
性の範囲内において前記比較電圧のヒステリシス範囲を
越えるまで出力信号を生成する第２のコンパレータ（1
2）と、 前記第１のコンパレータ（11）及び前記第２のコンパレ
ータ（12）からの出力信号が入力されるAND回路又はNAN
D回路（14）と、を具備し、 前記AND回路又はNAND回路（14）は、前記第１のコンパ
レータ（11）及び第２のコンパレータ（12）が出力信号
を生成したときにインデックス信号を生成し、かくして
前記インデックス信号は前記ゼロクロス点に合致して生
成される、ことを特徴とするインデックス信号回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155026A JPH0766614B2 (ja) | 1987-06-22 | 1987-06-22 | インデックス信号回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155026A JPH0766614B2 (ja) | 1987-06-22 | 1987-06-22 | インデックス信号回路 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JPS641155A JPS641155A (en) | 1989-01-05 |
| JPH011155A JPH011155A (ja) | 1989-01-05 |
| JPH0766614B2 true JPH0766614B2 (ja) | 1995-07-19 |
Family
ID=15597045
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62155026A Expired - Lifetime JPH0766614B2 (ja) | 1987-06-22 | 1987-06-22 | インデックス信号回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0766614B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP7080098B2 (ja) * | 2018-04-24 | 2022-06-03 | エイブリック株式会社 | ゼロクロス検出回路およびセンサ装置 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5745719A (en) * | 1980-09-01 | 1982-03-15 | Comput Basic Mach Technol Res Assoc | Readout circuit for magnetic disc device |
| JPS5745716A (en) * | 1980-09-01 | 1982-03-15 | Comput Basic Mach Technol Res Assoc | Magnetic disc device |
| JPS59167812A (ja) * | 1983-03-14 | 1984-09-21 | Toshiba Corp | 信号検出回路 |
| JPH0132209Y2 (ja) * | 1984-09-28 | 1989-10-03 | ||
| JPH0132207Y2 (ja) * | 1984-12-10 | 1989-10-03 | ||
| JPS62135720A (ja) * | 1985-12-09 | 1987-06-18 | Nippon Densan Kk | 波形出力装置 |
-
1987
- 1987-06-22 JP JP62155026A patent/JPH0766614B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS641155A (en) | 1989-01-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |