JPS583532A - 電源装置 - Google Patents
電源装置Info
- Publication number
- JPS583532A JPS583532A JP56101081A JP10108181A JPS583532A JP S583532 A JPS583532 A JP S583532A JP 56101081 A JP56101081 A JP 56101081A JP 10108181 A JP10108181 A JP 10108181A JP S583532 A JPS583532 A JP S583532A
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- JP
- Japan
- Prior art keywords
- power supply
- power
- signal
- switch
- ready
- Prior art date
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- Pending
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- Supply And Distribution Of Alternating Current (AREA)
- Direct Current Feeding And Distribution (AREA)
- Power Sources (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
電子機器における電源装置は第１図に示す如く、通常Ａ
ＣまたはＤＣを入力として所定の電圧および電流を負荷
装置５に供給するために使用され、電源投入／切断スイ
ｙ ４ Ｋより電源入力が投入、切断され、該スイッチ
の投入動作に従って制御回路２が作動し、開閉素子３ａ
、３ｂを介して電源入力の接続、複数の電源ユニｙ）４
ｍ＋４ｂの投入順序および時間制御を行なうと共に電源
ユニット４ｍ、４ｂの各作動可能信号を受信し、その論
理積を得て負荷装置５に電源機能の準備完了を通知し、
負荷装置５の作動待機を解除して電源の投入を完了する
。を九電源切断操作は投入／切断スイ、チの切断動作に
従って制御回路２が電源ユニ。
ＣまたはＤＣを入力として所定の電圧および電流を負荷
装置５に供給するために使用され、電源投入／切断スイ
ｙ ４ Ｋより電源入力が投入、切断され、該スイッチ
の投入動作に従って制御回路２が作動し、開閉素子３ａ
、３ｂを介して電源入力の接続、複数の電源ユニｙ）４
ｍ＋４ｂの投入順序および時間制御を行なうと共に電源
ユニット４ｍ、４ｂの各作動可能信号を受信し、その論
理積を得て負荷装置５に電源機能の準備完了を通知し、
負荷装置５の作動待機を解除して電源の投入を完了する
。を九電源切断操作は投入／切断スイ、チの切断動作に
従って制御回路２が電源ユニ。
）４１１，４ｂを切断順序および時間制御を行なった後
、開閉素子３ａ、３ｂをして電源入力よ）受電を切断し
電源の切断を終了する。電源切断時におけるＰＯＷ Ｒ
ＥＡＤＹ信号は制御回路２により制御される電源ユニ、
）４ａ＋４ｂ内の最初０ユニ、ト断で作動可能信号の論
理積がとれなくなシ負荷装置５へ送出していたＰＯＷ
ＲＥＡＤＹの送出を停止し負荷装置５の作動を閉鎖する
。以上は電源装置の正常動作であるが、電源装置に異常
が発生し、例えば開閉素子３ｍ、３ｂとして使用する電
磁開閉器、半導体開閉素子（サイリスタ、トライアック
等）に短絡障害が発生すると投入／切断スイッチが切断
動作状態でも開閉素子３ａ、３ｂが導通状態となり、電
源ユニッ）４ａ、４ｂが動作して制御回路２が誤ったＰ
ＯＷ ＲＥＡＤＹを送出し負荷装置５が作動してＪう場
合、あるいは電源が正常動作をしていた後開閉素子３ａ
、３ｂが短絡障害を起すと投入／切断スイッチにおいて
切断動作を行なっても開閉素子３ｍ、３ｂが導通状態を
続けるので電源の切断が行なわれず、且ＰＯＷ ＲＥＡ
ＤＹも切断されず、負荷装置５は動作したｔ−の不都合
な状態が存在する。
、開閉素子３ａ、３ｂをして電源入力よ）受電を切断し
電源の切断を終了する。電源切断時におけるＰＯＷ Ｒ
ＥＡＤＹ信号は制御回路２により制御される電源ユニ、
）４ａ＋４ｂ内の最初０ユニ、ト断で作動可能信号の論
理積がとれなくなシ負荷装置５へ送出していたＰＯＷ
ＲＥＡＤＹの送出を停止し負荷装置５の作動を閉鎖する
。以上は電源装置の正常動作であるが、電源装置に異常
が発生し、例えば開閉素子３ｍ、３ｂとして使用する電
磁開閉器、半導体開閉素子（サイリスタ、トライアック
等）に短絡障害が発生すると投入／切断スイッチが切断
動作状態でも開閉素子３ａ、３ｂが導通状態となり、電
源ユニッ）４ａ、４ｂが動作して制御回路２が誤ったＰ
ＯＷ ＲＥＡＤＹを送出し負荷装置５が作動してＪう場
合、あるいは電源が正常動作をしていた後開閉素子３ａ
、３ｂが短絡障害を起すと投入／切断スイッチにおいて
切断動作を行なっても開閉素子３ｍ、３ｂが導通状態を
続けるので電源の切断が行なわれず、且ＰＯＷ ＲＥＡ
ＤＹも切断されず、負荷装置５は動作したｔ−の不都合
な状態が存在する。
本発明はこのような欠点を解決する手段を提供すること
を目的とするものである。その九め本発明は電源投入に
伴い制御回路により複数の電ｌ１３−二、トの投入動作
を制御し、電源ユニットにおける各作動可能信号の論理
積をＰＯＷ ＲＥＡＤＹ 信号として送出する機能を備
えた電源装置において、該各電源二二、トにおける作動
可能信号に加えて電源投入／切断信号との論理積をＰＯ
ｗＲＩＣＡＤＹ信号として送出する手段を備えたことを
特徴とするものである。
を目的とするものである。その九め本発明は電源投入に
伴い制御回路により複数の電ｌ１３−二、トの投入動作
を制御し、電源ユニットにおける各作動可能信号の論理
積をＰＯＷ ＲＥＡＤＹ 信号として送出する機能を備
えた電源装置において、該各電源二二、トにおける作動
可能信号に加えて電源投入／切断信号との論理積をＰＯ
ｗＲＩＣＡＤＹ信号として送出する手段を備えたことを
特徴とするものである。
以下図面を参照しつ＼本発明の一実施例について具体的
に説明する。第２図は本発明の一実施例におけるプロ、
り図を示す。ｌｔｉ電源の投入／切断スイッチ、２ａは
電源装置の制御回路、３ｍおよび３ｂは開閉素子、４ａ
および４ｂは電源ユニ、ト、５け負荷装置である。投入
／切断スイッチ１に従って制御回路２ａが開閉素子３ａ
、３ｂを制御して電源入力の開閉動作を行なわせ、電源
ユ＝ｙ）４ａ、４ｂの投入および切断順序ならびに時間
制御を行なうことは従来通〕である。但し従来は電源ユ
ニ、）４ｍ、４ｂからの作動可能信号を受信し、その論
理積を取って負荷装置５へＰＯ％ＶＲＥＡＤＹ信号を送
出していたが本ｌＩ總例では従来の条件に投入／切断ス
イッチ１の操作に伴う投Ｖ切断動作条件を加えて論理積
を得、Ｐｏ％Ｖ ＲＥＡＤＹ信号を送出するようにした
ので、開閉素子３ ” ｒ３ｂに短絡障害を発生したと
きに起る投入／切断スイッチが投入動作されていないで
開閉素子３ａ。
に説明する。第２図は本発明の一実施例におけるプロ、
り図を示す。ｌｔｉ電源の投入／切断スイッチ、２ａは
電源装置の制御回路、３ｍおよび３ｂは開閉素子、４ａ
および４ｂは電源ユニ、ト、５け負荷装置である。投入
／切断スイッチ１に従って制御回路２ａが開閉素子３ａ
、３ｂを制御して電源入力の開閉動作を行なわせ、電源
ユ＝ｙ）４ａ、４ｂの投入および切断順序ならびに時間
制御を行なうことは従来通〕である。但し従来は電源ユ
ニ、）４ｍ、４ｂからの作動可能信号を受信し、その論
理積を取って負荷装置５へＰＯ％ＶＲＥＡＤＹ信号を送
出していたが本ｌＩ總例では従来の条件に投入／切断ス
イッチ１の操作に伴う投Ｖ切断動作条件を加えて論理積
を得、Ｐｏ％Ｖ ＲＥＡＤＹ信号を送出するようにした
ので、開閉素子３ ” ｒ３ｂに短絡障害を発生したと
きに起る投入／切断スイッチが投入動作されていないで
開閉素子３ａ。
３ｂが導通状態となシ、電源ユニｙ ト４ ” ａ ４
ｂが作動して作動可能信号を制御回路２ｍに送出して
も論理積がとれないのでＰＯＷ ＲＥＩＡＪ）Ｙ信号が
送出されない。同様に電源装置が正常動作状態から開閉
素子３ａ、３ｂが短絡障害を発生したとき、投入／切断
スイッチにおいて切断操作されていれば、開閉素子３ａ
、３ｂが導通状態のま＼で電源ユニッ）４ａ、４ｂから
作画可能信号が制御回路２ａに送出されていても論理積
がとれず、ＰＯＷＲＥＡＤＹ信号は送出されない。従っ
て本発明によれば負荷装置５は従来のように動作したま
＼の不都合な状態はなくなり有用である。
ｂが作動して作動可能信号を制御回路２ｍに送出して
も論理積がとれないのでＰＯＷ ＲＥＩＡＪ）Ｙ信号が
送出されない。同様に電源装置が正常動作状態から開閉
素子３ａ、３ｂが短絡障害を発生したとき、投入／切断
スイッチにおいて切断操作されていれば、開閉素子３ａ
、３ｂが導通状態のま＼で電源ユニッ）４ａ、４ｂから
作画可能信号が制御回路２ａに送出されていても論理積
がとれず、ＰＯＷＲＥＡＤＹ信号は送出されない。従っ
て本発明によれば負荷装置５は従来のように動作したま
＼の不都合な状態はなくなり有用である。
第１図は従来における電源装置のブロック図。
第２図は本発明の一実施例における電源装置のブロック
図である。 ｌは投入／切断スイッチ、２．２ａｈ制御装置。 ３ａ、３ｂは開閉素子、 ４ａｔ ４ｂは電源ユニッ
ト、５は負荷装置である。 ＄１図 第２図
図である。 ｌは投入／切断スイッチ、２．２ａｈ制御装置。 ３ａ、３ｂは開閉素子、 ４ａｔ ４ｂは電源ユニッ
ト、５は負荷装置である。 ＄１図 第２図
Claims (1)
- 【特許請求の範囲】 電源の投入切断に伴い制御回路により複数の電源ユニ、
トの投入切断動作を制御し、電源ユニ。 トにおける各作動可能信号の論理積をＰＯＷ ＲＥＡＤ
Ｙ信号として選出する機能を備えに電源装置において、
該各電源二二、トにおける作動可能信号に加えて電源投
入、切断信号との論理積をＰＯ％Ｖ ＲＥＡＤＹ信号と
して選出する手段を備えたことを特徴とする電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56101081A JPS583532A (ja) | 1981-06-29 | 1981-06-29 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56101081A JPS583532A (ja) | 1981-06-29 | 1981-06-29 | 電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS583532A true JPS583532A (ja) | 1983-01-10 |
Family
ID=14291144
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56101081A Pending JPS583532A (ja) | 1981-06-29 | 1981-06-29 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS583532A (ja) |
-
1981
- 1981-06-29 JP JP56101081A patent/JPS583532A/ja active Pending
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