JPS59106975A - 荷電偏向型インクジエツト印写装置の印字歪補正装置 - Google Patents
荷電偏向型インクジエツト印写装置の印字歪補正装置Info
- Publication number
- JPS59106975A JPS59106975A JP21725082A JP21725082A JPS59106975A JP S59106975 A JPS59106975 A JP S59106975A JP 21725082 A JP21725082 A JP 21725082A JP 21725082 A JP21725082 A JP 21725082A JP S59106975 A JPS59106975 A JP S59106975A
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- JP
- Japan
- Prior art keywords
- pattern
- printing
- clock
- distortion
- code
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/485—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes
Landscapes
- Particle Formation And Scattering Control In Inkjet Printers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は、荷電偏向型インクジェット印写装置における
印写歪補正装置に関する。
印写歪補正装置に関する。
従来技術
一般に、荷電偏向型インクジェット印写装置においては
、インク滴が印写情報に応じて荷電、偏向され、記録紙
上に印写される。この時、各インク滴はその後方に空気
の流れを作り、この空気流の中に後続のインク滴が入る
と、後続インク滴の空気抵抗が小さくなるので、先行イ
ンク滴と後続インク滴が接近して、或いは、併合して印
写歪を生じる。壕だ、印写用インク滴は荷電されている
ので、各荷電インク滴間にクーロン力が働き、このクー
ロン力によって各インク滴間の間隔が乱されて印写歪を
生じる。更に、先行する荷電インク滴の影響により、今
正に荷電されようとしているインク滴の荷電量が減じら
れ、これによっても印写歪を生じる。このような欠点を
解決するものとして例えば特公昭５２−３０３３０ 号
公報に示すように、偏向段を上又は下から順次印写する
のではなく、飛び飛びに印写することによりインク滴間
隔を太きくシ、これによシ、印写歪を小さくすることが
提案されている。
、インク滴が印写情報に応じて荷電、偏向され、記録紙
上に印写される。この時、各インク滴はその後方に空気
の流れを作り、この空気流の中に後続のインク滴が入る
と、後続インク滴の空気抵抗が小さくなるので、先行イ
ンク滴と後続インク滴が接近して、或いは、併合して印
写歪を生じる。壕だ、印写用インク滴は荷電されている
ので、各荷電インク滴間にクーロン力が働き、このクー
ロン力によって各インク滴間の間隔が乱されて印写歪を
生じる。更に、先行する荷電インク滴の影響により、今
正に荷電されようとしているインク滴の荷電量が減じら
れ、これによっても印写歪を生じる。このような欠点を
解決するものとして例えば特公昭５２−３０３３０ 号
公報に示すように、偏向段を上又は下から順次印写する
のではなく、飛び飛びに印写することによりインク滴間
隔を太きくシ、これによシ、印写歪を小さくすることが
提案されている。
第１図は、上記従来の印字パターンの一例を説明するた
めの図で、図中、■〜■は各偏向段を示し、（５）図は
偏向段を上又は下から順に印写した順次印字の場合の図
、（Ｂ）図は例えば■、■、■、０・・・・・０、■、
・・・■、■、・・・・・■、■と飛ひ飛びに印写した
非順次印字の場合の図を示すが、このように飛び飛びに
印字すると、キャリッジの影響で（Ｂ）図に示すように
縦線にギザギザを発生する。
めの図で、図中、■〜■は各偏向段を示し、（５）図は
偏向段を上又は下から順に印写した順次印字の場合の図
、（Ｂ）図は例えば■、■、■、０・・・・・０、■、
・・・■、■、・・・・・■、■と飛ひ飛びに印写した
非順次印字の場合の図を示すが、このように飛び飛びに
印字すると、キャリッジの影響で（Ｂ）図に示すように
縦線にギザギザを発生する。
第２図は、第１図（Ｂ）に示した非順次印字のためのデ
ータ変換回路の例を示す図で、図中、１は３２ピツトシ
リアルイン・パラレルアウト型シフトレジスタ、２〜５
はパラン１１４フ番シリアルアウト型シフトレジスタ、
６はタイミングコントローラ、７はマルチプレクサで、
■〜■段のマトリクスに印写するかし々いかのデータ（
２値）がシリアルイン・パラレルアウト型レジスタ１に
入力され、０段まで入力されると、■、■、■・・０段
はパラレルイン・シリアルアウト型レジスタ２にロード
され、それより１つシフトされて■、■・・・・・・０
段が３にロードされ、以下同様にして、■、■・・・０
段は４に、■、■ ・０段は５にロードされ、これらレ
ジスタ２〜５がタイミングコントローラ６によって２．
３．４．５の順に作動され、各レジスタにロードされた
データが１［次シリアルデータとして送り出され、これ
によって、第１図（Ｂ）に示したように、■、■、■、
０％・・■、■、■・■、■、■・・・＠、■、■ ・
・■の順で印写される。しかし、このように、非）順次
で印写すると、嬉１図（Ｂ）に示したように、縦線にギ
ザギザが発生し、また、第２図に示したように、データ
変換回路が必要である。
ータ変換回路の例を示す図で、図中、１は３２ピツトシ
リアルイン・パラレルアウト型シフトレジスタ、２〜５
はパラン１１４フ番シリアルアウト型シフトレジスタ、
６はタイミングコントローラ、７はマルチプレクサで、
■〜■段のマトリクスに印写するかし々いかのデータ（
２値）がシリアルイン・パラレルアウト型レジスタ１に
入力され、０段まで入力されると、■、■、■・・０段
はパラレルイン・シリアルアウト型レジスタ２にロード
され、それより１つシフトされて■、■・・・・・・０
段が３にロードされ、以下同様にして、■、■・・・０
段は４に、■、■ ・０段は５にロードされ、これらレ
ジスタ２〜５がタイミングコントローラ６によって２．
３．４．５の順に作動され、各レジスタにロードされた
データが１［次シリアルデータとして送り出され、これ
によって、第１図（Ｂ）に示したように、■、■、■、
０％・・■、■、■・■、■、■・・・＠、■、■ ・
・■の順で印写される。しかし、このように、非）順次
で印写すると、嬉１図（Ｂ）に示したように、縦線にギ
ザギザが発生し、また、第２図に示したように、データ
変換回路が必要である。
一方、インク滴をマトリクスの下の方から順に偏向させ
ていった場合、例えば、第３図（４）に示すように下か
ら順に■、■、■、■、■と印写していった場合、先頭
部■はその前にインク滴がないために歪み、これを補正
しようとすると、第３図（Ｂ）に示すようにインク滴■
と■が併合する。このような場合、第３図（０に示すよ
うに、インク滴■と■の印写順序を入れ換えるとインク
滴■と■の併合はなくなる。なお、この他にも、あるパ
ターンで印写順序を入れ換えると、歪が減少する場合が
多数存在する。
ていった場合、例えば、第３図（４）に示すように下か
ら順に■、■、■、■、■と印写していった場合、先頭
部■はその前にインク滴がないために歪み、これを補正
しようとすると、第３図（Ｂ）に示すようにインク滴■
と■が併合する。このような場合、第３図（０に示すよ
うに、インク滴■と■の印写順序を入れ換えるとインク
滴■と■の併合はなくなる。なお、この他にも、あるパ
ターンで印写順序を入れ換えると、歪が減少する場合が
多数存在する。
１血
本発明は、上述のごとき、実情に鑑みてなされたもので
、特に、データの変換はせず、あるパターンの時のみ、
パターン内の印写順序を変えるようにし、もって、印字
歪、印字部どうしの併合を防止することを目的としてな
されたものである。
、特に、データの変換はせず、あるパターンの時のみ、
パターン内の印写順序を変えるようにし、もって、印字
歪、印字部どうしの併合を防止することを目的としてな
されたものである。
ハ
本発明の構成について、以下、一実施例に基づいて説明
する。
する。
第４図は、偏肉部入れ換えのための回路構成の一実施例
を説明するための電気回路図、第５図は、第４図のＡ部
の詳細図で、図中、１１はアドレスカウンタ、１２は歪
補正ＲＯＭ、１３はカウンタタイミング回路、１４はゲ
ート回路、１５は加算回路、１６．１７はラッチ回路、
１８はシフトレジスタ、１９はパターンデコーダ、加は
マルチプレクサ、２］はゲート回路、２２はデコーダで
、ドツト情報として送られてきた印写（プリント）デー
タは、シフトレジスタ１８に入力される。このシフトレ
ジスタ１８の入力クロック（ＣＬＯＣＫ ２ ）は、印
字の実効絢波数と同期したものであり、１滴の印字と同
期してシフトされる。また、このシフトレジスタ１８の
Ｑｌ 〜Ｑ８の８ビツトの出力は前後のインク滴のパ
ターンを示す情報としてパターンデコーダ１９に送られ
、該パターンデコーダ１９の１６種類のパターンのどれ
に当てはまるかという出力Ｑ。−Ｑｌ５の１６イ固の出
力の１個又は複数個に現われる。なお、９ビツトアドレ
スカウンタ１１を駆動するクロック（ＣＬＯＣＫｌ）は
、ＣＬＯＣＫ ２の１６倍の周波数を有し、これによシ
歪補正ＲＯＭ１２のアドレスを指定する。
を説明するための電気回路図、第５図は、第４図のＡ部
の詳細図で、図中、１１はアドレスカウンタ、１２は歪
補正ＲＯＭ、１３はカウンタタイミング回路、１４はゲ
ート回路、１５は加算回路、１６．１７はラッチ回路、
１８はシフトレジスタ、１９はパターンデコーダ、加は
マルチプレクサ、２］はゲート回路、２２はデコーダで
、ドツト情報として送られてきた印写（プリント）デー
タは、シフトレジスタ１８に入力される。このシフトレ
ジスタ１８の入力クロック（ＣＬＯＣＫ ２ ）は、印
字の実効絢波数と同期したものであり、１滴の印字と同
期してシフトされる。また、このシフトレジスタ１８の
Ｑｌ 〜Ｑ８の８ビツトの出力は前後のインク滴のパ
ターンを示す情報としてパターンデコーダ１９に送られ
、該パターンデコーダ１９の１６種類のパターンのどれ
に当てはまるかという出力Ｑ。−Ｑｌ５の１６イ固の出
力の１個又は複数個に現われる。なお、９ビツトアドレ
スカウンタ１１を駆動するクロック（ＣＬＯＣＫｌ）は
、ＣＬＯＣＫ ２の１６倍の周波数を有し、これによシ
歪補正ＲＯＭ１２のアドレスを指定する。
第６図は、歪補正ＲＯＭ１２の一例を示す図で、アドレ
ス００〜０７に第１段目のに２補正（後続２滴が偏向さ
れる場合の補正コード）、Ｋ１ 補正、ｖｃｓ ：：
（標準補正コード）、Ｓ０補正（先行１滴が偏向される
場合の補正コード）、Ｓ２ 補正、Ｓ３補正、Ｓ５補正
の各コードが格納されており、０８〜ＯＦに第１段目の
特殊パターン補正コードが入力されている。以下、同様
にして、１０〜ＩＦには第２段目の補正コードが入力さ
れており、ＩＦＯ〜ＩＦＦには第３２段目の補正コード
が入力されている。
ス００〜０７に第１段目のに２補正（後続２滴が偏向さ
れる場合の補正コード）、Ｋ１ 補正、ｖｃｓ ：：
（標準補正コード）、Ｓ０補正（先行１滴が偏向される
場合の補正コード）、Ｓ２ 補正、Ｓ３補正、Ｓ５補正
の各コードが格納されており、０８〜ＯＦに第１段目の
特殊パターン補正コードが入力されている。以下、同様
にして、１０〜ＩＦには第２段目の補正コードが入力さ
れており、ＩＦＯ〜ＩＦＦには第３２段目の補正コード
が入力されている。
９ビツトのアドレスカウンタ１１でＯＯ〜ＯＦ。
１０〜ＩＦと順次歪補正ＲＯＭ １２を読１み出してい
くのに対応して、マルチプレクサ２０の出力會アドレス
の下位４ビツト（Ｓｏ”ｓａ ）でｌｌｐに選び出し
、ゲート回路１４で順に補正コードを加算するか否かを
決め、補正されるコードのみ加算器１５へ送る。加算器
１５の加テ矧結果は、ラッチ回路１６でラッチされ、１
６回加算されるとラッチ回路１７によってラッチされ、
ラッチ回路１６のラッチ結果はリセットされる。なお、
この場合、インク滴に荷電したく々い時でも、ラッチ回
路１７のラッチ結果には補正コードのみが加算されてい
る場合があるので、荷電する時だけゲート回路２１によ
り荷電コードを通過させ、Ｄ／Ａコンバータに入力して
荷電電圧を発生させる。
くのに対応して、マルチプレクサ２０の出力會アドレス
の下位４ビツト（Ｓｏ”ｓａ ）でｌｌｐに選び出し
、ゲート回路１４で順に補正コードを加算するか否かを
決め、補正されるコードのみ加算器１５へ送る。加算器
１５の加テ矧結果は、ラッチ回路１６でラッチされ、１
６回加算されるとラッチ回路１７によってラッチされ、
ラッチ回路１６のラッチ結果はリセットされる。なお、
この場合、インク滴に荷電したく々い時でも、ラッチ回
路１７のラッチ結果には補正コードのみが加算されてい
る場合があるので、荷電する時だけゲート回路２１によ
り荷電コードを通過させ、Ｄ／Ａコンバータに入力して
荷電電圧を発生させる。
さて、前述のように、第３図囚のように印字すると歪が
生じるので、これを防止するために、第３図（Ｃ）に示
すように■と■を入れ換えたい場合、つまり、第７図は
）のパターンに該当する場合について説明すると、第７
図において、黒丸は印字段、白丸は非印字段を示し、第
７図（５）において、印字Ｙ１油Ｘは、Ｘ二に２・に□
・Ｓｌ・Ｓ２・Ｓ３・Ｓ４・Ｓ５ である。つまり、こ
の例は、後続１滴及び先行１滴が荷電され、先行する２
−５滴が荷電されない場合の例で、この場合、第５図の
パターンデコーダ１９のＱ９の出力がゝゝ１“となり、
ゲート回路］４により第６図に示したＰ２の補正コード
が出力される。
生じるので、これを防止するために、第３図（Ｃ）に示
すように■と■を入れ換えたい場合、つまり、第７図は
）のパターンに該当する場合について説明すると、第７
図において、黒丸は印字段、白丸は非印字段を示し、第
７図（５）において、印字Ｙ１油Ｘは、Ｘ二に２・に□
・Ｓｌ・Ｓ２・Ｓ３・Ｓ４・Ｓ５ である。つまり、こ
の例は、後続１滴及び先行１滴が荷電され、先行する２
−５滴が荷電されない場合の例で、この場合、第５図の
パターンデコーダ１９のＱ９の出力がゝゝ１“となり、
ゲート回路］４により第６図に示したＰ２の補正コード
が出力される。
従って、この補正コードに、隣接段との差の分だけのコ
ードを入力しておけば、第３図（５）に示した■は■の
位置まで高く偏向される。また、第７図（Ｂ）のパター
ンに該当する場合、つ捷り、Ｘ−８１・Ｓ２・Ｓ３・Ｓ
４・Ｓ５の時は、例えば、パターンデコーダ】９のＱ、
。の出力がゝゝ１“になるものとすれば、第６図に示し
たＰ３の補正コードが加算される。
ードを入力しておけば、第３図（５）に示した■は■の
位置まで高く偏向される。また、第７図（Ｂ）のパター
ンに該当する場合、つ捷り、Ｘ−８１・Ｓ２・Ｓ３・Ｓ
４・Ｓ５の時は、例えば、パターンデコーダ】９のＱ、
。の出力がゝゝ１“になるものとすれば、第６図に示し
たＰ３の補正コードが加算される。
この補記コードに前記Ｐ２の補数を入れておくと、■は
１段分１＠向量が下がり、これによって、第３図囚に示
した■は■の位置まで低く偏向され、これによって、■
と■を入れ換えることができる。
１段分１＠向量が下がり、これによって、第３図囚に示
した■は■の位置まで低く偏向され、これによって、■
と■を入れ換えることができる。
効果
以上の説明から明らかなように、本発明によると、印字
データを変換することなく、荷電コードを相対的に加減
算することにより、印写順序を変えることができ、それ
によって、印字歪（併合を含む）を大幅に低減すること
ができる。特に、本発明においては、パターン内で一部
打点位置関係（打点順序）が変るだけなので、縦線のギ
ザギザが大きな形で表われるようなことはない。
データを変換することなく、荷電コードを相対的に加減
算することにより、印写順序を変えることができ、それ
によって、印字歪（併合を含む）を大幅に低減すること
ができる。特に、本発明においては、パターン内で一部
打点位置関係（打点順序）が変るだけなので、縦線のギ
ザギザが大きな形で表われるようなことはない。
第１図は、従来の印字パターンの一例を示す図、第２図
は、第１図（Ｂ）に示した印字パターンを得るための電
気回路の一例を示す図、第３図は、従来技術の問題点及
び本発明の動作原理を説明するための印字＋Ｖ序図、第
４図は、本発明の一実施例を説明するための電気回路図
、第５図は、第４図のＡ部の詳細図、第６図は、歪補正
ＲＯＭの一例を示す図、第７図は、本発明の一動作例を
説明するためのドツト構成図である。 １１・・・アドレスカウンタ、１２・歪補正ＲＯＭ、１
３・カウンタタイミング回路、１４・・・ゲート回路、
１５・・加算回路、】６．１７ ラッチ回路、１８・
シフトレジスタ、１９・・・パターンデコーダ、加・・
マルチプレクサ、２１・・・ゲート回路、２２・・・デ
コーダ。
は、第１図（Ｂ）に示した印字パターンを得るための電
気回路の一例を示す図、第３図は、従来技術の問題点及
び本発明の動作原理を説明するための印字＋Ｖ序図、第
４図は、本発明の一実施例を説明するための電気回路図
、第５図は、第４図のＡ部の詳細図、第６図は、歪補正
ＲＯＭの一例を示す図、第７図は、本発明の一動作例を
説明するためのドツト構成図である。 １１・・・アドレスカウンタ、１２・歪補正ＲＯＭ、１
３・カウンタタイミング回路、１４・・・ゲート回路、
１５・・加算回路、】６．１７ ラッチ回路、１８・
シフトレジスタ、１９・・・パターンデコーダ、加・・
マルチプレクサ、２１・・・ゲート回路、２２・・・デ
コーダ。
Claims (1)
- ノズルより噴射されたインク滴に荷電する手段と、荷電
されたインク滴に偏向電界を加えてイｍ向する手段と、
偏向されたインク滴により印写面にパターンを形成する
手段とを有する荷電偏向型インクジェット印写装置にお
いて、印写するパターンが予め設定した印写パターンに
合致しているか否かを判別する手段と、前記判別手段に
より合致したと判断した時に、その印写パターンの形状
を満足し得る形で前記荷電手段の荷電レベルを変えるよ
うにしたことを特徴とする荷電偏向型インクジェット印
写装置の印字歪補正装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21725082A JPS59106975A (ja) | 1982-12-10 | 1982-12-10 | 荷電偏向型インクジエツト印写装置の印字歪補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21725082A JPS59106975A (ja) | 1982-12-10 | 1982-12-10 | 荷電偏向型インクジエツト印写装置の印字歪補正装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59106975A true JPS59106975A (ja) | 1984-06-20 |
Family
ID=16701198
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21725082A Pending JPS59106975A (ja) | 1982-12-10 | 1982-12-10 | 荷電偏向型インクジエツト印写装置の印字歪補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59106975A (ja) |
-
1982
- 1982-12-10 JP JP21725082A patent/JPS59106975A/ja active Pending
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