JPS61282952A - 入出力装置制御システムの構築方式 - Google Patents

入出力装置制御システムの構築方式

Info

Publication number
JPS61282952A
JPS61282952A JP60123528A JP12352885A JPS61282952A JP S61282952 A JPS61282952 A JP S61282952A JP 60123528 A JP60123528 A JP 60123528A JP 12352885 A JP12352885 A JP 12352885A JP S61282952 A JPS61282952 A JP S61282952A
Authority
JP
Japan
Prior art keywords
processing
macro
input
instruction word
output
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60123528A
Other languages
English (en)
Inventor
Shinichi Nakamura
信一 中村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP60123528A priority Critical patent/JPS61282952A/ja
Publication of JPS61282952A publication Critical patent/JPS61282952A/ja
Pending legal-status Critical Current

Links

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 ′本発明はデータ処理装置に関し、特に電子交換機やデ
ータ通信システムの様に多機種の入出力装置や各種ファ
イル形式の入出力制御をせねばならないデータ処理装置
に於ける入出力装置制御システムの構築方式に関する。
〔従来の技術〕
従来、この種の入出力装置制御システムは、アプリケー
ションプログラムからの人出・力要求種別に従い、各入
出力制御を一連のプログラム・ロジックにより構築して
いた。
以下余日 〔発明が解決しようとする問題点〕 上述した従来の入出力装置制御システムは、各入出力要
求種別毎に一連のプログラム・ロジックを実行する事に
よシ対応した各入出力制御を°実行する様になっている
ので、対象入出力装置の機種の変更や追加、対象ファイ
ル形式の変更や追加にともない、入出力装置制御システ
ム内のゾログラム・ロジック自体の変更や追加をせねば
ならないという欠点がある。
〔問題点を解決するための手段〕
本発明による入出力装置制御システムの構築方法は、メ
イン・メモリと、該メイン・メモリに記憶されたゾログ
ラムを順次読み出し命令を実行する中央処理装置と、外
部記憶装置としての入出力装置から構成されたデータ処
理装置に於いて、前記メイン・メモリは、処理を示す処
理指示語と飛び先を示す飛び先指示語を組とした処理マ
クロを複数個持つ処理マクロテーブルと、各入出力要求
種別毎の処理マクロテーブルの先頭アドレス?示すアド
レステーブルと、処理指示語毎の処理を実行する処理ル
ーチンと、前記処理マクロテーブルから処理マクロを読
み出し実行を制御する制御ルーチンを有し、入出力要求
種別に従い、前記制御ルーチンが前記処理マクロテーブ
ルを選択し、前記処理マクロテーブル内の各処理マクロ
を前記処理指示語対応の処理ルーチンで実行し、その処
理結果に基づき1通常は次の処理マクロへ、各処理指示
語毎の特定条件成立時には該飛び先指示語が示す処理マ
クロへ飛び越し、順次処理マクロを実行する事によ曳、
入出力制御を行い、対象入出力装置の機種の変更や追加
、対象ファイル形式の変更や追加が容易となることを特
徴とする。
〔実施例〕
以下2図面を参照して本発明の実施例について説明する
以下の実施例の説明に於いては、入出力装置として磁気
テープ装置を使用した場合の例について述べる。
第1図は本発明によるメイン・メモリを構成するテーブ
ルの一実施例を示した図、第2図は本発明によるメイン
・メモリに格納されたルーチンの一実施例を示した図で
ある。
第1図及び第2図を参照すると、メイン・メモリ中には
、処理マクロテーブルのアドレステーブル1.リードオ
ープン処理マクロテーブル6、リードクローズ処理マク
ロテーブル10.リード処理マクロテーブル14と処理
マクロテーブルノ制御ルーチン20.及び各処理指示語
対応の処理ルーチン21,22,23,24が有る。次
に、リードオープン要求、リード要求及びリードクロー
ズ要求をされた場合の動作について説明する。
先ず、リードオープン要求によシ、処理マクロテーブル
制御ルーチン20がアドレステーブル1から要求種別番
号2によりリードオープン処理マクロテーブル6のアド
レス3を求め、該アドレスの示すリードオープン処理マ
クロテーブル6がら処理マクロ7を抽出し、該処理マク
ロ内の処理指示語8に基づき対応する処理ルーチン21
 、22゜23.24を実行し、その実行結果に基づき
次処理マクロ又は飛び先指示語9が示す処理マクロを順
次実行する事によシリードオープン処理を実現し、処理
指示語対応の処理ルーチンのうちの1種類である終了指
示処理を最後に実行する事によシ。
リードオープン要求元へコントロールヲ戻ス。
同様に、リード要求、リードクローズ要求によシ、処理
マクロテーブル制御ルーチ:/20が7ドレステーブル
1から要求種別番号2によシリード処理マクロテーブル
14のアドレス5.IJ−1’クロース処理マクロテー
ブル10のアドレx4t−求め、該アドレスの示すリー
ド処理マクロテーブル14、リードクローズ処理マクロ
テーブル10から処理マクロ15.ll’e抽出し、該
処理マクロ内の処理指示語16.12に基づき対応する
処理ルーチン21,22,23,24を実行し、その実
行結果に基づき次処理マクロ又は飛び先指示語17.1
3が示す処理マクロを順次実行する事により、リード処
理、リードクローズ処、埋を実現する。
次に第3図及び第4図によシ具体的な実現方法を説明す
る。
第3図はリードオープン処理マクロテーブル6リードク
ローズ処理マクロテーブル10.リード処理マクロテー
ブル14の具体的な処理マクロの構成例を示している。
又第4図は各処理マクロの処理指示語に対応する処理ル
ーチンの処理内容を各処理ルーチン毎の特定条件発生時
の飛び先指示語の扱いとともに示している。
次に、具体例としてリード要求がされた場合に関して第
3図中のリード処理マクロテーブル14を基に説明する
先頭の処理マクロ内の処理指示語であるデータ・ブロッ
ク・リード指示(コード&0.略号(JTを実行し、デ
ータ・ブロックをリードできた場合は次の処理マクロ(
コードA31.略号BUP )に進み、ブロック・カウ
ンタのカウントアツプを行い、更に次の処理マクロ(コ
ード煮11.略号END )に進み、終了指示によシ正
常終了を通知する為にリード要求元へコントロールを戻
す。
一方、先頭のデータ・ブロック・リード指示を実行し、
データ・ブロックをリードできずにファ、  イルマー
ク(テーゾマークとも呼ぶ)を検出した場合は、飛び先
指示語が示す相対アドレスの処理マクロに飛び越し、終
了指示によシ異常終了を通知する為にリード要求元へコ
ントロールを戻す。
〔発明の効果〕
以上説明したように本発明は、処理を示す処理指示語と
飛び先を示す飛び先指示語を組みとした処理マクロを複
数個持つ処理マクロテーブルと。
各入出力要求種別毎の処理マクロテーブルの先頭アドレ
スを示すアドレステーブルと、処理指示語毎の処理を実
行する処理ルーチンと、処理マクロ)  テーブルから
処理マクロを読み出し実行を制御する制御ルーチンをメ
イン・メモリ中に持ち、入出力要求種別に従い、制御ル
ーチンが処理マクロテーブルを選択し、処理マクロテー
ブル内の各処理マクロを各処理指示語対応の処理ルーチ
ンで実行し、その処理結果に基づき2通常は次の処理マ
クロへ、各処理指示語毎の特定条件成立時には各飛び先
指示語が示す処理マクロへ飛び越し、順次処理マクロを
実行して入出力制御を行う事にょシ。
対象入出力装置の機種の変更や追加、対象ファイル形式
の変更や追加に対して、入出力装置制御システム内のプ
ログラム・ロジックを変更せずに。
処理マクロテーブル内の6処理マクロの組み合わせの変
更や処理マクロテーブルの追加だけで容易に対処できる
という効果が有る。
【図面の簡単な説明】
第1図は本発明によるメイン・メモリを構成するテーブ
ルの一実施例を示した図、第2図は本発明によるメイン
・メモリに格納されたルーチンの一実施例を示した図、
第3図は第1図に示したリードオープン処理マクロテー
ブル、リードクローズ処理マクロテーブル、リード処理
マクロテーブルの具体的な処理マクロの構成例を示した
図、第4図は第3図に示す各処理マクロの処理指示語に
対応する処理ルーチンの処理内容を各処理ルーチン毎の
特定条件発生時の飛び先指示語の扱いとともに示した図
である。 ■・・・入出力要求種別11牟の肌理マクロテーブル箇
先頭アドレスを示すアドレステーブル、2・・・入出力
要求種別を示す要求種別番号、3・・・リードオープン
処理マクロテーブルのアドレス、4・・・リードクロー
ズ処理マクロテーブルのアドレス、5・・・リード処理
マクロテーブルのアドレス、6・・・リード。 オープン処理マクロテーブル、7・・・処11マクロ。 8・・・処理指示語、9・・・飛び先指示語、10・・
・リードクローズ処理マクロテーブル、11・・・処理
マクロ、12・・・処理指示語、13・・・飛び先指示
語。 14・・・リード処理マクロテーブル、15・・・処理
マクロ、16・・・処理指示語、17・・・飛び先指示
語。 20・・・処理マクロテーブル制御ルーチン、21゜2
2.23,24・・・処理指示語対応の処理ルーチンO

Claims (1)

    【特許請求の範囲】
  1. 1、メイン・メモリと、該メイン・メモリに記憶された
    プログラムを順次読み出し命令を実行する中央処理装置
    と、外部記憶装置としての入出力装置から構成されたデ
    ータ処理装置に於いて、前記メイン・メモリは、処理を
    示す処理指示語と飛び先を示す飛び先指示語を組とした
    処理マクロを複数個持つ処理マクロテーブルと、各入出
    力要求種別毎の処理マクロテーブルの先頭アドレスを示
    すアドレステーブルと、処理指示語毎の処理を実行する
    処理ルーチンと、前記処理マクロテーブルから処理マク
    ロを読み出し実行を制御する制御ルーチンを有し、入出
    力要求種別に従い、前記制御ルーチンが前記処理マクロ
    テーブルを選択し、前記処理マクロテーブル内の各処理
    マクロを前記処理指示語対応の処理ルーチンで実行し、
    その処理結果に基づき、通常は次の処理マクロへ、各処
    理指示語毎の特定条件成立時には該飛び先指示語が示す
    処理マクロへ飛び越し、順次処理マクロを実行する事に
    より、入出力制御を行う事を特徴とする入出力装置制御
    システムの構築方式。
JP60123528A 1985-06-08 1985-06-08 入出力装置制御システムの構築方式 Pending JPS61282952A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60123528A JPS61282952A (ja) 1985-06-08 1985-06-08 入出力装置制御システムの構築方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60123528A JPS61282952A (ja) 1985-06-08 1985-06-08 入出力装置制御システムの構築方式

Publications (1)

Publication Number Publication Date
JPS61282952A true JPS61282952A (ja) 1986-12-13

Family

ID=14862841

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60123528A Pending JPS61282952A (ja) 1985-06-08 1985-06-08 入出力装置制御システムの構築方式

Country Status (1)

Country Link
JP (1) JPS61282952A (ja)

Similar Documents

Publication Publication Date Title
KR20130016246A (ko) 다중 명령 세트에 의해 사용되는 레지스터 간의 매핑
JPS61282952A (ja) 入出力装置制御システムの構築方式
JPH0523447B2 (ja)
JP2826309B2 (ja) 情報処理装置
JPH01150935A (ja) 中央演算装置
JPS60181837A (ja) エクスキユ−ト命令処理方式
JPH0687221B2 (ja) 情報処理装置
JPS5829053A (ja) 割込みによるプログラム修正制御方法
JPH0267632A (ja) 電子計算機における分岐命令構成法
JPS5846439A (ja) 計算機のプログラム編集方法
JPS62154145A (ja) 動的拡張ス−パ−バイザ・コ−ル割込み処理方式
JPH02110636A (ja) タグ・アーキテクチャマシンのデバッグ装置とそのコンパイラ
JPS61199126A (ja) マイクロプログラムチエツク方式
JPH0460765A (ja) ベクトルレジスタ指定方式
JPH04227589A (ja) データフロープログラムの割付け装置および割付け方法
JPS6313202B2 (ja)
JPS6160132A (ja) デ−タ・タイプ制御方式
JPH10171509A (ja) プロセス制御装置
JPS6217837A (ja) デ−タ処理システム
JPS608943A (ja) 多岐分岐制御方式
JPS61289432A (ja) 記述子によるリスト制御方式
JPS60175154A (ja) 命令置換方式
JPH06161516A (ja) シーケンスプログラムのチェック方法
JPH04117526A (ja) マイクロプログラム制御装置
JPS6051949A (ja) 制御装置