JPS6140352B2 - - Google Patents
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- JPS6140352B2 JPS6140352B2 JP56032689A JP3268981A JPS6140352B2 JP S6140352 B2 JPS6140352 B2 JP S6140352B2 JP 56032689 A JP56032689 A JP 56032689A JP 3268981 A JP3268981 A JP 3268981A JP S6140352 B2 JPS6140352 B2 JP S6140352B2
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- phase
- input terminal
- impedance element
- voltage
- phase input
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-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R29/00—Arrangements for measuring or indicating electric quantities not covered by groups G01R19/00 - G01R27/00
- G01R29/18—Indicating phase sequence; Indicating synchronism
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Measurement Of Current Or Voltage (AREA)
Description
【発明の詳細な説明】
〔技術分野〕
この発明は三相電路の相順（正相または逆相）
を検出する三相検相器に関するものである。
を検出する三相検相器に関するものである。
実公昭50―24219号公報に開示された従来の相
回転検出装置は、星形結線したインピーダンス回
路を三相電源端子に接続し、いずれかのインピー
ダンス素子の電圧の大きさによつて正相か逆相か
を検出するように構成されていた。
回転検出装置は、星形結線したインピーダンス回
路を三相電源端子に接続し、いずれかのインピー
ダンス素子の電圧の大きさによつて正相か逆相か
を検出するように構成されていた。
しかし、この従来例では、１相が接続不良であ
つて検相不能である場合においても、出力として
正相出力および逆相出力のいずれかが出力される
ことになり、したがつて正相時に逆相出力が発生
したり、逆相時に正相出力が発生することがあ
り、検相の信頼性が低かつた。また、インピーダ
ンス素子の電圧と比較すべき基準となる電圧が一
定であつたため、検相すべき電源の電圧が変わつ
た場合には検相できなくなるという問題があつ
た。
つて検相不能である場合においても、出力として
正相出力および逆相出力のいずれかが出力される
ことになり、したがつて正相時に逆相出力が発生
したり、逆相時に正相出力が発生することがあ
り、検相の信頼性が低かつた。また、インピーダ
ンス素子の電圧と比較すべき基準となる電圧が一
定であつたため、検相すべき電源の電圧が変わつ
た場合には検相できなくなるという問題があつ
た。
この発明の目的は、検相の信頼性が高く、しか
も検相電圧範囲を広げることができる三相検相器
を提供することである。
も検相電圧範囲を広げることができる三相検相器
を提供することである。
この発明の三相検相器は、第１相入力端子、第
２相入力端子および第３相入力端子と、前記第１
相入力端子に一端を接続した第１のインピーダン
ス素子と、この第１のインピーダンス素子の他端
と前記第２相入力端子との間に接続した第２のイ
ンピーダンス素子と、前記第１のインピーダンス
素子の他端と前記第３相入力端子との間に接続し
て前記第２のインピーダンス素子とインピーダン
ス角の異なる第３のインピーダンス素子と、前記
第１相入力端子、第２相入力端子および第３相入
力端子のいずれか二つの間に印加される線間電圧
に応じた直流電圧を出力する電源回路と、この電
源回路から出力される直流電圧を分圧することに
より正相時の前記第１のインピーダンス素子の電
圧降下と逆相時の前記第１のインピーダンス素子
の電圧降下との中間の第１の基準電圧を発生する
とともに正相時および逆相時の前記第１のインビ
ーダンス素子の電圧降下のいずれか低い方と第１
相不接続時の前記第１のインピーダンス素子の電
圧降下との中間の第２の基準電圧を発生する基準
電圧発生回路と、前記第１のインビーダンス素子
の電圧降下を前記第１および第２の基準電圧と比
較し前記第１のインピーダンス素子の電圧降下が
前記第１の基準電圧より高いときに第１の出力端
より出力信号を発生するとともに前記第１のイン
ピーダンス素子の電圧降下が前記第１および第２
の基準電圧の間にあるときに第２の出力端より出
力信号を発生する比較回路と、前記第２相入力端
子および第３相入力端子間より給電されて前記比
較回路の第１の出力端からの出力信号の発生時に
作動する第１の報知回路と、前記第２相入力端子
および第３相入力端子間より給電されて前記比較
回路の第２の出力端からの出力信号の発生時に作
動する第２の報知回路とを備えている。
２相入力端子および第３相入力端子と、前記第１
相入力端子に一端を接続した第１のインピーダン
ス素子と、この第１のインピーダンス素子の他端
と前記第２相入力端子との間に接続した第２のイ
ンピーダンス素子と、前記第１のインピーダンス
素子の他端と前記第３相入力端子との間に接続し
て前記第２のインピーダンス素子とインピーダン
ス角の異なる第３のインピーダンス素子と、前記
第１相入力端子、第２相入力端子および第３相入
力端子のいずれか二つの間に印加される線間電圧
に応じた直流電圧を出力する電源回路と、この電
源回路から出力される直流電圧を分圧することに
より正相時の前記第１のインピーダンス素子の電
圧降下と逆相時の前記第１のインピーダンス素子
の電圧降下との中間の第１の基準電圧を発生する
とともに正相時および逆相時の前記第１のインビ
ーダンス素子の電圧降下のいずれか低い方と第１
相不接続時の前記第１のインピーダンス素子の電
圧降下との中間の第２の基準電圧を発生する基準
電圧発生回路と、前記第１のインビーダンス素子
の電圧降下を前記第１および第２の基準電圧と比
較し前記第１のインピーダンス素子の電圧降下が
前記第１の基準電圧より高いときに第１の出力端
より出力信号を発生するとともに前記第１のイン
ピーダンス素子の電圧降下が前記第１および第２
の基準電圧の間にあるときに第２の出力端より出
力信号を発生する比較回路と、前記第２相入力端
子および第３相入力端子間より給電されて前記比
較回路の第１の出力端からの出力信号の発生時に
作動する第１の報知回路と、前記第２相入力端子
および第３相入力端子間より給電されて前記比較
回路の第２の出力端からの出力信号の発生時に作
動する第２の報知回路とを備えている。
この発明の構成によれば、正相時および逆相時
の第１のインピーダンス素子の電圧降下のいずれ
か低い方と第１相不接続時の第１のインピーダン
ス素子の電圧降下との中間の第２の基準電圧と第
１のインピーダンス素子の電圧降下とを比較する
よにしたこと、および第１および第２の報知回路
へ第２相入力端子および第３相入力端子間より給
電するようにしたことにより、正相および逆相を
検出して第１および第２の報知回路を選択的に作
動させるとともに、各相の接続不良を検出して第
１および第２の報知回路の両方の作動を停止させ
るため、いずれか１相が接続不良であつて検相が
不能であるときは第１および第２の報知回路の両
方が作動を停止し、正相時に逆相出力を発生した
りまたは逆相時に正相出力を発生するということ
はなく、検相の信頼性を高めることができる。
の第１のインピーダンス素子の電圧降下のいずれ
か低い方と第１相不接続時の第１のインピーダン
ス素子の電圧降下との中間の第２の基準電圧と第
１のインピーダンス素子の電圧降下とを比較する
よにしたこと、および第１および第２の報知回路
へ第２相入力端子および第３相入力端子間より給
電するようにしたことにより、正相および逆相を
検出して第１および第２の報知回路を選択的に作
動させるとともに、各相の接続不良を検出して第
１および第２の報知回路の両方の作動を停止させ
るため、いずれか１相が接続不良であつて検相が
不能であるときは第１および第２の報知回路の両
方が作動を停止し、正相時に逆相出力を発生した
りまたは逆相時に正相出力を発生するということ
はなく、検相の信頼性を高めることができる。
また、第１および第２の基準電圧が線間電圧の
変動に応じて変化し、線間電圧が変わつて正相時
および逆相時の第１のインピーダンス素子の電圧
降下が変化しても、例えば第１の基準電圧が正相
および逆相時の第１のインピーダンス素子の電圧
降下の中間の範囲から外れることはなく、種々の
線間電圧に対して検相を行うことができる。
変動に応じて変化し、線間電圧が変わつて正相時
および逆相時の第１のインピーダンス素子の電圧
降下が変化しても、例えば第１の基準電圧が正相
および逆相時の第１のインピーダンス素子の電圧
降下の中間の範囲から外れることはなく、種々の
線間電圧に対して検相を行うことができる。
実施例
この発明の一実施例を図面に基づいて説明す
る。この三相検相器は、第１相入力端子Ｒ、第２
相入力端子Ｓおよび第３相入力端子Ｔと、前記第
１相入力端子Ｒに一端を接続した第１のインピー
ダンス素子IM1と、この第１のインビーダンス素
子IM1の他端と前記第２相入力端子Ｓとの間に接
続した第２のインビーダンス素子IM2と、前記第
１のインピーダンス素子IM1の他端と前記第３相
入力端子Ｔとの間に接続して前記第２のインピー
ダンス素子IM2とインピーダンス角の異なる第３
のインピーダンス素子IM3と、前記第１相入力端
子Ｒ、第２相入力端子Ｓおよび第３相入力端子Ｔ
のいずれか二つ（図面では第２相入力端子Ｓと第
３相入力端子Ｔ）の間に印加される線間電圧に応
じた直流電圧を出力する電源回路８と、この伝源
回路８から出力される直流電圧ＶCCを分圧するこ
とにより正相時の前記第１のインピーダンス素子
IM1の電圧降下と逆相時の前記第１のインピーダ
ンス素子IM1の電圧降下との中間の第１の基準電
圧ＶBを発生するとともに正相時および逆相時の
前記第１のインピーダンス素子IM1の電圧降下の
いずれか低い方と第１相不接続時の前記第１のイ
ンピーダンス素子IM1の電圧降下との中間の第２
の基準電圧ＶAを発生する基準電圧発生回路１
と、前記第１のインピーダンス素子IM1の電圧降
下を前記第１および第２の基準電圧ＶB，ＶAと比
較し前記第１のインピーダンス素子IM1の電圧降
下が前記第１の基準電圧ＶBより高いときに第１
の出力端より逆相検出信号を発生するとともに前
記第１のインピーダンス素子IM1の電圧降下が前
記第１および第２の基準電圧ＶB，ＶAの間にある
ときに第２の出力端より正相検出信号を発生する
比較回路２と、前記第２相入力端子Ｓおよび第３
相入力端子Ｔ間より給電されて前記比較回路２の
第１の出力端からの逆相検出信号の発生時に作動
する逆相表示用の第１の報知回路４と、前記第２
相入力端子Ｓおよび第３相入力端子Ｔ間より給電
されて前記比較回路２の第２の出力端からの正相
検出信号の発生時に作動する正相表示用の第２の
報知回路３とを備えている。
る。この三相検相器は、第１相入力端子Ｒ、第２
相入力端子Ｓおよび第３相入力端子Ｔと、前記第
１相入力端子Ｒに一端を接続した第１のインピー
ダンス素子IM1と、この第１のインビーダンス素
子IM1の他端と前記第２相入力端子Ｓとの間に接
続した第２のインビーダンス素子IM2と、前記第
１のインピーダンス素子IM1の他端と前記第３相
入力端子Ｔとの間に接続して前記第２のインピー
ダンス素子IM2とインピーダンス角の異なる第３
のインピーダンス素子IM3と、前記第１相入力端
子Ｒ、第２相入力端子Ｓおよび第３相入力端子Ｔ
のいずれか二つ（図面では第２相入力端子Ｓと第
３相入力端子Ｔ）の間に印加される線間電圧に応
じた直流電圧を出力する電源回路８と、この伝源
回路８から出力される直流電圧ＶCCを分圧するこ
とにより正相時の前記第１のインピーダンス素子
IM1の電圧降下と逆相時の前記第１のインピーダ
ンス素子IM1の電圧降下との中間の第１の基準電
圧ＶBを発生するとともに正相時および逆相時の
前記第１のインピーダンス素子IM1の電圧降下の
いずれか低い方と第１相不接続時の前記第１のイ
ンピーダンス素子IM1の電圧降下との中間の第２
の基準電圧ＶAを発生する基準電圧発生回路１
と、前記第１のインピーダンス素子IM1の電圧降
下を前記第１および第２の基準電圧ＶB，ＶAと比
較し前記第１のインピーダンス素子IM1の電圧降
下が前記第１の基準電圧ＶBより高いときに第１
の出力端より逆相検出信号を発生するとともに前
記第１のインピーダンス素子IM1の電圧降下が前
記第１および第２の基準電圧ＶB，ＶAの間にある
ときに第２の出力端より正相検出信号を発生する
比較回路２と、前記第２相入力端子Ｓおよび第３
相入力端子Ｔ間より給電されて前記比較回路２の
第１の出力端からの逆相検出信号の発生時に作動
する逆相表示用の第１の報知回路４と、前記第２
相入力端子Ｓおよび第３相入力端子Ｔ間より給電
されて前記比較回路２の第２の出力端からの正相
検出信号の発生時に作動する正相表示用の第２の
報知回路３とを備えている。
この場合、第１のインピーダンス素子IM1は抵
抗R1，R2の直列回路からなり、第２のインピー
ダンス素子IM2はインピーダンス角が０度の抵抗
R3からなり、第３のインピーダンス素子IM3は抵
抗R3よりインピーダンス角の遅れた、すなわち
インピーダンス角が−90度のコンデンサC1から
なる。そして、抵抗R3およびコンデンサC1は、
正相時のコンデンサC1および抵抗R1，R2を通る
電流ＩTRと抵抗R3および抵抗R1，R2を通る電流
ＩRSとの位相差を120度より大きくするとともに
逆相時の電流ＩTRと電流ＩRSの位相差を120度よ
り小さくする機能を有し、抵抗R2の電圧降下は
正相時より逆相時の方が大きい。したがつて、基
準電圧ＶBは、正相時の抵抗R2の低い電圧降下と
逆相時の抵抗R2の高い電圧降下との中間の値に
設定され、基準電圧ＶAは正相時の電圧降下と第
１相入力端子Ｒの不接続時の電圧降下、すなわち
OVとの中間の値に設定される。
抗R1，R2の直列回路からなり、第２のインピー
ダンス素子IM2はインピーダンス角が０度の抵抗
R3からなり、第３のインピーダンス素子IM3は抵
抗R3よりインピーダンス角の遅れた、すなわち
インピーダンス角が−90度のコンデンサC1から
なる。そして、抵抗R3およびコンデンサC1は、
正相時のコンデンサC1および抵抗R1，R2を通る
電流ＩTRと抵抗R3および抵抗R1，R2を通る電流
ＩRSとの位相差を120度より大きくするとともに
逆相時の電流ＩTRと電流ＩRSの位相差を120度よ
り小さくする機能を有し、抵抗R2の電圧降下は
正相時より逆相時の方が大きい。したがつて、基
準電圧ＶBは、正相時の抵抗R2の低い電圧降下と
逆相時の抵抗R2の高い電圧降下との中間の値に
設定され、基準電圧ＶAは正相時の電圧降下と第
１相入力端子Ｒの不接続時の電圧降下、すなわち
OVとの中間の値に設定される。
また、正相および逆相を報知する回路として、
上記２つの回路の他に、比較回路２の正相検出信
号に連続発音制御信号を発生する発音制御回路５
と、比較回路２の逆相検出信号に応答して発音制
御回路５より断続発音制御信号を発生させる発音
制御回路６と、発音制御回路５に応動する発音回
路７とを備えており、前記した電源回路８の電圧
Vccによつて比較回路２、第１および第２の報知
回路４，３、発音制御回路５，６および発音回路
７が駆動されるようになつている。なお、９は検
電回路である。
上記２つの回路の他に、比較回路２の正相検出信
号に連続発音制御信号を発生する発音制御回路５
と、比較回路２の逆相検出信号に応答して発音制
御回路５より断続発音制御信号を発生させる発音
制御回路６と、発音制御回路５に応動する発音回
路７とを備えており、前記した電源回路８の電圧
Vccによつて比較回路２、第１および第２の報知
回路４，３、発音制御回路５，６および発音回路
７が駆動されるようになつている。なお、９は検
電回路である。
つぎに、この三相検相器について詳しく説明す
る。三相電路に第１相入力端子Ｒ、第２相端子Ｓ
および第３相入力端子Ｔをれぞれ接続すると、抵
抗R2に電圧降下が生じ、この電圧降下がダイオ
ードD1およびコンデンサC3で整流平滑され抵抗
R4，R5を介して差動増幅器（比較器）A1の正側
入力端と差動増幅器（比較器）A2の負側入力端
と差動増幅器（比較器）A3の正側入力端とに加
えられる。一方、第２相入力端子Ｓおよび第３相
入力端子Ｔ間に加えられる線間電圧が電源トラン
スPTで降圧されたのちブリツジ整流器DB、抵抗
R22およびコンデンサC6で整流平滑されてコンデ
ンサC6の両端に電圧ＶCCが生じ、この電圧ＶCC
が各回路に電源電圧として印加され、電圧ＶCCを
可変抵抗VR1および抵抗R23，R24の直列回路で分
圧して得られた電圧ＶAが差動増幅器A1の負側入
力端に加えられ、また電圧ＶBが差動増幅器A2の
正側入力端および差動増幅器A3の負側入力端に
加えられる。
る。三相電路に第１相入力端子Ｒ、第２相端子Ｓ
および第３相入力端子Ｔをれぞれ接続すると、抵
抗R2に電圧降下が生じ、この電圧降下がダイオ
ードD1およびコンデンサC3で整流平滑され抵抗
R4，R5を介して差動増幅器（比較器）A1の正側
入力端と差動増幅器（比較器）A2の負側入力端
と差動増幅器（比較器）A3の正側入力端とに加
えられる。一方、第２相入力端子Ｓおよび第３相
入力端子Ｔ間に加えられる線間電圧が電源トラン
スPTで降圧されたのちブリツジ整流器DB、抵抗
R22およびコンデンサC6で整流平滑されてコンデ
ンサC6の両端に電圧ＶCCが生じ、この電圧ＶCC
が各回路に電源電圧として印加され、電圧ＶCCを
可変抵抗VR1および抵抗R23，R24の直列回路で分
圧して得られた電圧ＶAが差動増幅器A1の負側入
力端に加えられ、また電圧ＶBが差動増幅器A2の
正側入力端および差動増幅器A3の負側入力端に
加えられる。
三相電路が第１相入力端子Ｒ、第２相入力端子
Ｓおよび第３相入力端子Ｔに正しい相順で接続さ
れた場合（正相）は、抵抗R2の電圧降下が小さ
く差動増幅器A1〜A3に加えられる電圧ＶCが ＶA＜ＶC＜ＶB であるため、差動増幅器A1〜A3の出力はそれぞ
れ「Ｈ」，「Ｈ」，「Ｌ」（「Ｈ」は略ＶCCで「Ｌ」は
零）となり、こ差動増幅器A1，A2の出力がそれ
ぞれ抵抗６，R7を介してナンドゲートNA1に加え
られてナントゲートNA1の出力が「Ｌ」（正相検
出信号）となり、差動増幅器A3の出力が抵抗R8
を介してナンドゲート（インバータ）NA2に加え
られてナンドゲートNA2の出力が「Ｈ」となる。
Ｓおよび第３相入力端子Ｔに正しい相順で接続さ
れた場合（正相）は、抵抗R2の電圧降下が小さ
く差動増幅器A1〜A3に加えられる電圧ＶCが ＶA＜ＶC＜ＶB であるため、差動増幅器A1〜A3の出力はそれぞ
れ「Ｈ」，「Ｈ」，「Ｌ」（「Ｈ」は略ＶCCで「Ｌ」は
零）となり、こ差動増幅器A1，A2の出力がそれ
ぞれ抵抗６，R7を介してナンドゲートNA1に加え
られてナントゲートNA1の出力が「Ｌ」（正相検
出信号）となり、差動増幅器A3の出力が抵抗R8
を介してナンドゲート（インバータ）NA2に加え
られてナンドゲートNA2の出力が「Ｈ」となる。
ナンドゲートNA1の出力が「Ｌ」となると、緑
色の発光ダイオードLED1に抵抗R9を介して電流
が流れ、発光ダイオードLED1が点灯して正相を
表示する。また、ナンドゲートNA1の「Ｌ」出力
が抵抗R10およびコンデンサC4よりなる遅延回路
を介してナンドゲート（インバータ）NA3に加え
られてナンドゲートNA3の出力が「Ｈ」となり、
このナンドゲートNA3の出力が抵抗R12を介して
トランジスタTR1のベースに加えられ、トランジ
スタTR1が遮断し、トランジスタTR2，TR4、抵
抗R13〜R17およびコンデンサC5よりなる高周波
発振回路OSCHが連続的に作動して圧電ブザーBZ
が連続的に鳴動する。
色の発光ダイオードLED1に抵抗R9を介して電流
が流れ、発光ダイオードLED1が点灯して正相を
表示する。また、ナンドゲートNA1の「Ｌ」出力
が抵抗R10およびコンデンサC4よりなる遅延回路
を介してナンドゲート（インバータ）NA3に加え
られてナンドゲートNA3の出力が「Ｈ」となり、
このナンドゲートNA3の出力が抵抗R12を介して
トランジスタTR1のベースに加えられ、トランジ
スタTR1が遮断し、トランジスタTR2，TR4、抵
抗R13〜R17およびコンデンサC5よりなる高周波
発振回路OSCHが連続的に作動して圧電ブザーBZ
が連続的に鳴動する。
一方、ナンドゲートNA2の出力が「Ｈ」である
ため、赤色の発光ダイオードLED2に電流は流れ
ず、発光ダイオードLED2は消灯している。ナン
ドゲートNA2の出力が「Ｈ」であるため、ナンド
ゲート（インバータ）NA4の出力が「Ｌ」とな
り、差動増幅器A4、低抗R18，R26，R27およびコ
ンデンサC2よりなる低周波発振回路OSCLは作動
せず、差動増幅器A4の出力は「Ｌ」となりこの
差動増幅器A4の出力がダイオードD3，D4および
抵抗21を介してトランジスタTR3のベースに加え
られ、トランジスタTR3は導通状態となる。
ため、赤色の発光ダイオードLED2に電流は流れ
ず、発光ダイオードLED2は消灯している。ナン
ドゲートNA2の出力が「Ｈ」であるため、ナンド
ゲート（インバータ）NA4の出力が「Ｌ」とな
り、差動増幅器A4、低抗R18，R26，R27およびコ
ンデンサC2よりなる低周波発振回路OSCLは作動
せず、差動増幅器A4の出力は「Ｌ」となりこの
差動増幅器A4の出力がダイオードD3，D4および
抵抗21を介してトランジスタTR3のベースに加え
られ、トランジスタTR3は導通状態となる。
三相電路が第１相入力端子Ｒ、第２相入力端子
Ｓおよび第３相入力端子Ｔに逆の相順で接続され
た場合（逆相）は、抵抗R2の電圧降下が大き
く、差動増幅器A1〜A3に加えられる電圧ＶCが ＶC＞ＶB であるため、差動増幅器A1〜A3の出力はそれぞ
れれ「Ｈ」，「Ｌ」，「Ｈ」となり、ナンドゲート
NA1の出力が「Ｈ」となり、ナンドゲートNA2の
出力が「Ｌ」（逆相検出信号）となる。
Ｓおよび第３相入力端子Ｔに逆の相順で接続され
た場合（逆相）は、抵抗R2の電圧降下が大き
く、差動増幅器A1〜A3に加えられる電圧ＶCが ＶC＞ＶB であるため、差動増幅器A1〜A3の出力はそれぞ
れれ「Ｈ」，「Ｌ」，「Ｈ」となり、ナンドゲート
NA1の出力が「Ｈ」となり、ナンドゲートNA2の
出力が「Ｌ」（逆相検出信号）となる。
ナンドゲードNA1の出力が「Ｈ」となると、発
光ダイオードLED1に電流が流れず、発光ダイオ
ードLED1は消灯する。また、ナンドゲートNA1
の「Ｈ」出力が抵抗R10およびコンデンサC4によ
りなる遅延回路を介してナンドゲートNA3に加え
られてナンドゲートNA3の出力が「Ｌ」となり、
このナンドゲートNA3の出力がトランジスタTR1
のベースに加えられ、トランジスタTR1が導通す
る。
光ダイオードLED1に電流が流れず、発光ダイオ
ードLED1は消灯する。また、ナンドゲートNA1
の「Ｈ」出力が抵抗R10およびコンデンサC4によ
りなる遅延回路を介してナンドゲートNA3に加え
られてナンドゲートNA3の出力が「Ｌ」となり、
このナンドゲートNA3の出力がトランジスタTR1
のベースに加えられ、トランジスタTR1が導通す
る。
一方、ナンドゲートNA2の出力が「Ｌ」である
ため、発光ダイオードLED2が抵抗R11を介して電
流が流れ、発光ダイオードLED2が点灯して逆相
を表示する。また、ナンドゲートNA2の出力が
「Ｌ」であるため、ナンドゲートNA4の出力が
「Ｈ」となり、低周波発振回路OSCLに抵抗R25を
介して給電され、低周波発振回路OSCLが作動し
て差動増幅器A4の出力は「Ｌ」，「Ｈ」を繰返
し、この差動増幅器A4の出力がトランジスタTR3
のベースに加えられ、トランジスタTR3が導通・
遮断を繰返し、高周波発振回路OSCHが断続的に
作動して圧電ブザーBZが断続的に鳴動する。
ため、発光ダイオードLED2が抵抗R11を介して電
流が流れ、発光ダイオードLED2が点灯して逆相
を表示する。また、ナンドゲートNA2の出力が
「Ｌ」であるため、ナンドゲートNA4の出力が
「Ｈ」となり、低周波発振回路OSCLに抵抗R25を
介して給電され、低周波発振回路OSCLが作動し
て差動増幅器A4の出力は「Ｌ」，「Ｈ」を繰返
し、この差動増幅器A4の出力がトランジスタTR3
のベースに加えられ、トランジスタTR3が導通・
遮断を繰返し、高周波発振回路OSCHが断続的に
作動して圧電ブザーBZが断続的に鳴動する。
三相電路が第１相入力端子Ｒ、第２相入力端子
Ｓおよび第３相入力端子Ｔに完全に接続されてい
ない場合、例えば第１相入力端子Ｒが三相電路か
ら切離されている場合は、抵抗R2には電圧降下
は生じず、差動増幅器A1〜A3に加えられる電圧
ＶCが零、すなわち ＶC＜ＶA であるため、差動増幅器A1〜A3の出力はそれぞ
れ「Ｌ」，「Ｈ」，「Ｌ」となり、ナンドゲート
NA1，NA2がそれぞれ「Ｈ」，「Ｈ」となる。
Ｓおよび第３相入力端子Ｔに完全に接続されてい
ない場合、例えば第１相入力端子Ｒが三相電路か
ら切離されている場合は、抵抗R2には電圧降下
は生じず、差動増幅器A1〜A3に加えられる電圧
ＶCが零、すなわち ＶC＜ＶA であるため、差動増幅器A1〜A3の出力はそれぞ
れ「Ｌ」，「Ｈ」，「Ｌ」となり、ナンドゲート
NA1，NA2がそれぞれ「Ｈ」，「Ｈ」となる。
ナンドゲートNA1，NA2がそれぞれ「Ｈ」，
「Ｈ」となると、発光ダイオードLED1，LED2が
ともに消灯する。また、ナンドゲートNA3，NA4
がともに「Ｌ」となり、したがつてトランジスタ
TR1，TR3が導通して抵抗R13を短絡し、高周波
発振回路OSCHの作動が停止して圧電ブザーBZの
鳴動が停止する。
「Ｈ」となると、発光ダイオードLED1，LED2が
ともに消灯する。また、ナンドゲートNA3，NA4
がともに「Ｌ」となり、したがつてトランジスタ
TR1，TR3が導通して抵抗R13を短絡し、高周波
発振回路OSCHの作動が停止して圧電ブザーBZの
鳴動が停止する。
なお、第２相入力端子Ｓおよび第３相入力端子
Ｔが三相電路に接続されていないときは電源回路
８が作動せず、当然圧電ブザーBZも鳴動しな
い。
Ｔが三相電路に接続されていないときは電源回路
８が作動せず、当然圧電ブザーBZも鳴動しな
い。
検電回路９は、第３相入力端子Ｔを抵抗R19，
R20およびネオン管NEを介して人体でアースする
ようになつており、ネオン管NEの点灯により通
電確認を行うことができる。
R20およびネオン管NEを介して人体でアースする
ようになつており、ネオン管NEの点灯により通
電確認を行うことができる。
このように、この実施例の三相検相器は、第１
相入力端子Ｒ、第２相入力端子Ｓおよび第３相入
力端子Ｔ間に抵抗R1，R2，R3およびコンデンサ
C1をスター状に接続し、抵抗R2の電圧降下の大
小を基準電圧と比較し、この比較信号により正相
表示用の報知回路３および逆相表示用の報知回路
４を作動させるとともに発音回路７を作動させる
ようにしたため、三相電路の相順を検出して報知
することができる。また、正相時は逆相時とで表
示の色を変えるとともに発音回路７の鳴動状態を
変えている（連続鳴動、断続鳴動）ため、設置場
所から離れても正相か逆相かを確認できる。ま
た、第２相入力端子Ｓおよび第３相入力端子Ｔ間
に加えられる線間電圧により作動する電源回路８
により他の回路を駆動しているため、電池等の別
電源が不要でありメインテナンスが容易である。
また、基準電圧発生回路１が線間電圧に対応する
電圧Vccを分圧して基準電圧を発生する構成であ
るため、三相電路の線間電圧が変化したときに基
準電圧もそれに応じて変化し検相電圧範囲を広く
（AC100V〜AC500V）できる。
相入力端子Ｒ、第２相入力端子Ｓおよび第３相入
力端子Ｔ間に抵抗R1，R2，R3およびコンデンサ
C1をスター状に接続し、抵抗R2の電圧降下の大
小を基準電圧と比較し、この比較信号により正相
表示用の報知回路３および逆相表示用の報知回路
４を作動させるとともに発音回路７を作動させる
ようにしたため、三相電路の相順を検出して報知
することができる。また、正相時は逆相時とで表
示の色を変えるとともに発音回路７の鳴動状態を
変えている（連続鳴動、断続鳴動）ため、設置場
所から離れても正相か逆相かを確認できる。ま
た、第２相入力端子Ｓおよび第３相入力端子Ｔ間
に加えられる線間電圧により作動する電源回路８
により他の回路を駆動しているため、電池等の別
電源が不要でありメインテナンスが容易である。
また、基準電圧発生回路１が線間電圧に対応する
電圧Vccを分圧して基準電圧を発生する構成であ
るため、三相電路の線間電圧が変化したときに基
準電圧もそれに応じて変化し検相電圧範囲を広く
（AC100V〜AC500V）できる。
なお、上記実施例では、第２のインピーダンス
として抵抗R3を用いるとともに第３のインピー
ダンスとしてコンデンサC1を用いたが、逆に第
２のインピーダンスとしてコンデンサC1を用い
るとともに第３のインピーダンスとして抵抗R3
を用いれば、コンデンサC1および抵抗R3は正相
時のコンデンサC1および抵抗R1，R2を通る電流
ＩTRと抵抗R3および抵抗R1，R2を通る電流ＩRS
との位相差を120度より小さくするとともに逆相
時の電流ＩTRと電流ＩRSの位相差を120度より大
きくする機能を有し、抵抗R2の電圧降下は正相
時より逆相時の方が小さくなり、比較回路２を変
えることにより同様の動作を行わせることができ
る。また、第２および第３のインピーダンスとし
ては抵抗R3およびコンデンサC1の組合わせに限
定されることはない。
として抵抗R3を用いるとともに第３のインピー
ダンスとしてコンデンサC1を用いたが、逆に第
２のインピーダンスとしてコンデンサC1を用い
るとともに第３のインピーダンスとして抵抗R3
を用いれば、コンデンサC1および抵抗R3は正相
時のコンデンサC1および抵抗R1，R2を通る電流
ＩTRと抵抗R3および抵抗R1，R2を通る電流ＩRS
との位相差を120度より小さくするとともに逆相
時の電流ＩTRと電流ＩRSの位相差を120度より大
きくする機能を有し、抵抗R2の電圧降下は正相
時より逆相時の方が小さくなり、比較回路２を変
えることにより同様の動作を行わせることができ
る。また、第２および第３のインピーダンスとし
ては抵抗R3およびコンデンサC1の組合わせに限
定されることはない。
この発明の三相検相器によれば、正相時および
逆相時の第１のインピーダンス素子の電圧降下の
いずれか低い方と第１相不接続時の第１のインピ
ーダンス素子の電圧降下との中間の第２の基準電
圧と第１のインピーダンス素子の電圧降下とを比
較するようにしたこと、および第１および第２の
報知回路へ第２相入力端子および第３相入力端子
間より給電するようにしたことにより、正相およ
び逆相を検出きて第１および第２の報知回路を選
択的に作動させるとともに、各相の接続不良を検
出して第１および第２の報知回路の両方の作動を
停止させるため、いずれか１相が接続不良であつ
て検相が不能であるときは第１および第２の報知
回路の両方が作動を停止し、正相時に逆相出力を
発生したりまたは逆相時に正相出力を発生すると
いうことはなく、検相の信頼性を高めることがで
きる。
逆相時の第１のインピーダンス素子の電圧降下の
いずれか低い方と第１相不接続時の第１のインピ
ーダンス素子の電圧降下との中間の第２の基準電
圧と第１のインピーダンス素子の電圧降下とを比
較するようにしたこと、および第１および第２の
報知回路へ第２相入力端子および第３相入力端子
間より給電するようにしたことにより、正相およ
び逆相を検出きて第１および第２の報知回路を選
択的に作動させるとともに、各相の接続不良を検
出して第１および第２の報知回路の両方の作動を
停止させるため、いずれか１相が接続不良であつ
て検相が不能であるときは第１および第２の報知
回路の両方が作動を停止し、正相時に逆相出力を
発生したりまたは逆相時に正相出力を発生すると
いうことはなく、検相の信頼性を高めることがで
きる。
また、第１および第２の基準電圧が線間電圧の
変動に応じて変化し、線間電圧が変わつて正相時
および逆相時の第１のインピーダンス素子の電圧
降下が変化しても、例えば第１の基準電圧が正相
および逆相時の第１のインピーダンス素子の電圧
降下の中間の範囲から外れることはなく、種々の
線間電圧に対して検相を行うことができる。
変動に応じて変化し、線間電圧が変わつて正相時
および逆相時の第１のインピーダンス素子の電圧
降下が変化しても、例えば第１の基準電圧が正相
および逆相時の第１のインピーダンス素子の電圧
降下の中間の範囲から外れることはなく、種々の
線間電圧に対して検相を行うことができる。
図面はこの発明の一実施例の回路図である。
Ｒ……第１相入力端子、Ｓ……第２相入力端
子、Ｔ……第３相入力端子、IM1〜IM3……イン
ピーダンス素子、１……基準電圧発生回路、２…
…比較回路、３……報知回路、４……報知回路、
５，６……発音制御回路、７……発音回路、８…
…電源回路。
子、Ｔ……第３相入力端子、IM1〜IM3……イン
ピーダンス素子、１……基準電圧発生回路、２…
…比較回路、３……報知回路、４……報知回路、
５，６……発音制御回路、７……発音回路、８…
…電源回路。
Claims (1)
- １ 第１相入力端子、第２相入力端子および第３
相入力端子と、前記第１相入力端子に一端を接続
した第１のインピーダンス素子と、この第１のイ
ンピーダンス素子の他端と前記第２相入力端子と
の間に接続した第２のインピーダンス素子と、前
記第１のインピーダンス素子の他端と前記第３相
入力端子との間に接続して前記第２のインピーダ
ンス素子とインピーダンス角の異なる第３のイン
ピーダンス素子と、前記第１相入力端子、第２相
入力端子および第３相入力端子のいずれか二つの
間に印加される線間電圧に応じた直流電圧を出力
する電源回路と、この電源回路から出力される直
流電圧を分圧することにより正相時の前記第１の
インピーダンス素子の電圧降下と逆相時の前記第
１のインピーダンス素子の電圧降下との中間の第
１の基準電圧を発生するとともに正相時および逆
相時の前記第１のインピーダンス素子の電圧降下
のいずれか低い方と第１相不接続時の前記第１の
インピーダンス素子の電圧降下との中間の第２の
基準電圧を発生する基準電圧発生回路と、前記第
１のインピーダンス素子の電圧降下を前記第１お
よび第２の基準電圧と比較し前記第１のインピー
ダンス素子の電圧降下が前記第１の基準電圧より
高いときに第１の出力端より出力信号を発生する
とともに前記第１のインピーダンス素子の電圧降
下が前記第１および第２の基準電圧の間にあると
きに第２の出力端より出力信号を発生する比較回
路と、前記第２相入力端子および第３相入力端子
間より給電されて前記比較回路の第１の出力端か
らの出力信号の発生時に作動する第１の報知回路
と、前記第２相入力端子および第３相入力端子間
より給電されて前記比較回路の第２の出力端から
の出力信号の発生時に作動する第２の報知回路と
を備えた三相検相器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3268981A JPS57147070A (en) | 1981-03-06 | 1981-03-06 | Three phase detector |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3268981A JPS57147070A (en) | 1981-03-06 | 1981-03-06 | Three phase detector |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57147070A JPS57147070A (en) | 1982-09-10 |
| JPS6140352B2 true JPS6140352B2 (ja) | 1986-09-09 |
Family
ID=12365826
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3268981A Granted JPS57147070A (en) | 1981-03-06 | 1981-03-06 | Three phase detector |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57147070A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5024219U (ja) * | 1973-06-28 | 1975-03-19 |
-
1981
- 1981-03-06 JP JP3268981A patent/JPS57147070A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57147070A (en) | 1982-09-10 |
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