JPS6181004A - 半導体集積回路 - Google Patents
半導体集積回路Info
- Publication number
- JPS6181004A JPS6181004A JP20370084A JP20370084A JPS6181004A JP S6181004 A JPS6181004 A JP S6181004A JP 20370084 A JP20370084 A JP 20370084A JP 20370084 A JP20370084 A JP 20370084A JP S6181004 A JPS6181004 A JP S6181004A
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- JP
- Japan
- Prior art keywords
- amplifier
- terminal
- input
- case
- terminal pin
- Prior art date
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- Granted
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Landscapes
- Oscillators With Electromechanical Resonators (AREA)
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、マイクロコンビニーりの発Ｉ辰回路に関し、
端子ピン数を可及的に減少させようとするものである。
端子ピン数を可及的に減少させようとするものである。
１チツプマイクロコンピユータではクロック発振器は増
幅部を千ノブ（半導体基板）内に構成し、水晶振動子又
はＣＲ素子は外付けする構成をとっている。第２図（ａ
）は水晶発振回路の場合、同図（ｂ）′はＣＲＲ振回路
の場合で、１０．１２は増幅器（奇数段からなり入、出
力間ではインへ−夕）、１８．２０は端子ピンであり、
これらは図示のように接続される。ＣＲ発発註回路場合
増幅器１２はヒステリシスを持ち、水晶発振回路の場合
増幅器１０はヒステリシスを持た゛ず代ってＩＭΩ程度
の抵抗Ｉ６で躬い負帰還がかかっている。（ｃｌ、 （
ｄｉは所要部品を外付けした状懸を示し、（ｅｌは水晶
発振回路で２２はその水晶振動子、２４．２６はコンデ
ンサである。（ｄｌはＣＲ発振回路で２８はその抵抗、
３０はコンデンサである。
幅部を千ノブ（半導体基板）内に構成し、水晶振動子又
はＣＲ素子は外付けする構成をとっている。第２図（ａ
）は水晶発振回路の場合、同図（ｂ）′はＣＲＲ振回路
の場合で、１０．１２は増幅器（奇数段からなり入、出
力間ではインへ−夕）、１８．２０は端子ピンであり、
これらは図示のように接続される。ＣＲ発発註回路場合
増幅器１２はヒステリシスを持ち、水晶発振回路の場合
増幅器１０はヒステリシスを持た゛ず代ってＩＭΩ程度
の抵抗Ｉ６で躬い負帰還がかかっている。（ｃｌ、 （
ｄｉは所要部品を外付けした状懸を示し、（ｅｌは水晶
発振回路で２２はその水晶振動子、２４．２６はコンデ
ンサである。（ｄｌはＣＲ発振回路で２８はその抵抗、
３０はコンデンサである。
このように従来方式ではクロック発振回路は端子ピン２
個を使用しており、既知のように集積回路装置では端子
ピンは１個でも少ないのが望まれるので、問題である。
個を使用しており、既知のように集積回路装置では端子
ピンは１個でも少ないのが望まれるので、問題である。
水晶発振回路では、水晶振ジノ子は増幅器１ｏの大、出
力端間に接続されるので端子ピン２１［１ｉｌ使用は避
けられない。これに対しＣＲＲ振回路では増幅器１２の
入、出力端間に接続されるのは抵抗で、コンデンサは入
力端とグランド間に接続される。
力端間に接続されるので端子ピン２１［１ｉｌ使用は避
けられない。これに対しＣＲＲ振回路では増幅器１２の
入、出力端間に接続されるのは抵抗で、コンデンサは入
力端とグランド間に接続される。
抵抗なら内蔵可能である。
本発明はが＼る点に着目するものであって、端子ピンが
１個で済む発振回路を提供しようとするモノである。ま
た水晶発振回路、ＣＲＲ振回路などに必要に応じて切換
可能にすることを他の目的とする。
１個で済む発振回路を提供しようとするモノである。ま
た水晶発振回路、ＣＲＲ振回路などに必要に応じて切換
可能にすることを他の目的とする。
本発明は、半導体基板に形成されるマイクロコンビニー
夕のクロック発振回路において、ヒステリシスを持つ増
幅器と、その入、出力端間に接続された抵抗が該半導体
基板に構成され、かつ該増幅器の入力端が端子ピンに接
続され、該端子ピンとグランド間にコンデンサを接続す
ることにより発振回路が構成されるようにしてなること
を特徴とするものである。
夕のクロック発振回路において、ヒステリシスを持つ増
幅器と、その入、出力端間に接続された抵抗が該半導体
基板に構成され、かつ該増幅器の入力端が端子ピンに接
続され、該端子ピンとグランド間にコンデンサを接続す
ることにより発振回路が構成されるようにしてなること
を特徴とするものである。
第１図で説明すると、本発明では図示のように増幅器１
０，１２，１４、抵抗１６．２Ｂ、端子ピン１８．２０
をチップがち半導体基板に構成しておき、ＣＲ発発註回
路場合は（ａｌの如くまた水晶発振回路の場合は（ｂｌ
の如く結線する。即ち（ａｌの場合は抵抗２８を増幅器
１２の入、出力端間に接続し、該増幅器の入力端は端子
ピンに接続し、また増幅器１４の入、刃端を端子ピン２
０に接続する。
０，１２，１４、抵抗１６．２Ｂ、端子ピン１８．２０
をチップがち半導体基板に構成しておき、ＣＲ発発註回
路場合は（ａｌの如くまた水晶発振回路の場合は（ｂｌ
の如く結線する。即ち（ａｌの場合は抵抗２８を増幅器
１２の入、出力端間に接続し、該増幅器の入力端は端子
ピンに接続し、また増幅器１４の入、刃端を端子ピン２
０に接続する。
また（ｂｌの場合は抵抗１６を増幅器１０の入、出力端
間に接続し、該増幅器の入力端は端子ピン１８に、出力
端は端子ピン２ｏに［し、その他は未結線とする。ｆａ
＋、 ｆｂｌの切換えは配線用マスクパターンを変える
ことにより容易に実現できる。増幅器１０．１２は前述
のように入、出方端間で見ればインバータとなっている
ものであり、そして増幅器１２はヒステリシス特性を持
つ。増幅器１４はインバータであるａ・要はなく通常の
増幅器又はハ・ソファでよい。増幅器１０の帰還抵抗１
６はＩＭΩｆ呈度の高抵抗、増幅器１２の帰還抵抗部ち
ＣＲ素子の該Ｒは２〜５にΩの低抵抗である。
間に接続し、該増幅器の入力端は端子ピン１８に、出力
端は端子ピン２ｏに［し、その他は未結線とする。ｆａ
＋、 ｆｂｌの切換えは配線用マスクパターンを変える
ことにより容易に実現できる。増幅器１０．１２は前述
のように入、出方端間で見ればインバータとなっている
ものであり、そして増幅器１２はヒステリシス特性を持
つ。増幅器１４はインバータであるａ・要はなく通常の
増幅器又はハ・ソファでよい。増幅器１０の帰還抵抗１
６はＩＭΩｆ呈度の高抵抗、増幅器１２の帰還抵抗部ち
ＣＲ素子の該Ｒは２〜５にΩの低抵抗である。
第１図ｉａｌで端子ピン］８にコンデンサ３０１１］ち
ＣＲ素子のＣを接続すると第２図（ｄｉと同し回路構成
となり、ＣＲＲ振回路が得られる。この場合外付けする
のはコンデンサ３ｏのみであるから、こ＼ではＣ発振回
路と呼ぶ。端子ピン２ｏはＣ発振回路の場合は遊びにな
るので、これをマイクロコンピュータの他の端子例えば
データ端子とすることができる。入力データ用なら増幅
器１４は図示極性でよく、出力データ用なら逆極性にす
る。つまり増幅器１４はレシーバ／トランスミンクの機
能を有する。
ＣＲ素子のＣを接続すると第２図（ｄｉと同し回路構成
となり、ＣＲＲ振回路が得られる。この場合外付けする
のはコンデンサ３ｏのみであるから、こ＼ではＣ発振回
路と呼ぶ。端子ピン２ｏはＣ発振回路の場合は遊びにな
るので、これをマイクロコンピュータの他の端子例えば
データ端子とすることができる。入力データ用なら増幅
器１４は図示極性でよく、出力データ用なら逆極性にす
る。つまり増幅器１４はレシーバ／トランスミンクの機
能を有する。
第１図ｆｂｌで水晶振動子２２の両端を端子ピン１８と
２０に接続し、これらの端子ピンとグランドとの間にコ
ンデンサ２４．２６を接続すると、第２図（Ｃ１と同し
になり、水晶発振回路が得られる。
２０に接続し、これらの端子ピンとグランドとの間にコ
ンデンサ２４．２６を接続すると、第２図（Ｃ１と同し
になり、水晶発振回路が得られる。
この場合は端子ピンに余りは発注せず、データ入出力な
どに利用はできない。
どに利用はできない。
第１図に示すように土鈴幅器１０．１２，１４、及び抵
抗１６．２８を予めチップに形成゛しておけば、第１図
ｆａｔの０発（辰回路、第１図Ｃｂ）の水晶発振回路、
それに図示しないが第１図ｆａ）で抵抗２８は外付けす
る（２８は１２がら切離し、別に抵抗を１８．２０間に
接続し、端子２ｏと１４との接続は断ち、端子２０と１
２の出力端を接続する）ように巳でＣＲＲ振回路を構成
でき、融通性のある回路構成とすることができる。勿論
０発（辰回路とする場合は第１図（ａ）で増幅器１ｏ及
び抵抗１６を除いて、増幅器１２．１４（場合により１
４は省略）、抵抗２８のみとしてよい。
抗１６．２８を予めチップに形成゛しておけば、第１図
ｆａｔの０発（辰回路、第１図Ｃｂ）の水晶発振回路、
それに図示しないが第１図ｆａ）で抵抗２８は外付けす
る（２８は１２がら切離し、別に抵抗を１８．２０間に
接続し、端子２ｏと１４との接続は断ち、端子２０と１
２の出力端を接続する）ように巳でＣＲＲ振回路を構成
でき、融通性のある回路構成とすることができる。勿論
０発（辰回路とする場合は第１図（ａ）で増幅器１ｏ及
び抵抗１６を除いて、増幅器１２．１４（場合により１
４は省略）、抵抗２８のみとしてよい。
以上詳細に説明したように本発明ではＣ発振回路構成と
して端子ピンを１個節約することができ、実用上有効で
ある。
して端子ピンを１個節約することができ、実用上有効で
ある。
第１図は本発明を説明する回路図、第２図は従来例を示
す回路図である。 図面で１２はヒステリシスを持つ増幅器、２８は抵抗、
１８は端子ピン、３ｏはコンデンサ、ｌＯは水晶発振回
路用の増幅器、１６はその抵抗である。
す回路図である。 図面で１２はヒステリシスを持つ増幅器、２８は抵抗、
１８は端子ピン、３ｏはコンデンサ、ｌＯは水晶発振回
路用の増幅器、１６はその抵抗である。
Claims (2)
- （１）ヒステリシスを持つ増幅器と、その入、出力端間
に接続された抵抗が該半導体基板に構成され、かつ該増
幅器の入力端が端子ピンに接続され、該端子ピンとグラ
ンド間にコンデンサを接続することにより発振回路が構
成されるようにしてなることを特徴とする発振回路。 - （２）半導体基板には、ヒステリシスを持つ増幅器とそ
の入、出力端間に接続される抵抗の他に、水晶発振回路
用の増幅器とその入、出力端間に接続される抵抗が形成
されていることを特徴とする特許請求の範囲第１項記載
の発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20370084A JPS6181004A (ja) | 1984-09-28 | 1984-09-28 | 半導体集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20370084A JPS6181004A (ja) | 1984-09-28 | 1984-09-28 | 半導体集積回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6181004A true JPS6181004A (ja) | 1986-04-24 |
| JPH0347003B2 JPH0347003B2 (ja) | 1991-07-18 |
Family
ID=16478398
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20370084A Granted JPS6181004A (ja) | 1984-09-28 | 1984-09-28 | 半導体集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6181004A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58219803A (ja) * | 1982-06-14 | 1983-12-21 | Mitsubishi Electric Corp | 発振回路 |
-
1984
- 1984-09-28 JP JP20370084A patent/JPS6181004A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58219803A (ja) * | 1982-06-14 | 1983-12-21 | Mitsubishi Electric Corp | 発振回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0347003B2 (ja) | 1991-07-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |