JPS62119952A - 集積回路装置 - Google Patents
集積回路装置Info
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- JPS62119952A JPS62119952A JP60259972A JP25997285A JPS62119952A JP S62119952 A JPS62119952 A JP S62119952A JP 60259972 A JP60259972 A JP 60259972A JP 25997285 A JP25997285 A JP 25997285A JP S62119952 A JPS62119952 A JP S62119952A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は複数の集積回路素子を1つのパッケージ内に収
納した集積回路装置に関する。
納した集積回路装置に関する。
第4図(alは、一つのリードフレームに複数の集積回
路素子を載置し結線した樹脂封止前の従来の集積回路装
置の平面図、同図(b)は同図(a)図のA−A断面図
である。これらの図において、リードフレームのアイラ
ンド14に集積回路素子11.12をマクントし、ボン
ディングワイヤ7で、リード17と集積回路素子11.
12とを電気的に接続したものでめる。
路素子を載置し結線した樹脂封止前の従来の集積回路装
置の平面図、同図(b)は同図(a)図のA−A断面図
である。これらの図において、リードフレームのアイラ
ンド14に集積回路素子11.12をマクントし、ボン
ディングワイヤ7で、リード17と集積回路素子11.
12とを電気的に接続したものでめる。
上述した従来の集積回路装置は、複数の集積回路素子を
同一パッケージ内に収納する場合、占有面積が増大する
欠点がある。例えば、ある四−機能を有する2個の集積
回路素子を第4図の禄に平面的に配置し、各々の素子の
選択は、各々に選択信号を加えて各集積回路素子を使用
する場合や、異なる機能の重子′t″複畝個央裟し、1
個の集積回路装置として利用する場合など、素子の占有
面積やパッケージの容積等が限定されていれば、それら
の収納は非常に困難となる欠点がある。
同一パッケージ内に収納する場合、占有面積が増大する
欠点がある。例えば、ある四−機能を有する2個の集積
回路素子を第4図の禄に平面的に配置し、各々の素子の
選択は、各々に選択信号を加えて各集積回路素子を使用
する場合や、異なる機能の重子′t″複畝個央裟し、1
個の集積回路装置として利用する場合など、素子の占有
面積やパッケージの容積等が限定されていれば、それら
の収納は非常に困難となる欠点がある。
本発明の集積回路装置は、集積回路系子が載置され結線
された第1のリードフレーム上に、別の集積回路系子が
載置され結線された7ip、2のリードフレームが配置
され、第1と第2のリードフレームは電気的に接続され
、そしてこれらは樹脂で一体に封止されているのである
。
された第1のリードフレーム上に、別の集積回路系子が
載置され結線された7ip、2のリードフレームが配置
され、第1と第2のリードフレームは電気的に接続され
、そしてこれらは樹脂で一体に封止されているのである
。
本発明について図面を参照して説明する。第1図は本発
明の、第1の実施例の断面図を示したものである。図に
於いて、1,2は第1及び第2の集積回路系子であり、
3,5は第1及び第2のリードフレーム、4,6は第1
及び謝2のリードフレームのアイランド、7はボンゲイ
ンクワイヤ、8は樹脂部である。
明の、第1の実施例の断面図を示したものである。図に
於いて、1,2は第1及び第2の集積回路系子であり、
3,5は第1及び第2のリードフレーム、4,6は第1
及び謝2のリードフレームのアイランド、7はボンゲイ
ンクワイヤ、8は樹脂部である。
本発明の集積回路装置を得る為には、まず、第1のアイ
ランド4に第1の集積回路系子lをマウントし、ボンゲ
インクワイヤ7にて第1のリードフレーム3と第1の集
積回路素子1とを電気的に接続する。次に第2のアイラ
ンド6に第2の集積回路素子2をマウントし、ボンディ
ングワイヤ7にて第2のリードフレーム5と第2の集積
回路素子2とを電気的に接続する。最後に第1のリード
フレーム3と第2のリードフレーム5と全熱的又は機械
的に接続した後、樹脂8にて封止する事により本集積回
路装置を得る事ができる。
ランド4に第1の集積回路系子lをマウントし、ボンゲ
インクワイヤ7にて第1のリードフレーム3と第1の集
積回路素子1とを電気的に接続する。次に第2のアイラ
ンド6に第2の集積回路素子2をマウントし、ボンディ
ングワイヤ7にて第2のリードフレーム5と第2の集積
回路素子2とを電気的に接続する。最後に第1のリード
フレーム3と第2のリードフレーム5と全熱的又は機械
的に接続した後、樹脂8にて封止する事により本集積回
路装置を得る事ができる。
第2図は本発明の第2の実施例の断面図を示したもので
ある。図に於いて、11.12は下段側の集積回路系子
であり、21.22は上段側の集積回路素子である。1
3.15は下段と上段のリードフレーム、14.15は
下段と上段のリードフレームのアイランド、7はボンデ
ィングワイヤ、18は樹脂部である。図に示す通り、第
2の実施例は、下段と上段のリードフレーム上の集積回
路素子を複数設けたものでるる。尚、第2の実施例の集
積回路装置を得るための方法については、第1の実施例
と同一方法で得られる。
ある。図に於いて、11.12は下段側の集積回路系子
であり、21.22は上段側の集積回路素子である。1
3.15は下段と上段のリードフレーム、14.15は
下段と上段のリードフレームのアイランド、7はボンデ
ィングワイヤ、18は樹脂部である。図に示す通り、第
2の実施例は、下段と上段のリードフレーム上の集積回
路素子を複数設けたものでるる。尚、第2の実施例の集
積回路装置を得るための方法については、第1の実施例
と同一方法で得られる。
第3図は耐湿性及び熱に対する動作特性の向上を図って
、セラミックパッケージに本発明を応用した応用例の断
面図である。図に於いて、1,2は第1及び第2の集積
回路素子であり、34 、37は第1及び集2のアイラ
ンド部、33.36はセラミックパッケージの基底部、
35.38は第1及び第2のリード部、7はボンディン
グワイヤ、39はセラミックパッケージのキャップであ
る。
、セラミックパッケージに本発明を応用した応用例の断
面図である。図に於いて、1,2は第1及び第2の集積
回路素子であり、34 、37は第1及び集2のアイラ
ンド部、33.36はセラミックパッケージの基底部、
35.38は第1及び第2のリード部、7はボンディン
グワイヤ、39はセラミックパッケージのキャップであ
る。
この応用例を得る為の方法について説明する。
まず第1のセラミックパッケージ基底部33のアイラン
ド部34に第1の集積回路索子1をマクントシ、ワイヤ
ポンチインクを行う。次に第2のセラミックパッケージ
基底部36のアイランド部37に第2の集積回路索子2
をマウントシ、ワイヤボンディングを行なう。最後に、
セラミックパッケージの基底部33と36を重ねて封止
し、基底部3Gにキャップ39で蓋をし封じる事により
、製品が得られる。
ド部34に第1の集積回路索子1をマクントシ、ワイヤ
ポンチインクを行う。次に第2のセラミックパッケージ
基底部36のアイランド部37に第2の集積回路索子2
をマウントシ、ワイヤボンディングを行なう。最後に、
セラミックパッケージの基底部33と36を重ねて封止
し、基底部3Gにキャップ39で蓋をし封じる事により
、製品が得られる。
以上説明した株に本発明は、従来技術を使って容易に実
現する拳が可能であシ、しかも、41I数の集積回路系
子を同一パッケージ内に収納する場合の占有面積の増加
を半分以下におさえる事ができる効果がある。
現する拳が可能であシ、しかも、41I数の集積回路系
子を同一パッケージ内に収納する場合の占有面積の増加
を半分以下におさえる事ができる効果がある。
第1図は本発明の第1の実施例の断面図、第2図は本発
明の第2の実施例の断面図、第3図は本発明をセラミッ
クパッケージに応用した一応用例の断面図、第4図(a
)は従来の集積回路装置の樹脂封止前の平面図、同図(
b)は同図(a)のA−A断面図である。 1.2,11,12,21.22・・・・・・集積回路
素子、3.5,13,15・・・・・・リードフレーム
、4,6,14゜16・・・・・・アイランド、7・・
・・・・ボンディングワイヤ、8.18・・・・・・封
止樹脂、33.36・・・・・・セラミックパ、ケージ
基底部、34.37・・団・アイランド部、35゜38
・・・・・・リード部、39・・・・・・キャップ。 代′理人 弁理士 内 原 晋 (a) 第 4 図
明の第2の実施例の断面図、第3図は本発明をセラミッ
クパッケージに応用した一応用例の断面図、第4図(a
)は従来の集積回路装置の樹脂封止前の平面図、同図(
b)は同図(a)のA−A断面図である。 1.2,11,12,21.22・・・・・・集積回路
素子、3.5,13,15・・・・・・リードフレーム
、4,6,14゜16・・・・・・アイランド、7・・
・・・・ボンディングワイヤ、8.18・・・・・・封
止樹脂、33.36・・・・・・セラミックパ、ケージ
基底部、34.37・・団・アイランド部、35゜38
・・・・・・リード部、39・・・・・・キャップ。 代′理人 弁理士 内 原 晋 (a) 第 4 図
Claims (2)
- (1)集積回路素子が載置され、かつ、結線されたリー
ドフレームを2段に重ね、さらに、前記上下のリードフ
レームが互いに接続され、樹脂で封止されてなることを
特徴とする集積回路装置。 - (2)上記上下のリードフレームの少くとも一方のリー
ドフレームには、複数の集積回路素子が載置されている
ことを特徴とする特許請求の範囲第1項に記載の集積回
路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60259972A JPS62119952A (ja) | 1985-11-19 | 1985-11-19 | 集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60259972A JPS62119952A (ja) | 1985-11-19 | 1985-11-19 | 集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62119952A true JPS62119952A (ja) | 1987-06-01 |
Family
ID=17341484
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60259972A Pending JPS62119952A (ja) | 1985-11-19 | 1985-11-19 | 集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62119952A (ja) |
Cited By (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US5295045A (en) * | 1990-11-14 | 1994-03-15 | Hitachi, Ltd. | Plastic-molded-type semiconductor device and producing method therefor |
| US5587341A (en) * | 1987-06-24 | 1996-12-24 | Hitachi, Ltd. | Process for manufacturing a stacked integrated circuit package |
| US5701031A (en) * | 1990-04-26 | 1997-12-23 | Hitachi, Ltd. | Sealed stacked arrangement of semiconductor devices |
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| US6531784B1 (en) | 2000-06-02 | 2003-03-11 | Amkor Technology, Inc. | Semiconductor package with spacer strips |
| US6552416B1 (en) | 2000-09-08 | 2003-04-22 | Amkor Technology, Inc. | Multiple die lead frame package with enhanced die-to-die interconnect routing using internal lead trace wiring |
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| US20160379933A1 (en) * | 2007-02-21 | 2016-12-29 | Amkor Technology, Inc. | Semiconductor package in package |
-
1985
- 1985-11-19 JP JP60259972A patent/JPS62119952A/ja active Pending
Cited By (21)
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| US9768124B2 (en) | 2007-02-21 | 2017-09-19 | Amkor Technology, Inc. | Semiconductor package in package |
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