JPH01109764A - 光電子集積回路 - Google Patents

光電子集積回路

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Publication number
JPH01109764A
JPH01109764A JP62267005A JP26700587A JPH01109764A JP H01109764 A JPH01109764 A JP H01109764A JP 62267005 A JP62267005 A JP 62267005A JP 26700587 A JP26700587 A JP 26700587A JP H01109764 A JPH01109764 A JP H01109764A
Authority
JP
Japan
Prior art keywords
inp
layer
high resistance
gaas
effect transistor
Prior art date
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Pending
Application number
JP62267005A
Other languages
English (en)
Inventor
Akira Suzuki
明 鈴木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Priority to US07/261,286 priority patent/US4982256A/en
Publication of JPH01109764A publication Critical patent/JPH01109764A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10HINORGANIC LIGHT-EMITTING SEMICONDUCTOR DEVICES HAVING POTENTIAL BARRIERS
    • H10H29/00Integrated devices, or assemblies of multiple devices, comprising at least one light-emitting semiconductor element covered by group H10H20/00
    • H10H29/10Integrated devices comprising at least one light-emitting semiconductor component covered by group H10H20/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
    • H01S5/02Structural details or components not essential to laser action
    • H01S5/026Monolithically integrated components, e.g. waveguides, monitoring photo-detectors, drivers
    • H01S5/0261Non-optical elements, e.g. laser driver components, heaters

Landscapes

  • Solid State Image Pick-Up Elements (AREA)
  • Junction Field-Effect Transistors (AREA)
  • Light Receiving Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は光通信システム等に用いて好適な光電子集積回
路の改良に関する。
(従来技術とその問題点) 光通信技術の進歩に伴い、その適用分野は基幹伝送系か
ら加入者系、LAN、データリンク等のシステムへ急速
に拡がりつつある。このような光システムの高度化に対
応する為には光デバイスの、より高性能化、高機能化が
不可欠である。
光電子集積回路はこれらの光システムの核となるキーデ
バイスの一つである。すなわち、この光電子集積回路の
研究、開発は、低価格・小型・高信頼・無調整化といっ
た集積による基本的メリットの享受のみならず、高速化
・高感度化といった光デバイスの性能改善、さらには、
光配線・光交換といった将来の光システムを支える高機
能・新機能デバイスの実現をねらいとする。
このような光電子集積回路を実現するために、光デバイ
スとしてのInP系材系材子電子デバイスてのGaAs
系材料という最適な組合せが得られるGaAs系とIn
P系の複合材料について検討が行なわれている( M、
 Razeghi、 Appl、 Phys、 Let
t−vol、 49゜、pp−215,1986)、こ
れは、半絶縁性GaAs基板上に減圧MOVPHによる
歪へテロエピタキシーを用いてGaInAsを成長し、
GaInAsから成る受光素子とGaAsから成るME
SFETをモノリシックに集積したものである。
しかしながら、この従来例においてはMESFETを形
成するGaAs層の上に光デバイスを形成するInP系
半導体層を成長し、InP系半導体層が数−以上の厚き
をもつから、光デバイスと電子デバイスの間に大きな段
差を生じ、プロセス工程の歩留りを低下させたり、ある
いはMESFETのゲートの微細加工を困難にするとい
った欠点を有していた。
本発明の目的は、これらの欠点を除去し、製造歩留りが
高くしかも性能の高い光電子集積回路を提供することで
ある。
(問題点を解決するための手段) 前述の問題点を解決し、上記目的を達成するために本発
明が提供する光電子集積回路は、半絶縁性InP基板上
に、工nGaAs又は1nGaAsPを含むInP系半
導体から成る光デバイスが、高抵抗InPから成る高抵
抗埋込め層で埋込まれ、前記高抵抗埋込み層の上に、G
aAs又はAQGaAsから成る歪バッファ層をはさん
で、AQGaAsを含むGaAs系半導体から成る電界
効果トランジスタがモノリジクに集積されていることを
特徴とする。
(作用) 半絶縁性InP基板上に光デバイスを、その動作に必要
な部分を残して高抵抗InPで埋込み平坦化し、その埋
込み層の上部にGaAsから成る電界効果トランジスタ
を構成することにより、光デバイスと電子デバイスの厚
さの違いによる段差を1−以下におさえることが可能に
なる。従って、従来、段差が5−以上あった光電子集積
回路に比べて、段差部のフォトレジストパターン不良に
よる配線切れや、段差によりフォトレジストが不均一に
コーティングされることによる電極効果トランジスタの
ゲート部分のパターンぼけが飛躍的に改善され、高歩留
りかつ高性能な光電子集積回路が得られる。
(実施例) 次に図面を参照して本発明の実施例を詳細に説明する。
第1図はその実施例の光電子集積回路を示す断面図であ
る。半絶縁性InP基板1上に、フォトダイオード2が
高抵抗埋込み層3で埋込まれ、その上部に歪バッファ層
4をはさんで電界効果トランジスタ5が構成されている
。フォトダイオード2は、Siが5 :K IQ”cm
−”ドープされた厚さ1−のInPから成るバッファ層
21.アンドープで厚さ3−のInGaAsから成る光
吸収層22.アンドープで厚き1−の1nPから成るウ
ィンドウ層23゜Znが深さ1−拡散きれたZn選択拡
散領域24.厚さO,1PenのAuZnから成るp電
極25.厚さ0.1−のAuGeNiから成るn電極2
6.厚さ0.2−のSi、N、誘電体膜から成るパッシ
ベーション膜27.直径60−の円形状の光入射窓28
.厚さ0.5−のAuの配線29から成る。各半導体層
の結晶成長には、LPE法。
VPE法、 MO−VPE法、 MBE法のいずれの方
法をも用いることができる。高抵抗埋込み層3は、フォ
トダイオードとして動作する部分以外を半絶縁性InP
基板1に至るまで、厚さ3000人のSin、膜から成
るマスクを用いてエツチング除去し、続いてFeをドー
プした高抵抗InPをMO−VPE法、 MBE法のう
ちいずれかの方法を用いて、フォトダイオードをエツチ
ング除去した部分のみ選択的に5−成長することにより
形成きれる。歪バッファ層4は、高抵抗埋込み層3の成
長に連続してMO−VPE法又はMBE法を用いて、ア
ンドープのGaAsを0.5#a成長するごとにより形
成される。電界効果トランジスタ5は、厚キ0.2−の
Siが2XIQ”cm−”ドープきれたGaAsから成
るチャネル層51.ゲート長1−2厚き0.5−のMか
ら成るゲート電極52.厚さ0.1−のAuGeNiか
ら成るソース電極53.ドレイン電極54で構成されて
いる。チャネル層51の成長はMO−VPE法又はMB
E法を用いて歪バッファ層4の成長に連続して行なわれ
る。第1図の実施例は光受信用の光電子集積回路として
動作する。
尚、上述の実施例において、電界効果トランジスタのゲ
ート電極はMに限らず、ショットキー接合がとれればい
かなるものでも良く、また光デバイスは、半導体レーザ
や発光ダイオード、アバランシェフォトダイオードさら
には光双安定素子や光アンプ、光スィッチなどの光機能
素子であってもよい、電子回路も電界効果トランジスタ
のみならず、ダイオード抵抗を含んでもよく、その集積
回路規模もさらに大きなものであってもよい。
(発明の効果) 以上に説明したように、本発明によれば、半絶縁性In
P基板上に、光デバイスを、その動作に必要な部分を残
して高抵抗InPで埋込み平坦化し、その埋込み層の上
部にGaAsから成る電界効果トランジスタを構成する
ことにより、ウエーファの段差を小言くシ、高歩留りか
つ高性能な光電子集積回路が得られる。
【図面の簡単な説明】
第1図は本発明の一実施例の光電子集積回路を示す断面
図である。 図中、1は半絶縁性XnP基板、2はフォトダイオード
、21はバッファ層、22は光吸収層、23はウィンド
ウ層、24はZn選択拡散領域、25はp電極、26は
n電極、27はパッシベーション膜、28は光入射窓、
29は配線、3は高抵抗埋込み層、4は歪バッファ層、
5は電界効果トランジスタ、51はチャネル層、52は
ゲート電極、53はソース電極、54はドレイン電極で
ある。

Claims (1)

    【特許請求の範囲】
  1.  半絶縁性InP基板上に、InGaAs又はInGa
    AsPを含むInP系半導体から成る光デバイスが、高
    抵抗InPから成る高抵抗埋込み層で埋込まれ、前記高
    抵抗埋込み層の上に、GaAs又はAlGaAsから成
    る歪バッファ層をはさんで、AlGaAsを含むGaA
    s系半導体から成る電界効果トランジスタがモノリジク
    に集積されていることを特徴とする光電子集積回路。
JP62267005A 1987-10-22 1987-10-22 光電子集積回路 Pending JPH01109764A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP62267005A JPH01109764A (ja) 1987-10-22 1987-10-22 光電子集積回路
US07/261,286 US4982256A (en) 1987-10-22 1988-10-24 Optoelectronic integrated circuit

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JP62267005A JPH01109764A (ja) 1987-10-22 1987-10-22 光電子集積回路

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ID=17438734

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JP62267005A Pending JPH01109764A (ja) 1987-10-22 1987-10-22 光電子集積回路

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US4982256A (en) 1991-01-01

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