JPH0254942A - 半導体チップへの導電性接着剤塗布方法およびその半導体チップを有する半導体製品 - Google Patents

半導体チップへの導電性接着剤塗布方法およびその半導体チップを有する半導体製品

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Publication number
JPH0254942A
JPH0254942A JP63206003A JP20600388A JPH0254942A JP H0254942 A JPH0254942 A JP H0254942A JP 63206003 A JP63206003 A JP 63206003A JP 20600388 A JP20600388 A JP 20600388A JP H0254942 A JPH0254942 A JP H0254942A
Authority
JP
Japan
Prior art keywords
conductive adhesive
semiconductor chip
semiconductor
uniformly
application
Prior art date
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Pending
Application number
JP63206003A
Other languages
English (en)
Inventor
Osamu Umeda
修 梅田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu General Ltd
Original Assignee
Fujitsu General Ltd
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Publication date
Application filed by Fujitsu General Ltd filed Critical Fujitsu General Ltd
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Publication of JPH0254942A publication Critical patent/JPH0254942A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/01Manufacture or treatment
    • H10W72/013Manufacture or treatment of die-attach connectors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/073Connecting or disconnecting of die-attach connectors

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  • Die Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、半導体チップ裏面への導電性接着剤塗布方
法に関するものである。
〔従来の技術〕
半導体チップのダイ・ボンディング法には、■導電性接
着剤法、■共晶合金法、■ハンダ付は法がある。このう
ち、■の接着剤法によるダイ・ボンディングは1次のよ
うな順序で行なわれる。
基板への接着剤塗布→その接着剤上への半導体チップの
実装→半導体チップの圧着およびその位置修正→硬化。
そして、接着剤の塗布方法としては、(A)ディスペン
ス法、(B)スタンピング法、(C)スクリーン印刷法
の3つが知られている。
〔発明が解決しようとする課題〕
比較的面積の大きな半導体チップに対し、その裏面全体
に均一に接着剤を塗布する場合、上記方法にはそれなり
の欠点があった。
すなわち、(A)ディスペンス法によると、接着剤が半
球形に塗布され、圧着時に円形に広がるため、正方形チ
ップに対してはその四隅に接着剤が付きにくいか、もし
くは四辺からはみ出す。長方形チップに対しては、多点
塗布が必要となる。また、接着剤が糸をひく。
(B)スタンピング法の場合には、スタンプピンの形状
がきれいに転写されない。また、その中央と周囲とにお
いて、転写の厚みが異なってしまう。
(C)スクリーン印刷法は、ハイブリットICのように
、すでに部品が実装されているような場合には、適用で
きない。また、塗布厚みを薄くすることが困難である。
この発明は上記した従来の欠点に鑑みなされたもので、
その目的は、半導体チップ裏面全体に導電性接着剤を薄
く、しかも均一に塗布し得るようにした接着剤塗布方法
を提供することにある。
〔課題を解決するための手段〕
上記目的を達成するため、この発明においては、平坦面
上に、ほぼ均一厚みの導電性接着剤層を形成し、半導体
チップの裏面をその導電性接着剤層上に載置することに
より、半導体チップ裏面全体に導電性接着剤を塗布する
ようにしている。
〔実 施 例〕
以下、この発明の実施例を添付図面を参照しながら詳細
に説明する。
まず、第1図に示すように、表面が平らな基台1を用意
し、その表面上に導電性接着剤2を薄く均一に印刷する
。場合によっては、刷毛塗りしてもよい。
次に、この導電性接着剤2上に半導体チップ3の裏面側
をのせる(第2図参照)。
しかるのち、第3図に示すように、半導体チップ3を導
電性接着剤2上より取る。これにより、同半導体チップ
3の裏面には、導電性接着剤2′が薄く、しかも均一に
塗布される。なお、その塗布厚は、基台1上における導
電性接着剤2の厚み、半導体チップ3の加圧によってコ
ントロールすることができる。
そして、同半導体チップ3を基板4上に実装しく第4図
参照)、必要に応じて圧着、修正を行ない、導電性接着
剤2′を硬化させることにより、半導体製品が得られる
〔発明の効果〕
以上説明したように、この発明によれば、半導体チップ
をダイ・ボンディングするに際して、きわめて簡単な方
法によってそのチップ裏面に導電性接着剤を薄く、しか
も均一に塗布することが可能となる。
【図面の簡単な説明】
第1図ないし第4図はこの発明による導電性接着剤塗布
方法の一例を示した説明図である。 図中、1は基台、2は導電性接着剤、3は半導体チップ
、4は基板である。 第1図 第2図 特許出願人  株式会社富士通ゼネラル代理人 弁理士
   大 原  拓 也第3図 第4図 、3

Claims (3)

    【特許請求の範囲】
  1. (1)平坦面上に、ほぼ均一厚みの導電性接着剤層を形
    成し、半導体チップの裏面をその導電性接着剤層上に載
    置することにより、半導体チップ裏面全体に導電性接着
    剤を塗布することを特徴とする半導体チップへの導電性
    接着剤塗布方法。
  2. (2)上記平坦面に対する導電性接着剤層の形成は、印
    刷法にて行なわれる請求項1記載の半導体チップへの導
    電性接着剤塗布方法。
  3. (3)請求項1記載の半導体チップを基板に実装してな
    る半導体製品。
JP63206003A 1988-08-19 1988-08-19 半導体チップへの導電性接着剤塗布方法およびその半導体チップを有する半導体製品 Pending JPH0254942A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001349094A (ja) * 2000-06-08 2001-12-21 Sekisui House Ltd 同調振り子式制振装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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