JPH0342680Y2 - - Google Patents
Info
- Publication number
- JPH0342680Y2 JPH0342680Y2 JP1982170111U JP17011182U JPH0342680Y2 JP H0342680 Y2 JPH0342680 Y2 JP H0342680Y2 JP 1982170111 U JP1982170111 U JP 1982170111U JP 17011182 U JP17011182 U JP 17011182U JP H0342680 Y2 JPH0342680 Y2 JP H0342680Y2
- Authority
- JP
- Japan
- Prior art keywords
- region
- base
- transistor
- high concentration
- emitter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Landscapes
- Electrodes Of Semiconductors (AREA)
- Bipolar Transistors (AREA)
- Bipolar Integrated Circuits (AREA)
Description
【考案の詳細な説明】
(イ) 産業上の利用分野
本考案はダーリントントランジスタ、特に保護
用のツエナーダイオードを内蔵したダーリントン
トランジスタの改良に関する。
用のツエナーダイオードを内蔵したダーリントン
トランジスタの改良に関する。
(ロ) 従来技術
従来のダーリントントランジスタは第1図に示
す如く、共通コレクタ領域を形成するN型シリコ
ン半導体基板1と、基板1表面に設けられ第1の
トランジスタ15を構成するP型の第1ベース領
域2およびN+型の第1エミツタ領域3と、基板
1表面に設けられ第2のトランジスタ16を構成
するP型の第2ベース領域4およびN+型の第2
エミツタ領域5と、基板1表面に設けたN型高濃
度領域6と第1エミツタ領域3から第1ベース領
域2を横切つて延在するP+型高濃度領域7とで
形成される第1ツエナーダイオード8と、同様に
N型高濃度領域6と第2エミツタ領域5から第2
ベース領域4を横切つて延在するP+型高濃度領
域7とで形成される第2のツエナーダイオード9
と、ペレツト周辺に設けたN+型のチャンネルス
トツプ領域10と、第1ベース領域2にオーミツ
ク接触するベース電極11と、第1エミツタ領域
3および第2ベース領域4を接続する接続電極1
2と、第2エミツタ領域5にオーミツク接触する
エミツタ電極13と、チヤンネルストツプ領域1
0に一端をオーミツク接触し内側に延在されたシ
ールド電極14より構成されている。
す如く、共通コレクタ領域を形成するN型シリコ
ン半導体基板1と、基板1表面に設けられ第1の
トランジスタ15を構成するP型の第1ベース領
域2およびN+型の第1エミツタ領域3と、基板
1表面に設けられ第2のトランジスタ16を構成
するP型の第2ベース領域4およびN+型の第2
エミツタ領域5と、基板1表面に設けたN型高濃
度領域6と第1エミツタ領域3から第1ベース領
域2を横切つて延在するP+型高濃度領域7とで
形成される第1ツエナーダイオード8と、同様に
N型高濃度領域6と第2エミツタ領域5から第2
ベース領域4を横切つて延在するP+型高濃度領
域7とで形成される第2のツエナーダイオード9
と、ペレツト周辺に設けたN+型のチャンネルス
トツプ領域10と、第1ベース領域2にオーミツ
ク接触するベース電極11と、第1エミツタ領域
3および第2ベース領域4を接続する接続電極1
2と、第2エミツタ領域5にオーミツク接触する
エミツタ電極13と、チヤンネルストツプ領域1
0に一端をオーミツク接触し内側に延在されたシ
ールド電極14より構成されている。
斯上の構造を有するダーリントントランジスタ
は第2図に示す如く、ダーリントン接続した第1
トランジスタTr1と第2トランジスタTr2と、第
1および第2トランジスタTr1・Tr2のベースと
コレクタ間に接続された第1ツエナーダイオード
ZD1および第2ツエナーダイオードZD2より成る回
路構成となる。
は第2図に示す如く、ダーリントン接続した第1
トランジスタTr1と第2トランジスタTr2と、第
1および第2トランジスタTr1・Tr2のベースと
コレクタ間に接続された第1ツエナーダイオード
ZD1および第2ツエナーダイオードZD2より成る回
路構成となる。
斯上のダーリントントランジスタは第1および
第2ツエナーダイオード8,9が同一のツエナー
電圧に設定されるので、ダーリントントランジス
タにL負荷を接続した場合、L負荷で発生する高
電圧が第1ツエナーダイオード8を介して前段の
ドライブ用MOSICを破壊するおそれがあつた。
第2ツエナーダイオード8,9が同一のツエナー
電圧に設定されるので、ダーリントントランジス
タにL負荷を接続した場合、L負荷で発生する高
電圧が第1ツエナーダイオード8を介して前段の
ドライブ用MOSICを破壊するおそれがあつた。
(ハ) 目的
本考案によるダーリントントランジスタは第3
図の如く、共通コレクタ領域21となる一導電型
の半導体基板22と、第1のトランジスタ37を
構成する第1ベースおよびエミツタ領域23,2
4と、第2のトランジスタ38を構成する第2ベ
ースおよびエミツタ領域25,26と、第2ベー
ス領域25に隣接して基板22表面に設けた一導
電型の高濃度領域27と、第1ベース領域23表
面に設け共通コレクタ領域21に達する逆導電型
の高濃度領域28と共通コレクタ領域21とで形
成される第1ツエナーダイオード29と、第2ベ
ース領域25表面に設け一導電型の高濃度領域2
7に達する逆導電型の高濃度領域28と一導電型
の高濃度領域27とで形成される第2ツエナーダ
イオード30と、ベース電極31接続電極32お
よびエミツタ電極33より構成され、第1のツエ
ナーダイオード29のツエナー電圧を第2のツエ
ナーダイオード30より大きく設定することに特
徴を有する。
図の如く、共通コレクタ領域21となる一導電型
の半導体基板22と、第1のトランジスタ37を
構成する第1ベースおよびエミツタ領域23,2
4と、第2のトランジスタ38を構成する第2ベ
ースおよびエミツタ領域25,26と、第2ベー
ス領域25に隣接して基板22表面に設けた一導
電型の高濃度領域27と、第1ベース領域23表
面に設け共通コレクタ領域21に達する逆導電型
の高濃度領域28と共通コレクタ領域21とで形
成される第1ツエナーダイオード29と、第2ベ
ース領域25表面に設け一導電型の高濃度領域2
7に達する逆導電型の高濃度領域28と一導電型
の高濃度領域27とで形成される第2ツエナーダ
イオード30と、ベース電極31接続電極32お
よびエミツタ電極33より構成され、第1のツエ
ナーダイオード29のツエナー電圧を第2のツエ
ナーダイオード30より大きく設定することに特
徴を有する。
(ホ) 実施例
本考案に依るダーリントントランジスタは第3
図に示す如く、共通コレクタ領域21となるN型
のシリコン半導体基板22、基板22表面に二重
拡散で形成された前段の第1のトランジスタ37
を構成するP型の第1ベース領域23およびN+
型の第1エミツタ領域24と、第1のトランジス
タ37に隣接して基板22表面に二重拡散して設
けた後段の第2のトランジスタ38を構成するP
型の第2ベース領域25およびN+型の第2エミ
ツタ領域26と、基板22表面に第2ベース領域
25を囲む様に隣接してイオン注入により設けた
N型の高濃度領域27と、第1エミツタ領域24
端より基板22表面を延在され第1ベース領域2
3を横切つて共通コレクタ領域21に達する選択
拡散によるP+型の高濃度領域28と共通コレク
タ領域21とで形成される第1ツエナーダイオー
ド29と、第2エミツタ領域26端より基板22
表面を延在され第2ベース領域25を横切つてN
型の高濃度領域27に達する選択拡散によるP+
型の高濃度領域28とN型の高濃度領域27とで
形成される第2ツエナーダイオード30と、ペレ
ツト周辺に設けたエミツタ拡散時に形成される
N+型のチヤンネルストツプ領域34と、第1ベ
ース領域23にオーミツク接触する蒸着アルミニ
ウムのベース電極31と、第1エミツタ領域24
および第2ベース領域25とを接続する酸化膜3
5上に延在された蒸着アルミニウムの接続電極3
2と、第2エミツタ領域26にオーミツク接触す
るエミツタ電極33と、チヤンネルストツプ領域
34に一端をオーミツク接触し酸化膜35上を内
側に延在されたシールド電極36より構成されて
いる。
図に示す如く、共通コレクタ領域21となるN型
のシリコン半導体基板22、基板22表面に二重
拡散で形成された前段の第1のトランジスタ37
を構成するP型の第1ベース領域23およびN+
型の第1エミツタ領域24と、第1のトランジス
タ37に隣接して基板22表面に二重拡散して設
けた後段の第2のトランジスタ38を構成するP
型の第2ベース領域25およびN+型の第2エミ
ツタ領域26と、基板22表面に第2ベース領域
25を囲む様に隣接してイオン注入により設けた
N型の高濃度領域27と、第1エミツタ領域24
端より基板22表面を延在され第1ベース領域2
3を横切つて共通コレクタ領域21に達する選択
拡散によるP+型の高濃度領域28と共通コレク
タ領域21とで形成される第1ツエナーダイオー
ド29と、第2エミツタ領域26端より基板22
表面を延在され第2ベース領域25を横切つてN
型の高濃度領域27に達する選択拡散によるP+
型の高濃度領域28とN型の高濃度領域27とで
形成される第2ツエナーダイオード30と、ペレ
ツト周辺に設けたエミツタ拡散時に形成される
N+型のチヤンネルストツプ領域34と、第1ベ
ース領域23にオーミツク接触する蒸着アルミニ
ウムのベース電極31と、第1エミツタ領域24
および第2ベース領域25とを接続する酸化膜3
5上に延在された蒸着アルミニウムの接続電極3
2と、第2エミツタ領域26にオーミツク接触す
るエミツタ電極33と、チヤンネルストツプ領域
34に一端をオーミツク接触し酸化膜35上を内
側に延在されたシールド電極36より構成されて
いる。
本考案の特徴は第1ツエナーダイオード29の
ツエナー電圧を第1P+型高濃度領域28と低濃度
の共通コレクタ領域21とで形成されるPN接合
で決定し、共通コレクタ領域21の不純物濃度が
低いことを利用して第2ツエナーダイオード30
より高く設定している。即ち第2ツエナーダイオ
ード30はN型高濃度領域27とP+型高濃度領
域28とのPN接合で形成され、両者の濃度を約
60Vのツエナー電圧になる様に設定している。こ
のとき第1ツエナーダイオード29のツエナー電
圧は約120〜130Vになる。
ツエナー電圧を第1P+型高濃度領域28と低濃度
の共通コレクタ領域21とで形成されるPN接合
で決定し、共通コレクタ領域21の不純物濃度が
低いことを利用して第2ツエナーダイオード30
より高く設定している。即ち第2ツエナーダイオ
ード30はN型高濃度領域27とP+型高濃度領
域28とのPN接合で形成され、両者の濃度を約
60Vのツエナー電圧になる様に設定している。こ
のとき第1ツエナーダイオード29のツエナー電
圧は約120〜130Vになる。
斯上の構造に依れば、L負荷により発生する高
電圧は第2ツエナーダイオード30を流れ、第2
トランジスタ38のベースに流れる。
電圧は第2ツエナーダイオード30を流れ、第2
トランジスタ38のベースに流れる。
(ヘ) 効果
本考案に依ればN型の高濃度領域27を第2ベ
ース領域25に隣接して選択的に設けるだけで、
従来の保護機能を保持したままドライブ用ICの
保護を実現できる。この結果本考案はL負荷の多
いスイツチングトランジスタに最適なものであ
る。
ース領域25に隣接して選択的に設けるだけで、
従来の保護機能を保持したままドライブ用ICの
保護を実現できる。この結果本考案はL負荷の多
いスイツチングトランジスタに最適なものであ
る。
第1図は従来例を説明する断面図、第2図は等
価回路図、第3図は本考案を説明する断面図であ
る。 主な図番の説明 21は共通コレクタ領域、2
2は半導体基板、23,24は第1のトランジス
タ37を構成する第1ベースおよびエミツタ領
域、25,26は第2トランジスタ38を構成す
る第2ベースおよびエミツタ領域、29,30は
第1および第2ツエナーダイオード、27はN型
高濃度領域、28はP+型高濃度領域である。
価回路図、第3図は本考案を説明する断面図であ
る。 主な図番の説明 21は共通コレクタ領域、2
2は半導体基板、23,24は第1のトランジス
タ37を構成する第1ベースおよびエミツタ領
域、25,26は第2トランジスタ38を構成す
る第2ベースおよびエミツタ領域、29,30は
第1および第2ツエナーダイオード、27はN型
高濃度領域、28はP+型高濃度領域である。
Claims (1)
- 共通コレクタ領域となる一導電型の半導体基板
と、第1のトランジスタを構成する前記基板表面
に設けられた第1ベースおよびエミツタ領域と、
前記第1のトランジスタに隣接し第2のトランジ
スタを構成する前記基板表面に設けられた第2ベ
ースおよびエミツタ領域と、前記基板表面に前記
第2ベース領域に隣接して設けた一導電型の高濃
度領域と、前記第1ベース領域から前記共通コレ
クタ領域に達する逆導電型の高濃度領域と前記共
通コレクタ領域とで形成される第1ツエナーダイ
オードと、前記第2ベース領域から前記一導電型
の高濃度領域に達する逆導電型の高濃度領域と前
記一導電型の高濃度領域とで形成される第2ツエ
ナーダイオードと、前記第1エミツタ領域と第2
ベース領域を接続する接続電極とを具備して成る
ダーリントントランジスタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1982170111U JPS5974745U (ja) | 1982-11-09 | 1982-11-09 | ダ−リントントランジスタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1982170111U JPS5974745U (ja) | 1982-11-09 | 1982-11-09 | ダ−リントントランジスタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5974745U JPS5974745U (ja) | 1984-05-21 |
| JPH0342680Y2 true JPH0342680Y2 (ja) | 1991-09-06 |
Family
ID=30371448
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1982170111U Granted JPS5974745U (ja) | 1982-11-09 | 1982-11-09 | ダ−リントントランジスタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5974745U (ja) |
-
1982
- 1982-11-09 JP JP1982170111U patent/JPS5974745U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5974745U (ja) | 1984-05-21 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPH04233232A (ja) | 半導体装置 | |
| JPS62115765A (ja) | 半導体装置 | |
| JPS6157711B2 (ja) | ||
| JPH0465552B2 (ja) | ||
| JPH04280670A (ja) | スイッチ回路およびゲート電圧クランプ型半導体装置 | |
| JPH0414929Y2 (ja) | ||
| JP3018417B2 (ja) | 集積回路用保護装置 | |
| JPH0195568A (ja) | 半導体装置 | |
| US6781804B1 (en) | Protection of the logic well of a component including an integrated MOS power transistor | |
| JPH0124939Y2 (ja) | ||
| JPS625346B2 (ja) | ||
| JPH0236558A (ja) | 半導体装置 | |
| JPS6230703B2 (ja) | ||
| JPH0440272Y2 (ja) | ||
| JP2901275B2 (ja) | 半導体集積回路装置 | |
| JPH0440273Y2 (ja) | ||
| JPS626659B2 (ja) | ||
| US6624502B2 (en) | Method and device for limiting the substrate potential in junction isolated integrated circuits | |
| JPH0110938Y2 (ja) | ||
| JP2542533Y2 (ja) | サージ吸収回路 | |
| JPS60254651A (ja) | Cmos回路の入力保護回路 | |
| JPH0530073B2 (ja) | ||
| JPS61150383A (ja) | 半導体装置 | |
| JPH0440867B2 (ja) | ||
| JPS61170058A (ja) | レベルシフト複合回路 |