JPH04127545A - 半導体集積回路装置 - Google Patents
半導体集積回路装置Info
- Publication number
- JPH04127545A JPH04127545A JP2249184A JP24918490A JPH04127545A JP H04127545 A JPH04127545 A JP H04127545A JP 2249184 A JP2249184 A JP 2249184A JP 24918490 A JP24918490 A JP 24918490A JP H04127545 A JPH04127545 A JP H04127545A
- Authority
- JP
- Japan
- Prior art keywords
- pads
- integrated circuit
- circuit device
- positions
- semiconductor integrated
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/547—Dispositions of multiple bond wires
- H10W72/5473—Dispositions of multiple bond wires multiple bond wires connected to a common bond pad
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
- H10W72/932—Plan-view shape, i.e. in top view
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体集積回路装置に関する。
従来の半導体集積回路装置は、内蔵する半導体チップを
インナーリードに接続する構造を取る場合、リード線の
構造上の制約から半導体チップ上のパッドの位置と半導
体集積回路装置のリードとの位置の対応が決っていた。
インナーリードに接続する構造を取る場合、リード線の
構造上の制約から半導体チップ上のパッドの位置と半導
体集積回路装置のリードとの位置の対応が決っていた。
この従来の半導体集積回路装置では、半導体チップ上の
パッドの位置に対する半導体集積回路装置のリードの位
置の対応が決っているため、半導体チップ上で最適のレ
イアウトを行うと、半導体集積回路装置の入出力信号の
リードの位置がおのずと決定され、このことが逆にこの
半導体集積回路装置を用いるプリント基板での信号線の
配線を困難にすることがあるという問題点があった。ま
た、半導体集積回路装置のリード線側で入出力信号のビ
ンの位置を決定すると、半導体チップ上でのパッドの位
置がおのずと決定されてしまい、半導体チップ上で最適
なレイアウトを行うことができず、例えば出力バッファ
の同時動作等による誤動作の原因となるという問題点も
あった。
パッドの位置に対する半導体集積回路装置のリードの位
置の対応が決っているため、半導体チップ上で最適のレ
イアウトを行うと、半導体集積回路装置の入出力信号の
リードの位置がおのずと決定され、このことが逆にこの
半導体集積回路装置を用いるプリント基板での信号線の
配線を困難にすることがあるという問題点があった。ま
た、半導体集積回路装置のリード線側で入出力信号のビ
ンの位置を決定すると、半導体チップ上でのパッドの位
置がおのずと決定されてしまい、半導体チップ上で最適
なレイアウトを行うことができず、例えば出力バッファ
の同時動作等による誤動作の原因となるという問題点も
あった。
本発明の半導体集積回路装置は、内蔵する半導体チップ
をインナーリードに接続する構造の半導体集積回路装置
において、接続経路を変換する機能を持つ接続経路変換
板を介して前記半導体チップを前記インナーリードに接
続する構成である。
をインナーリードに接続する構造の半導体集積回路装置
において、接続経路を変換する機能を持つ接続経路変換
板を介して前記半導体チップを前記インナーリードに接
続する構成である。
本発明の半導体集積回路装置は、前記半導体チップと前
記接続経路変換板との間および前記接続経路変換板と前
記インナーリードとの間の接続の少くなくとも一部をボ
ンデングワイヤを用いて行ってもよい。
記接続経路変換板との間および前記接続経路変換板と前
記インナーリードとの間の接続の少くなくとも一部をボ
ンデングワイヤを用いて行ってもよい。
次に本発明について図面を参照して説明する。
第1図(a)は本発明の一実施例のボンデングワイヤの
接続を模式化した平面図、第1図(b)は同じく側面図
である。
接続を模式化した平面図、第1図(b)は同じく側面図
である。
半導体チップ1は、両端に接続用パッドを持つ複数の信
号線2を配設した配線板3との間に絶縁膜4を挟んで半
導体集積回路装置5に収容されている。半導体チップ1
の入出力パッドと信号線2の一方のパッドとの間は、ボ
ンデングワイヤ6で接続している。信号線2の他方のパ
ッドは、半導体集積回路装置5に外部と接続するため設
けである。リードの一部であるインナーリード7との間
を、ボンデングワイヤ8で接続している。配線板3に配
設する信号線2の両端のパッドは、半導体チップ1の入
出力パッドとこれに対応するインナーリードとの位置に
合せてそれぞれ位置を定めることが可能である。又、配
線板3は、この対応する2個のパッド間を接続する信号
線2が他の信号線2との間で交叉しても電気的に接続し
ないよう、2層以上の配線経路を持つ構造とすることに
より、必要に応じ任意のパッド間を最短距離で接続する
ことができる。
号線2を配設した配線板3との間に絶縁膜4を挟んで半
導体集積回路装置5に収容されている。半導体チップ1
の入出力パッドと信号線2の一方のパッドとの間は、ボ
ンデングワイヤ6で接続している。信号線2の他方のパ
ッドは、半導体集積回路装置5に外部と接続するため設
けである。リードの一部であるインナーリード7との間
を、ボンデングワイヤ8で接続している。配線板3に配
設する信号線2の両端のパッドは、半導体チップ1の入
出力パッドとこれに対応するインナーリードとの位置に
合せてそれぞれ位置を定めることが可能である。又、配
線板3は、この対応する2個のパッド間を接続する信号
線2が他の信号線2との間で交叉しても電気的に接続し
ないよう、2層以上の配線経路を持つ構造とすることに
より、必要に応じ任意のパッド間を最短距離で接続する
ことができる。
以上説明したように本発明は、半導体チップ上の任意の
パッドと任意のインナーリードとを接続することを可能
としたので、半導体チップ上でのレイアウトから半導体
集積回路装置のインターリードの位置が制約を受けるこ
とがなくなり、プリント基板上での信号線の配線も容易
に行えるようになるという効果がある。また、半導体チ
ップ上でのレイアウトが自由に行えるため、出力バッフ
ァを各地気パッドごとに分散させて配置することが可能
となり、出力バッファの同時動作業による影響を小さく
できるという効果もある。
パッドと任意のインナーリードとを接続することを可能
としたので、半導体チップ上でのレイアウトから半導体
集積回路装置のインターリードの位置が制約を受けるこ
とがなくなり、プリント基板上での信号線の配線も容易
に行えるようになるという効果がある。また、半導体チ
ップ上でのレイアウトが自由に行えるため、出力バッフ
ァを各地気パッドごとに分散させて配置することが可能
となり、出力バッファの同時動作業による影響を小さく
できるという効果もある。
第1図(a)は本発明の一実施例のボンデングワイヤの
接続を模式化した平面図、第1図(b)は同じく側面図
である。 1・・・半導体チップ、2・・・信号線、3・・・配線
板、4・・・絶縁板、5・・・半導体集積回路装置、6
.8・・・ボンデングワイヤ、7・・・インナーリード
。
接続を模式化した平面図、第1図(b)は同じく側面図
である。 1・・・半導体チップ、2・・・信号線、3・・・配線
板、4・・・絶縁板、5・・・半導体集積回路装置、6
.8・・・ボンデングワイヤ、7・・・インナーリード
。
Claims (1)
- 【特許請求の範囲】 1、内蔵する半導体チップをインナーリードに接続する
構造の半導体集積回路装置において、接続経路を変換す
る機能を持つ接続経路変換板を介して前記半導体チップ
を前記インナーリードに接続することを特徴とする半導
体集積回路装置。 2、前記半導体チップと前記接続経路変換板との間およ
び前記接続経路変換板と前記インナーリードとの間の接
続の少くなくとも一部をボンデングワイヤを用いて行う
ことを特徴とする請求項1記載の半導体集積回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2249184A JP2911988B2 (ja) | 1990-09-19 | 1990-09-19 | 半導体集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2249184A JP2911988B2 (ja) | 1990-09-19 | 1990-09-19 | 半導体集積回路装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04127545A true JPH04127545A (ja) | 1992-04-28 |
| JP2911988B2 JP2911988B2 (ja) | 1999-06-28 |
Family
ID=17189153
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2249184A Expired - Lifetime JP2911988B2 (ja) | 1990-09-19 | 1990-09-19 | 半導体集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2911988B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003174111A (ja) * | 2001-12-06 | 2003-06-20 | Sanyo Electric Co Ltd | 半導体装置 |
| US6812575B2 (en) | 2000-08-29 | 2004-11-02 | Nec Corporation | Semiconductor device |
| US8471349B2 (en) | 2010-01-29 | 2013-06-25 | Fujitsu Optical Components Limited | Photoreceiving device |
| CN105914194A (zh) * | 2016-06-20 | 2016-08-31 | 东莞市联洲知识产权运营管理有限公司 | 一种优化的集成电路封装 |
| CN106098672A (zh) * | 2016-06-20 | 2016-11-09 | 东莞市联洲知识产权运营管理有限公司 | 一种改进的集成电路封装 |
-
1990
- 1990-09-19 JP JP2249184A patent/JP2911988B2/ja not_active Expired - Lifetime
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6812575B2 (en) | 2000-08-29 | 2004-11-02 | Nec Corporation | Semiconductor device |
| JP2003174111A (ja) * | 2001-12-06 | 2003-06-20 | Sanyo Electric Co Ltd | 半導体装置 |
| US8471349B2 (en) | 2010-01-29 | 2013-06-25 | Fujitsu Optical Components Limited | Photoreceiving device |
| CN105914194A (zh) * | 2016-06-20 | 2016-08-31 | 东莞市联洲知识产权运营管理有限公司 | 一种优化的集成电路封装 |
| CN106098672A (zh) * | 2016-06-20 | 2016-11-09 | 东莞市联洲知识产权运营管理有限公司 | 一种改进的集成电路封装 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2911988B2 (ja) | 1999-06-28 |
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