JPH0635697A - 制御装置 - Google Patents
制御装置Info
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- JPH0635697A JPH0635697A JP4190346A JP19034692A JPH0635697A JP H0635697 A JPH0635697 A JP H0635697A JP 4190346 A JP4190346 A JP 4190346A JP 19034692 A JP19034692 A JP 19034692A JP H0635697 A JPH0635697 A JP H0635697A
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- voltage
- microprocessor
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Abstract
(57)【要約】
【目的】マイクロプロセッサが装置内温度に対応した適
切なタイミングで周辺Ｉ／Ｏとのアクセスを行いマイク
ロプロセッサにおける処理の高速化を図る。 【構成】一定の基準電圧を生成する基準電圧生成手段６
と、装置内の温度を電圧に変換する温度−電圧変換手段
７のそれぞれの出力電圧を電圧比較手段８で比較し、電
圧比較手段８からの出力信号に応じて、ウェイト信号発
生手段９からマイクロプロセッサ１に入力するウェイト
信号のアクティブ時間幅を変化させる。 【効果】装置内温度の変化をウェイト信号発生手段９が
検知し装置内温度の変化に応じてマイクロプロセッサ１
に入力するウェイト信号のアクティブ時間幅を変化させ
ることが可能となり、これによりマイクロプロセッサ１
が装置内温度に対応した適切なタイミングで周辺Ｉ／Ｏ
とのアクセスを行うことができる。
切なタイミングで周辺Ｉ／Ｏとのアクセスを行いマイク
ロプロセッサにおける処理の高速化を図る。 【構成】一定の基準電圧を生成する基準電圧生成手段６
と、装置内の温度を電圧に変換する温度−電圧変換手段
７のそれぞれの出力電圧を電圧比較手段８で比較し、電
圧比較手段８からの出力信号に応じて、ウェイト信号発
生手段９からマイクロプロセッサ１に入力するウェイト
信号のアクティブ時間幅を変化させる。 【効果】装置内温度の変化をウェイト信号発生手段９が
検知し装置内温度の変化に応じてマイクロプロセッサ１
に入力するウェイト信号のアクティブ時間幅を変化させ
ることが可能となり、これによりマイクロプロセッサ１
が装置内温度に対応した適切なタイミングで周辺Ｉ／Ｏ
とのアクセスを行うことができる。
Description
【０００１】
【産業上の利用分野】本発明は、マイクロプロセッサに
よりメモリーなどの周辺Ｉ／Ｏの制御装置に関するもの
である。
よりメモリーなどの周辺Ｉ／Ｏの制御装置に関するもの
である。
【０００２】
【従来の技術】図３は従来例における制御装置のブロッ
ク図を示す。図３において、１は外部からウェイト信号
を入力することにより周辺Ｉ／Ｏへのアクセスタイミン
グ可変のマイクロプロセッサである。
ク図を示す。図３において、１は外部からウェイト信号
を入力することにより周辺Ｉ／Ｏへのアクセスタイミン
グ可変のマイクロプロセッサである。
【０００３】まずマイクロプロセッサ１が周辺Ｉ／Ｏを
アクセスする際の動作について図４を参照しながら説明
する。図４（Ａ）はノンウェイト状態におけるマイクロ
プロセッサのマシンサイクルの様子を示すタイミングチ
ャートであり、クロック信号に同期してＴ１，Ｔ２，Ｔ
３の３つのステートより成る。
アクセスする際の動作について図４を参照しながら説明
する。図４（Ａ）はノンウェイト状態におけるマイクロ
プロセッサのマシンサイクルの様子を示すタイミングチ
ャートであり、クロック信号に同期してＴ１，Ｔ２，Ｔ
３の３つのステートより成る。
【０００４】ウェイト信号はＴ２ステートのクロックの
立ち下がりでマイクロプロセッサにサンプリングされ、
“１”であればノンウェイト状態となりＴ２ステートの
直後にＴ３ステートが来る。逆に“０”であれば図４
（Ｂ）（Ｃ）に示すようにＴｗステートがＴ２ステート
の直後に挿入される。またＴｗステートのクロックの立
ち下がりにおいてもウェイト信号がサンプリングされ、
“０”であれば次もＴｗステートが挿入され、ウェイト
信号が“１”であることが検出された次のステートがＴ
３ステートとなる。
立ち下がりでマイクロプロセッサにサンプリングされ、
“１”であればノンウェイト状態となりＴ２ステートの
直後にＴ３ステートが来る。逆に“０”であれば図４
（Ｂ）（Ｃ）に示すようにＴｗステートがＴ２ステート
の直後に挿入される。またＴｗステートのクロックの立
ち下がりにおいてもウェイト信号がサンプリングされ、
“０”であれば次もＴｗステートが挿入され、ウェイト
信号が“１”であることが検出された次のステートがＴ
３ステートとなる。
【０００５】一般に、マイクロプロセッサはアクセスす
べき対象のアドレスを示すアドレス信号と、そのアドレ
ス信号が安定かつ有効であるタイミングを示すアドレス
イネーブル信号を出力するが、アドレス信号はＴ１ステ
ートのクロックの立ち上がりで変化するものとし、アド
レスイネーブル信号はＴ１ステートのクロックの立ち下
がりからＴ３ステートのクロックの立ち下がりまでがア
クティブとなるものとすると、上記のようにウェイト信
号のアクティブ時間幅をコントロールすることにより、
アドレス信号およびアドレスイネーブル信号のアクティ
ブ時間幅をコントロールすることができる。
べき対象のアドレスを示すアドレス信号と、そのアドレ
ス信号が安定かつ有効であるタイミングを示すアドレス
イネーブル信号を出力するが、アドレス信号はＴ１ステ
ートのクロックの立ち上がりで変化するものとし、アド
レスイネーブル信号はＴ１ステートのクロックの立ち下
がりからＴ３ステートのクロックの立ち下がりまでがア
クティブとなるものとすると、上記のようにウェイト信
号のアクティブ時間幅をコントロールすることにより、
アドレス信号およびアドレスイネーブル信号のアクティ
ブ時間幅をコントロールすることができる。
【０００６】アドレスイネーブル信号とアドレス信号の
ＡＮＤ条件をとった信号が周辺Ｉ／Ｏチップセレクト信
号として用いられるので、結局、ウェイト信号のアクテ
ィブ時間幅をコントロールすることにより周辺Ｉ／Ｏの
チップセレクト信号のアクティブ時間幅をコントロール
することができる。
ＡＮＤ条件をとった信号が周辺Ｉ／Ｏチップセレクト信
号として用いられるので、結局、ウェイト信号のアクテ
ィブ時間幅をコントロールすることにより周辺Ｉ／Ｏの
チップセレクト信号のアクティブ時間幅をコントロール
することができる。
【０００７】逆に言えば、アクセスタイムの変化する周
辺Ｉ／Ｏに対してマイクロプロセッサが正常にアクセス
を行うにはウェイト信号のアクティブ時間幅をコントロ
ールしてやればよい。
辺Ｉ／Ｏに対してマイクロプロセッサが正常にアクセス
を行うにはウェイト信号のアクティブ時間幅をコントロ
ールしてやればよい。
【０００８】さて図３において、２はメモリーなどの周
辺Ｉ／Ｏ、３はマイクロプロセッサから出力されるアド
レス信号とアドレスイネーブル信号のＡＮＤ条件をとり
周辺Ｉ／Ｏのチップセレクト信号を生成するアドレスデ
コーダ、４はマイクロプロセッサおよびウェイト信号発
生手段にクロック信号を供給する発振器、５はクロック
信号とチップセレクト信号をもとにマイクロプロセッサ
が正常に周辺Ｉ／Ｏにアクセスするためのウェイト信号
を発生させるウェイト信号発生手段である。
辺Ｉ／Ｏ、３はマイクロプロセッサから出力されるアド
レス信号とアドレスイネーブル信号のＡＮＤ条件をとり
周辺Ｉ／Ｏのチップセレクト信号を生成するアドレスデ
コーダ、４はマイクロプロセッサおよびウェイト信号発
生手段にクロック信号を供給する発振器、５はクロック
信号とチップセレクト信号をもとにマイクロプロセッサ
が正常に周辺Ｉ／Ｏにアクセスするためのウェイト信号
を発生させるウェイト信号発生手段である。
【０００９】以上を踏まえて従来例における制御装置の
動作を図３および図４（Ｂ）（Ｃ）を参照しながら説明
する。マイクロプロセッサ１には発振器４よりクロック
信号が供給されており、マイクロプロセッサ１はこのク
ロック信号に同期して周辺Ｉ／Ｏ２とのアクセスを行
う。マイクロプロセッサ１が周辺Ｉ／Ｏ２にアクセスし
ようとする際、マイクロプロセッサ１はＴ１ステートの
クロック信号の立ち上がりに同期してアドレス信号を出
力し、同クロック信号の立ち下がりに同期してアドレス
イネーブル信号を出力する。
動作を図３および図４（Ｂ）（Ｃ）を参照しながら説明
する。マイクロプロセッサ１には発振器４よりクロック
信号が供給されており、マイクロプロセッサ１はこのク
ロック信号に同期して周辺Ｉ／Ｏ２とのアクセスを行
う。マイクロプロセッサ１が周辺Ｉ／Ｏ２にアクセスし
ようとする際、マイクロプロセッサ１はＴ１ステートの
クロック信号の立ち上がりに同期してアドレス信号を出
力し、同クロック信号の立ち下がりに同期してアドレス
イネーブル信号を出力する。
【００１０】アドレスデコーダ３において、このアドレ
ス信号とアドレスイネーブル信号のＡＮＤ条件をとった
信号が生成され、これがチップセレクト信号として周辺
Ｉ／Ｏ２とウェイト信号発生手段５に出力される。チッ
プセレクト信号がアクティブとなることによりマイクロ
プロセッサ１のバスの専有権を周辺Ｉ／Ｏ２が有したこ
ととなりマイクロプロセッサ１とのアクセスが可能とな
る。そのときウェイト信号発生手段５では前記チップセ
レクト信号により周辺Ｉ／Ｏ２がアクセスされたことが
わかるので発振器４より供給されたクロック信号に同期
して必要とされる時間分ウェイト信号をアクティブとす
る。このためマイクロプロセッサ１のマシンサイクルに
Ｔｗステートが挿入されその結果チップセレクト信号の
アクティブ時間幅が延長され、周辺Ｉ／Ｏ２のアクセス
タイムが保証される。
ス信号とアドレスイネーブル信号のＡＮＤ条件をとった
信号が生成され、これがチップセレクト信号として周辺
Ｉ／Ｏ２とウェイト信号発生手段５に出力される。チッ
プセレクト信号がアクティブとなることによりマイクロ
プロセッサ１のバスの専有権を周辺Ｉ／Ｏ２が有したこ
ととなりマイクロプロセッサ１とのアクセスが可能とな
る。そのときウェイト信号発生手段５では前記チップセ
レクト信号により周辺Ｉ／Ｏ２がアクセスされたことが
わかるので発振器４より供給されたクロック信号に同期
して必要とされる時間分ウェイト信号をアクティブとす
る。このためマイクロプロセッサ１のマシンサイクルに
Ｔｗステートが挿入されその結果チップセレクト信号の
アクティブ時間幅が延長され、周辺Ｉ／Ｏ２のアクセス
タイムが保証される。
【００１１】ここでウェイト信号のアクティブ時間幅を
どのくらいに設定するかについて説明する。メモリーな
どに代表される周辺Ｉ／Ｏ２は使用温度が上昇するとと
もにアクセスタイムが増大することが知られている。
どのくらいに設定するかについて説明する。メモリーな
どに代表される周辺Ｉ／Ｏ２は使用温度が上昇するとと
もにアクセスタイムが増大することが知られている。
【００１２】このことから、たとえば装置の使用開始当
初は図４（Ｂ）に示すようにウェイト信号のアクティブ
時間幅をクロック信号の１サイクル分としＴｗステート
を１ステート挿入するだけでアクセスタイムが保証でき
たものが、装置内の温度が上昇するに従い、ある温度以
上では図４（Ｃ）に示すようにＴｗステートを２ステー
ト挿入しなければならない場合がありうる。このような
場合、従来の制御装置は装置内の温度の上昇をウェイト
信号発生手段に知らしめる構成となっていないため、保
証する使用条件での最大装置内温度における周辺Ｉ／Ｏ
２のアクセスタイムに対応したＴｗステートの挿入数を
実現するウェイト信号のアクティブ時間幅を設定するこ
とになる。
初は図４（Ｂ）に示すようにウェイト信号のアクティブ
時間幅をクロック信号の１サイクル分としＴｗステート
を１ステート挿入するだけでアクセスタイムが保証でき
たものが、装置内の温度が上昇するに従い、ある温度以
上では図４（Ｃ）に示すようにＴｗステートを２ステー
ト挿入しなければならない場合がありうる。このような
場合、従来の制御装置は装置内の温度の上昇をウェイト
信号発生手段に知らしめる構成となっていないため、保
証する使用条件での最大装置内温度における周辺Ｉ／Ｏ
２のアクセスタイムに対応したＴｗステートの挿入数を
実現するウェイト信号のアクティブ時間幅を設定するこ
とになる。
【００１３】
【発明が解決しようとする課題】このように従来の制御
装置では、最大装置内温度における周辺Ｉ／Ｏのアクセ
スタイムに対応してウェイト信号のアクティブ時間幅を
設定しているため、それより装置内温度の低い状況でも
必要以上にＴｗステートが挿入され、マイクロプロセッ
サにおける処理の低速化をまねくという問題があった。
装置では、最大装置内温度における周辺Ｉ／Ｏのアクセ
スタイムに対応してウェイト信号のアクティブ時間幅を
設定しているため、それより装置内温度の低い状況でも
必要以上にＴｗステートが挿入され、マイクロプロセッ
サにおける処理の低速化をまねくという問題があった。
【００１４】本発明は上記問題を解決するもので、マイ
クロプロセッサが温度に対応した適切なタイミングで周
辺Ｉ／Ｏとのアクセスを行いマイクロプロセッサにおけ
る処理の高速化を図ることができる制御装置を提供する
ことを目的としている。
クロプロセッサが温度に対応した適切なタイミングで周
辺Ｉ／Ｏとのアクセスを行いマイクロプロセッサにおけ
る処理の高速化を図ることができる制御装置を提供する
ことを目的としている。
【００１５】
【課題を解決するための手段】上記目的を達成するため
に、本発明の制御装置は、一定の基準電圧を生成する基
準電圧生成手段と、装置内の温度を電圧に変換する温度
−電圧変換手段と、基準電圧生成手段からの出力電圧と
前記温度−電圧変換手段の出力電圧を比較する電圧比較
手段と、電圧比較手段からの出力信号に応じて前記マイ
クロプロセッサに入力するウェイト信号のアクティブ時
間幅を変化させるウェイト信号発生手段を設けたもので
ある。
に、本発明の制御装置は、一定の基準電圧を生成する基
準電圧生成手段と、装置内の温度を電圧に変換する温度
−電圧変換手段と、基準電圧生成手段からの出力電圧と
前記温度−電圧変換手段の出力電圧を比較する電圧比較
手段と、電圧比較手段からの出力信号に応じて前記マイ
クロプロセッサに入力するウェイト信号のアクティブ時
間幅を変化させるウェイト信号発生手段を設けたもので
ある。
【００１６】
【作用】本発明は、上記した構成により、一定の基準電
圧を生成する基準電圧生成手段の出力電圧と装置内の温
度を電圧に変換する温度−電圧変換手段の出力電圧を電
圧比較手段において比較しその結果をウェイト信号発生
手段に信号として伝達することにより、ウェイト信号発
生手段は装置内温度がある一定温度より大きいか小さい
かを検知することが可能となり、したがって装置内温度
の変化に応じてマイクロプロセッサに入力するウェイト
信号のアクティブ時間幅を変化させることができる。
圧を生成する基準電圧生成手段の出力電圧と装置内の温
度を電圧に変換する温度−電圧変換手段の出力電圧を電
圧比較手段において比較しその結果をウェイト信号発生
手段に信号として伝達することにより、ウェイト信号発
生手段は装置内温度がある一定温度より大きいか小さい
かを検知することが可能となり、したがって装置内温度
の変化に応じてマイクロプロセッサに入力するウェイト
信号のアクティブ時間幅を変化させることができる。
【００１７】
【実施例】以下本発明の一実施例について図を参照しな
がら説明する。図１は本発明における制御装置の一実施
例のブロック図である。図１において、１はマイクロプ
ロセッサ、２はメモリーなどの周辺Ｉ／Ｏ，３はアドレ
スデコーダ、４は発振器、これらは従来例と同様のもの
であるので同一の番号を付し説明を省略する。
がら説明する。図１は本発明における制御装置の一実施
例のブロック図である。図１において、１はマイクロプ
ロセッサ、２はメモリーなどの周辺Ｉ／Ｏ，３はアドレ
スデコーダ、４は発振器、これらは従来例と同様のもの
であるので同一の番号を付し説明を省略する。
【００１８】９はクロック信号とチップセレクト信号を
もとに後述の電圧比較手段８からのウェイト切換信号に
応じたウェイト信号を発生させるウェイト信号発生手
段、６は電源から一定の基準電圧を生成する３端子レギ
ュレータなどの基準電圧生成手段、７はサーミスタなど
を利用して装置内の温度が高いほど低い電力を出力する
ように構成した温度−電圧変換手段、８は基準電圧生成
手段からの出力電圧と前記温度−電圧変換手段からの出
力電圧を比較する電圧比較手段で、基準電圧生成手段か
らの出力電圧の方が高い場合（温度が高い）は“０”、
温度−電圧変換手段からの出力電圧の方が高い場合（温
度が低い）は“１”となるウェイト切換信号をウェイト
信号発生手段９に対し出力する。これに対応してウェイ
ト信号発生手段９は、ウェイト切換信号が“１”である
場合にはクロック信号１サイクル分の時間アクティブと
なるウェイト信号を出力し、ウェイト切換信号が“０”
である場合はクロック信号２サイクル分の時間アクティ
ブとなるウェイト信号を出力する。
もとに後述の電圧比較手段８からのウェイト切換信号に
応じたウェイト信号を発生させるウェイト信号発生手
段、６は電源から一定の基準電圧を生成する３端子レギ
ュレータなどの基準電圧生成手段、７はサーミスタなど
を利用して装置内の温度が高いほど低い電力を出力する
ように構成した温度−電圧変換手段、８は基準電圧生成
手段からの出力電圧と前記温度−電圧変換手段からの出
力電圧を比較する電圧比較手段で、基準電圧生成手段か
らの出力電圧の方が高い場合（温度が高い）は“０”、
温度−電圧変換手段からの出力電圧の方が高い場合（温
度が低い）は“１”となるウェイト切換信号をウェイト
信号発生手段９に対し出力する。これに対応してウェイ
ト信号発生手段９は、ウェイト切換信号が“１”である
場合にはクロック信号１サイクル分の時間アクティブと
なるウェイト信号を出力し、ウェイト切換信号が“０”
である場合はクロック信号２サイクル分の時間アクティ
ブとなるウェイト信号を出力する。
【００１９】次に本実施例の制御装置の動作を図１およ
び図２を参照しながら説明する。マイクロプロセッサに
は発振器４よりクロック信号が供給されており、マイク
ロプロセッサ１はこのクロック信号に同期して周辺Ｉ／
Ｏ２とのアクセスを行なう。マイクロプロセッサ１が周
辺Ｉ／Ｏ２にアクセスしようとする際、マイクロプロセ
ッサ１はＴ１ステートのクロック信号の立ち上がりに同
期してアドレス信号を出力し、同クロック信号の立ち下
がりに同期してアドレスイネーブル信号が出力される。
び図２を参照しながら説明する。マイクロプロセッサに
は発振器４よりクロック信号が供給されており、マイク
ロプロセッサ１はこのクロック信号に同期して周辺Ｉ／
Ｏ２とのアクセスを行なう。マイクロプロセッサ１が周
辺Ｉ／Ｏ２にアクセスしようとする際、マイクロプロセ
ッサ１はＴ１ステートのクロック信号の立ち上がりに同
期してアドレス信号を出力し、同クロック信号の立ち下
がりに同期してアドレスイネーブル信号が出力される。
【００２０】アドレスデコーダ３において、このアドレ
ス信号とアドレスイネーブル信号のＡＮＤ条件をとった
信号が生成され、これがチップセレクト信号として周辺
Ｉ／Ｏ２とウェイト信号発生手段５に出力される。チッ
プセレクト信号がアクティブとなることによりマイクロ
プロセッサ１のバスの専有権を周辺Ｉ／Ｏ２が有したこ
ととなりマイクロプロセッサ１とのアクセスが可能とな
る。そのときウェイト信号発生手段５では前記チップセ
レクト信号により周辺Ｉ／Ｏ２がアクセスされたことが
わかるので発振器４より供給されたクロック信号に同期
してウェイト切換信号に対応した時間分アクティブなウ
ェイト信号を発生させる。このためマイクロプロセッサ
１のマシンサイクルにＴｗステートが挿入されその結果
チップセレクト信号のアクティブ時間幅が延長され、周
辺Ｉ／Ｏ２のアクセスタイムが保証される。
ス信号とアドレスイネーブル信号のＡＮＤ条件をとった
信号が生成され、これがチップセレクト信号として周辺
Ｉ／Ｏ２とウェイト信号発生手段５に出力される。チッ
プセレクト信号がアクティブとなることによりマイクロ
プロセッサ１のバスの専有権を周辺Ｉ／Ｏ２が有したこ
ととなりマイクロプロセッサ１とのアクセスが可能とな
る。そのときウェイト信号発生手段５では前記チップセ
レクト信号により周辺Ｉ／Ｏ２がアクセスされたことが
わかるので発振器４より供給されたクロック信号に同期
してウェイト切換信号に対応した時間分アクティブなウ
ェイト信号を発生させる。このためマイクロプロセッサ
１のマシンサイクルにＴｗステートが挿入されその結果
チップセレクト信号のアクティブ時間幅が延長され、周
辺Ｉ／Ｏ２のアクセスタイムが保証される。
【００２１】図２（Ａ）は保証する使用条件での最小装
置内温度におけるマイクロプロセッサ１の周辺Ｉ／Ｏ２
へのアクセスの様子を示すタイミングチャートであり、
この時点ではまだ温度−電圧変換手段７からの出力電圧
の方が基準電圧生成手段６からの出力電圧より高く、電
圧比較手段８から出力されるウェイト切換信号は“１”
である。したがって、ウェイト信号発生手段４はクロッ
ク信号１サイクル分の時間アクティブとなり、Ｔｗステ
ートが１ステート挿入され、その分チップセレクト信号
のアクティブ時間幅が延長される。
置内温度におけるマイクロプロセッサ１の周辺Ｉ／Ｏ２
へのアクセスの様子を示すタイミングチャートであり、
この時点ではまだ温度−電圧変換手段７からの出力電圧
の方が基準電圧生成手段６からの出力電圧より高く、電
圧比較手段８から出力されるウェイト切換信号は“１”
である。したがって、ウェイト信号発生手段４はクロッ
ク信号１サイクル分の時間アクティブとなり、Ｔｗステ
ートが１ステート挿入され、その分チップセレクト信号
のアクティブ時間幅が延長される。
【００２２】図２（Ｂ）は保証する使用条件での最大装
置内温度におけるマイクロプロセッサ１の周辺Ｉ／Ｏ２
へのアクセスの様子を示すタイミングチャートであり、
この時点では基準電圧生成手段６からの出力電圧の方が
温度−電圧変換手段７からの出力電圧より高くウェイト
切換信号は“０”である。したがって、ウェイト信号発
生手段４はクロック信号２サイクル分の時間アクティブ
となり、Ｔｗステートが２ステート挿入され、その分チ
ップセレクト信号のアクティブ時間幅が延長される。
置内温度におけるマイクロプロセッサ１の周辺Ｉ／Ｏ２
へのアクセスの様子を示すタイミングチャートであり、
この時点では基準電圧生成手段６からの出力電圧の方が
温度−電圧変換手段７からの出力電圧より高くウェイト
切換信号は“０”である。したがって、ウェイト信号発
生手段４はクロック信号２サイクル分の時間アクティブ
となり、Ｔｗステートが２ステート挿入され、その分チ
ップセレクト信号のアクティブ時間幅が延長される。
【００２３】ここで、周辺Ｉ／Ｏ２のアクセスタイム
が、Ｔｗステートが１ステート挿入されたときのチップ
セレクト信号のアクティブ時間幅よりも大きくなる装置
内温度において、電圧比較手段８がちょうど“０”のウ
ェイト切換信号を出力するように基準電圧生成手段６の
基準電圧を設定しておけば、マイクロプロセッサ１が装
置内温度に対応した適切なタイミングで周辺Ｉ／Ｏとの
アクセスを行い、マイクロプロセッサ１における処理の
高速化を図ることができる。
が、Ｔｗステートが１ステート挿入されたときのチップ
セレクト信号のアクティブ時間幅よりも大きくなる装置
内温度において、電圧比較手段８がちょうど“０”のウ
ェイト切換信号を出力するように基準電圧生成手段６の
基準電圧を設定しておけば、マイクロプロセッサ１が装
置内温度に対応した適切なタイミングで周辺Ｉ／Ｏとの
アクセスを行い、マイクロプロセッサ１における処理の
高速化を図ることができる。
【００２４】
【発明の効果】以上のように本発明によれば、一定の基
準電圧を生成する基準電圧生成手段と、装置内の温度を
電圧に変換する温度−電圧変換手段と、基準電圧生成手
段からの出力電圧と前記温度−電圧変換手段の出力電圧
を比較する電圧比較手段と、電圧比較手段からの出力信
号に応じてマイクロプロセッサに入力するウェイト信号
のアクティブ時間幅を変化させるウェイト信号発生手段
を設けたので、装置内温度の変化をウェイト発生手段が
検知し装置内温度の変化に応じてマイクロプロセッサに
入力するウェイト信号のアクティブ時間幅を変化させる
ことが可能となり、これによりマイクロプロセッサが装
置内温度に対応した適切なタイミングで周辺Ｉ／Ｏとの
アクセスを行い、マイクロプロセッサにおける処理の高
速化を図ることができる優れた制御装置が得られる。
準電圧を生成する基準電圧生成手段と、装置内の温度を
電圧に変換する温度−電圧変換手段と、基準電圧生成手
段からの出力電圧と前記温度−電圧変換手段の出力電圧
を比較する電圧比較手段と、電圧比較手段からの出力信
号に応じてマイクロプロセッサに入力するウェイト信号
のアクティブ時間幅を変化させるウェイト信号発生手段
を設けたので、装置内温度の変化をウェイト発生手段が
検知し装置内温度の変化に応じてマイクロプロセッサに
入力するウェイト信号のアクティブ時間幅を変化させる
ことが可能となり、これによりマイクロプロセッサが装
置内温度に対応した適切なタイミングで周辺Ｉ／Ｏとの
アクセスを行い、マイクロプロセッサにおける処理の高
速化を図ることができる優れた制御装置が得られる。
【図１】本発明における制御装置の一実施例のブロック
図
図
【図２】本発明における制御装置の一実施例のタイミン
グチャート図
グチャート図
【図３】従来例における制御装置のブロック図
【図４】従来例における制御装置のタイミングチャート
図
図
１ マイクロプロセッサ ２ 周辺Ｉ／Ｏ ３ アドレスデコーダ ４ 発振器 ６ 基準電圧生成手段 ７ 温度−電圧変換手段 ８ 電圧比較手段 ９ ウェイト信号発生手段
Claims (1)
- 【請求項１】 外部からウェイト信号を入力することに
より周辺Ｉ／Ｏへのアクセスタイミング可変のマイクロ
プロセッサと、一定の基準電圧を生成する基準電圧生成
手段と、装置内の温度を電圧に変換する温度−電圧変換
手段と、前記基準電圧生成手段からの出力電圧と前記温
度−電圧変換手段の出力電圧を比較する電圧比較手段
と、前記電圧比較手段からの出力信号に応じて前記マイ
クロプロセッサに入力するウェイト信号のアクティブ時
間幅を変化させるウェイト信号発生手段を備えたことを
特徴とする制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19034692A JP3190121B2 (ja) | 1992-07-17 | 1992-07-17 | 制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19034692A JP3190121B2 (ja) | 1992-07-17 | 1992-07-17 | 制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0635697A true JPH0635697A (ja) | 1994-02-10 |
| JP3190121B2 JP3190121B2 (ja) | 2001-07-23 |
Family
ID=16256671
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19034692A Expired - Fee Related JP3190121B2 (ja) | 1992-07-17 | 1992-07-17 | 制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3190121B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6748464B2 (en) | 2000-09-20 | 2004-06-08 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device comprising CPU and peripheral circuit wherein control unit performs wait cycle control that makes peripheral circuit wait a predetermined time before responding to CPU |
| WO2024024516A1 (ja) * | 2022-07-29 | 2024-02-01 | ソニーグループ株式会社 | 通信装置、駆動装置、表示装置、及び通信方法 |
-
1992
- 1992-07-17 JP JP19034692A patent/JP3190121B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6748464B2 (en) | 2000-09-20 | 2004-06-08 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device comprising CPU and peripheral circuit wherein control unit performs wait cycle control that makes peripheral circuit wait a predetermined time before responding to CPU |
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| JP3190121B2 (ja) | 2001-07-23 |
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