JPH10107034A - ワードラインの製造方法 - Google Patents
ワードラインの製造方法Info
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- JPH10107034A JPH10107034A JP9011965A JP1196597A JPH10107034A JP H10107034 A JPH10107034 A JP H10107034A JP 9011965 A JP9011965 A JP 9011965A JP 1196597 A JP1196597 A JP 1196597A JP H10107034 A JPH10107034 A JP H10107034A
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- H10D64/01308—Manufacture or treatment of electrodes having a conductor capacitively coupled to a semiconductor by an insulator the insulator being formed after the semiconductor body, the semiconductor being silicon characterised by the conductor the conductor comprising a layer of silicon contacting the insulator, e.g. polysilicon the conductor further comprising a non-elemental silicon additional conductive layer, e.g. a metal silicide layer formed by the reaction of silicon with an implanted metal
- H10D64/01312—Manufacture or treatment of electrodes having a conductor capacitively coupled to a semiconductor by an insulator the insulator being formed after the semiconductor body, the semiconductor being silicon characterised by the conductor the conductor comprising a layer of silicon contacting the insulator, e.g. polysilicon the conductor further comprising a non-elemental silicon additional conductive layer, e.g. a metal silicide layer formed by the reaction of silicon with an implanted metal the additional layer comprising a metal or metal silicide formed by deposition, i.e. without a silicidation reaction, e.g. sputter deposition
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Semiconductor Memories (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
- Electrodes Of Semiconductors (AREA)
Abstract
(57)【要約】
【課題】 ワードラインのパターン化を容易に行えるワ
ードラインの製造方法を提供する。 【解決手段】 基板上に多数の列のゲートを形成する。
金属珪化物層をゲートの上方に形成した後、シリコン富
有層を形成する。シリコン富有層は高シリコン濃度を持
つ他の金属珪化物層かまたは純粋なシリコン層である。
ードラインの製造方法を提供する。 【解決手段】 基板上に多数の列のゲートを形成する。
金属珪化物層をゲートの上方に形成した後、シリコン富
有層を形成する。シリコン富有層は高シリコン濃度を持
つ他の金属珪化物層かまたは純粋なシリコン層である。
Description
【0001】
【発明の属する技術分野】本発明は一般に半導体集積回
路(IC)の製造に関し、特に、ダイナミックランダム
アクセスメモリ回路中のワードライン(単語線)の製造
に関する。
路(IC)の製造に関し、特に、ダイナミックランダム
アクセスメモリ回路中のワードライン(単語線)の製造
に関する。
【0002】
【従来の技術】ダイナミックランダムアクセスメモリ
(DRAM)のキャパシタ(コンデンサ)の表面積を最
大にするために、キャパシタは一般にワードラインの上
方に形成される。しかし、ワードラインと蓄電セルは両
方導電性層であるので、それらの間には絶縁層が必要で
ある。酸化珪素(珪素酸化物)および窒化珪素(珪素窒
化物)は両方とも絶縁層として広く使用されている。し
かし、窒化珪素を用いることは関連するトランジスタの
ゲートに潜在的な応力効果を生じさせると共にゲートの
パターン化の際の困難さが生ずる。したがって、酸化珪
素がこの用途に対して最もよく用いられる材料である。
蒸着が酸化珪素(頂部酸化物)層を形成するためによく
用いられ、特に、700℃における低圧化学蒸着(LP
CVD)が効率がよいので好ましい。
(DRAM)のキャパシタ(コンデンサ)の表面積を最
大にするために、キャパシタは一般にワードラインの上
方に形成される。しかし、ワードラインと蓄電セルは両
方導電性層であるので、それらの間には絶縁層が必要で
ある。酸化珪素(珪素酸化物)および窒化珪素(珪素窒
化物)は両方とも絶縁層として広く使用されている。し
かし、窒化珪素を用いることは関連するトランジスタの
ゲートに潜在的な応力効果を生じさせると共にゲートの
パターン化の際の困難さが生ずる。したがって、酸化珪
素がこの用途に対して最もよく用いられる材料である。
蒸着が酸化珪素(頂部酸化物)層を形成するためによく
用いられ、特に、700℃における低圧化学蒸着(LP
CVD)が効率がよいので好ましい。
【0003】下記はDRAM製造の際に用いられるワー
ドラインを形成するためのプロセスを述べるものであ
る。
ドラインを形成するためのプロセスを述べるものであ
る。
【0004】図3を参照すると、ゲート酸化物層14と
ワードライン16を持った基板10が設けられる。次
に、耐火性タングステン珪化物(WSi2 )層18がポ
リシリコン材料であるワードライン16上に形成され
る。この方法は相互連結抵抗を減少させる。問題の珪化
物は下記の3つの基本的な技術によって形成され、いず
れの技術も珪化物18を形成する熱工程がその後行われ
る。 (1)ポリシリコン層16上への純粋なタングステンの
蒸着、(2)2つの供給源(共通蒸発源)からシリコン
およびタングステンの同時蒸発、(3)複合ターゲット
からの、または共通スパッタリングまたは積層化による
タングステン珪化物のスパッタ蒸着。
ワードライン16を持った基板10が設けられる。次
に、耐火性タングステン珪化物(WSi2 )層18がポ
リシリコン材料であるワードライン16上に形成され
る。この方法は相互連結抵抗を減少させる。問題の珪化
物は下記の3つの基本的な技術によって形成され、いず
れの技術も珪化物18を形成する熱工程がその後行われ
る。 (1)ポリシリコン層16上への純粋なタングステンの
蒸着、(2)2つの供給源(共通蒸発源)からシリコン
およびタングステンの同時蒸発、(3)複合ターゲット
からの、または共通スパッタリングまたは積層化による
タングステン珪化物のスパッタ蒸着。
【0005】
【発明が解決しようとする課題】次に、図4を参照する
と、絶縁層20が、タングステン珪化物層18をその後
に蒸着される層から分離するために、タングステン珪化
物層18の表面上に形成されねばならない。蒸着した酸
化珪素および窒化珪素がこの用途に用いられるが、70
0℃におけるLPCVDによって形成された酸化珪素層
が一般に一層良好な材料特性を与えるので、好ましい。
形成された酸化物層20は安定でなければならないし、
適切な電気物理特性を呈しなければならない。しかし、
実際には、タングステン珪化物層18の表面は、例えば
700℃のような高温で酸素が存在すると、容易にタン
グステン酸化物に変換する。タングステン酸化物は初期
には揮発性であるが、頂部酸化物層20が蒸着工程の結
果によって蒸着した後ではタングステン酸化物がタング
ステン珪化物層18の上部表面に残ることは避けられな
い。したがって、望ましくないタングステン酸化物(W
O3 )の層22が酸化珪素層20の下に形成されるのは
避けられない。言い換えると、タングステン酸化物層2
2がタングステン珪化物層18と酸化珪素層20との間
に形成される。さらに、タングステン酸化物層22は滑
らかでなく、多数の凸凹の面を持つので、酸化珪素の表
面も同様に荒くなる。観察される他の結果は、ポリシリ
コン層16が厚い一方、対照的に、タングステン珪化物
層18が薄いことである。前述の望ましくない結果によ
ってワードライン線16のパターン化を困難にする。
と、絶縁層20が、タングステン珪化物層18をその後
に蒸着される層から分離するために、タングステン珪化
物層18の表面上に形成されねばならない。蒸着した酸
化珪素および窒化珪素がこの用途に用いられるが、70
0℃におけるLPCVDによって形成された酸化珪素層
が一般に一層良好な材料特性を与えるので、好ましい。
形成された酸化物層20は安定でなければならないし、
適切な電気物理特性を呈しなければならない。しかし、
実際には、タングステン珪化物層18の表面は、例えば
700℃のような高温で酸素が存在すると、容易にタン
グステン酸化物に変換する。タングステン酸化物は初期
には揮発性であるが、頂部酸化物層20が蒸着工程の結
果によって蒸着した後ではタングステン酸化物がタング
ステン珪化物層18の上部表面に残ることは避けられな
い。したがって、望ましくないタングステン酸化物(W
O3 )の層22が酸化珪素層20の下に形成されるのは
避けられない。言い換えると、タングステン酸化物層2
2がタングステン珪化物層18と酸化珪素層20との間
に形成される。さらに、タングステン酸化物層22は滑
らかでなく、多数の凸凹の面を持つので、酸化珪素の表
面も同様に荒くなる。観察される他の結果は、ポリシリ
コン層16が厚い一方、対照的に、タングステン珪化物
層18が薄いことである。前述の望ましくない結果によ
ってワードライン線16のパターン化を困難にする。
【0006】したがって、本発明の目的は、前述の問題
を克服したワードラインの製造方法を提供することにあ
る。
を克服したワードラインの製造方法を提供することにあ
る。
【0007】
【課題を解決するための手段】本発明は、前述の目的
を、基板上に複数の列のゲートを形成し、ゲートの各列
に第1の金属珪化物層を形成し、珪素富有である他の金
属珪化物層を形成するか、またはそれに代えて前に形成
した金属珪化物層上に珪素層を形成することから成るワ
ードラインの新規な製造方法によって達成する。
を、基板上に複数の列のゲートを形成し、ゲートの各列
に第1の金属珪化物層を形成し、珪素富有である他の金
属珪化物層を形成するか、またはそれに代えて前に形成
した金属珪化物層上に珪素層を形成することから成るワ
ードラインの新規な製造方法によって達成する。
【0008】
【発明の実施の形態】以下に、添付図面を参照して本発
明の実施例を詳細に説明する。
明の実施例を詳細に説明する。
【0009】最初に図1を参照すると、ゲート酸化物層
24とポリシリコンワードライン26を持った基板20
が用意される。次に、耐火性金属珪化物層28、好まし
くは、タングステン珪化物がワードライン上に形成され
る。この点までの製造工程は当業者にとって公知である
ので、詳細には説明しない。次に、シリコン富有金属珪
化物、または純粋シリコン層30が金属珪化物層28の
上部表面に形成される。かくして、層30は層28より
高濃度のシリコンを持つ。このシリコン富有金属珪化物
層30は、好ましくは、反応体シリコン塩化物(SiC
l2 H2 )およびタングステン弗化物(WF6 )で化学
蒸着されたタングステン珪化物層である。タングステン
弗化物は腐食性ガスであり、比較的高い密度を持ち、室
温でかなり高い蒸気圧を持つ。市販のコールドウオール
(cold−wall)システムがタングステン珪化物
蒸着に用いられて成功を収めている。シリコン塩化物と
タングステン弗化物は、例えば、1:1の比でよい。
24とポリシリコンワードライン26を持った基板20
が用意される。次に、耐火性金属珪化物層28、好まし
くは、タングステン珪化物がワードライン上に形成され
る。この点までの製造工程は当業者にとって公知である
ので、詳細には説明しない。次に、シリコン富有金属珪
化物、または純粋シリコン層30が金属珪化物層28の
上部表面に形成される。かくして、層30は層28より
高濃度のシリコンを持つ。このシリコン富有金属珪化物
層30は、好ましくは、反応体シリコン塩化物(SiC
l2 H2 )およびタングステン弗化物(WF6 )で化学
蒸着されたタングステン珪化物層である。タングステン
弗化物は腐食性ガスであり、比較的高い密度を持ち、室
温でかなり高い蒸気圧を持つ。市販のコールドウオール
(cold−wall)システムがタングステン珪化物
蒸着に用いられて成功を収めている。シリコン塩化物と
タングステン弗化物は、例えば、1:1の比でよい。
【0010】次に、図2を参照すると、次に、頂部酸化
物層32がシリコン富有タングステン珪化物または純粋
珪素の層30の上部面に形成される。この方法で、タン
グステン酸化物の形成という欠点がないことが見いださ
れており、したがって、ワードラインのパターン化の困
難性が小さくなる。さらに、酸化物層32の表面は滑ら
かに保たれる。さらに、本発明の前述の実施例に従って
ワードラインを製造することによって、ゲート、ポリシ
リコン26または金属珪化物層28の厚みは変化しな
い。
物層32がシリコン富有タングステン珪化物または純粋
珪素の層30の上部面に形成される。この方法で、タン
グステン酸化物の形成という欠点がないことが見いださ
れており、したがって、ワードラインのパターン化の困
難性が小さくなる。さらに、酸化物層32の表面は滑ら
かに保たれる。さらに、本発明の前述の実施例に従って
ワードラインを製造することによって、ゲート、ポリシ
リコン26または金属珪化物層28の厚みは変化しな
い。
【0011】本発明は好ましい実施例で説明してきた
が、本発明はこの実施例に限定されるものではない。反
対に、本発明は種々の変形および同様な手順を含むもの
である。したがって、本発明の範囲は、すべてのそのよ
うな変形や同様な手順を含むように最も広義に解釈すべ
きである。
が、本発明はこの実施例に限定されるものではない。反
対に、本発明は種々の変形および同様な手順を含むもの
である。したがって、本発明の範囲は、すべてのそのよ
うな変形や同様な手順を含むように最も広義に解釈すべ
きである。
【0012】
【発明の効果】以上説明したように、本発明によれば、
ワードラインのパターン化が容易なワードラインの製造
方法が得られる。
ワードラインのパターン化が容易なワードラインの製造
方法が得られる。
【図1】図1は本発明のワードライン製造方法の好まし
い実施例の工程を示す断面図である。
い実施例の工程を示す断面図である。
【図2】図2は本発明のワードライン製造方法の好まし
い実施例の工程を示す断面図である。
い実施例の工程を示す断面図である。
【図3】図3はワードラインを製造する従来例の工程を
示す断面図である。
示す断面図である。
【図4】図4はワードラインを製造する従来例の工程を
示す断面図である。
示す断面図である。
24 ゲート酸化物層 26 ポリシリコン 28 耐火性金属珪化物層 30 シリコン富有金属珪化物、または純粋シリコン
層 32 頂部酸化物層
層 32 頂部酸化物層
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 FI H01L 21/336 (72)発明者 イー チュン シェン 台湾 タイチュン シティ クオフェン ストリート レイン 70 ナンバー 30
Claims (6)
- 【請求項1】 ワードラインの製造方法において、 基板を用意し、 基板上にゲートを形成し、 ゲート上に第1金属珪化物層を形成し、 第1金属珪化物層より高い濃度のシリコンを持つ第2金
属珪化物層を第1金属珪化物層上に形成する、 ことを特徴とする製造方法。 - 【請求項2】 請求項1記載の製造方法に従って製造さ
れたダイナミックランダムアクセスメモリ(DRAM)
のワードライン。 - 【請求項3】 第2金属珪化物層の上方に頂部酸化物層
をさらに形成することを特徴とする請求項1記載の製造
方法。 - 【請求項4】 ワードラインの製造方法において、 基板を用意し、 基板上にゲートを形成し、 ゲート上に第1金属珪化物層を形成し、 金属珪化物層上にシリコン層を形成する、 ことを特徴とする製造方法。
- 【請求項5】 請求項4記載の製造方法に従って製造さ
れたダイナミックランダムアクセスメモリ(DRAM)
のワードライン。 - 【請求項6】 シリコン層の上方に頂部酸化物層をさら
に形成することを特徴とする請求項1記載の製造方法。
Applications Claiming Priority (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| TW085111565A TW316326B (en) | 1996-09-21 | 1996-09-21 | Manufacturing method of word line |
| TW85111565 | 1996-09-21 | ||
| GB9624435A GB2319658B (en) | 1996-09-21 | 1996-11-25 | Method of fabricating a word line |
| NL1007868A NL1007868C2 (nl) | 1996-09-21 | 1997-12-23 | Werkwijze voor het vervaardigen van een woordregel, en hiermee verkregen geïntegreerde halfgeleiderschakeling. |
| FR9800082A FR2773418B1 (fr) | 1996-09-21 | 1998-01-07 | Procede de fabrication d'un conducteur de mot |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10107034A true JPH10107034A (ja) | 1998-04-24 |
Family
ID=27447012
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9011965A Pending JPH10107034A (ja) | 1996-09-21 | 1997-01-07 | ワードラインの製造方法 |
Country Status (5)
| Country | Link |
|---|---|
| JP (1) | JPH10107034A (ja) |
| DE (1) | DE19648733C2 (ja) |
| FR (1) | FR2773418B1 (ja) |
| GB (1) | GB2319658B (ja) |
| NL (1) | NL1007868C2 (ja) |
Cited By (3)
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| JP2000294775A (ja) * | 1999-04-07 | 2000-10-20 | Sony Corp | 半導体装置の製造方法 |
| KR100771538B1 (ko) | 2005-12-14 | 2007-10-31 | 주식회사 하이닉스반도체 | 낮은 저항의 텅스텐-폴리사이드 게이트 및 리세스채널을갖는 반도체소자의 제조방법 |
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|---|---|---|---|---|
| US7243027B2 (en) | 2005-07-07 | 2007-07-10 | Schlumberger Technology Corporation | Method and system to generate deliverable files |
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| JPS6376479A (ja) * | 1986-09-19 | 1988-04-06 | Oki Electric Ind Co Ltd | 半導体装置の製造方法 |
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-
1996
- 1996-11-25 GB GB9624435A patent/GB2319658B/en not_active Expired - Fee Related
- 1996-11-25 DE DE19648733A patent/DE19648733C2/de not_active Expired - Fee Related
-
1997
- 1997-01-07 JP JP9011965A patent/JPH10107034A/ja active Pending
- 1997-12-23 NL NL1007868A patent/NL1007868C2/nl not_active IP Right Cessation
-
1998
- 1998-01-07 FR FR9800082A patent/FR2773418B1/fr not_active Expired - Fee Related
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| NL1007868C2 (nl) | 1999-06-24 |
| FR2773418B1 (fr) | 2002-12-06 |
| GB9624435D0 (en) | 1997-01-15 |
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