JPS5953082A - 電流制御回路 - Google Patents
電流制御回路Info
- Publication number
- JPS5953082A JPS5953082A JP16307182A JP16307182A JPS5953082A JP S5953082 A JPS5953082 A JP S5953082A JP 16307182 A JP16307182 A JP 16307182A JP 16307182 A JP16307182 A JP 16307182A JP S5953082 A JPS5953082 A JP S5953082A
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- Japan
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- circuit
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- control circuit
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
- H02M3/325—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
- Power Conversion In General (AREA)
- Emergency Protection Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（１）発明の技術分野
本発明は電源装置に係わり、特に簡単な回路を用いて出
力′ｒ１．流制限特性を改善した電流制御回路にｌ５ｌ
ｊｌする。
力′ｒ１．流制限特性を改善した電流制御回路にｌ５ｌ
ｊｌする。
（２）従沫技術と問題点
電りτ“’、ｌ１ｉｉ路における従来形の′ｉＴｔ流制
御回路が第１図に示τ〜１ｔも。第１は１の霜、流制御
回路は、入力電源平削−゛Ｊン？ンザＣ８、ダイオード
ＤＩ、変ｊＬ器ＴＩ、出力子（′１１回路１１、主スイ
ツチトランジスタＴＩ’＋、・ぐルス幅制御１Ｌｊｌ路
１２ 、ｆｉ’（算増幅器１３、’ｆｉ、（ｊｌｃ ４
欠出抵４九Ｒ１、ビークイＩＩ′１整汎回１１’＋’ｉ
１４、基準電圧源Ｖｒ８ｆにより構成される。第１１
°ソ１のｉ４１流制御回路においては、変圧器Ｔ１の一
次（ｔｉｌｌ電流を１１Ｌ流検出抵抗Ｒ１′″Ｃ検出し
、ピーク値整流回路１４により曲流電圧信号に変換する
。この直流電化４ハ号６、演３′（、増幅器１３におい
て基準’＋１？、王Ｖ、。ｆと比較され、演算増幅器１
３からの比較出力によリハルス幅制御回路１２が主トラ
ンジスタ゛ｒＲ１の導通時間を制御する。
御回路が第１図に示τ〜１ｔも。第１は１の霜、流制御
回路は、入力電源平削−゛Ｊン？ンザＣ８、ダイオード
ＤＩ、変ｊＬ器ＴＩ、出力子（′１１回路１１、主スイ
ツチトランジスタＴＩ’＋、・ぐルス幅制御１Ｌｊｌ路
１２ 、ｆｉ’（算増幅器１３、’ｆｉ、（ｊｌｃ ４
欠出抵４九Ｒ１、ビークイＩＩ′１整汎回１１’＋’ｉ
１４、基準電圧源Ｖｒ８ｆにより構成される。第１１
°ソ１のｉ４１流制御回路においては、変圧器Ｔ１の一
次（ｔｉｌｌ電流を１１Ｌ流検出抵抗Ｒ１′″Ｃ検出し
、ピーク値整流回路１４により曲流電圧信号に変換する
。この直流電化４ハ号６、演３′（、増幅器１３におい
て基準’＋１？、王Ｖ、。ｆと比較され、演算増幅器１
３からの比較出力によリハルス幅制御回路１２が主トラ
ンジスタ゛ｒＲ１の導通時間を制御する。
ところで、第１図の従来形の回路においては、第２図の
電流・電圧特性に示されるように、負荷が知略した場合
に電流が増加するという欠点がある。
電流・電圧特性に示されるように、負荷が知略した場合
に電流が増加するという欠点がある。
（３）発明の目的
本発明の目的は、前述した従来形の問題点にかんがみ、
電流制限特性を１７」の字形特性とすることによシ負荷
短絡時の電流を少なくし負荷を保護するとともに電源装
置におけるＶ流夕゛イオードの負Ｊ′３（を軽減するこ
とができる電流制御１回路を提供することにある。
電流制限特性を１７」の字形特性とすることによシ負荷
短絡時の電流を少なくし負荷を保護するとともに電源装
置におけるＶ流夕゛イオードの負Ｊ′３（を軽減するこ
とができる電流制御１回路を提供することにある。
（４）発明の構成
本発明においては、パルス幅制御回路によって駆用山さ
れスイッチング動作を行う主トランジスタぐ’ −’ｉ
−！、ｌ ｆｌｉｌｌ（ｉｉ１１ン冒する’Ｔｌｊ、
３ｉｉを検出するため（７−１’ｒｔｉわｉｃ ｌ’Ｗ
’ｌｌ−ｉ９＋、’ｒＭ 挿入８ ｔＬ ｌｒ： ＩＪ
Ｌ抗〕両９ｊ１！ ｉｌＱ ＋（−ｉたＱ：ｊ恋！ｉｌ
’（ｊ：ｎ ？ｃ介して２ど人′１）１リレ・−（口、
゛１．てＳれたＪ！（１′ｉ′シの両立ｊ＋’ＩＸｉ
ｆ、 ｒ（：、をピ゛−り値賂流回路および５１′−均
イ１１（平滑回路に」、、・いて−で−れぞれ直流′１
１．Ｉ：圧に変換し、前記平均イｉｉ’！平・ど）を回
ｒ１１の出力１ｉ、４． ＬＪ二をＬ［足の定電圧に加
えて基準電工と（〜、前ｉ１２基準ηを圧と前記ピーク
仙舶ｂｊｒ回１ｊゝｔの出力孔Ｈ３［とを比較しその比
較出力粗列を前記パ゛ルク・幅ηｉｌｌ １１１１１！
ｊｌ路に入力し前り１主トランジスタのシ、・１通１１
．’、ｉ ｎｉｌ ４１制ｆｌ’ｉｔｌし、それによシ
過犬１１１□１流を防止するようにｌ−たことを特仰と
する、電流制御回路が４足供される。
れスイッチング動作を行う主トランジスタぐ’ −’ｉ
−！、ｌ ｆｌｉｌｌ（ｉｉ１１ン冒する’Ｔｌｊ、
３ｉｉを検出するため（７−１’ｒｔｉわｉｃ ｌ’Ｗ
’ｌｌ−ｉ９＋、’ｒＭ 挿入８ ｔＬ ｌｒ： ＩＪ
Ｌ抗〕両９ｊ１！ ｉｌＱ ＋（−ｉたＱ：ｊ恋！ｉｌ
’（ｊ：ｎ ？ｃ介して２ど人′１）１リレ・−（口、
゛１．てＳれたＪ！（１′ｉ′シの両立ｊ＋’ＩＸｉ
ｆ、 ｒ（：、をピ゛−り値賂流回路および５１′−均
イ１１（平滑回路に」、、・いて−で−れぞれ直流′１
１．Ｉ：圧に変換し、前記平均イｉｉ’！平・ど）を回
ｒ１１の出力１ｉ、４． ＬＪ二をＬ［足の定電圧に加
えて基準電工と（〜、前ｉ１２基準ηを圧と前記ピーク
仙舶ｂｊｒ回１ｊゝｔの出力孔Ｈ３［とを比較しその比
較出力粗列を前記パ゛ルク・幅ηｉｌｌ １１１１１！
ｊｌ路に入力し前り１主トランジスタのシ、・１通１１
．’、ｉ ｎｉｌ ４１制ｆｌ’ｉｔｌし、それによシ
過犬１１１□１流を防止するようにｌ−たことを特仰と
する、電流制御回路が４足供される。
（ｊ５）各６明のソ″Ｍｌｉ伸１
本発明の−・丈ｂ（１（例としてのｊ（４，ｉｒＷ ｆ
ｌｉＱ机１回ｌｌ！τ町、がｔｌ、３図に示される。第
３図の１（ｉ、が１制＃回ＶＩｉ律１、人力霜５分平谷
フ化コンデンサＣＩ、グイ刈−ドＬ）ｌ ’１ ％：Ｕ
ｊ）ｊ Ｔ １ 、出力子ｍ回ｙｅｓ １ ］ 、主）
９ ンシスクＴＲ，、パルス幅１）ｌ制御回路１２、
演Ｓｔ、、増ｌｌ’ｉ１”、回ｊ’１’ｉ １３、市、
６１「検出抵抗Ｉζ１、ピーク値整流回路Ｊ４、平均値
平滑回路１５、基準’ＩＬｒ、ＥＪ二６Ｑ Ｖｌ（１１
Ｎ ＃’；・よびｌｔＪ’、Ｊ、ｔ＋’、 Ｒ４ｒＲ５
から構成される。出力平滑回路］】仁；、ダイオードＤ
２ 、Ｄ３、チョークコイルＬ１％ コンデンサＣ２を
有する。ピーク値整流回路１４は、ダイオードＤ４、コ
ンデン”）’ Ｃ３、抵抗１１ｚを有する。また、平均
値平均回路１５は、抵抗Ｒ３、コンデン′ｖＣ４を有す
る。
ｌｉＱ机１回ｌｌ！τ町、がｔｌ、３図に示される。第
３図の１（ｉ、が１制＃回ＶＩｉ律１、人力霜５分平谷
フ化コンデンサＣＩ、グイ刈−ドＬ）ｌ ’１ ％：Ｕ
ｊ）ｊ Ｔ １ 、出力子ｍ回ｙｅｓ １ ］ 、主）
９ ンシスクＴＲ，、パルス幅１）ｌ制御回路１２、
演Ｓｔ、、増ｌｌ’ｉ１”、回ｊ’１’ｉ １３、市、
６１「検出抵抗Ｉζ１、ピーク値整流回路Ｊ４、平均値
平滑回路１５、基準’ＩＬｒ、ＥＪ二６Ｑ Ｖｌ（１１
Ｎ ＃’；・よびｌｔＪ’、Ｊ、ｔ＋’、 Ｒ４ｒＲ５
から構成される。出力平滑回路］】仁；、ダイオードＤ
２ 、Ｄ３、チョークコイルＬ１％ コンデンサＣ２を
有する。ピーク値整流回路１４は、ダイオードＤ４、コ
ンデン”）’ Ｃ３、抵抗１１ｚを有する。また、平均
値平均回路１５は、抵抗Ｒ３、コンデン′ｖＣ４を有す
る。
第３図の電流制御回路においては、主トランジスタ’ｌ
’Ｒ，を流れる電流は、電流検出遅（抗Ｒ１により検出
され、１に流検出抵抗Ｒ１の両端電圧は、ピーク値順流
回路１４および平均値平滑回路１５に入力される。ピー
ク値整流回路１４の出力電圧ｄ演舞増幅器１３の一方の
入力に印加される。一方、平均イ１１１平滑回路１５の
出力型１Ｅｉｔ、抵抗１’４＋Ｒ５により基準電圧源ｖ
ｒｅｆの出力η上圧と加１）、されて演舞増幅器１３の
他方の入力に印加される。
’Ｒ，を流れる電流は、電流検出遅（抗Ｒ１により検出
され、１に流検出抵抗Ｒ１の両端電圧は、ピーク値順流
回路１４および平均値平滑回路１５に入力される。ピー
ク値整流回路１４の出力電圧ｄ演舞増幅器１３の一方の
入力に印加される。一方、平均イ１１１平滑回路１５の
出力型１Ｅｉｔ、抵抗１’４＋Ｒ５により基準電圧源ｖ
ｒｅｆの出力η上圧と加１）、されて演舞増幅器１３の
他方の入力に印加される。
第４図には、第３図の回路の動作を説明するための電工
波形が示される。第４図（１）、（２）に示される波形
は、主トランジスタＴＲ，のオン時間が長い場合に対応
しており、第４図（３）、（４）に示される波形は、主
トランジスタＴＲ，のオン時間が炉かい場合を承り。第
４図（１） 、 （３）には、主トランジスタＴｉｔ、
のコレクタ・エミック電用■。。が示され、（２）。
波形が示される。第４図（１）、（２）に示される波形
は、主トランジスタＴＲ，のオン時間が長い場合に対応
しており、第４図（３）、（４）に示される波形は、主
トランジスタＴＲ，のオン時間が炉かい場合を承り。第
４図（１） 、 （３）には、主トランジスタＴｉｔ、
のコレクタ・エミック電用■。。が示され、（２）。
（４）に−１電流検出抵抗Ｒ１の両り：Ｈ，Ｈ電王ＶＲ
，、ピーク値整流回路１４の出力型！’ｈ Ｖｌｌｚ、
および、平均値平滑回路１５の出力型ＥＥＶＣ４が示さ
れる。第４図に示されるように、ぎ−ク仙整ｂ１ｆ回路
１４の出力電王■Ｒ２Ｖｉ主トランジスタ’Ｉ’ＲＩの
オン時間の長短にかかわらず一５１Ｆであるが、平均仙
平ｒ１゛１回路１５の出力型圧■Ｃ４はオン時間が知か
くなるとともに減少する。
，、ピーク値整流回路１４の出力型！’ｈ Ｖｌｌｚ、
および、平均値平滑回路１５の出力型ＥＥＶＣ４が示さ
れる。第４図に示されるように、ぎ−ク仙整ｂ１ｆ回路
１４の出力電王■Ｒ２Ｖｉ主トランジスタ’Ｉ’ＲＩの
オン時間の長短にかかわらず一５１Ｆであるが、平均仙
平ｒ１゛１回路１５の出力型圧■Ｃ４はオン時間が知か
くなるとともに減少する。
従ツー（、第３図の回路Ｋ −ＩＩ’ イテｔｒｉ ％
演ｆ’ｓ増’ｌ’！、ｉ 器１３の）、１、準入力の
電圧け、トランジスタＴＲ，のメン時間がｔ・トい時高
くなり、ｔＩｉかい時低くなる。一方、ピーク値抛流回
路１４の出力電圧ＶＲ２ｒ：を前記の基準人力と等しく
なるようにｆｆｌループ制御されておρ、主トランジス
タＴＲ，のオン時間が短かい場合、すなわち、負φ；ｉ
短絡時に粋いてｖＲ２が低下するように制御さＪする。
演ｆ’ｓ増’ｌ’！、ｉ 器１３の）、１、準入力の
電圧け、トランジスタＴＲ，のメン時間がｔ・トい時高
くなり、ｔＩｉかい時低くなる。一方、ピーク値抛流回
路１４の出力電圧ＶＲ２ｒ：を前記の基準人力と等しく
なるようにｆｆｌループ制御されておρ、主トランジス
タＴＲ，のオン時間が短かい場合、すなわち、負φ；ｉ
短絡時に粋いてｖＲ２が低下するように制御さＪする。
釘って、第３図の１１？□浦制御回路の出力Ｑ＝’ｊ
ｆ’４：は、第５図に示されるように「フＪｅ’、＋字
形特性を有する。
ｆ’４：は、第５図に示されるように「フＪｅ’、＋字
形特性を有する。
次に、第（５図に本発明の他のり’： Ｍ＋Ｈ例として
の↑ｂ。
の↑ｂ。
流１１Ｊ旧６１回路が示される。第６図の１ｋか口ｔｉ
’ｌ 御回路にＪｉ−いてｅ」、第３図の回路における
演ぷ−Ｊ１，４幅器の代りにトランジスタ’ｒＲ２が用
いられでお・す、ビーク佃、動Ｍｒ回路１４の出力電圧
がトランジスタ’ｒＲ２のペースに４１４ｆｒ’ｊｔさ
れ、平均値平滑回路１５の出力’？Ｆｉ；圧はトランジ
スタＴＲ２のエミッタに接続される。
’ｌ 御回路にＪｉ−いてｅ」、第３図の回路における
演ぷ−Ｊ１，４幅器の代りにトランジスタ’ｒＲ２が用
いられでお・す、ビーク佃、動Ｍｒ回路１４の出力電圧
がトランジスタ’ｒＲ２のペースに４１４ｆｒ’ｊｔさ
れ、平均値平滑回路１５の出力’？Ｆｉ；圧はトランジ
スタＴＲ２のエミッタに接続される。
トランジスタ’ｒＲ２のコレクタは、抵抗ＲＧを介して
１１□、源Ｖ、に接続される。従って、第６図の回路に
おいてハ、トランジスタＴＲ２のペース・エミッタ電圧
ＶＢいと平均値平滑回路１５の出力電圧を加えた電圧が
基準電圧としてピーク値整流回路１４の出力電圧と比較
される。前記の比較結果に対応するトランジスタＴＲ２
のコレクタ電圧がパルス幅制御回路１２に入力される。
１１□、源Ｖ、に接続される。従って、第６図の回路に
おいてハ、トランジスタＴＲ２のペース・エミッタ電圧
ＶＢいと平均値平滑回路１５の出力電圧を加えた電圧が
基準電圧としてピーク値整流回路１４の出力電圧と比較
される。前記の比較結果に対応するトランジスタＴＲ２
のコレクタ電圧がパルス幅制御回路１２に入力される。
第６図の回路の動作は、前記の第３図の回路と同様であ
るが、トランジスタＴＲ２１個で制呻司能であるためコ
ストが安くなるという利点がある。
るが、トランジスタＴＲ２１個で制呻司能であるためコ
ストが安くなるという利点がある。
更に、本発明の他の実施例とじての箪流制岬装置が第７
図に示される。第７図の電流制胛回路においては、主ト
ランジスタＴＲ，を流れる電流の検出が変’ＪＥ ？！
ＩＶ Ｔ ２を用いて１°ｊわれる。従って、変王器′
ｒ２の２次側に接続された箱、流検出抵抗Ｒ，の両端ｉ
１ｊ、 ｌ １−がピーク値整流回路１４および平均値
平滑回路を？−人力される。基準■、王の構成は、第６
図の回路と同ドＲである。
図に示される。第７図の電流制胛回路においては、主ト
ランジスタＴＲ，を流れる電流の検出が変’ＪＥ ？！
ＩＶ Ｔ ２を用いて１°ｊわれる。従って、変王器′
ｒ２の２次側に接続された箱、流検出抵抗Ｒ，の両端ｉ
１ｊ、 ｌ １−がピーク値整流回路１４および平均値
平滑回路を？−人力される。基準■、王の構成は、第６
図の回路と同ドＲである。
（６）発明の効里
本発明ＫＪ：れば、簡単な回路により「フ」の字形′ｒ
４Ｌ流制限特性をイｊする電流副側１回路を構成するこ
とができ、それによシ負荷短絡時の過大電流を防止する
ことができるとともに、霜、源装置１′Ｉの整流ダイオ
ードおよび平滑チロ−クコイルの負荷を軽減することが
できる。
４Ｌ流制限特性をイｊする電流副側１回路を構成するこ
とができ、それによシ負荷短絡時の過大電流を防止する
ことができるとともに、霜、源装置１′Ｉの整流ダイオ
ードおよび平滑チロ−クコイルの負荷を軽減することが
できる。
第１図は、従来形の電流制御１１回路を示す図、第２図
は、第１図の回路の出力ｌ特性を示す図、第３図は、本
発明の一実施例としての電流制餌回路を示す図、 第４図←［、第３図の回路の動作電圧波形を示す図、 第５図Ｌｌ ”ｔ’第３図の回路の出力ｌ特性を示す図
、第６しｌ ｉｆ ％本発明の他の１つの実施例゛とし
での箱、流制自１回路を示す図、 第７し１は、庫発ｊＪｌの更に他の１つの実施例として
の市、ｖｉＣ制０１１１回路を示す図である。 （杓→じのｈ９明） １１・・・出力平滑回路、１２・・・パルス幅制胛回路
、１３・・・演）’ｔ Ｊ’ｔ’ｆ幅器、１４・・・ビ
ークｆ１に整流回路、１５・・・平均値平滑回路・ 特許出願人 富士通株式会社 慣ｒ［出願代理人 弁理士 竹 本 朗 弁」！ｐ士西舘和之 弁理士 内 １）幸 男 弁理士 山 口 昭 之 第１ 口 Ｑｇ ２ １．マ、°１ 亭３図 轄５ 図 第４図
は、第１図の回路の出力ｌ特性を示す図、第３図は、本
発明の一実施例としての電流制餌回路を示す図、 第４図←［、第３図の回路の動作電圧波形を示す図、 第５図Ｌｌ ”ｔ’第３図の回路の出力ｌ特性を示す図
、第６しｌ ｉｆ ％本発明の他の１つの実施例゛とし
での箱、流制自１回路を示す図、 第７し１は、庫発ｊＪｌの更に他の１つの実施例として
の市、ｖｉＣ制０１１１回路を示す図である。 （杓→じのｈ９明） １１・・・出力平滑回路、１２・・・パルス幅制胛回路
、１３・・・演）’ｔ Ｊ’ｔ’ｆ幅器、１４・・・ビ
ークｆ１に整流回路、１５・・・平均値平滑回路・ 特許出願人 富士通株式会社 慣ｒ［出願代理人 弁理士 竹 本 朗 弁」！ｐ士西舘和之 弁理士 内 １）幸 男 弁理士 山 口 昭 之 第１ 口 Ｑｇ ２ １．マ、°１ 亭３図 轄５ 図 第４図
Claims (1)
- 【特許請求の範囲】 １ パルス幅制御回路によって駆動されスイッチング動
作をイｊう主トランジスタによυ制？ｉｌ’ｌ＋される
電びｒを検出するために、電流路に直接挿入された抵抗
の両端電圧または変圧器を介して２次側に接続された抵
抗の両端電圧をピーク値整流回路および平均値平滑回路
においてそれぞれ直流電圧に変換し、前記平均値平滑回
路の出力１ｂ、圧を所定の定電圧に加えて基準電圧とし
、前記基準電圧と前記ピーク値整流回路の出力電圧とを
比較しその比較出力信号を前記ノＲルス幅制御回路に入
力し前記主トランジスタの導通時間を制御し、それによ
シ遜犬電流を防止するようにしたことを特徴とする、１
１１浦［制御回路。 ２、前記所定の定電圧として、安定な直流電圧諒の出力
電圧を用いた、特許請求の範囲第１項に記載の′ｌ、流
制動制御回 路、 ＋’＋ｉＪ記所定の定電圧として、トランジス
タのペース・エミッタ電圧を用いる、行ｉ′［請求の神
５囲第１項に記載の電流制御回路。 ４、ｉ’ｊｌ ｔｆａ所定の定電圧として、ツェナーダ
イオードのツェナー電圧を用いる、’Ｆ’ｆ ｒｉ’ｌ
’ Ｒｊ求のｉｉｉ’Ｑ、間第１項にｊｆＬ： １シ１
の電流制御回路つ
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16307182A JPS5953082A (ja) | 1982-09-21 | 1982-09-21 | 電流制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16307182A JPS5953082A (ja) | 1982-09-21 | 1982-09-21 | 電流制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5953082A true JPS5953082A (ja) | 1984-03-27 |
Family
ID=15766623
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16307182A Pending JPS5953082A (ja) | 1982-09-21 | 1982-09-21 | 電流制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5953082A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5996825A (ja) * | 1982-11-24 | 1984-06-04 | スタンレー電気株式会社 | スイツチング過電流保護回路 |
| JPH02174556A (ja) * | 1988-12-23 | 1990-07-05 | Origin Electric Co Ltd | 出力垂下特性を有するコンバータ |
| JPH04500641A (ja) * | 1988-09-14 | 1992-02-06 | ローベルト・ボッシュ・ゲゼルシャフト・ミット・ベシュレンクテル・ハフツング | 自動車の搭乗者を保護するエアバッグ装置 |
| JP2008199878A (ja) * | 2007-01-19 | 2008-08-28 | Toyota Industries Corp | Ｄｃ−ｄｃコンバータの制御方法、およびｄｃ−ｄｃコンバータ |
-
1982
- 1982-09-21 JP JP16307182A patent/JPS5953082A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5996825A (ja) * | 1982-11-24 | 1984-06-04 | スタンレー電気株式会社 | スイツチング過電流保護回路 |
| JPH04500641A (ja) * | 1988-09-14 | 1992-02-06 | ローベルト・ボッシュ・ゲゼルシャフト・ミット・ベシュレンクテル・ハフツング | 自動車の搭乗者を保護するエアバッグ装置 |
| JPH02174556A (ja) * | 1988-12-23 | 1990-07-05 | Origin Electric Co Ltd | 出力垂下特性を有するコンバータ |
| JP2008199878A (ja) * | 2007-01-19 | 2008-08-28 | Toyota Industries Corp | Ｄｃ−ｄｃコンバータの制御方法、およびｄｃ−ｄｃコンバータ |
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