JPS6143876B2 - - Google Patents
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- Publication number
- JPS6143876B2 JPS6143876B2 JP52146882A JP14688277A JPS6143876B2 JP S6143876 B2 JPS6143876 B2 JP S6143876B2 JP 52146882 A JP52146882 A JP 52146882A JP 14688277 A JP14688277 A JP 14688277A JP S6143876 B2 JPS6143876 B2 JP S6143876B2
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- JP
- Japan
- Prior art keywords
- element body
- layer
- resin layer
- semiconductor element
- metal
- Prior art date
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- Expired
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Description
【発明の詳細な説明】
本発明は、半導体素子特に高移動度半導体を利
用した磁気抵抗素子の製造方法に関する。
用した磁気抵抗素子の製造方法に関する。
まず従来のこの種素子の製造方法を第1図を用
いて説明する。第1図Aは絶縁基板1上にインジ
ウムアンチモナイドInSb等高移動半導体により
半導体素子本体2を形成した平面図を示し、この
素子本体2の形成は、基板1全面に被着した半導
体ウエハをフオトエツチング等により所定の素子
形状に分割することにより行なわれる。第1図B
は第1図Aの−断面図を示している。この素
子本体2を形成した基板1上には、第1図Cに示
すごとく感光樹脂層3が被覆される。この樹脂層
3の半導体素子本体2上の所定の箇所は、第1図
Aの−方向の断面を示す第1図Dに示す如く
樹脂層3が除去され、半導体素子本体2が部分的
に顕出せしめられている。その後、この顕出部分
および樹脂層3上に導電金属層4が電着等により
形成される(第1図E,F参照)。しかる後、素
子顕出部分に位置する金属層4を残して、他の部
分を樹脂層3とともに除去すれば第1図G,Hに
示す素子が得られる。図中5,5……は、前記金
属層4を分割して形成した金属バー、6,6は引
出電極である。
いて説明する。第1図Aは絶縁基板1上にインジ
ウムアンチモナイドInSb等高移動半導体により
半導体素子本体2を形成した平面図を示し、この
素子本体2の形成は、基板1全面に被着した半導
体ウエハをフオトエツチング等により所定の素子
形状に分割することにより行なわれる。第1図B
は第1図Aの−断面図を示している。この素
子本体2を形成した基板1上には、第1図Cに示
すごとく感光樹脂層3が被覆される。この樹脂層
3の半導体素子本体2上の所定の箇所は、第1図
Aの−方向の断面を示す第1図Dに示す如く
樹脂層3が除去され、半導体素子本体2が部分的
に顕出せしめられている。その後、この顕出部分
および樹脂層3上に導電金属層4が電着等により
形成される(第1図E,F参照)。しかる後、素
子顕出部分に位置する金属層4を残して、他の部
分を樹脂層3とともに除去すれば第1図G,Hに
示す素子が得られる。図中5,5……は、前記金
属層4を分割して形成した金属バー、6,6は引
出電極である。
しかしながらこのような方法で素子を製造する
場合、以下のような欠点が生じる。すなわち、感
光樹脂層3を用いて金属バー形成箇所以外の部分
をマスキングするとき、素子本体2と基板1との
間に段差が生じるため、スピンナー等により感光
樹脂層3を塗布形成すると、この樹脂層3の厚み
は均一にならず、特に素子本体2のエツジ2aに
位置する樹脂層3aは第1図Cに示す如く薄くそ
のため感光樹脂層3の現像或はその後の工程にお
いてピンホールを生じたり、剥離し易いという問
題が生じている。そしてこのピンホールや剥離部
分においては、爾後の金属層4電着形成の際、金
属層4が素子本体2に接触してしまい、樹脂層3
を除去した後も、第1図Gに示すごとき金属バー
5,5……の短絡部分5a,5a……として残る
こととなる。このような素子は、磁気抵抗効果を
示さず、使用に耐えないことは言うまでもない。
場合、以下のような欠点が生じる。すなわち、感
光樹脂層3を用いて金属バー形成箇所以外の部分
をマスキングするとき、素子本体2と基板1との
間に段差が生じるため、スピンナー等により感光
樹脂層3を塗布形成すると、この樹脂層3の厚み
は均一にならず、特に素子本体2のエツジ2aに
位置する樹脂層3aは第1図Cに示す如く薄くそ
のため感光樹脂層3の現像或はその後の工程にお
いてピンホールを生じたり、剥離し易いという問
題が生じている。そしてこのピンホールや剥離部
分においては、爾後の金属層4電着形成の際、金
属層4が素子本体2に接触してしまい、樹脂層3
を除去した後も、第1図Gに示すごとき金属バー
5,5……の短絡部分5a,5a……として残る
こととなる。このような素子は、磁気抵抗効果を
示さず、使用に耐えないことは言うまでもない。
本発明は上述の欠点を解消するもので、以下第
2図に示す工程図を参考にして1実施例を説明す
る。フエライト板、セラミツク板、或いはガラス
板等よりなる絶縁基板10上に、厚さ4〜5μm
程度の半導体膜を全面に形成し、次いで第2図A
及び同図Aの−断面図である第2図Bで示す
ように、パターニングを行ないフオトエツチング
等を用いて所定の形状に半導体素子本体11を形
成する。この半導体素子本体11は前述の例と同
様、InSb等の高移動度半導体が使用される。
2図に示す工程図を参考にして1実施例を説明す
る。フエライト板、セラミツク板、或いはガラス
板等よりなる絶縁基板10上に、厚さ4〜5μm
程度の半導体膜を全面に形成し、次いで第2図A
及び同図Aの−断面図である第2図Bで示す
ように、パターニングを行ないフオトエツチング
等を用いて所定の形状に半導体素子本体11を形
成する。この半導体素子本体11は前述の例と同
様、InSb等の高移動度半導体が使用される。
次に、絶縁基板10上にKMER(コダツク社
製フオトレジスト)等の感光樹脂(或いはSiO2
等)よりなる絶縁物を素子本体11と略同一の厚
さ(約4〜5μm)だけ第2図Cに示す如く塗布
し、さらに硬化させた後、素子本体1表面に付着
した樹脂膜部分12aを露光、現像処理して除去
する(SiO2の場合にはエツチング除去する)。
尚、この現像処理工程で隣接する素子本体間の絶
縁層12は部分的に少許陥没するがその陥没量は
素子本体11の厚さに比べて十分小さくさせるこ
とができる。
製フオトレジスト)等の感光樹脂(或いはSiO2
等)よりなる絶縁物を素子本体11と略同一の厚
さ(約4〜5μm)だけ第2図Cに示す如く塗布
し、さらに硬化させた後、素子本体1表面に付着
した樹脂膜部分12aを露光、現像処理して除去
する(SiO2の場合にはエツチング除去する)。
尚、この現像処理工程で隣接する素子本体間の絶
縁層12は部分的に少許陥没するがその陥没量は
素子本体11の厚さに比べて十分小さくさせるこ
とができる。
次に、絶縁基板10上の素子本体11及び絶縁
層12の上にこれらを覆うように他の感光樹脂を
塗布して絶縁層13を形成する(第2図E)。こ
の絶縁層13は隣接する素子本体間に絶縁層12
を配備しているので第1図Cに示すような段差に
基づくエツジ部11aのピンホールや剥離を防止
することができている。素子本体11の長手方向
上の絶縁層13は後に、金属バーを形成する部分
13aが除去される(第2図F、第2図Aの−
方向の断面を示す)。その後、インジウム若し
くは銅等の金属が電着法により、絶縁層13及び
この絶縁層が除去された結果表出された素子本体
11の上に付設され金属層14が形成される(第
2図G、H)。このとき感光樹脂層13にはピン
ホールや剥離が殆んど生じていないから、素子本
体表出部分以外にこの金属層14が接触すること
はない。しかる後、感光樹脂層13をこれに付着
した金属層14とともに除去すれば半導体素子1
1上にこれに交差するように金属バー15,15
……が分割形成されて素子が完成する(第2図
I、J)。すなわち素子本体2は、その周囲の絶
縁層12と略同一面を形成しており、素子本体1
1上に所定の数だけ金属バー15,15……およ
び引出電極16,16が形成されている。
層12の上にこれらを覆うように他の感光樹脂を
塗布して絶縁層13を形成する(第2図E)。こ
の絶縁層13は隣接する素子本体間に絶縁層12
を配備しているので第1図Cに示すような段差に
基づくエツジ部11aのピンホールや剥離を防止
することができている。素子本体11の長手方向
上の絶縁層13は後に、金属バーを形成する部分
13aが除去される(第2図F、第2図Aの−
方向の断面を示す)。その後、インジウム若し
くは銅等の金属が電着法により、絶縁層13及び
この絶縁層が除去された結果表出された素子本体
11の上に付設され金属層14が形成される(第
2図G、H)。このとき感光樹脂層13にはピン
ホールや剥離が殆んど生じていないから、素子本
体表出部分以外にこの金属層14が接触すること
はない。しかる後、感光樹脂層13をこれに付着
した金属層14とともに除去すれば半導体素子1
1上にこれに交差するように金属バー15,15
……が分割形成されて素子が完成する(第2図
I、J)。すなわち素子本体2は、その周囲の絶
縁層12と略同一面を形成しており、素子本体1
1上に所定の数だけ金属バー15,15……およ
び引出電極16,16が形成されている。
本発明製造方法によれば、金属バーを形成する
マスクとして平坦な感光樹脂層が使用できるよう
素子本体周囲にこれと同一厚さを有する絶縁層を
介在せしめるものであるから、絶縁層にピンホー
ルや剥離を生じる惧れはなく、したがつて素子本
体エツジに金属部分が残ることはない。すなわ
ち、金属バーは、それぞれ完全に独立させること
ができ、金属バーで挾まれた部分の半導体素子本
体に、充分な磁気抵抗効果を発揮させることがで
きる。また素子本体は、その周囲を絶縁層にて囲
繞されているため、外部からの衝撃等に対し保護
される利点もある。
マスクとして平坦な感光樹脂層が使用できるよう
素子本体周囲にこれと同一厚さを有する絶縁層を
介在せしめるものであるから、絶縁層にピンホー
ルや剥離を生じる惧れはなく、したがつて素子本
体エツジに金属部分が残ることはない。すなわ
ち、金属バーは、それぞれ完全に独立させること
ができ、金属バーで挾まれた部分の半導体素子本
体に、充分な磁気抵抗効果を発揮させることがで
きる。また素子本体は、その周囲を絶縁層にて囲
繞されているため、外部からの衝撃等に対し保護
される利点もある。
第1図A,B,C,D,E,F,G,Hは従来
の製法の工程図、第2図A,B,C,D,E,
F,G,H,I,Jは本発明方法の1実施例の工
程説明図であり、第2図A,Iは平面図、第2図
B,C,D,E,Gは第2図Aの−方向の断
面図、第2図F,H,Jは第2図Aの−方向
の断面図である。 10……絶縁基板、11……半導体素子本体、
13……感光樹脂層、14……金属層、15……
金属バー、16……引出電極、5a……短絡形
状、12……絶縁層。
の製法の工程図、第2図A,B,C,D,E,
F,G,H,I,Jは本発明方法の1実施例の工
程説明図であり、第2図A,Iは平面図、第2図
B,C,D,E,Gは第2図Aの−方向の断
面図、第2図F,H,Jは第2図Aの−方向
の断面図である。 10……絶縁基板、11……半導体素子本体、
13……感光樹脂層、14……金属層、15……
金属バー、16……引出電極、5a……短絡形
状、12……絶縁層。
Claims (1)
- 1 絶縁基板上に所定形状に半導体素子本体を形
成する工程、前記絶縁基板上において半導体素子
本体間隙を埋め素子本体と略同一の厚さを有する
絶縁層を形成する工程、この絶縁層および素子本
体上に樹脂層を形成する工程、この樹脂層の前記
半導体素子本体上部適所を除去し半導体素子本体
を顕出させる工程、樹脂層上に金属層を形成する
工程、前記樹脂層をこれに付着した金属層ととも
に除去し前記半導体素子本体顕出部分に金属バー
を形成する工程とを有してなる磁気抵抗素子の製
造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14688277A JPS5478094A (en) | 1977-12-02 | 1977-12-02 | Manufacture of semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14688277A JPS5478094A (en) | 1977-12-02 | 1977-12-02 | Manufacture of semiconductor device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5478094A JPS5478094A (en) | 1979-06-21 |
| JPS6143876B2 true JPS6143876B2 (ja) | 1986-09-30 |
Family
ID=15417697
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14688277A Granted JPS5478094A (en) | 1977-12-02 | 1977-12-02 | Manufacture of semiconductor device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5478094A (ja) |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5431675B2 (ja) * | 1972-06-21 | 1979-10-08 | ||
| JPS5437478B2 (ja) * | 1972-08-01 | 1979-11-15 | ||
| JPS5110778A (en) * | 1974-07-17 | 1976-01-28 | Naito Densei Kogyo Co Ltd | Jidenhenkansoshi oyobi sonoseizoho |
-
1977
- 1977-12-02 JP JP14688277A patent/JPS5478094A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5478094A (en) | 1979-06-21 |
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