JPS6333814B2 - - Google Patents

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JPS6333814B2
JPS6333814B2 JP18627981A JP18627981A JPS6333814B2 JP S6333814 B2 JPS6333814 B2 JP S6333814B2 JP 18627981 A JP18627981 A JP 18627981A JP 18627981 A JP18627981 A JP 18627981A JP S6333814 B2 JPS6333814 B2 JP S6333814B2
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JP
Japan
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pulse
data
serial
hold
clock
Prior art date
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Expired
Application number
JP18627981A
Other languages
English (en)
Other versions
JPS5887941A (ja
Inventor
Yasuhito Ookawa
Noboru Kurata
Shuichiro Kishi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP56186279A priority Critical patent/JPS5887941A/ja
Publication of JPS5887941A publication Critical patent/JPS5887941A/ja
Publication of JPS6333814B2 publication Critical patent/JPS6333814B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04JMULTIPLEX COMMUNICATION
    • H04J3/00Time-division multiplex systems
    • H04J3/16Time-division multiplex systems in which the time allocation to individual channels within a transmission cycle is variable, e.g. to accommodate varying complexity of signals, to vary number of channels transmitted
    • H04J3/1676Time-division multiplex with pulse-position, pulse-interval, or pulse-width modulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Time-Division Multiplex Systems (AREA)

Description

【発明の詳細な説明】 本発明は、複数のデータを時分割多重伝送する
装置に関し、伝送部が断線等により通信不能状態
になつた場合に受信部に具備するデータ保護回路
により受信クロツクパルスが再生されていないこ
とを検出した後ホールドパルスを停止させ、断線
直前の状態を半永久的に保持させておき、伝送部
が復旧しても受信部が同期を確立するまで断線直
前の状態を保持させておいたり、あるいは、停止
状態に保持させておき、同期確立後は迅やかに正
常動作に戻すことにより、通信不能状態において
受信部が異常動作することを防止するようにした
装置を提供することを目的とする。
複数のデータを多重伝送する場合、それぞれの
データを非同期サンプリングした後並列・直列変
換器による時分割多重する方式が用いられるが、
そのブロツクを第1図に示して説明する。
第1図において、Aは送信部、Bは伝送部、C
は受信部である。送信部Aは、複数のデータD1
〜Dnを入力して時分割多重する並列・直列変換
器2と、内部に発振回路を有しクロツクパルスa
とサンプリングパルスbとフレームパルスcを発
生する送信タイミング作成器1よりなる。伝送部
Bは、同軸ケーブルまたは光フアイバケーブルで
構成されるが、光フアイバケーブルを用いる場合
には送信部Aの出力端に電気信号・光信号変換器
(E/O)が、受信部Cの入力端に光信号・電気
信号変換器(O/E)が必要である。受信部C
は、伝送データdを入力し、受信クロツクパルス
fを抽出する例えばPLL(Phase Locked Loop)
で構成されるクロツク抽出回路4と、伝送データ
dと受信クロツクパルスfを入力して受信クロツ
クの立ち上りのタイミングにおいて伝送データd
をサンプリングした後順次シフトする直列・並列
変換器5の1番目の出力(Q1)と(n+1)番
目の出力(Qo+1)と受信クロツクパルスfを入
力してフレームパルスgを検出し、同期を確立し
た後ホールドパルスg′を発生する受信タイミング
作成器6と、直列・並列変換器5の出力(Q2
Qo+1)とホールドパルスg′を入力して、ホールド
パルスg′の立ち上りのタイミングにおいて直列・
並列変換器5の出力(Q2〜Qo+1)を保持してデ
ータD1′〜Dn′とフレームパルスC′を出力するホー
ルド回路8よりなる。
次に、データDiが7個入力された場合を仮定
して動作を説明する。並列・直列変換器2に第2
図のデータD−1〜D〜7が入力されるとサンプ
リングパルスbによつて非同期サンプリングされ
る。x点を時間軸上に拡大すると第3図の様にな
る。サンプリングパルスbの立ち上りのタイミン
グにおいてフレームパルスc、データD−1〜D
−7の状態を保持させておき、クロツクパルスの
タイミングで順次読み出して直列信号に変換して
伝送データdとして伝送部Bを介して受信部Cに
送られる。受信部Cにおいて伝送データdはクロ
ツク抽出回路4に入力され、第4図に示す受信ク
ロツクパルスfを再生する。また、伝送データd
は直列・並列変換器5に入力され、受信クロツク
パルスによつてサンプリングされた後順次シフト
され出力Q1〜Q9を得る。受信タイミング作成器
6は直列・並列変換器5の出力Q1とQ9および受
信クロツクパルスfを入力してホールドパルス
g′を作る。ホールド回路8に直列・並列変換器5
の出力Q2〜Q9とホールドパルスg′を入力すると、
ホールドパルスg′の立ち上りのタイミングでそれ
ぞれQ2〜Q9が保持され、フレームパルスf′とデー
タD−1′〜D〜7′が再生される。
いま、伝送部Bが断線した場合、第5図に示す
様に伝送データeはy1点より以後論理Oとなり、
最終(y2点)のホールドパルスg′の立ち上りのタ
イミングでQ2〜Q8をサンプリンし、その出力デ
ータDi(D1〜D7)は論理Oとなる。したがつて送
信部Aにおいては、伝送データeを送り続けてい
るにもかかわらず受信部CのデータDiは異なつ
た内容を示すことになる。例えば、動力機構を制
御する目的に用いられる場合、このような異常動
作によつて、機器や破損や人命に危険を及ぼすと
いう問題がある。
そこで、本発明は、かかる従来の不都合を解消
することのできるデータ伝送装置を提供すること
を目的とするものである。
以下、その一実施例について図面を参照しつつ
説明する。
第6図に示す様に、内部に発振回路を備えクロ
ツクパルスa、サンプリングパルスb、フレーム
パルスcを発生する送信タイミング作成器1と、
フレームパルスcと複数のデータD−1〜D〜n
を入力しサンプリングパルスbとクロツクパルス
aによりデータD−1〜D〜7を時分割多重して
直列信号dとする並列・直列変換器2と、直列信
号dとクロツクパルスaを入力して直列信号dが
論理1または論理0の期間を所定のパルスコード
に変調して伝送データeとするパルス幅変調回路
3よりなる送信部A、同軸ケーブルまたは光フア
イバケーブルで構成される伝送部B、伝送部Bを
介して送信部Aと接続され、伝送データeを入力
しその立ち上りを検出して受信クロツクfを抽出
するクロツク抽出回路4と、伝送データeと受信
クロツクパルスfを入力し、受信クロツクパルス
fの立ち上りのタイミングで伝送データeをサン
プリングした後順次シフトする直列・並列変換器
5と、直列・並列変換器5の出力Q1とQo+1およ
び受信クロツクパルスfを入力してフレームパル
スgを検出し、同期を確立した後ホールドパルス
g′を発生する受信タイミング作成器6と、受信ク
ロツクパルスfとホールドパルスg′を入力して受
信クロツクパルスfが所定の間隔で連続している
か否かを判断してホールドパルスhを出力または
停止させるデータ保護回路7と、直列・並列変換
器5の出力Q2〜Qo+1とホールドパルスhを入力
してホールドパルスhの立ち上りのタイミングで
入力Q2〜Qo+1を保持してフレームタイミングパ
ルスc′とデータD−1′〜D〜7′を再生するホー
ルド回路8よりなる受信部Cにより構成される。
以下、データDiが7個入力された場合を仮定
して動作を説明する。
本装置において、パルス幅変調回路3は第7図
に示す回路で構成することができる。第7図にお
いて分周器31にクロツクパルスaを入力すると
第8図に示すa−1,a−2がその出力に得られ
る。a−1とa−2をそれぞれ論理和素子33と
論理積素子34に入力すると論理和素子33の出
力にa−3が、論理積素子34の出力にa−4が
得られる。a−3は3・T1の期間が論理1で、
1・T1の期間が論理0とする。また、a−4は
1・T1の期間が論理1で、3・T1の期間が論理
0とする。直列信号dとa−3を論理積素子34
に入力すると、直列信号が論理1の期間にのみa
−3がその出力が得られe−1となる。また、直
列信号dを否定素子32に入力すると反転信号d
−1が得られ、反転信号d−1とa−4を論理積
素子34に入力すると、直列信号dが論理0の期
間にa−4がその出力に得られる。次に、a−3
とa−4を論理和素子33に入力すると、直列信
号dが論理1の期間にa−3が、直列信号dが論
理0の期間にa−4がそう入された伝送データe
が得られる。伝送データeは同軸ケーブル、また
は光フアイバケーブルを介して受信部Cと接続さ
れる。受信部Cにおいて、伝送データeはクロツ
ク抽出回路4に入力される。クロツク抽出回路4
は第9図に示すようにモノステーブル・マルチバ
イブレータで構成することができる。第9図にお
いてモノステーブル・マルチバイブレータに伝送
データeを入力すると、第10図に示すように伝
送データeの立ち上りの変化点を検出して2・
T1の期間だけ動作するので、受信クロツクパル
スfを得ることができる。伝送データeと受信ク
ロツクパルスfを直列・並列変換器5に入力する
と、第11図に示す様に、受信クロツクパルスf
の立ち上りのタイミングで伝送データeをサンプ
リングした後順次シフトして出力Q1〜Q9を得る。
出力Q1〜Q9および受信クロツクパルスfを受信
タイミング作成器6に入力すると、ホールドパル
スg′が得られる。次に、ホールドパルスg′と受信
クロツクパルスfをデータ保護回路7に入力す
る。データ保護回路7は第12図に示すような回
路で構成することができる。モノステーブル・マ
ルチバイブレータ71に受信クロツクパルスfを
入力すると、受信クロツクfの立ち上りを検出し
た後6.T1の期間動作するが、動作中に次の立ち上
りが入力されると再トリガされるように動作す
る。したがつて、受信クロツクパルスfが連続し
ている場合には出力f−1は常に論理1の状態で
ある。第13図に示す様にy1において伝送部が断
線等によつて伝送データeが受信部Cに入力され
なくなると、受信クロツクパルスfも得られなく
なる。モノステーブル・マルチバイブレータ71
の動作期間を6・T1に設定しているので受信ク
ロツクパルスの最後の立ち上りを検出した後6・
T1経て論理0になる。f−1をモノステーブ
ル・マルチバイブレータ72に入力するとf−1
の立ち上りを検出した後にリセツトパルスf−2
を出力して、フリツプ・フロツプ75をリセツト
するので、その出力f−5は論理0となる。フリ
ツプ・フロツプ75の出力f−5を論理積素子7
6に入力するとホールドパルスg′に関係なくその
出力hは論理0となる。次に、断線が復旧した場
合についてのべる。第14図に示す様に受信クロ
ツクパルスfが復旧(y3時点)すると、伝送デー
タeが受信部Cに入力されるので受信クロツクパ
ルスfは連続して得られるようになり、モノステ
ーブル・マルチバイブレータ71の出力f−1は
論理0から論理1に変わる。出力f−1をモノス
テーブル・マルチバイブレータ73に入力する
と、f−1の立ち上りを検出した後動作してf−
3が得られる。
ホールドパルスg′の周期をT2(=32・T1)とす
ると、伝送部Bが正常状態に復旧して伝送データ
eが入力されてから受信部Cの同期が確立するま
でに約8・T2を要するのでモノステーブル・マ
ルチバイブレータ73の動作時間は10・T2に設
定しておく。f−3をモノステーブル・マルチバ
イブレータ74に入力すると、f−3の立ち下り
を検出した後セツトパルスf−4を出力してフリ
ツプ・フロツプ76をセツトするので、その出力
f−5は論理1になる。したがつて論理積素子7
6の出力にはホールドパルスhが得られる。直
列・並列変換器5の出力Q2〜Q9とホールドパル
スhをホールド回路8に入力すると、ホールドパ
ルスhの立ち上りのタイミングでQ2〜Q9を保持
するので第11図に示すフレームパルスc′とデー
タD−1′〜D−7′が得られる。また、リセツト
パルスf−2により、ホールド回路8をリセツト
すると、データD−1′〜D−7′を強制的に論理
0に設定することができる。
このように、本発明によれば、送信部において
並列・直列変換された直列信号をパルス幅変調す
ることにより直列信号にクロツク情報をもたせ、
受信部のビツト同期を容易にするとともに、デー
タ保護回路によつて伝送部の断線等に起因する直
列信号の無信号を即時に検出することが可能とな
り、直列信号の無信号時における受信部再生デー
タを断線直前の状態で保持させたりあるいは、停
止状態に保持させておき、伝送部の復旧後におい
ては同期が完全に確立された後正常動作に戻すこ
とにより受信部再生データによつて制御される機
器の異常動作を緩和することが可能となる。
【図面の簡単な説明】
第1図は従来のデータ伝送装置のブロツク図、
第2図、第3図、第4図、第5図は第1図の装置
の動作を説明するためのタイムチヤート、第6図
は本発明の一実施例におけるデータ伝送装置のブ
ロツク図、第7図は同装置におけるパルス幅変調
回路の回路図、第8図は同回路の動作説明のため
のタイムチヤート、第9図は同回路におけるクロ
ツク抽出回路の回路図、第10図は同回路の動作
説明のためのタイムチヤート、第11図は同装置
の動作説明のためのタイムチヤート、第12図は
同装置におけるデータ保護回路の回路図、第13
図、第14図は同回路の動作説明のためのタイム
チヤートである。 1……送信タイミング作成器、2……並列・直
列変換器、3……パルス幅変調回路、4……クロ
ツク抽出回路、5……直列・並列変換回路、6…
…送信タイミング作成器、7……データ保護回
路、8……ホールド回路。

Claims (1)

    【特許請求の範囲】
  1. 1 内部に発振回路を備えクロツクパルス、サン
    プリングパルス、フレームパルスを発生する送信
    タイミング作成器と、フレームパルスとn個のデ
    ータを入力し、サンプリングパルスとクロツクパ
    ルスによりフレームパルスとn個のデータを時分
    割多重して直列信号とする並列・直列変換器と、
    直列信号とクロツクパルスを入力して直列信号の
    論理1および0の期間を所定のパルスコードに変
    調して伝送データとするパルス幅変調回路よりな
    る送信部と、伝送部を介して送信部のパルス幅変
    調回路に接続され、伝送データの立ち上りの変化
    点を検出して受信クロツクパルスを再生するクロ
    ツク再生器と、伝送データと受信クロツクパルス
    を入力して受信クロツクパルスの立ち上りのタイ
    ミングで伝送データをサンプリングした後に(n
    +1)ビツトシフトする直列・並列変換器と、直
    列・並列変換器の1番目と(n+1)番目の出力
    信号とクロツクパルスとを入力してフレームパル
    スを検出して同期を確立しホールドパルスを発生
    する受信タイミング作成器と、受信クロツクパル
    スとホールドパルスを入力して受信クロツクパル
    スが所定の間隔で連続していることを検出し、受
    信クロツクパルスが所定の間隔で連続している時
    にホールドパルスを出力するデータ保護回路と、
    直列・並列変換器の出力信号とホールドパルスを
    入力してホールドパルスの立ち上りのタイミング
    で直列・並列変換器の出力信号を保持してデータ
    を再生するホールド回路よりなる受信部とにより
    構成されることを特徴とするデータ伝送装置。
JP56186279A 1981-11-19 1981-11-19 デ−タ伝送装置 Granted JPS5887941A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56186279A JPS5887941A (ja) 1981-11-19 1981-11-19 デ−タ伝送装置

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JP56186279A JPS5887941A (ja) 1981-11-19 1981-11-19 デ−タ伝送装置

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Publication Number Publication Date
JPS5887941A JPS5887941A (ja) 1983-05-25
JPS6333814B2 true JPS6333814B2 (ja) 1988-07-07

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ID=16185513

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JP56186279A Granted JPS5887941A (ja) 1981-11-19 1981-11-19 デ−タ伝送装置

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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61237540A (ja) * 1985-04-13 1986-10-22 Sumitomo Electric Ind Ltd 多重伝送装置
JPH04314226A (ja) * 1991-04-12 1992-11-05 Fujitsu Ltd 通信データ保護回路
JPH08181675A (ja) * 1994-12-22 1996-07-12 Nec Corp 多重機能の監視装置および監視方法

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JPS5887941A (ja) 1983-05-25

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