JPH0455906A - シーケンサの高速割込み型制御方法および装置 - Google Patents
シーケンサの高速割込み型制御方法および装置Info
- Publication number
- JPH0455906A JPH0455906A JP16703490A JP16703490A JPH0455906A JP H0455906 A JPH0455906 A JP H0455906A JP 16703490 A JP16703490 A JP 16703490A JP 16703490 A JP16703490 A JP 16703490A JP H0455906 A JPH0455906 A JP H0455906A
- Authority
- JP
- Japan
- Prior art keywords
- processing
- interruption
- high speed
- control
- interrupt
- Prior art date
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- Pending
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- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はシーケンサの高速割込み型制御方法および装置
、特にラダ一方式のシーケンサの高速割込み型制御方法
および装置に関する。
、特にラダ一方式のシーケンサの高速割込み型制御方法
および装置に関する。
従来、この種のセンサは、ラダー図でプログラミングさ
れたラダーを先頭から遂次実行し、最後のラダーを実行
すると再び先頭のラダーに戻るというように繰り返し方
式により制御していた。
れたラダーを先頭から遂次実行し、最後のラダーを実行
すると再び先頭のラダーに戻るというように繰り返し方
式により制御していた。
上述した従来の技術は、必ず先頭から最後までラダーを
逐一実行するのでラダーのステップサイズが大きくなる
と、1周期の実行時間が長くなり、制御対象の装置に要
求される応答時間を満足出来な(なると共に、特に高速
で応答したい制御対象に対しては処理出来ないという欠
点がある。
逐一実行するのでラダーのステップサイズが大きくなる
と、1周期の実行時間が長くなり、制御対象の装置に要
求される応答時間を満足出来な(なると共に、特に高速
で応答したい制御対象に対しては処理出来ないという欠
点がある。
本発明のシーケンサの高速割込み型制御装置は、制御対
象の作業を2つに分けており、1つは、繰り返し処理を
実行する繰り返し制御部と、又もう一方は、高速応答を
可能とするために制御対象信号を確認し、高速応答を行
うか否かの判定を行うと共に、割込み処理番地を発生さ
せその処理を実行する高速割込み制御部とを有している
。
象の作業を2つに分けており、1つは、繰り返し処理を
実行する繰り返し制御部と、又もう一方は、高速応答を
可能とするために制御対象信号を確認し、高速応答を行
うか否かの判定を行うと共に、割込み処理番地を発生さ
せその処理を実行する高速割込み制御部とを有している
。
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例を示すブロック図である。
制御信号入出力部100より入力される信号のうち、高
速応答を必要とする信号の一部を割込み条件判定部20
0に取り込み、入出力信号制御部403からの割込み許
可信号により高速割込み処理を行うか否かが判定される
。
速応答を必要とする信号の一部を割込み条件判定部20
0に取り込み、入出力信号制御部403からの割込み許
可信号により高速割込み処理を行うか否かが判定される
。
割込み許可となった場合は、割込み信号に応じた処理開
始番地が割込み番地発生部300で発生し、ラダーシー
ケンス制御部400の中の高速割込み制御部401の相
当する割込み処理が開始される。
始番地が割込み番地発生部300で発生し、ラダーシー
ケンス制御部400の中の高速割込み制御部401の相
当する割込み処理が開始される。
一方、電源ON時以降、高速割込み処理が発生していな
い通常の場合は制御信号入出力部100、入出力制御部
403.繰り返し制御部402の間で通常処理が実行さ
れる。
い通常の場合は制御信号入出力部100、入出力制御部
403.繰り返し制御部402の間で通常処理が実行さ
れる。
第2図では、繰り返し制御部の通常処理と高速割込み制
御部の割込み処理(1,2・・・n)が並行して実行さ
れることを示す。
御部の割込み処理(1,2・・・n)が並行して実行さ
れることを示す。
以上説明したように本発明は、ラダーシーケンス制御を
2つに分割し、1つは、通常の繰り返し制御を、又もう
1方は、高速割込み制御を行うことにより、高速応答を
必要とする処理を低速でもよい処理と分離すると共に、
高速応答処理の中でも割込み順位の初期設定の仕方によ
り、割込みのひん度や処理の優先度等への対応を考慮出
来、ラダーの効率的な実行を可能にすることが出来る効
果がある。
2つに分割し、1つは、通常の繰り返し制御を、又もう
1方は、高速割込み制御を行うことにより、高速応答を
必要とする処理を低速でもよい処理と分離すると共に、
高速応答処理の中でも割込み順位の初期設定の仕方によ
り、割込みのひん度や処理の優先度等への対応を考慮出
来、ラダーの効率的な実行を可能にすることが出来る効
果がある。
第1図は、本発明の一実施例を示すブロック図、第2図
は第1図の動作を説明した模式図である。 100・・・制御信号入出力部、200・・・割込み条
件判定部、300・・・割込み番地発生部、400・・
・ラダーシーケンス制御部、401・・・高速割込み制
御部、402・・・繰り返し制御部、403・・・入出
力信号制御部。
は第1図の動作を説明した模式図である。 100・・・制御信号入出力部、200・・・割込み条
件判定部、300・・・割込み番地発生部、400・・
・ラダーシーケンス制御部、401・・・高速割込み制
御部、402・・・繰り返し制御部、403・・・入出
力信号制御部。
Claims (1)
- 【特許請求の範囲】 1、ラダー図でプログラミングするラダーシーケンサの
高速割込み型制御方法において、制御対象の作業を2つ
に分類し、1つは通常の繰り返し処理を実行し、又もう
1つは高速割込みの条件判定部とその割込み処理番地発
生部により起動される高速割込み処理とを並行して実行
することを特徴とするシーケンサの高速割込み型制御方
法。 2、繰り返し処理を実行する繰り返し制御部と、制御対
象入力信号を確認し、高速応答を行うか否かの判定を行
うと共に割込み処理番地を発生させその処理を実行する
高速割込み制御部とを含むことを特徴とするシーケンサ
の高速割込み型制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16703490A JPH0455906A (ja) | 1990-06-26 | 1990-06-26 | シーケンサの高速割込み型制御方法および装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16703490A JPH0455906A (ja) | 1990-06-26 | 1990-06-26 | シーケンサの高速割込み型制御方法および装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0455906A true JPH0455906A (ja) | 1992-02-24 |
Family
ID=15842162
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16703490A Pending JPH0455906A (ja) | 1990-06-26 | 1990-06-26 | シーケンサの高速割込み型制御方法および装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0455906A (ja) |
-
1990
- 1990-06-26 JP JP16703490A patent/JPH0455906A/ja active Pending
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